WO2010137088A1 - インターフェース回路 - Google Patents
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Abstract
Description
図1は実施形態1に係るインターフェース回路の構成を概略的に示す回路図である。図1に示すインターフェース回路100は、トランスミッター回路102、レシーバ回路103、データバスに接続される送信用パッド106、および、データバスに接続される受信用パッド107を備えている。トランスミッター回路102と送信用パッド106との間、およびレシーバ回路103と受信用パッド107との間には、バスの能動終端抵抗として機能する可変抵抗部104A,104Bがそれぞれ設けられている。また、インターフェース回路100は、能動終端抵抗を校正するための校正回路101(201,301)を備えている。校正回路101(201,301)は、外付けされた参照抵抗Rtermとパッド105を介して接続されている。そして、校正動作を実行した後、校正データとしての第1および第2の制御コードUPCODE,DNCODEによって、可変抵抗部104A,104Bの抵抗値を制御する。第1および第2の制御コードUPCODE,DNCODEは、例えば5ビットで構成される。
このように構成された校正回路101が実行する校正動作について、説明する。本実施形態では、まず、電圧V1と参照電圧VREFとを比較して、第1の制御コードを決定する(比較工程A)。その後、電圧V1と電圧V2とを比較して、第2の制御コードを決定する(比較工程B)。また、比較工程A,Bにおいてそれぞれ、2つの電圧の比較器130への入力先を正負入れ替えて、それぞれの状態で比較動作を行うものとする。
制御回路140は、セレクタ制御信号INSELによって、比較器130の(+)入力に電圧V1が入力され、(-)入力に参照電圧VREFが入力されるように、セレクタ120を制御する(第1の比較状態)。
制御回路140は、セレクタ制御信号INSELによって、比較器130の(+)入力に電圧V1が入力され、(-)入力に電圧V2が入力されるように、セレクタ120を制御する(第3の比較状態)。
また、本実施形態では、一旦校正を行った後に、再度校正を行う場合において、上述したものと同様の校正動作を行う。この場合、第1および第2の可変抵抗制御信号UPCODE,DNCODEを、現在の校正データすなわち第1および第2の制御コードに基づく所定の範囲内でのみ変化させるのが好ましい。すなわち、比較工程Aにおいて、第1の可変抵抗制御信号UPCODEを、制御コード候補a±MAまたは制御コード候補b±MA(MAは正の整数)の範囲で変化させ、比較工程Bにおいて、第2の可変抵抗制御信号DNCODEを、制御コード候補c±MBまたは制御コード候補d±MB(MBは正の整数)の範囲で変化させる。これにより、再校正を短時間で実行することが可能になる。ここでは例えば、MA,MBをそれぞれ1とし、次のような動作を行うものとする。
まず第1の比較状態において、第1の可変抵抗制御信号UPCODEを「制御コード候補a-1」に設定して比較器130の出力を得、その後、第1の可変抵抗制御信号UPCODEを「制御コード候補a+1」に設定して比較器130の出力を得る。そして、出力がLレベルとHレベルの場合は、元の制御コード候補aを新たな制御コード候補aとして保持する。出力がともにLレベルの場合は、電圧V1が参照電圧VREFより低いので、ダミー可変抵抗110の抵抗値を小さくするように、「制御コード候補a+1」を新たな制御コード候補aとする。出力がともにHレベルの場合は、電圧V1が参照電圧VREFより高いので、ダミー可変抵抗110の抵抗値を大きくするように、「制御コード候補a-1」を新たな制御コード候補aとする。
まず第3の比較状態において、第2の可変抵抗制御信号DNCODEを「制御コード候補c-1」に設定して比較器130の出力を得、その後、第2の可変抵抗制御信号DNCODEを「制御コード候補c+1」に設定して比較器130の出力を得る。そして、出力がLレベルとHレベルの場合は、元の制御コード候補cを新たな制御コード候補cとして保持する。出力がともにLレベルの場合は、電圧V2は電圧V1より高いので、第2の可変抵抗112の抵抗値を小さくするように、「制御コード候補c+1」を新たな制御コード候補cとする。出力がともにHレベルの場合は、電圧V2は電圧V1より低いので、第2の可変抵抗112の抵抗値を大きくするように、「制御コード候補c-1」を新たな制御コード候補cとする。
実施形態2に係るインターフェース回路の構成は、実施形態1で示した図1と同様であり、ここではその詳細な説明を省略する。
このように構成された校正回路201が実行する校正動作について、説明する。本実施形態では、まず、比較器130のオフセットを補正するためのオフセット補正データを求める(オフセット検出工程)。そして、オフセットを補正した状態で、電圧V1と参照電圧VREFとを比較して、第1の制御コードを決定する(比較工程A)。その後、電圧V1と電圧V2とを比較して、第2の制御コードを決定する(比較工程B)。
制御回路240は、セレクタ制御信号INSELによって、比較器130の(+)入力と(-)入力の両方に参照電圧VREFが入力されるように、セレクタ120を制御する(第1の比較状態)。
制御回路240は、セレクタ制御信号INSELによって、比較器130の(+)入力に電圧V1が入力され、(-)入力に参照電圧VREFが入力されるように、セレクタ120を制御する(第2の比較状態)。
制御回路240は、セレクタ制御信号INSELによって、比較器130の(+)入力に電圧V1が入力され、(-)入力に電圧V2が入力されるように、セレクタ120を制御する(第3の比較状態)。
また、本実施形態では、一旦校正を行った後に、再度校正を行う場合において、上述したものと同様の校正動作を行う。この場合、第1および第2の可変抵抗制御信号UPCODE,DNCODEを、現在の校正データに基づく所定の範囲内でのみ変化させるのが好ましい。すなわち、比較工程Aにおいて、第1の可変抵抗制御信号UPCODEを、第1の制御コード±MA(MAは正の整数)の範囲で変化させ、比較工程Bにおいて、第2の可変抵抗制御信号DNCODEを、第2の制御コード±MB(MBは正の整数)の範囲で変化させる。これにより、再校正を短時間で実行することが可能になる。ここでは例えば、MA,MBをそれぞれ1とし、次のような動作を行うものとする。
第2の比較状態において、第1の可変抵抗制御信号UPCODEを「第1の制御コード-1」に設定して比較器130の出力を得、その後、第1の可変抵抗制御信号UPCODEを「第1の制御コード+1」に設定して比較器130の出力を得る。そして、出力がLレベルとHレベルの場合は、元の第1の制御コードを新たな第1の制御コードとして保持する。出力がともにLレベルの場合は、電圧V1が参照電圧VREFより低いので、ダミー可変抵抗110の抵抗値を小さくするように、「第1の制御コード+1」を新たな第1の制御コードとする。出力がともにHレベルの場合は、電圧V1が参照電圧VREFより高いので、ダミー可変抵抗110の抵抗値を大きくするように、「第1の制御コード-1」を新たな第1の制御コードとする。次の比較工程Bでは、ここで定めた新たな第1の制御コードを第1の可変抵抗制御信号UPCODEとして用いて、第1の可変抵抗111の抵抗値を設定する。
第3の比較状態において、第2の可変抵抗制御信号DNCODEを「第2の制御コード-1」に設定して比較器130の出力を得、その後、第2の可変抵抗制御信号DNCODEを「第2の制御コード+1」に設定して比較器130の出力を得る。そして、出力がLレベルとHレベルの場合は、元の第2の制御コードを新たな第2の制御コードとして保持する。出力がともにLレベルの場合は、電圧V2は電圧V1より高いので、第2の可変抵抗112の抵抗値を小さくするように、「第2の制御コード+1」を新たな制御コード候補cとする。出力がともにHレベルの場合は、電圧V2は電圧V1より低いので、第2の可変抵抗112の抵抗値を大きくするように、「第2の制御コード-1」を新たな第2の制御コードとする。
実施形態3に係るインターフェース回路の構成は、実施形態1で示した図1と同様であり、ここではその詳細な説明を省略する。
101,201,301 校正回路
104A,104B 可変抵抗部
105 パッド
110 ダミー可変抵抗
111 第1可変抵抗
112 第2可変抵抗
120 セレクタ
130 比較器
140,240,340 制御回路
250 加算器
260 DAコンバータ
331,332 比較器(温度検出用比較部)
370 温度補正テーブル
381 温度電圧変換素子
UPCODE 第1の可変抵抗制御信号
DNCODE 第2の可変抵抗制御信号
INSEL セレクタ制御信号
OFFCAN オフセット補正信号
OFSTCODE 温度補正量
Rterm 参照抵抗
V1 第1ノード
V2 第2ノード
VREF 参照電圧
Claims (8)
- 終端抵抗の抵抗値を校正する機能を有するインターフェース回路であって、
終端抵抗として機能する可変抵抗部と、
参照抵抗が外付けされるパッドと、
前記パッドに接続されており、前記可変抵抗部に、抵抗値を制御するための校正データを出力する校正回路とを備え、
前記校正回路は、
第1の電源と前記パッドとの間に接続されたダミー可変抵抗と、
前記第1の電源と第2の電源との間に直列に接続された第1および第2の可変抵抗と、
正入力および負入力を有する比較器と、
前記ダミー可変抵抗と前記パッドとの間の第1ノードの電圧、前記第1および第2の可変抵抗の間の第2ノードの電圧、並びに、参照電圧を入力とし、これらの電圧の中から、前記比較器の正入力および負入力に与える電圧を、それぞれ選択出力するセレクタと、
前記比較器の出力を入力とし、前記ダミー可変抵抗および前記第1の可変抵抗の抵抗値を制御する第1の可変抵抗制御信号と、前記第2の可変抵抗の抵抗値を制御する第2の可変抵抗制御信号と、前記セレクタを制御するセレクタ制御信号とを出力する制御回路とを備え、
前記制御回路は、
校正を実行する場合において、前記第1ノードの電圧と前記参照電圧、または前記第1ノードの電圧と前記第2ノードの電圧が前記比較器に与えられるように、前記セレクタを前記セレクタ制御信号によって制御した状態で、前記第1または第2の可変抵抗制御信号を変化させつつ前記比較器の出力をモニターし、出力変化時における前記第1または第2の可変抵抗制御信号の信号値を基にして、前記校正データを求めるものであり、かつ、
前記比較器の出力変化時における前記第1または第2の可変抵抗制御信号の信号値を、前記第1ノードの電圧と前記参照電圧、または前記第1ノードの電圧と前記第2ノードの電圧の前記比較器への入力先を正負入れ替えたそれぞれの状態で求め、求めた信号値の平均値を用いて、前記校正データを求める
ことを特徴とするインターフェース回路。 - 請求項1記載のインターフェース回路において、
前記制御回路は、
再校正を行う場合において、前記第1または第2の可変抵抗制御信号を、現在の校正データに基づく所定の範囲内でのみ変化させて、新たな校正データを求める
ことを特徴とするインターフェース回路。 - 終端抵抗の抵抗値を校正する機能を有するインターフェース回路であって、
終端抵抗として機能する可変抵抗部と、
参照抵抗が外付けされるパッドと、
前記パッドに接続されており、前記可変抵抗部に、抵抗値を制御するための校正データを出力する校正回路とを備え、
前記校正回路は、
第1の電源と前記パッドとの間に接続されたダミー可変抵抗と、
前記第1の電源と第2の電源との間に直列に接続された第1および第2の可変抵抗と、
正入力および負入力を有する比較器と、
前記ダミー可変抵抗と前記パッドとの間の第1ノードの電圧、前記第1および第2の可変抵抗の間の第2ノードの電圧、並びに、参照電圧を入力とし、これらの電圧の中から、前記比較器の正入力および負入力に与える電圧を、それぞれ選択出力するセレクタと、
前記比較器のオフセット補正用のDAコンバータと、
前記DAコンバータの出力を、前記比較器の正入力または負入力に加算する加算器と、
前記比較器の出力を入力とし、前記ダミー可変抵抗および前記第1の可変抵抗の抵抗値を制御する第1の可変抵抗制御信号と、前記第2の可変抵抗の抵抗値を制御する第2の可変抵抗制御信号と、前記セレクタを制御するセレクタ制御信号と、前記DAコンバータに与えるオフセット補正信号とを出力する制御回路とを備え、
前記制御回路は、
校正を実行する場合において、前記第1ノードの電圧と前記参照電圧、または前記第1ノードの電圧と前記第2ノードの電圧が前記比較器に与えられるように、前記セレクタを前記セレクタ制御信号によって制御した状態で、前記第1または第2の可変抵抗制御信号を変化させつつ前記比較器の出力をモニターし、出力変化時における前記第1または第2の可変抵抗制御信号の信号値を基にして、前記校正データを求めるものであり、かつ、
前記校正データを求める前に、前記参照電圧が前記比較器の正負入力の両方に与えられるように前記セレクタ制御信号によって前記セレクタを制御した状態で、前記オフセット補正信号を変化させつつ前記比較器の出力をモニターし、出力変化時における前記オフセット補正信号の信号値を基にして、オフセット補正データを求め、
校正を実行する場合において、前記オフセット補正データを前記DAコンバータに与えるものである
ことを特徴とするインターフェース回路。 - 請求項3記載のインターフェース回路において、
前記制御回路は、
再校正を行う場合において、前記第1または第2の可変抵抗制御信号を、現在の校正データに基づく所定の範囲内でのみ変化させて、新たな校正データを求める
ことを特徴とするインターフェース回路。 - 請求項4記載のインターフェース回路において、
前記制御回路は、
再校正を行う場合において、オフセット補正データを再度求めた後に、新たな校正データを求める
ことを特徴とするインターフェース回路。 - 請求項2または4記載のインターフェース回路において、
温度電圧変換素子と、
前記温度電圧変換素子の出力と、少なくとも2つ以上の異なる温度検出用基準電圧とを比較する温度検出用比較部と、
校正データの温度補正量が、前記温度検出用比較部の出力と関連付けて格納されている温度補正テーブルとを備え、
前記制御回路は、
再校正を行う場合において、前記温度検出用比較部の出力を受け、この出力を用いて前記温度補正テーブルを参照することによって、校正データの温度補正量を求める
ことを特徴とするインターフェース回路。 - 請求項2または4記載のインターフェース回路において、
前記制御回路は、再校正を行う場合に、処理を時間的に分割して実行する
ことを特徴とするインターフェース回路。 - 請求項2または4記載のインターフェース回路において、
前記制御回路は、再校正を、繰り返し実行する
ことを特徴とするインターフェース回路。
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