TWI670548B - 畫素陣列基板 - Google Patents

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Abstract

一種畫素陣列基板包含具有畫素區的顯示區、複數條訊號線、傳輸線、選擇線與跳線。訊號線與傳輸線交錯形成畫素區。選擇線通過畫素區且與訊號線交錯而形成交錯區。選擇線具有第一接點及與第一接點相鄰的第二接點與第三接點。第一接點位於交錯區上及第二接點與第三接點之間。第一部分的第一接點由顯示區的直線通過。跳線分別通過第一接點，且每一跳線的兩端分別位於第二接點其中之一上與第三接點其中之一上。第一部分的跳線電性連接第一部分的第一接點與相鄰第一部分第一接點的第二接點，但與相鄰第一部分第一接點的第三接點電性絕緣。

Description

畫素陣列基板
本案是有關於一種畫素陣列基板。
隨著顯示面板被廣泛地應用在各式顯示器中，例如：電視、筆記型電腦、平板電腦、電子紙(e-paper)書及行動電話等。窄邊框(Narrow boarder)設計的顯示器是目前顯示器產業的發展趨勢。
為了實現顯示器窄邊框的設計，在畫素陣列中，訊號線(掃描線或資料線)可沿水平方向延伸，選擇線可沿垂直方向延伸並利用接點與訊號線連接，以將訊號從選擇線傳送至訊號線。如此一來，當訊號傳輸時，訊號可從垂直方向的選擇線傳送至水平方向的訊號線，進而傳送至訊號線通過的同列畫素區。這種線路佈局可稱為T-wired設計，能讓線路從顯示面板的同一側進出畫素區，取代傳統從顯示面板相鄰兩側進出畫素區的線路設計，因此可縮小邊框覆蓋的面積。
然而，T-wired設計會因為選擇線與畫素電極之間的電容耦合效應，會導致面板在顯示畫面時出現對角線亮度不均的狀況(Mura)，進而影響顯示器的畫面品質。
本發明之一技術態樣為一種畫素陣列基板。
根據本發明一實施方式，一種畫素陣列基板包含顯示區、複數條訊號線、複數條傳輸線、複數條選擇線與複數條跳線。顯示區內具有複數個畫素區。訊號線與傳輸線交錯形成畫素區。選擇線通過畫素區且與訊號線交錯而形成複數個交錯區。選擇線具有複數個第一接點及與第一接點相鄰的複數個第二接點與複數個第三接點。第一接點分別位於交錯區上。每一第一接點位於第二接點其中之一與第三接點其中之一之間。第一部分的第一接點由顯示區的直線通過。跳線分別通過第一接點，且每一跳線的兩端分別位於第二接點其中之一上與第三接點其中之一上。第一部分的跳線電性連接第一部分的第一接點與相鄰第一部分第一接點的第二接點，但與相鄰第一部分第一接點的第三接點電性絕緣。
在本發明一實施方式中，上述畫素陣列基板更包含絕緣層。絕緣層覆蓋選擇線，且絕緣層具有複數個開口。第一部分的第一接點及與其相鄰的第二接點位於開口中，第一部分的跳線接觸開口中的第一接點與第二接點。
在本發明一實施方式中，上述畫素陣列基板更包含複數個絕緣體。絕緣體位於絕緣層與第一部分的跳線之間，且絕緣體的位置對應相鄰第一部分第一接點的第三接點的位置。
在本發明一實施方式中，上述絕緣體的寬度大致與開口的寬度相同。
在本發明一實施方式中，上述第二部分的第一接點位於直線一側，且第二部分的跳線電性連接與第二部分第一接點相鄰的第二接點與第三接點，但與第二部分第一接點電性絕緣。
在本發明一實施方式中，上述畫素陣列基板更包含絕緣層。絕緣層覆蓋選擇線，且絕緣層具有複數個開口。與第二部分第一接點相鄰的第二接點與第三接點位於開口中，第二部分的跳線接觸開口中的第二接點與第三接點。
在本發明一實施方式中，上述畫素陣列基板更包含複數個絕緣體。絕緣體位於絕緣層與第二部分的跳線之間，且絕緣體的位置對應第二部分的第一接點的位置。
在本發明一實施方式中，上述第三部分的第一接點位於直線一側，且第三部分的跳線與第三部分的第一接點、相鄰第三部分第一接點的第二接點與第三接點電性絕緣。
在本發明一實施方式中，上述畫素陣列基板更包含絕緣層與複數個絕緣體。絕緣層覆蓋選擇線。絕緣體位於絕緣層與第三部分的跳線之間，且絕緣體的位置對應該第三部分的第一接點的位置、相鄰第三部分第一接點的第二接點與第三接點的位置。
在本發明一實施方式中，上述訊號線為資料線或掃描線。
在本發明上述實施方式中，雖然顯示區的對角線(即直線)有通過第一接點，但因選擇線還具有與第一接點相鄰的第二接點與第三接點，因此跳線可電性連接第一接點與第二 接點但與第三接點電性絕緣。如此一來，選擇線傳送的訊號可經第二接點與跳線傳送至第一接點，而第一接點位於選擇線與訊號線的交錯區，因此訊號可傳送至訊號線。由於與對角線通過之第一接點相鄰的第三接點與跳線電性絕緣，因此顯示區對角線一側的選擇線不會傳遞訊號，可避免畫素陣列基板在顯示畫面時出現顯示區對角線亮度不均的狀況(Mura)，提升顯示器的畫面品質。
100、100a‧‧‧畫素陣列基板
110‧‧‧顯示區
112‧‧‧畫素區
120、120a‧‧‧訊號線
130、130a‧‧‧選擇線
132a、132b、132c‧‧‧第一接點
134‧‧‧第二接點
136‧‧‧第三接點
140a、140b、140c‧‧‧跳線
150‧‧‧基板
160‧‧‧絕緣層
162、164、166、168‧‧‧開口
170a、170b、170c、170d、170e‧‧‧絕緣體
180‧‧‧傳輸線
2-2、3-3、4-4‧‧‧線段
D1、D2、D3‧‧‧方向
L‧‧‧對角線
P‧‧‧交錯區
W1、W2‧‧‧寬度
第1圖繪示根據本發明一實施方式之畫素陣列基板的顯示區的局部放大圖。
第2圖繪示第1圖之畫素陣列基板沿線段2-2的剖面圖。
第3圖繪示第1圖之畫素陣列基板沿線段3-3的剖面圖。
第4圖繪示第1圖之畫素陣列基板沿線段4-4的剖面圖。
第5圖繪示根據本發明一實施方式之畫素陣列基板的顯示區的局部放大圖。
以下將以圖式揭露本發明之複數個實施方式，為明確說明，許多實務上的細節將在以下敘述中一併說明。然而，應瞭解到，這些實務上的細節不應用以限制本發明。也就是說，在本發明部分實施方式中，這些實務上的細節是非必要的。此外，為簡化圖式起見，一些習知慣用的結構與元件在圖 式中將以簡單示意的方式繪示之。
第1圖繪示根據本發明一實施方式之畫素陣列基板100的顯示區110的局部放大圖。如圖所示，畫素陣列基板100包含顯示區110、複數條訊號線120、複數條傳輸線180、複數條選擇線130與複數條跳線140a、140b、140c。顯示區110內具有複數個畫素區112，複數個畫素區112由複數條訊號線120與複數條傳輸線180交錯形成。選擇線130通過畫素區112且與訊號線120交錯而形成複數個交錯區P。舉例來說，選擇線130大致垂直訊號線120。選擇線130具有複數個第一接點132a、132b、132c、複數個第二接點134與複數個第三接點136。其中，第一部分的第一接點132a由顯示區110的對角線L通過，第二部分的第一接點132b位於顯示區110的對角線L一側(如對角線L下側或右側)，第三部分的第一接點132c位於顯示區110的對角線L另一側(如對角線L上側或左側)。此外，每一第一接點132a、132b、132c與第二接點134、第三接點136相鄰，且位於第二接點134與第三接點136之間。第一接點132a、132b、132c分別位於選擇線130與訊號線120的交錯區P上。最佳實施例的對角線L，可以定義為，通過顯示區110內的每一條相鄰選擇線130上的各一個第一接點132a，所構成的直線。
第一部分的跳線140a通過第一接點132a，第二部分的跳線140b通過第一接點132b，第三部分的跳線140c通過第一接點132c。在本文中，「跳線通過第一接點」表示跳線從第一接點上方經過之意，跳線與第一接點電性連接或電性絕 緣皆有可能。此外，每一跳線140a、140b、140c的兩端分別位於第二接點134與第三接點136上。跳線140a電性連接第一接點132a與相鄰第一接點132a的第二接點134，但跳線140a與相鄰第一接點132a的第三接點136電性絕緣。在第1圖中，斜線標示的接點表示與跳線電性連接，而空白的接點表示與跳線電性絕緣。
在畫素陣列基板100中，雖然顯示區110的對角線L有通過第一接點132a，但因選擇線130還具有與第一接點132a相鄰的第二接點134與第三接點136，因此跳線140a可電性連接第一接點132a與第二接點134但與第三接點136電性絕緣。如此一來，選擇線130以方向D1傳送的訊號可經第二接點134與跳線140a傳送至第一接點132a，而第一接點132a位於選擇線130與訊號線120的交錯區P，因此訊號可傳送至訊號線120，訊號線120便能以方向D2、D3將訊號至與其同列的畫素區112。由於與對角線L通過之第一接點132a相鄰的第三接點136與跳線140a電性絕緣，因此顯示區110對角線L一側(如對角線L上側或左側)的選擇線130不會傳遞方向D1的訊號，可避免畫素陣列基板100在顯示畫面時出現顯示區110對角線L亮度不均的狀況(Mura)，提升顯示器的畫面品質。
在利用自動光學檢查(Automated Optical Inspection；AOI)機台檢測畫素陣列基板100時，機台會比較交錯區P附近的線路結構是否一致，若出現不一致的狀況，則會被判定為線路結構出現缺陷(Defect)。在本實施方式中，跳線140b電性連接與第一接點132b相鄰的第二接點134與第三 接點136，但與第一接點132b電性絕緣。跳線140c與第一接點132c、相鄰第一接點132c的第二接點134與第三接點136電性絕緣。如此一來，可讓每一畫素區112的線路結構具有相同的設計，例如每一畫素區112都有一條訊號線120與一條選擇線130交錯，且在每一交錯區P附近均設有三個相鄰的接點及一條跳線，使得訊號線120與選擇線130的交錯處附近的線路結構一致，能通過自動光學檢查，避免機台判讀錯誤，確保畫素陣列基板100應有之良率。
在本實施方式中，訊號線120電性連接畫素陣列基板100的閘極，因此訊號線120為掃描線(或稱閘極線)。訊號線120利用第一接點132a與選擇線130電性連接而將訊號傳遞至閘極。
應瞭解到，已敘述過的元件連接關係將不再重複贅述，合先敘明。在以下敘述中，將說明畫素陣列基板100的剖面結構。
第2圖繪示第1圖之畫素陣列基板100沿線段2-2的剖面圖。同時參閱第1圖與第2圖，畫素陣列基板100更包含絕緣層160。絕緣層160、選擇線130與訊號線120位於基板150上。絕緣層160覆蓋選擇線130，且絕緣層160具有複數個開口162、164。選擇線130從開口162、164裸露而分別作為第1圖的第一接點132a與第二接點134。也就是說，第一接點132a位於絕緣層160的開口162中，而與第一接點132a相鄰的第二接點134位於絕緣層160的開口164中。跳線140a接觸開口162中的第一接點132a與開口164中的第二接點134。
此外，畫素陣列基板100更包含複數個絕緣體170a，且絕緣體170a位於絕緣層160與跳線140a之間。絕緣體170a的位置對應相鄰第一接點132a的第三接點136的位置。也就是說，絕緣體170a作為第1圖的第三接點136，其不與跳線140a、選擇線130電導通，作為假性接點。在本實施方式中，絕緣體170a的寬度W2大致與開口162、164的寬度W1相同。
在本實施方式中，基板150可具有撓性，其包含聚合物材料。畫素陣列基板100上方可設置電子墨水層與前面板，能應用於可彎折的顯示裝置中，例如電子紙(e-paper)顯示裝置。
第3圖繪示第1圖之畫素陣列基板100沿線段3-3的剖面圖。同時參閱第1圖與第3圖，絕緣層160具有複數個開口166、168。選擇線130從開口166、168裸露而分別作為第1圖與第一接點132b相鄰的第二接點134與第三接點136。也就是說，與第一接點132b相鄰的第二接點134位於絕緣層160的開口166中，而第一接點132b相鄰的第三接點136位於絕緣層160的開口168中。跳線140b接觸開口166中的第二接點134與開口168中的第三接點136。
此外，畫素陣列基板100更包含複數個絕緣體170b，且絕緣體170b位於絕緣層160與跳線140b之間。絕緣體170b的位置對應第一接點132b的位置。也就是說，絕緣體170b作為第1圖的第一接點132b，其不與跳線140b、選擇線 130電導通，作為假性接點。在本實施方式中，絕緣體170b的寬度W2大致與開口166、168的寬度W1相同。
第4圖繪示第1圖之畫素陣列基板100沿線段4-4的剖面圖。同時參閱第1圖與第4圖，畫素陣列基板100更包含複數個絕緣體170c、170d、170e。絕緣體170c、170d、170e位於絕緣層160與跳線140c之間，且絕緣體170c的位置對應第一接點132c的位置，絕緣體170d的位置對應相鄰第一接點132c的第二接點134的位置，絕緣體170e的位置對應相鄰第一接點132c的第三接點136的位置。也就是說，絕緣體170c、170d、170e分別作為第1圖的第一接點132c、相鄰第一接點132c的第二接點134與相鄰第一接點132c的第三接點136。絕緣體170c、170d、170e不與跳線140c、選擇線130電導通，作為假性接點。在本實施方式中，絕緣體170c、170d、170e具有相同的寬度W2。
第5圖繪示根據本發明一實施方式之畫素陣列基板100a的顯示區110的局部放大圖。畫素陣列基板100a包含顯示區110、複數條訊號線120a、複數條選擇線130a與跳線140a、140b、140c。與第1圖實施方式不同的地方在於訊號線120a電性連接畫素陣列基板100的源極，因此訊號線120a為資料線。訊號線120a利用第一接點132a與選擇線130a電性連接而將訊號傳遞至源極。
雖然本發明已以實施方式揭露如上，然其並非用以限定本發明，任何熟習此技藝者，在不脫離本發明之精神和範圍內，當可作各種之更動與潤飾，因此本發明之保護範圍當 視後附之申請專利範圍所界定者為準。

Claims (10)

  1. 一種畫素陣列基板，包含：一顯示區，其內具有複數個畫素區；複數條訊號線與複數條傳輸線交錯形成該些畫素區；複數條選擇線，通過該些畫素區且與該些訊號線交錯而形成複數個交錯區，該些選擇線具有複數個第一接點及與該些第一接點相鄰的複數個第二接點與複數個第三接點，其中該些第一接點分別位於該些交錯區上，每一該些第一接點位於該些第二接點其中之一與該些第三接點其中之一之間，且該些第一接點的一第一部分由該顯示區的一直線通過；以及複數條跳線，分別通過該些第一接點，且每一該些跳線的兩端分別位於該些第二接點其中之一上與該些第三接點其中之一上，其中該些跳線的一第一部分電性連接該第一部分的該些第一接點與相鄰該第一部分該些第一接點的該些第二接點，但該第一部分的該些跳線與相鄰該第一部分該些第一接點的該些第三接點電性絕緣。
  2. 如請求項1所述之畫素陣列基板，更包含：一絕緣層，覆蓋該些選擇線，且該絕緣層具有複數個開口，其中該第一部分的該些第一接點及與其相鄰的該些第二接點位於該些開口中，該第一部分的該些跳線接觸該些開口中的該些第一接點與該些第二接點。
  3. 如請求項2所述之畫素陣列基板，更包含：複數個絕緣體，位於該絕緣層與該第一部分的該些跳線之間，且該些絕緣體的位置對應相鄰該第一部分該些第一接點的該些第三接點的位置。
  4. 如請求項3所述之畫素陣列基板，其中該些絕緣體的寬度大致與該些開口的寬度相同。
  5. 如請求項1所述之畫素陣列基板，其中該些第一接點的一第二部分位於該直線一側，且該些跳線的一第二部分電性連接與該第二部分該些第一接點相鄰的該些第二接點與該些第三接點，但該第二部分的該些跳線與該第二部分該些第一接點電性絕緣。
  6. 如請求項1所述之畫素陣列基板，更包含：一絕緣層，覆蓋該些選擇線，且該絕緣層具有複數個開口，其中與該第二部分該些第一接點相鄰的該些第二接點與該些第三接點位於該些開口中，該第二部分的該些跳線接觸該些開口中的該些第二接點與該些第三接點。
  7. 如請求項6所述之畫素陣列基板，更包含：複數個絕緣體，位於該絕緣層與該第二部分的該些跳線之間，且該些絕緣體的位置對應該第二部分的該些第一接點的位置。
  8. 如請求項1所述之畫素陣列基板，其中該些第一接點的一第三部分位於該直線一側，且該些跳線的一第三部分與該第三部分的該些第一接點、相鄰該第三部分該些第一接點的該些第二接點與該些第三接點電性絕緣。
  9. 如請求項8所述之畫素陣列基板，更包含：一絕緣層，覆蓋該些選擇線；以及複數個絕緣體，位於該絕緣層與該第三部分的該些跳線之間，且該些絕緣體的位置對應該第三部分的該些第一接點的位置、相鄰該第三部分該些第一接點的該些第二接點與該些第三接點的位置。
  10. 如請求項1所述之畫素陣列基板，其中該些訊號線為資料線或掃描線。
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