TWI660338B - 畫素電路及其驅動方法 - Google Patents

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Abstract

一種畫素電路及其驅動方法。畫素電路包括第一至第二 畫素電極、第一至第三液晶電容、第一儲存電容以及第一至第三開關。第一液晶電容與第一儲存電容皆位於第一畫素電極與第一共同電壓之間。第二液晶電容位於第一畫素電極與第二畫素電極之間。第三液晶電容位於第二畫素電極與第一共同電壓之間。第一開關具有接收資料電壓、接收掃描信號以及耦接第一畫素電極的端點。第二開關具有接收第二共同電壓、接收重置信號以及耦接第一畫素電極的端點。第三開關具有接收重置電壓、接收重置信號以及耦接第二畫素電極的端點。

Description

畫素電路及其驅動方法
本發明是有關於一種顯示裝置,且特別是有關於一種畫素電路及其驅動方法。
隨著液晶顯示面板的興起,使用者對於顯示器畫面更新的頻率以及解析度的品質要求愈來愈高。當液晶的所反應速度不夠快速時,將會造成顯示螢幕所呈現出的畫面會模糊或不清楚等問題。在此情況下,將導致使用者在觀看的品質上受到影響。
在現有的技術中,由於橫向螺旋結構(Uniform Lying Helix Structure,ULH)液晶具備反應時間快、高穿透度、低吸收率等特性,因此時常被運用於顯示面板中,以作為液晶顯示面板中的材料。值得一提的是,當驅動橫向螺旋結構液晶時,設計者通常需施加不同的外加電場以使液晶分子的光軸被偏向。然而,隨著正負電場的交替切換下,部份的液晶分子可能會無法反應電場方向的快速變化,而造成液晶分子排列混亂,亦即驅動橫向螺旋結構液晶的光軸會偏向不同的方向,進而使得整體的穿透度下 降。因此,如何改善顯示面板中的穿透度下降等問題,將是本領域相關技術人員重要的課題。
本發明提供一種畫素電路及其驅動方法,可以在橫向螺旋結構液晶被驅動之前,預先將橫向螺旋結構液晶執行重置動作,並且透過對其施壓一水平電場的方式,以加速橫向螺旋結構液晶分子重新排列,進而改善穿透度下降的問題。
本發明的畫素電路包括第一至第二畫素電極、第一至第三液晶電容、第一儲存電容以及第一至第三開關。第一液晶電容位於第一畫素電極與第一共同電壓之間。第一儲存電容位於第一畫素電極與第一共同電壓之間。第二液晶電容位於第一畫素電極與第二畫素電極之間。第三液晶電容位於第二畫素電極與第一共同電壓之間。第一開關具有接收資料電壓的第一端、接收掃描信號的控制端以及耦接第一畫素電極的第二端。第二開關具有接收第二共同電壓的第一端、接收重置信號的控制端以及耦接第一畫素電極的第二端。第三開關具有接收重置電壓的第一端、接收重置信號的控制端以及耦接第二畫素電極的第二端。
本發明的畫素電路的驅動方法,畫素電路具有第一畫素電極、第二畫素電極及傳送第一共同電壓的共同電極,並且在共同電極與第一畫素電極及第二畫素電極配置液晶層,包括:在一重置期間,提供第二共同電壓至第一畫素電極,並且提供重置電 壓至第二畫素電極;在一充電期間,提供資料電極至第一畫素電極,並且浮接第二畫素電極;在一發射期間,浮接第一畫素電極及第二畫素電極。
基於上述,本發明實施例所述畫素電路操作於重置期間時,可以透過第一畫素電極與第二畫素電極之間所形成的水平電場,來使橫向螺旋結構液晶中的分子回歸到初始或預設狀態,並且將橫向螺旋結構液晶分子重新排列,得以改善穿透度下降的問題。
為讓本發明的上述特徵和優點能更明顯易懂,下文特舉實施例,並配合所附圖式作詳細說明如下。
100‧‧‧畫素電路
410‧‧‧主動陣列基板
420‧‧‧液晶層
430‧‧‧彩色濾波基板
C1‧‧‧第一液晶電容
C2‧‧‧第二液晶電容
C3‧‧‧第三液晶電容
Cst‧‧‧第一儲存電容
M1‧‧‧第一開關
M2‧‧‧第二開關
M3‧‧‧第三開關
PX1‧‧‧第一畫素電極
PX2‧‧‧第二畫素電極
Vcom1‧‧‧第一共同電壓
Vcom2‧‧‧第二共同電壓
Pcom‧‧‧共同電極
LCX‧‧‧液晶層
EF1、EF2‧‧‧電場
Vdata‧‧‧資料電壓
Scan‧‧‧掃描信號
Reset‧‧‧重置信號
Vreset‧‧‧重置電壓
VCH‧‧‧高共同電壓
VCL‧‧‧低共同電壓
TFR‧‧‧畫面期間
Tr‧‧‧重置期間
Tch‧‧‧充電期間
Te‧‧‧發射期間
SB1、SB2‧‧‧基板
G1、G2‧‧‧閘極
E1、E2‧‧‧電極
GI1、GI2‧‧‧閘極絕緣層
CH1、CH2‧‧‧通道層
CX‧‧‧電容
ES1、ES2‧‧‧蝕刻阻止層
S1、S2‧‧‧源極
D1、D2‧‧‧汲極
T1、T2‧‧‧電晶體
BP、BP1、BP2、BP3‧‧‧保護層
PL‧‧‧絕緣層
BM1‧‧‧黑矩陣
OC1‧‧‧塗佈層
PV1‧‧‧鈍化層
S510~S530‧‧‧畫素電路的驅動步驟
圖1是依照本發明一實施例的畫素電路的電路圖。
圖2是依照本發明一實施例的畫素電路的波形示意圖。
圖3A至3C是依照本發明一實施例的畫素電路於重置期間、充電期間及發射期間的液晶狀態示意圖。
圖4是依照本發明一實施例的顯示面板的剖面示意圖。
圖5是依照本發明一實施例的畫素電路的驅動方法的流程圖。
圖1是依照本發明一實施例的畫素電路100的電路圖。請參照圖1,在本實施例中,畫素電路100包括第一畫素電極PX1、第二畫素電極PX2、第一至第三液晶電容C1~C3、第一儲存電容Cst以及第一至第三開關M1~M3,其中第一至第三開關M1~M3是以電晶體為例,但本發明實施例不以此為限。
在本實施例中,第一液晶電容C1與第一儲存電容Cst皆位於第一畫素電極PX1與第一共同電壓Vcom1之間。第二液晶電容C2位於第一畫素電極PX1與第二畫素電極PX2之間。第三液晶電容C3位於第二畫素電極PX2與第一共同電壓Vcom1之間。
第一開關M1的汲極(對應於第一端)接收資料電壓Vdata,第一開關M1的閘極(對應於控制端)接收掃描信號Scan,第一開關M1的源極(對應於第二端)耦接至第一畫素電極PX1。第二開關M2的汲極(對應於第一端)接收第二共同電壓Vcom2,第二開關M2的閘極(對應於控制端)接收重置信號Reset,第二開關M2的源極(對應於第二端)耦接至第一畫素電極PX1。第三開關M3的汲極(對應於第一端)接收重置電壓Vreset,第三開關M3的閘極(對應於控制端)接收重置信號Reset,第三開關M3的源極(對應於第二端)耦接至第二畫素電極PX2。
依據上述,本實施例中的畫素電路100可以利用掃描信號Scan控制第一開關M1的導通狀態,以控制資料電壓Vdata是否被寫入至畫素電路100中。並且,可利用重置信號Reset來控制第二至第三開關M2~M3的導通狀態,以控制第二共用電壓 Vcom2與重置電壓Vreset是否分別被提供至第一畫素電極PX1與第二畫素電極PX2中。
詳細來說,本實施例中的第一畫素電極PX1可以是一片電極(未繪示),第二畫素電極PX2可以是一圖案化電極(未繪示),並且此圖案化電極可以例如是梳狀結構的圖型,但並不限於此。為片電極的第一畫素電極PX1與為圖案化電極的第二畫素電極PX2可以相互重疊但沒有電性接觸,而第一畫素電極PX1及第二畫素電極PX2的電場是透過第二畫素電極PX2的鏤空部份(或間隙部份)來形成,使得在第一畫素電極PX1與第二畫素電極PX2之間的壓差可在液晶中產生出一水平電場,進而加速液晶分子重新排列。
在本發明實施例中,上述掃描信號Scan可以例如由顯示面板(未繪示)中的多條閘極線(Gate Line)的其中之一來傳送。另外,資料電壓Vdata可以例如由顯示面板(未繪示)中的多條資料線(Data Line)的其中之一來傳送。並且,顯示面板(未繪示)中的多個畫素(Pixel)是以矩陣排列,並且配置於資料線與閘極線的交錯處,以透過相對應的閘極線與資料線來控制畫素電路(如畫素電路100)進行電路操作。
在本實施例中,顯示面板(未繪示)中的多個畫素可參照畫素電路100來理解。舉例來說,畫素電路100可以利用掃描信號Scan來控制第一開關M1的導通狀態,當第一開關M1被導通時,畫素電路100可以提供資料電壓Vdata至第一畫素電極PX1 中,以使儲存電容Cst儲存資料電壓Vdata。
圖2是依照本發明一實施例的畫素電路的波形示意圖。圖3A至3C是依照本發明一實施例的畫素電路於重置期間、充電期間及發射期間的液晶狀態示意圖。請參照圖2,在本實施例中,畫素電路100的一個畫面期間TFR可以區分為重置期間Tr、充電期間Tch以及發射期間Te,並且重置期間Tr、充電期間Tch以及發射期間Te彼此不相互重疊,其中充電期間Tch是位於重置期間Tr與發射期間Te之間。舉例來說,在畫面期間TFR中,畫素電路100的重置期間Tr及充電期間Tch可以視為畫素電路100的資料寫入時間;畫素電路100的發射期間Te可以視為畫素電路100的顯示時間。
請參照圖1及圖3A,在本實施例中,第二畫素電極PX2可以位於傳送第一共同電壓Vcom1的共同電極Pcom與第一畫素電極PX1之間,並且共同電極Pcom與第一畫素電極PX1以及第二畫素電極PX2之間配置液晶層LCX,其中液晶層LCX的材質可以例如是橫向螺旋結構液晶(Uniform Lying Helix Structure,ULH),但本發明實施例不限於此。
並且,本實施例的第一至第三液晶電容C1~C3可以為形成於橫向螺旋結構液晶之中的等效電容。除此之外,根據電路設計的不同,本實施例中的第一共同電壓Vcom1可以是直流共同電壓或是交流共同電壓,在此第一共同電壓Vcom1是以交流共同電壓為例。
請同時參照圖1、圖2及圖3A。詳細來說,當畫素電路100操作於重置期間Tr時,可以設定掃描信號Scan為禁能(例如為低電壓準位),以使第一開關M1可以被斷開。在此情況下,畫素電路100將無法提供資料電壓Vdata至第一畫素電極PX1中。另一方面,在重置期間Tr中,可以設定重置信號Reset為致能(例如為高電壓準位),以使第二開關M2與第三開關M3導通。此時,第一共同電壓Vcom1與第二共同電壓Vcom2由高共同電壓VCH切換為低共同電壓VCL,並且畫素電路100可以提供第二共同電壓Vcom2至第一畫素電極PX1中,以使第一畫素電極PX1具有低共同電壓VCL。並且,畫素電路100亦可以提供重置電壓Vreset至第二畫素電極PX2中,以使第二畫素電極PX2上具有重置電壓Vreset。其中,本實施例中的第二共同電壓Vcom2的波形可以相同於第一共同電壓Vcom1的波形,並且重置電壓Vreset不同於低共同電壓VCL,但本發明實施例並不限於此。
另一方面,當畫素電路100操作於重置期間Tr時,由於第一畫素電極PX1接收來自第二共同電壓Vcom2的低共同電壓VCL,並且第二畫素電極PX2接收重置電壓Vreset,因此,第二畫素電極PX2可以在第二液晶電容C2上,產生電場EF1至第一畫素電極PX1的方向,亦即第一畫素電極PX1與第二畫素電極PX2之間形成水平電場。並且,利用此第一畫素電極PX1與第二畫素電極PX2之間所產生的水平電場,來使液晶面板中的橫向螺旋結構液晶分子的排列回歸到預設或初始的狀態。
請同時參照圖1、圖2及圖3B。詳細來說,當畫素電路100操作於充電期間Tch時,可以設定掃描信號Scan為致能(例如為高電壓準位),以使第一開關M1可以被導通。在此情況下,畫素電路100可以提供資料電壓Vdata至第一畫素電極PX1中,以使儲存電容Cst儲存資料電壓Vdata。另一方面,在充電期間Tch中,可以設定重置信號Reset為禁能(例如為低電壓準位),以使第二開關M2與第三開關M3被斷開,使得重置電壓Vreset無法被提供至第二畫素電極PX2中。此時,第一共同電壓Vcom1與第二共同電壓Vcom2持續維持於低共同電壓VCL,並且浮接第二畫素電極PX2。
另一方面,當畫素電路100操作於充電期間Tch時,由於第一畫素電極PX1上具有所接收的資料電壓Vdata,並且第二畫素電極PX2為浮接狀態,因此,第一畫素電極PX1可以在第一液晶電容C1上,產生電場EF2至第一共同電壓Vcom1的共同電極Pcom的方向,亦即第一畫素電極PX1與第一共同電壓Vcom1之間形成垂直電場。並且,利用此第一畫素電極PX1與第一共同電壓Vcom1之間所產生的垂直電場,來轉動液晶面板中的橫向螺旋結構液晶分子的光軸,以使液晶分子可以形成亮暗灰階。
請同時參照圖1、圖2及圖3C。詳細來說,當畫素電路100操作於發射期間Te時,可以設定掃描信號Scan為禁能(例如為低電壓準位),以使第一開關M1可以被斷開。在此情況下,畫素電路100將無法提供資料電壓Vdata至第一畫素電極PX1中, 以浮接第一畫素電極PX1。另一方面,在發射期間Te中,可以設定重置信號Reset為禁能(例如為低電壓準位),以使第二開關M2與第三開關M3被斷開,使得重置電壓Vreset無法被提供至第二畫素電極PX2中,以持續浮接第二畫素電極PX2。此時,第一共同電壓Vcom1與第二共同電壓Vcom2持續維持於低共同電壓VCL。
另一方面,當畫素電路100操作於發射期間Te時,由於第一畫素電極PX1上仍保持於所接收的資料電壓Vdata,並且第一畫素電極PX1及第二畫素電極PX2仍維持在浮接狀態,因此畫素電路100中的橫向螺旋結構液晶可以被驅動,以使畫素電路100根據資料電壓Vdata呈現所需求的灰階。
值得一提的是,在圖3A至圖3C中,第一畫素電極PX1可以形成於基板SB1上,並且在第一畫素電極PX1上,會依序形成保護層BP及第二畫素電極PX2。此外,共用電極Pcom可以形成於基板SB2下。需注意到的是,本發明的圖3A至圖3C僅為本實施例的液晶狀態的示意圖,在本實施例中,各層元件之間還可以包含其它元件。為了方便說明,圖3A至圖3C僅繪示出本發明所需必要的元件,但本發明並不限於此。
依據上述,本實施例可以在液晶分子被驅動之前,預先在畫素電路100操作於重置期間Tr時,利用致能(例如為高電壓準位)重置信號Reset以導通第二開關M2與第三開關M3的方式,以使畫素電路100可以提供第二共同電壓Vcom2至第一畫素電極 PX1中,使得第一畫素電極PX1具有低共同電壓VCL。並且,畫素電路100亦可以提供重置電壓Vreset至第二畫素電極PX2中,使得第二畫素電極PX2上具有重置電壓Vreset。在此情況下,第一畫素電極PX1與第二畫素電極PX2之間可以形成水平電場,進而使顯示面板中的液晶分子可以加速的重新排列,藉以改善光軸在正負電場交替切換的過程中,部份的液晶分子可能會受到電場方向的影響,而導致液晶分子排列混亂與穿透度下降等問題。
圖4是依照本發明一實施例的顯示面板的剖面示意圖。顯示面板包括主動陣列基板410、液晶層420以及彩色濾波基板430。其中,在主動陣列基板410的基板SB1上,會先形成閘極G1、G2及電極E1,接著依序形成閘極絕緣層GI1及GI2。在閘極絕緣層GI2上,會再形成通道層CH1、CH2及電極E2,其中電極E1及E2用以形成電容CX,例如圖1所示儲存電容Cst。並且,在通道層CH1、CH2上會形成蝕刻阻止層ES1、ES2、源極S1、S2、汲極D1、D2,其中閘極G1、通道層CH1、蝕刻阻止層ES1、源極S1及汲極D1構成電晶體T1,閘極G2、通道層CH2蝕刻阻止層ES2、源極S2及汲極D2構成電晶體T2。
在電極E2、蝕刻阻止層ES1、ES2、源極S1、S2及汲極D1、D2上,會依序形成保護層BP1及絕緣層PL。接著,在絕緣層PL上形成第一畫素電極PX1,並且第一畫素電極PX1透過保護層BP1及絕緣層PL的穿孔而接觸到源極S2。在第一畫素電極PX1上,會依序形成保護層BP2及第二畫素電極PX2,並且第二 畫素電極PX2透過保護層BP1及絕緣層PL的穿孔而接觸到源極S1。最後,在第二畫素電極PX2上形成保護層BP3,以完成主動陣列基板410。
另一方面,在彩色濾波基板430的基板SB2上,會形成黑矩陣BM1,接著形成塗佈層OC1。在塗佈層OC1上會依序形成共同電極Pcom及鈍化層PV1,以完成彩色濾波基板430。其中,所謂“在...上”是以製程方向來看,而非圖式方向。接著,將主動陣列基板410與彩色濾波基板430相對組立,並且填充液晶以形成液晶層420,以完成顯示面板。
圖5是依照本發明一實施例的畫素電路的驅動方法的流程圖。請同時參照圖1、圖2及圖5,在步驟S510中,當畫素電路100操作於重置期間Tr時,畫素電路100可以提供第二共同電壓Vcom2至第一畫素電極PX1中,並且畫素電路100亦可以提供重置電壓Vreset至第二畫素電極PX2中。在步驟S520中,當畫素電路100操作於充電期間Tch時,畫素電路100可以提供資料電壓Vdata至第一畫素電極PX1中,並且可以浮接第二畫素電極PX2。在步驟S530中,當畫素電路100操作於發射期間Te時,畫素電路100可以浮接第一畫素電極PX1及第二畫素電極PX2。關於各步驟的實施細節在前述的實施例及實施方式都有詳盡的說明,在此則不再贅述。
綜上所述,本發明實施例所述畫素電路及其驅動方法可以當畫素電路操作於重置期間時,利用第一畫素電極與第二畫素 電極之間所產生的水平電場,來使液晶面板中的橫向螺旋結構液晶分子的排列回歸到預設或初始的狀態。透過上述的方式,不但可以加速液晶分子的重新排列,更可以改善光軸在正負電場交替的過程中,部份的液晶分子可能會受到電場方向的影響,而導致液晶分子排列混亂與穿透度下降等問題。
雖然本發明已以實施例揭露如上,然其並非用以限定本發明,任何所屬技術領域中具有通常知識者,在不脫離本發明的精神和範圍內,當可作些許的更動與潤飾,故本發明的保護範圍當視後附的申請專利範圍所界定者為準。

Claims (17)

  1. 一種畫素電路,包括: 一第一畫素電極; 一第二畫素電極; 一第一液晶電容,位於該第一畫素電極與一第一共同電壓之間; 一第一儲存電容,位於該第一畫素電極與該第一共同電壓之間; 一第二液晶電容,位於該第一畫素電極與該第二畫素電極之間; 一第三液晶電容,位於該第二畫素電極與該第一共同電壓之間; 一第一開關,具有接收一資料電壓的一第一端、接收一掃描信號的一控制端以及耦接該第一畫素電極的一第二端; 一第二開關,具有接收一第二共同電壓的一第一端、接收一重置信號的一控制端以及耦接該第一畫素電極的一第二端;以及 一第三開關,具有接收一重置電壓的一第一端、接收該重置信號的一控制端以及耦接該第二畫素電極的一第二端。
  2. 如申請專利範圍第1項所述的畫素電路,其中該掃描信號致能於一充電期間,該重置信號致能於一重置期間,並且該掃描信號及該重置信號同時禁能於一發射期間。
  3. 如申請專利範圍第2項所述的畫素電路,其中在一畫面期間中,該充電期間、該重置期間及該發射期間彼此不重疊,並且該充電期間位於該重置期間與該發射期間之間。
  4. 如申請專利範圍第1項所述的畫素電路,其中該第一液晶電容、該第二液晶電容及該第三液晶電容為形成於橫向螺旋結構(Uniform Lying Helix Structure,ULH)液晶之中。
  5. 如申請專利範圍第1項所述的畫素電路,其中該第一畫素電極為一片電極,並且該第二畫素電極為一圖案化電極。
  6. 如申請專利範圍第5項所述的畫素電路,其中該第二畫素電極位於傳送該第一共同電壓的一共同電極與該第一畫素電極之間。
  7. 如申請專利範圍第1項所述的畫素電路,其中該第一共同電壓為一直流共同電壓。
  8. 如申請專利範圍第1項所述的畫素電路,其中該第一共同電壓為一交流共同電壓。
  9. 如申請專利範圍第1項所述的畫素電路,其中該第二共同電壓的波形相同於該第一共同電壓的波形。
  10. 一種畫素電路的驅動方法,該畫素電路具有一第一畫素電極、一第二畫素電極及傳送一第一共同電壓的一共同電極,並且在該共同電極與該第一畫素電極及該第二畫素電極配置一液晶層,包括: 在一重置期間,提供一第二共同電壓至該第一畫素電極,並且提供一重置電壓至該第二畫素電極; 在一充電期間,提供一資料電壓至該第一畫素電極,並且浮接該第二畫素電極;以及 在一發射期間,浮接該第一畫素電極及該第二畫素電極。
  11. 如申請專利範圍第10項所述的畫素電路的驅動方法,其中在一畫面期間中,該充電期間、該重置期間及該發射期間彼此不重疊,並且該充電期間位於該重置期間與該發射期間之間。
  12. 如申請專利範圍第10項所述的畫素電路的驅動方法,其中該液晶層的材質包括橫向螺旋結構液晶。
  13. 如申請專利範圍第10項所述的畫素電路的驅動方法,其中該第一畫素電極為一片電極,並且該第二畫素電極為一圖案化電極。
  14. 如申請專利範圍第10項所述的畫素電路的驅動方法,其中該第二畫素電極位於該共同電極與該第一畫素電極之間。
  15. 如申請專利範圍第10項所述的畫素電路的驅動方法,其中該第一共同電壓為一直流共同電壓。
  16. 如申請專利範圍第10項所述的畫素電路的驅動方法,其中該第一共同電壓為一交流共同電壓。
  17. 如申請專利範圍第10項所述的畫素電路的驅動方法,其中該第二共同電壓的波形相同於該第一共同電壓的波形。
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