TW202139319A - 半導體裝置的製造裝置以及半導體裝置的製造方法 - Google Patents

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Abstract

本發明提供一種能以更簡易的順序進一步提高封裝半導體晶片時的位置精度的、半導體裝置的製造裝置。半導體裝置的製造裝置10包括平台16、接合頭14、安裝於所述接合頭14的接合工具24及第一相機26、以及控制器18,所述控制器18以針對一個以上的點分別執行下述處理的方式構成:使檢查晶片130載置於載置面;獲取使所述第一相機26對載置所述檢查晶片130後的所述載置面進行攝像所得的圖像作為檢查圖像44;基於所述檢查圖像44內的所述檢查晶片130的位置,算出相機偏移量Ocm的補正量作為區域補正量C;以及將算出的區域補正量C與所述任意的點的位置對應地記憶於記憶裝置。

Description

半導體裝置的製造裝置以及半導體裝置的製造方法
本說明書揭示一種於基板上封裝半導體晶片而製造半導體裝置的、半導體裝置的製造裝置以及半導體裝置製造方法。
先前以來,於基板上封裝半導體晶片而製造半導體裝置的技術已廣為人知。該半導體裝置的製造技術中,要求將半導體晶片可靠地封裝於目標位置。因此,先前以來提出:於接合頭設置接合半導體晶片的接合工具、及對基板進行攝像的相機,基於相機的拍攝圖像來判斷接合工具相對於基板的相對位置,將半導體晶片封裝於目標位置。
根據該技術,可將半導體晶片更可靠地封裝於目標位置。此處,為了基於拍攝圖像來準確算出接合工具相對於基板的相對位置,需要接合工具與相機的偏移量(以下稱為「相機偏移量」)的準確值。然而,相機偏移量大多因製造裝置的應變(尤其是接合頭的驅動系統的應變)或溫度變化等而變動,難以獲取相機偏移量的準確值。其結果為,先前技術中,有時半導體晶片的位置精度降低。 [先前技術文獻] [專利文獻]
[專利文獻1]日本專利第6256486號公報 [專利文獻2]日本專利特開2004-146776號公報
[發明所欲解決之課題] 專利文獻1及專利文獻2中揭示有下述技術:設置可同時對由接合工具所保持的晶片及基板兩者進行攝像的上下二視場相機,基於由該二視場相機所得的圖像,以檢查用的晶片位於基板的目標位置的方式驅動接合頭,根據所載置的晶片的實際的位置來算出必要的補正量。
根據該專利文獻1、專利文獻2,可於某種程度上減小晶片的位置誤差。然而,專利文獻1、專利文獻2需要昂貴的上下二視場相機,有導致成本增加之虞。另外,專利文獻1中,於算出補正量時,需要標註有對準標記(alignment mark)的專用的基板。另外,專利文獻2中,算出補正量的順序非常複雜,耗費時間。
因此,本說明書中,揭示一種能以更簡易的順序進一步提高封裝半導體晶片時的位置精度的、半導體裝置的製造裝置及半導體裝置的製造方法。 [解決課題之手段]
本說明書所揭示的半導體裝置的製造裝置的特徵在於包括:平台,載置基板;接合頭,相對於所述平台而可相對地移動至任意的點(point);位置檢測機構,檢測所述接合頭的位置;接合工具,安裝於所述接合頭,保持晶片;第一相機,安裝於所述接合頭,自上方對載置面進行攝像,所述載置面為所述平台上表面或載置於所述平台的基板上表面;以及控制器,所述控制器以針對一個以上的點分別執行下述處理的方式構成:載置處理,使所述接合頭移動至所述任意的點後,驅動所述接合工具,使所述晶片載置於所述載置面;檢查圖像獲取處理,獲取使所述第一相機對載置所述晶片後的所述載置面進行攝像所得的圖像作為檢查圖像;補正值算出處理,基於所述檢查圖像內的所述晶片的位置,算出相機偏移量的補正量作為區域補正量,所述相機偏移量為所述第一相機相對於所述接合工具的偏移量;以及記憶處理,將所算出的區域補正量、與由所述位置檢測機構所檢測的所述任意的點的位置對應地記憶於記憶裝置。
於該情形時,所述控制器亦可於所述補正值算出處理中,基於所述檢查圖像內的晶片的實際位置、與根據設計上的所述相機偏移量所求出的所述檢查圖像內的所述晶片的理想位置的差量,來算出所述區域補正量。
另外,於該情形時,亦可更包括:第二相機,自下側對所述接合工具進行攝像,所述控制器以於所述載置處理之前執行工具圖像獲取處理的方式構成,所述工具圖像獲取處理獲取使所述第二相機對由所述接合工具所保持的所述晶片進行攝像所得的圖像作為工具圖像,所述控制器基於所述工具圖像來算出作為所述接合工具的中心相對於所述晶片的中心的偏移量的晶片偏移量,基於所述晶片偏移量及設計上的所述相機偏移量,來算出所述檢查圖像內的所述晶片的理想位置。
另外,所述控制器亦可於執行所述載置處理後,不使所述接合頭水平移動,而執行所述檢查圖像獲取處理。
另外,所述位置檢測機構亦可包含搭載於所述接合頭的驅動系統的位置感測器。
本說明書所揭示的半導體裝置的製造方法的特徵在於,針對一個以上的點分別執行下述步驟:使安裝有接合工具及第一相機的接合頭移動至平台之上的任意的點;將由所述接合工具所保持的晶片載置於載置面,所述載置面為所述平台的上表面或載置於所述平台的基板的上表面;獲取使所述第一相機對載置所述晶片後的所述載置面進行攝像所得圖像作為檢查圖像;基於所述檢查圖像內的所述晶片的位置,算出相機偏移量的補正量作為區域補正量,所述相機偏移量為所述第一相機相對於所述接合工具的偏移量;以及將所算出的區域補正量、與所述任意的點的位置對應地記憶於記憶裝置。
本說明書所揭示的另一半導體裝置的製造裝置的特徵在於包括:平台,載置基板;接合頭,相對於所述平台而可相對地移動;接合工具,安裝於所述接合頭,將晶片接合於所述基板;第一相機,安裝於所述接合頭,自上方對載置面進行攝像,所述載置面為所述平台上表面或載置於所述平台的基板上表面;以及控制器,所述控制器以針對一個以上的點分別執行下述處理的方式構成:第一載置處理,使所述接合頭移動至任意的點後,驅動所述接合工具,使參照晶片載置於所述載置面;參照圖像獲取處理,獲取使所述第一相機對載置所述參照晶片後的所述載置面進行攝像所得的圖像作為參照圖像;第二載置處理,以基於所述參照圖像而可於所述參照晶片的正上方載置檢查晶片的方式將所述接合頭定位後,驅動所述接合工具,使檢查晶片載置於所述參照晶片之上;檢查圖像獲取處理,獲取使所述第一相機對載置所述檢查晶片後的所述載置面進行攝像所得的圖像作為檢查圖像;補正值算出處理,基於所述檢查圖像內的所述參照晶片與所述檢查晶片的位置偏差,算出相機偏移量的補正量作為區域補正量,所述相機偏移量為所述第一相機相對於所述接合工具的偏移量;以及記憶處理,將所算出的區域補正量、與所述任意的點的位置對應地記憶於記憶裝置。 [發明的效果]
根據本說明書所揭示的半導體裝置的製造裝置及製造方法,能以更簡易的順序進一步提高封裝半導體晶片時的位置精度。
以下,參照圖式對半導體裝置的製造裝置10的結構進行說明。圖1為表示製造裝置10的結構的示意圖。所述製造裝置10通過將多個半導體晶片110接合於基板100從而製造半導體裝置。
製造裝置10具有拾取單元12、接合頭14、平台16及控制器18。拾取單元12具有:上推銷20,將載置於切割帶(dicing tape)120的半導體晶片110上推;以及拾取頭22,以其底面保持經上推的半導體晶片110。拾取頭22以沿水平方向延伸的旋轉軸O為中心而可旋轉。拾取頭22可通過旋轉180度,從而使所拾取的半導體晶片110於厚度方向反轉180度。由此,半導體晶片110中接著於切割帶120的面朝向上方。
接合頭14藉由未圖示的XY驅動機構而於與平台16的上表面平行的水平方向移動。XY驅動機構包括驅動源(馬達等)、及檢測移動位置的感測器(例如編碼器等)。於所述接合頭14,設有吸附保持半導體晶片110的接合工具24。所述接合工具24藉由未圖示的Z軸驅動機構而於與水平方向正交的鉛垂方向可升降,並且以沿鉛垂方向延伸的軸A為中心而可旋轉。
另外,於接合頭14亦設有第一相機26。第一相機26以光軸朝向下方的姿勢安裝於接合頭14,對平台16的上表面或載置於該平台16的基板100的上表面(以下稱為「載置面」)進行攝像。接合工具24及第一相機26均固定於接合頭14,故而兩者與接合頭14一起移動。
再者,以下將第一相機26的光軸相對於接合工具24的中心軸的偏移量稱為「相機偏移量Ocm」。該相機偏移量Ocm的設計上的值作為基礎相機偏移量Ocm_b而預先記憶於控制器18的記憶體。然而,有時由於驅動系統的應變或溫度變化等,而於實際的相機偏移量Ocm與基礎相機偏移量Ocm_b之間產生稍許的誤差。因此,本例中,於半導體晶片110的接合處理之前,算出用以補正實際的相機偏移量Ocm與基礎相機偏移量Ocm_b的誤差的區域補正量C,關於這一情況將於後述。
平台16真空吸附並支持由未圖示的搬送機構所搬送的基板100。於平台16的附近,設有以光軸向上方延伸的姿勢配置的第二相機28。第二相機28對接合工具24的底面及由該接合工具24所保持的半導體晶片110進行攝像。
控制器18對製造裝置10的各部的驅動進行控制,例如具有執行各種運算的處理器、以及記憶各種程式及資料的記憶體。所述控制器18驅動拾取單元12及接合頭14,使多個半導體晶片110接合於基板100上。另外,控制器18為了提高接合的位置精度,而針對多個點Pi(i=1,2,…,imax)分別算出所述區域補正量C並記憶,關於這一情況將於後述。
繼而,參照圖2對將半導體晶片110接合於基板100上的目標位置時的流程進行說明。於將半導體晶片110接合於基板100時,控制器18首先驅動接合頭14及拾取單元12,使接合工具24的底面保持半導體晶片110(S10)。繼而,控制器18以接合工具24進入第二相機28的視場的方式使接合頭14移動後,利用第二相機28對保持有半導體晶片110的接合工具24的底面進行攝像(S12)。以下,將對所述接合工具24的底面進行攝像所得的圖像稱為「工具圖像40」。圖3為表示所述工具圖像40的一例的圖。
如圖3所示,於工具圖像40,拍攝有接合工具24的底面、及由該底面吸附保持的半導體晶片110。控制器18基於所述工具圖像40,算出半導體晶片110相對於X軸的傾斜,並以補正該傾斜的方式(即,以半導體晶片110的邊與X軸成平行的方式),使接合工具24繞軸A旋轉。另外,所得的工具圖像40暫時記憶於控制器18的記憶體。
若可獲得工具圖像40,則控制器18使接合頭14移動至基板100的上側(S14)。於該狀態下,控制器18驅動第一相機26,對載置面(即,基板100上表面)進行攝像(S16)。以下,將由該第一相機26所得的圖像稱為「載置面圖像42」。圖4為表示載置面圖像42的一例的圖。
若可獲得載置面圖像42,則控制器18基於所述載置面圖像42、工具圖像40、相機偏移量Ocm,算出半導體晶片110與目標位置Ptg的相對位置關係(S18)。
參照圖4對其計算原理進行說明。作為目標位置Ptg相對於半導體晶片110的中心Pcp的偏移量的最終偏移量Os成為Os=Ocp+Ocm+Otg。此處,Ocp為接合工具24的中心軸Ptl相對於半導體晶片110的中心Pcp的偏移量(以下稱為「晶片偏移量Ocp」)。該晶片偏移量Ocp可藉由分析工具圖像40從而算出。另外,Ocm為第一相機26的光軸Pcm相對於接合工具24的中心軸Ptl的偏移量、即相機偏移量Ocm。該相機偏移量Ocm可基於預先記憶的基礎相機偏移量Ocm_b及後述的區域補正量C而算出。
進而,Otg為目標位置Ptg相對於第一相機26的光軸Pcm的偏移量(以下稱為「目標偏移量Otg」)。該目標偏移量Otg可藉由分析載置面圖像42從而算出。即,如圖4所示,通常於基板100存在成為定位基準的基板側標記102。圖4的圖示例中,基板側標記102為十字狀的標記,設於基板100的四角附近。第一相機26以拍攝到所述基板側標記102般的視角對載置面進行攝像。因此,於載置面圖像42拍攝到基板側標記102。載置面圖像42內的目標位置Ptg可將該基板側標記102作為基準而確定。另外,載置面圖像42的中心位置可視為第一相機26的光軸位置Pcm。而且,目標偏移量Otg可根據載置面圖像42內的目標位置Ptg相對於載置面圖像42的中心位置(第一相機26的光軸位置Pcm)的偏移量而求出。
若可算出半導體晶片110的中心Pcp與目標位置Ptg的相對位置關係、即最終偏移量Os,則控制器18使接合頭14以該最終偏移量Os移動。藉此,由接合工具24所保持的半導體晶片110位於目標位置Ptg的正上方。若成為該狀態,則控制器18使接合工具24下降,使半導體晶片110接合於目標位置Ptg。
如由以上的說明所表明,本例中,於半導體晶片110的定位時,利用晶片偏移量Ocp、相機偏移量Ocm及目標偏移量Otg。換言之,為了將半導體晶片110準確地定位,需要晶片偏移量Ocp、相機偏移量Ocm及目標偏移量Otg各自的準確值。此處,晶片偏移量Ocp及目標偏移量Otg的準確值可根據工具圖像40及載置面圖像42而算出。
另一方面,相機偏移量Ocm無法根據工具圖像40及載置面圖像42來把握,需要預先記憶準確值。此處,如上文所述,於控制器18的記憶體,記憶有相機偏移量Ocm的設計上的值、即基礎相機偏移量Ocm_b。然而,有時由於接合頭14的驅動系統的應變等,而於實際的相機偏移量Ocm與基礎相機偏移量Ocm_b之間產生誤差(以下稱為「相機偏移誤差」)。
參照圖5對這一情況進行說明。圖5為表示產生相機偏移誤差的狀況的映像圖。有時接合頭14的驅動系統產生機械應變。例如,如圖5所示,有時引導接合頭14的X方向的移動的X導軌15x發生撓曲。於該情形時,視接合頭14的位置不同,有時第一相機26相對於接合工具24的相對位置變化,產生相機偏移誤差。另外,有時伴隨X導軌15x的撓曲,而第一相機26的光軸或接合工具24的中心軸傾斜。於該情形時,載置面圖像42內的、第一相機26的光軸相對於接合工具24的中心軸的相對位置變化,產生相機偏移誤差。此種相機偏移誤差視接合頭14的位置而不同。例如,上文所述的X導軌15x的撓曲量越接近該X導軌15x的中心則越容易變大,因而相機偏移誤差也是越接近X導軌15x的中心則越容易變大。
為了將半導體晶片110準確地定位,需要將視接合頭14的位置而不同的相機偏移誤差準確地補正。因此,本例中,於接合半導體晶片110之前,針對多個點Pi分別獲取用以補正所述相機偏移誤差的區域補正量C。以下,對該區域補正量C的獲取進行說明。
圖6為表示區域補正量C的獲取流程的流程圖。另外,圖7A~圖7C為表示區域補正量C的獲取流程的映像圖。圖6所示的處理於接合半導體晶片110之前進行。另外,於控制器18的記憶體,預先記憶有多個點Pi的座標值。該多個點Pi的個數或配置間隔、配置範圍等並無特別限定。例如,通常於一個基板100設定有多個目標位置,半導體晶片110封裝於該多個目標位置。多個點Pi亦可與該多個目標位置相同。
於獲取區域補正量C時,控制器18首先將參數i初始化,設為i=1(S30)。繼而,控制器18驅動拾取單元12及接合頭14,使接合工具24的前端保持檢查晶片130(S32)。此處,檢查晶片130只要可由接合工具24操作,則並無特別限定。因此,檢查晶片130例如亦可為實際接合的半導體晶片110。另外,檢查晶片130亦可為特別設置以用於算出區域補正量C的專用晶片。於該情形時,於檢查晶片130亦可標註有某些對準標記。
繼而,控制器18驅動接合頭14及第二相機28,獲取工具圖像40(S34)。具體而言,控制器18如圖7A所示,以接合工具24位於第二相機28的正上方的方式使接合頭14移動後,使第二相機28對接合工具24及其所保持的檢查晶片130進行攝像。於檢查晶片130相對於X軸傾斜的情形時,控制器18以消除該傾斜的方式使接合工具24繞軸A旋轉。另外,由該攝像所得的工具圖像40暫時記憶於控制器18的記憶體。
繼而,控制器18使接合頭14移動至點Pi(S36)。該移動可基於搭載於接合頭14的驅動系統的位置感測器(例如編碼器等)的偵測結果而控制。若到達點Pi,則控制器18如圖7B所示,使接合工具24下降,使檢查晶片130載置於載置面(S38)。此處,載置面如上文所述,可為平台16的上表面,亦可為載置於平台16的基板100的上表面。於任一情形時,於載置面均無需特殊的對準標記。換言之,本例的情形時,無須為了獲取區域補正量C而準備專用的基板100等。
若可將檢查晶片130載置於載置面,則控制器18如圖7C所示,驅動第一相機26,對載置面及載置於該載置面的檢查晶片130進行攝像(S40)。以下,將對該載置面及檢查晶片130進行攝像所得的圖像稱為「檢查圖像44」。
若獲得檢查圖像44,則控制器18基於該檢查圖像44及工具圖像40而算出區域補正量C(S42)。參照圖8對這一情況進行說明。圖8為檢查圖像44的局部放大圖。
本例中,基於檢查圖像44內的檢查晶片130的實際位置與理想位置的差量,來算出區域補正量C。此處,所謂檢查晶片130的理想位置,為相機偏移量Ocm與基礎相機偏移量Ocm_b相等的情形、換言之相機偏移誤差為零的情形時的、檢查晶片130於檢查圖像44內的位置。圖8中,以實線來圖示檢查晶片130的實際位置,以二點鏈線來圖示理想位置。
理想位置成為自檢查圖像44的中心(即,第一相機26的光軸)偏離L=Ocm_b+Ocp的位置。基礎相機偏移量Ocm_b如反覆說明般,預先記憶於記憶體。另外,晶片偏移量Ocp可根據工具圖像40而求出。
另外,檢查晶片130的實際位置可藉由對檢查圖像44進行圖像分析從而算出。例如,於在檢查晶片130標註有對準標記的情形時,只要使用圖案匹配(pattern matching)等技術來提取該對準標記,並確定所提取的對準標記於檢查圖像44內的座標即可。
若可分別算出檢查圖像44內的檢查晶片130的實際位置及理想位置,則控制器18算出兩者的差量,算出抵消該差量值的值作為區域補正量C。例如,如圖8所示,檢查晶片130的理想位置自實際位置偏離(-X1,-Y1)。於該情形時,控制器18算出抵消該偏離的值(X1,Y1)作為區域補正量C。於接合半導體晶片110時,只要將對基礎相機偏移量Ocm_b加上該區域補正量C所得的值用作相機偏移量Ocm即可。
若可算出區域補正量C,則控制器18將該區域補正量C與當前的點Pi的位置對應地記憶於記憶體(S44)。若可針對一個點Pi算出區域補正量C,則將參數i遞增後(S46),返回步驟S32。繼而,以同樣的順序算出新的點Pi的區域補正量C。再者,用於獲取新的點Pi的區域補正量C的檢查晶片130可為自拾取單元12新供給的晶片,亦可為已載置於載置面的檢查晶片130。因此,例如亦可針對多個點Pi分別逐一載置檢查晶片130。另外,作為另一形態,亦可將一個檢查晶片130依序載置於多個點Pi,並且依序獲取多個區域補正量C。總之,若可針對所有點Pi算出區域補正量C(即,若S46中成為是(Yes)),則處理結束。
此處,如由到此為止的說明所表明,區域補正量C所補正的誤差並非以載置面上的絕對位置為基準的誤差,而是第一相機26與接合工具24的相機偏移誤差。因此,本例中,即便於為了獲取區域補正量C而載置檢查晶片130的情形時,亦無須嚴格管理該檢查晶片130相對於載置面的相對位置。其結果為,無需用以進行檢查晶片130的定位的複雜順序,能以簡易的順序獲得區域補正量C。
另外,於算出該區域補正量C時,無須嚴格管理檢查晶片130相對於載置面的相對位置,因而無須於載置面標註有特殊的對準標記等。其結果為,無須準備用以算出補正量的特殊的載置面,可降低獲取補正量所需要的成本或工夫。進而,本例中,無須對接合工具24與載置面同時進行攝像,因而不需要昂貴的上下二視場的相機,可進一步降低成本。進而,本例中,藉由針對多個點Pi分別算出區域補正量C並記憶,從而亦可應對由位置所致的誤差,可進一步提高接合的位置精度。
繼而,參照圖9~圖13對區域補正量C的獲取順序的另一例進行說明。圖9、圖10為表示區域補正量C的另一獲取順序的流程圖。另外,圖11、圖12為表示按照圖9、圖10的流程圖的獲取順序的狀況的映像圖。本例中,為了獲取區域補正量C,除了檢查晶片130以外,使用參照晶片140。參照晶片140為較檢查晶片130先載置於載置面,用作檢查晶片130的定位目標的晶片。該參照晶片140的形狀或尺寸等並無特別限定。於該參照晶片140,亦可為了容易地藉由圖像分析來把握該參照晶片140的位置,而設有某些對準標記。
檢查晶片130載置於所述參照晶片140之上。該檢查晶片130的形狀或尺寸等亦無特別限定。然而,於在參照晶片140的表面標註有對準標記的情形時,檢查晶片130亦可為由透明材料、例如玻璃或聚碳酸酯、丙烯酸、聚酯、透明陶瓷等所構成的透明晶片。藉由設為該結構,從而即便於參照晶片140之上重疊檢查晶片130,亦可確認參照晶片140的對準標記。另外,亦可與參照晶片140同樣地,於檢查晶片130的表面亦設有某些對準標記。另外,檢查晶片130亦可為小於參照晶片140的尺寸。藉由設為該結構,即便於將檢查晶片130以相對於參照晶片140的位置偏離的狀態載置於參照晶片140之上的情形時,檢查晶片130亦不易自參照晶片140掉落。
於獲取區域補正量C的情形時,控制器18首先將參數i初始化,設為i=1(S50)。繼而,控制器18驅動接合頭14及拾取單元12,使接合工具24的前端保持參照晶片140(S52)。
繼而,控制器18驅動接合頭14及第二相機28,獲取工具圖像40(S54)。具體而言,控制器18如圖11A所示,以接合工具24位於第二相機28的正上方的方式使接合頭14移動後,使第二相機28對接合工具24及其所保持的參照晶片140進行攝像。控制器18基於所述工具圖像40,算出參照晶片140相對於X軸的傾斜,並以消除該傾斜的方式使接合工具24繞軸A旋轉。
繼而,控制器18使接合頭14移動至點Pi(S56)。該移動是基於搭載於接合頭14的驅動系統的位置感測器(例如編碼器等)的偵測結果而控制。若到達點Pi,則控制器18如圖11B所示,使接合工具24下降,使參照晶片140載置於載置面(S58)。此處,載置面可為平台16的上表面,亦可為載置於平台16的基板100的上表面。
若參照晶片140載置於載置面,則控制器18使接合工具24保持檢查晶片130(S60)。繼而,控制器18驅動接合頭14及第二相機28,獲取工具圖像40(S62)。即,控制器18如圖11C所示,以接合工具24位於第二相機28的正上方的方式使接合頭14移動後,使第二相機28對接合工具24及其所保持的檢查晶片130進行攝像。控制器18基於所述工具圖像40,算出檢查晶片130相對於X軸的傾斜,並以消除該傾斜的方式使接合工具24繞軸A旋轉。另外,控制器18將所述工具圖像40暫時記憶於記憶體。
繼而,控制器18使接合頭14移動至點Pi後(S64),如圖12A所示,使第一相機26對載置有參照晶片140的載置面進行攝像(S66)。以下,將對載置有該參照晶片140的載置面進行攝像所得的圖像稱為「參照圖像」。繼而,控制器18以由接合工具24所保持的檢查晶片130位於參照晶片140的正上方的方式,使接合頭14移動(S68)。即,控制器18基於參照圖像及步驟S62中獲取的工具圖像40,算出載置於載置面的參照晶片140、與接合工具24所保持的檢查晶片130的相對位置。該相對位置的算出順序除了使用基礎相機偏移量Ocm_b作為相機偏移量Ocm的方面以外,與參照圖5所說明的順序相同。即,控制器18基於工具圖像40,算出作為接合工具24相對於檢查晶片130的偏移量的晶片偏移量Ocp。另外,控制器18基於參照圖像,算出作為目標位置(即,參照晶片140)相對於第一相機26的光軸(即,參照圖像的中心)的偏移量的目標偏移量Otg。另外,控制器18算出將該所算出的晶片偏移量Ocp、目標偏移量Otg及基礎相機偏移量Ocm_b相加所得的值作為最終偏移量Os。於實際的相機偏移量Ocm與基礎相機偏移量Ocm_b相同的情形時,所算出的最終偏移量Os成為參照晶片140相對於檢查晶片130的偏移量。因此,於Ocm=Ocm_b的情形時,若使接合頭14以該最終偏移量Os移動,則使檢查晶片130位於參照晶片140的正上方。
若檢查晶片130位於參照晶片140的正上方,則控制器18如圖12B所示,驅動接合工具24,使檢查晶片130載置於參照晶片140之上(S70)。繼而,控制器18如圖12C所示,使第一相機26對載置面進行攝像,獲取檢查圖像44(S74)。
若可獲得檢查圖像44,則控制器18基於該檢查圖像44而算出區域補正量C(S76)。參照圖13對這一情況進行說明。圖13為表示檢查圖像44的一例的圖。該圖13中,參照晶片140以二點鏈線圖示,檢查晶片130以實線圖示。本例中,基於檢查圖像44內的檢查晶片130的位置與參照晶片140的位置的差量來算出區域補正量C。即,本例中,設Ocm=Ocm_b而將檢查晶片130相對於參照晶片140進行定位,並載置於參照晶片140之上。因此,於Ocm=Ocm_b的情形時,參照晶片140的中心Pr(空心的叉記號)與檢查晶片130的中心Pe(塗黑的叉記號)必定一致。反之,於Ocm≠Ocm_b而於兩者之間產生偏移誤差的情形時,檢查晶片130相對於參照晶片140以該偏移誤差而偏離。因此,若對檢查圖像44進行分析,提取檢查晶片130相對於參照晶片140的偏離量,則可獲得用以補正該偏離的區域補正量C。
圖13的示例中,檢查晶片130相對於參照晶片140而偏離(X1,-Y1)。因此,於該情形時,用以補正該偏離的區域補正量C成為(-X1,Y1)。
若可算出區域補正量C,則控制器18將該區域補正量C與點Pi的座標值對應地記憶於記憶體(S78)。若可針對一個點Pi算出區域補正量C,則將參數i遞增後(S82),回到步驟S52。繼而,以同樣的順序獲取新的點Pi的區域補正量C。再者,用於獲取新的點Pi的區域補正量C的參照晶片140及檢查晶片130可為自拾取單元12新供給的晶片,亦可為已載置於載置面的參照晶片140及檢查晶片130。若可針對所有點Pi獲取區域補正量C(即,若步驟S80中成為是(Yes)),則處理結束。
此處,如由到此為止的說明所表明,本例中,將較檢查晶片130先載置的參照晶片140用作檢查晶片130的載置目標位置。因此,無須於載置面標註有特殊的對準標記等。其結果為,無須準備用以算出補正量的特殊的載置面,可減少算出補正量所需要的成本或工夫。另外,本例中,將已載置於載置面的參照晶片140而非理論上的目標位置作為目標位置。因此,可更準確地算出相機偏移誤差及區域補正量C。
進而,本例中,無須對接合工具24與載置面同時進行攝像,因而不需要昂貴的上下二視場的相機,可進一步降低成本。進而,本例中,藉由針對多個點Pi算出區域補正量C並記憶,從而亦可應對由位置所致的誤差,亦可進一步提高接合的位置精度。
10:半導體裝置的製造裝置 12:拾取單元 14:接合頭 15x:X導軌 16:平台 18:控制器 20:上推銷 22:拾取頭 24:接合工具 26:第一相機 28:第二相機 40:工具圖像 42:載置面圖像 44:檢查圖像 100:基板 102:基板側標記 110:半導體晶片 120:切割帶 130:檢查晶片 140:參照晶片 A、X、Y、Z:軸 O:旋轉軸 Ocm:相機偏移量 Ocp:晶片偏移量 Os:最終偏移量 Otg:目標偏移量 Pcm:光軸位置 Pcp、Pe、Pr:中心 Ptg:目標位置 Ptl:中心軸 S10~S22、S30~S46、S50~S82:步驟 X1、Y1:值
圖1為表示製造裝置的結構的示意圖。 圖2為表示將半導體晶片接合於基板上的目標位置時的流程的流程圖。 圖3為表示工具圖像的一例的圖。 圖4為表示載置面圖像的一例的圖。 圖5為表示產生相機偏移誤差的狀況的映像圖。 圖6為表示區域補正量的獲取流程的流程圖。 圖7A為表示區域補正量的獲取流程的映像圖。 圖7B為表示區域補正量的獲取流程的映像圖。 圖7C為表示區域補正量的獲取流程的映像圖。 圖8為檢查圖像的局部放大圖。 圖9為表示區域補正量的另一獲取順序的流程圖。 圖10為表示區域補正量的另一獲取順序的流程圖。 圖11A為表示按照圖9、圖10的流程圖的獲取順序的狀況的映像圖。 圖11B為表示按照圖9、圖10的流程圖的獲取順序的狀況的映像圖。 圖11C為表示按照圖9、圖10的流程圖的獲取順序的狀況的映像圖。 圖12A為表示按照圖9、圖10的流程圖的獲取順序的狀況的映像圖。 圖12B為表示按照圖9、圖10的流程圖的獲取順序的狀況的映像圖。 圖12C為表示按照圖9、圖10的流程圖的獲取順序的狀況的映像圖。 圖13為表示檢查圖像的一例的圖。
10:半導體裝置的製造裝置
12:拾取單元
14:接合頭
16:平台
18:控制器
20:上推銷
22:拾取頭
24:接合工具
26:第一相機
28:第二相機
100:基板
110:半導體晶片
120:切割帶
A、X、Z:軸
O:旋轉軸

Claims (7)

  1. 一種半導體裝置的製造裝置,其特徵在於包括: 平台,載置基板; 接合頭,相對於所述平台而能夠相對地移動至任意的點; 位置檢測機構,檢測所述接合頭的位置; 接合工具,安裝於所述接合頭,保持晶片;以及 第一相機,安裝於所述接合頭,自上方對載置面進行攝像,所述載置面為所述平台上表面或載置於所述平台的基板上表面;以及 控制器,且 所述控制器以針對一個以上的點分別執行下述處理的方式構成: 載置處理,使所述接合頭移動至所述任意的點後,驅動所述接合工具,使所述晶片載置於所述載置面; 檢查圖像獲取處理,獲取使所述第一相機對載置所述晶片後的所述載置面進行攝像所得的圖像作為檢查圖像; 補正值算出處理,基於所述檢查圖像內的所述晶片的位置,算出相機偏移量的補正量作為區域補正量,所述相機偏移量為所述第一相機相對於所述接合工具的偏移量;以及 記憶處理,將所算出的區域補正量、與由所述位置檢測機構所檢測的所述任意的點的位置對應地記憶於記憶裝置。
  2. 如請求項1所述的半導體裝置的製造裝置,其中所述控制器於所述補正值算出處理中,基於所述檢查圖像內的晶片的實際位置、與根據設計上的所述相機偏移量而求出的所述檢查圖像內的所述晶片的理想位置的差量,來算出所述區域補正量。
  3. 如請求項2所述的半導體裝置的製造裝置,更包括: 第二相機,自下側對所述接合工具進行攝像, 所述控制器以於所述載置處理之前執行下述工具圖像獲取處理的方式構成:獲取使所述第二相機對由所述接合工具所保持的所述晶片進行攝像所得的圖像作為工具圖像, 所述控制器基於所述工具圖像而算出作為所述接合工具的中心相對於所述晶片的中心的偏移量的晶片偏移量,並基於所述晶片偏移量及設計上的所述相機偏移量,而算出所述檢查圖像內的所述晶片的理想位置。
  4. 如請求項1至請求項3中任一項所述的半導體裝置的製造裝置,其中所述控制器於執行所述載置處理後,不使所述接合頭水平移動,而執行所述檢查圖像獲取處理。
  5. 如請求項1至請求項4中任一項所述的半導體裝置的製造裝置,其中所述位置檢測機構包含:位置感測器,搭載於所述接合頭的驅動系統。
  6. 一種半導體裝置的製造方法,其特徵在於,針對一個以上的點分別執行下述步驟: 使安裝有接合工具及第一相機的接合頭移動至平台之上的任意的點; 將由所述接合工具所保持的晶片載置於載置面,所述載置面為所述平台的上表面或載置於所述平台的基板的上表面; 獲取使所述第一相機對載置所述晶片後的所述載置面進行攝像所得的圖像作為檢查圖像; 基於所述檢查圖像內的所述晶片的位置,算出相機偏移量的補正量作為區域補正量,所述相機偏移量為所述第一相機相對於所述接合工具的偏移量;以及 將所算出的區域補正量、與所述任意的點的位置對應地記憶於記憶裝置。
  7. 一種半導體裝置的製造裝置,其特徵在於包括: 平台,載置基板; 接合頭,相對於所述平台能夠相對地移動; 接合工具,安裝於所述接合頭,將晶片接合於所述基板; 第一相機,安裝於所述接合頭,自上方對載置面進行攝像,所述載置面為所述平台上表面或載置於所述平台的基板上表面;以及 控制器,且 所述控制器以針對一個以上的點分別執行下述處理的方式構成: 第一載置處理,使所述接合頭移動至任意的點後,驅動所述接合工具,使參照晶片載置於所述載置面; 參照圖像獲取處理,獲取使所述第一相機對載置所述參照晶片後的所述載置面進行攝像所得的圖像作為參照圖像; 第二載置處理,基於所述參照圖像以可將檢查晶片載置於所述參照晶片的正上方的方式將所述接合頭定位後,驅動所述接合工具,使檢查晶片載置於所述參照晶片之上; 檢查圖像獲取處理,獲取使所述第一相機對載置所述檢查晶片後的所述載置面進行攝像所得的圖像作為檢查圖像; 補正值算出處理,基於所述檢查圖像內的所述參照晶片與所述檢查晶片的位置偏離,算出相機偏移量的補正量作為區域補正量,所述相機偏移量為所述第一相機相對於所述接合工具的偏移量;以及 記憶處理,將所算出的區域補正量、與所述任意的點的位置對應地記憶於記憶裝置。
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Families Citing this family (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN114388418B (zh) * 2021-12-28 2022-12-13 凌波微步半导体设备(常熟)有限公司 一种半导体焊线机的闭环位置补偿方法及系统
CN114758969B (zh) * 2022-04-18 2023-09-12 无锡九霄科技有限公司 晶圆片背面视觉检测结构、检测方法和相关设备
CN116313859B (zh) * 2023-05-26 2023-09-15 青岛泰睿思微电子有限公司 悬臂产品的焊线方法

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP3125169B2 (ja) 1993-03-05 2001-01-15 日石三菱株式会社 液晶性ポリエステル
JP2004146776A (ja) 2002-08-29 2004-05-20 Shinko Electric Ind Co Ltd フリップチップ実装装置及びフリップチップ実装方法
JP4232511B2 (ja) * 2003-04-03 2009-03-04 日本電気株式会社 半導体製造装置
JP4264403B2 (ja) * 2004-10-18 2009-05-20 株式会社新川 ボンディング装置
JP2007115851A (ja) * 2005-10-19 2007-05-10 Toshiba Corp 半導体部品の位置検査方法、位置検査装置および半導体装置の製造方法
JP5277266B2 (ja) * 2011-02-18 2013-08-28 株式会社日立ハイテクインスツルメンツ ダイボンダ及び半導体製造方法
JP2015032613A (ja) * 2013-07-31 2015-02-16 凸版印刷株式会社 荷電ビーム描画装置用の照射位置補正装置、荷電ビーム照射位置の補正方法、フォトマスクの製造方法及び半導体装置
TWI567859B (zh) * 2014-02-10 2017-01-21 新川股份有限公司 安裝裝置及其偏移量修正方法
TWI545663B (zh) * 2014-05-07 2016-08-11 新川股份有限公司 接合裝置以及接合方法
CH711570B1 (de) * 2015-09-28 2019-02-15 Besi Switzerland Ag Vorrichtung für die Montage von Bauelementen auf einem Substrat.
JP6307730B1 (ja) * 2016-09-29 2018-04-11 株式会社新川 半導体装置の製造方法、及び実装装置

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