SU1322282A1 - Микропрограммное устройство управлени - Google Patents
Микропрограммное устройство управлени Download PDFInfo
- Publication number
- SU1322282A1 SU1322282A1 SU864043828A SU4043828A SU1322282A1 SU 1322282 A1 SU1322282 A1 SU 1322282A1 SU 864043828 A SU864043828 A SU 864043828A SU 4043828 A SU4043828 A SU 4043828A SU 1322282 A1 SU1322282 A1 SU 1322282A1
- Authority
- SU
- USSR - Soviet Union
- Prior art keywords
- input
- output
- register
- address
- field
- Prior art date
Links
Landscapes
- Executing Machine-Instructions (AREA)
Abstract
Изобретение относитс к вычислительной технике и автоматике и может быть использовано в ЭВМ и системах с микропрограммным управлением. Цель изобретени - расширение области применени за счет анализа логических условий, поступающих по второму входу логических условий устройства. Микропрограммное устройство управлени содержит блок 1 пам ти, регистры адреса 2, микроопераций 3, кода операций 4 и буферный 5, коммутатор 6 адреса, триггер 7 пуска, генератор 8 тактовых импульсов, два мультиплексора 9 и 10 логических условий, первый 1 1 и второй 12 элементы И. 2 ил. (Л f7
Description
Изобретение относитс к автоматике и вычислительной технике и может быть использовано в ЭВМ и вычислительных системах с микропрограммным управлершем.
Цель изобретени - расширение области применени за счет анализа логических условий, поступающих по второму входу логических условий устройства .
На фиг.1 приведена функциональна схема устройства; на фиг.2 - блок- схема алгоритма работы устройства.
Устройство содержит блок пам ти микропрограмм, содержащий поле 1( микроопераций, поле 1 кода логических условий, поле Ц модифицируемого разр да адреса, поле 1 немодифицируемых разр дов адреса, регистр 2 адреса , регистр 3 микроопераций с выхо дами конца команды 3, и конца работы 3 и выходом 3 микроопераций, регистр 4 кода команды с выходами пол адреса А, и пол адреса перехода, пол признака перехода и пол кода логических условий 4 , буферный регистр 5 с выходами пол 5, адреса перехода, пол 5 признака перехода и пол 5j кода логических условий, коммутатор 6 адреса, триггер 7 пуска генератор 8 тактовых импульсов с первым 8, и вторым 82 выходами, первый 9 и второй 10 мультиплексоры,элемент И 11, элемент И 12, выход 13 мультиплексора 9, вход 14 пуска устройства вход 15 кода команды, первьй вход 16 логических условий, второй вход 17 логических условий.
Микропрограм 1ное устройство управлени работает следующим образом.
В исходном состо нии все элементы пам ти устройства наход тс в нулевом состо нии за исключением разр да регистра 3 микроопераций, соответствующего выходу 3 конца команды регистра (цепи установки исходного состо ни устройства условно не показаны ) .
По сигналу Пуск с входа 14 устройства триггер 7 пуска устанавливаетс в единичное состо ние и включает генератор 8 тактовых импульсов. По заднему фронту первого иьтульса.с выхода 8, генератора 8, прошедшего через открытый элемент И 12, в регистр 4 запишетс информаци . Код операции с его выхода 4, поступит через коммутатор 6 адреса на вход ре
5
5
0
0
5
0
5
гистра 2 адреса, а альтернативный адрес ветвлени , метка ветвлени и код логических условий программы поступ т на вход буферного регистра 5.
Второй импульс с выхода 8 генератора 3 подтвердит исходное состо ние регистра 3 микроопераций. По заднему фронту следующего тактового импульса с выхода 8( генератора 8 код операции с выхода 4, регистра 4 запишетс в регистр 2 адреса, альтернативный адрес ветвлени , метка и код логических условий с выхода 4 регистра 4 запишутс в буферный регистр 5, а в регистр 4 запишутс очередной код операции, альтернативный адрес ветвлени , метка ветвлени и код логических условий программы.
Начальньй адрес (код операции) с выхода регистра 2 поступит на вход блока 1 пам ти и на его выходах по витс перва микрокоманда. По заднему фронту тактового импульса с выхода 8 генератора 8 операционна часть микрокоманды с выхода 1, блока 1 пам ти запишетс в регистр 3 микроопераций и на его выходе 3, конца команды пропадает единичный сигнал, который запретит прохождение тактовых импульсов через элемент И 12.
На вход регистра 2 адреса коммутатором 6 будет скоммутирован текущий адрес очередной микрокоманды, поступающий на его первый информационный вход (немодифицируемые разр ды адреса с выхода 1 блока 1 пам ти, а мо- дифии;:руемый разр д с выхода мультиплексора 9 логических условий). С выхода регистра 2 адрес очередной
микрокоманды поступит на вход блока 1 пам ти и т.д. В дальнейп ем устройство работает аналогично.
При записи в регистр 3 операционной части последней микрокоманды микропрограммы на его выходе 3. конца команды по витс единичный сигнал. Устройство закончило выполнение операции . Если после ее выполнени в программе нет ветвлени (условного
50 перехода), на что указывает нулевое значение метки, хран щейс в буферном регистре 5, коммутатор 6 коммутирует на вход регистра 2 адреса очередной код операции, записанный в ре55 гистре 4. Элемент И 12 открыт.
По следующему импульсу с выхода 8 генератора 8 в регистр 2 считываетс код операции с выхода 4 регистpa 4, a в регистр 5 - остальна информаци . После записи операционной части первой микрокоманды этой микропрограммы в регистр 3 на его выходе 3 конца команды по вл етс нулевой сигнал. Далее устройство работает ана.погично первому случаю.
Если после окончани операции (микропрограммы) в программе необходимо выполнить условный переход, то в этом случае значение сигнала метки равно единице. Так как значение сигнала на выходе 3, конца команды регистра 3 единичное, он разрешает работу мультиплексора 10 и на его выходе по витс провер емое логическое условие программы, в зависимости от значени которого коммутатор 6 будет передавать на вход регистра 2 адреса или адрес (текущий), записанный в поле адреса последней микрокома1щы микропрограммы , или альтернативный адрес ветвлени программы с выхода пол 5, буферного регистра 5.
По заднему фронту импульса с выхода 8, генератора 8 скоммутированный на вход регистра 2 адреса запишетс Б него и далее цикл работы устройства повторитс . Таким образом, осуществл етс условный переход (ветвле- ние) в программе на микропрограммном уровне.
При записи операционной части последней микрокоманды последней микропрограммы на выходе 3 конца работы регистра 3 по витс единичньш сигнал который выключит триггер 7 пуска, нулевой сигнал с выхода которого поступает на вход генератора 8 и формирование тактовых импульсов прекращает- с . Работа устройства заканчиваетс .
Claims (1)
- Формула изобретениМикропрограммное устройство управ- лени , содержащее блок пам ти микропрограмм , регистр адреса, регистр микроопераг;ий, коммутатор адреса, триггер пуска, генератор тактовых импульсов , первый мультиплексор логи- ческих условий, причем вход пуска устройства соединен с входом установки в 1 триггера пуска, выход которого соединен с входом пуска генератора тактовых импульсов, выход ком- мутатора адреса соединен с информа- входом регистра адреса, выход которого соединен с адресным входомблока пам ти микрогф11грамм, выхпд пол микрооперащп которого тсдннсн с информационным входом регистра микроопераций , выход которого соединен с выходом микроопераций устройства, выход пол модифицируемого разр да адреса блока пам ти микропрограмм соединен с первым информаиио 1ным входом первого мультиплексора логических условий, выход пол кода логических условий блока пам ти микропрограмм соединен с управл ющим входом мультиплексора логических условий, первый вход логических условий устройства соединен с вторым информационным входом первого мультиплексора логических услов{5й, пьгход которого и выход пол нe oдифициpye:I,rx разр дов адреса блока пам ти микропрограь м соединены с первым информационным входом коммутатора адреса, выход признака конца работы регистра микроопераций соединен с входом ки в О триггера пускл, первый и второй выходы генератора тактовых импульсов соединены с вxoдa И синхронизации соответственно регистра адреса и регистра микроопераций, о т - лич ающеес тем, что, с целью расщирени области применени за счет анализа логических условий, поступающих по второму входу логических условий устройства , устройство содержит регистр кода команд), буферный регистр, второй ryльтиплeк- сор логических условий, первьй и второй элементы И, причем вход кода команды устройства соединен с информационным входом регистра кода команды выход пол адреса которого соединен с вторым информационным входом коммутатора адреса, выход пол адреса перехода , пол признака перехода и пол кода логических условий регистра кода команды соединены с информационным входом буферного регистра, выход пол адреса перехода которого соединен с третьим информационным входом коммутатора адреса, выход пол кода логических условий буферного регист-- ра и второй вход логических условий устройства соединены соответственно с первым управл юштм и информационным входами второго мультиплексора логических условий, выход признака конца команды регистра микроопераций соединен с первым входом первого элемента И, с первым входом второго элеиента И и с вторым управл ющим входом второго мультиплексора логических условий , первый выход генератора тактовых импульсов соединен с вторым входом второго элемента И, выход которо- го соединен с входом синхронизации регистра кода команды и с входом синхронизации буферного регистра, выход пол признака перехода буферного регистра соединен с вторьм входом пер- вого элемента И, выход которого соединен с первым управл ющим входом коммутатора адреса, выход второгоКК- MHtu команды (быход 25 ЯСЗ). Kf - амви faSomu (бымд 26 ез), М-н9тк (пмл S.I KCS), /fy/MMA значение /тичесмю ислобив9 npoipttHHt (Оь.ход пик 10}, MtMt. ft.9l -код слебующеео адреса,дюрнирденый на дыходах 2 и /J.Фм. 2Редактор П.ГерещиСоставитель А.МихайловТехред Л.Олийнык Корректор Л.ПатайЗаказ 2865/45 Тираж 672ПодписноеВНИИПИ Государственного комитета СССРпо делам изобретений и открытий 113035, Москва, Ж-35, Раушска наб., д, А/5Производственно-полиграфическое предпри тие, г. Ужгород, ул. Проектна , 4.мультиплексора логических условий соединен с вторым управл ющим входом коммутатора адреса, выход признака конца команды регистра микроопераций соединен с третьим управл ющим входом коммутатора адреса, выход пол признака перехода буферного регистра соединен с четвертым и п тым управл ющими входами коммутатора адреса, выход второго мультиплексора логических условий соединен с шестым управл ющим входом коммутатора адреса,
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU864043828A SU1322282A1 (ru) | 1986-03-26 | 1986-03-26 | Микропрограммное устройство управлени |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU864043828A SU1322282A1 (ru) | 1986-03-26 | 1986-03-26 | Микропрограммное устройство управлени |
Publications (1)
Publication Number | Publication Date |
---|---|
SU1322282A1 true SU1322282A1 (ru) | 1987-07-07 |
Family
ID=21228921
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
SU864043828A SU1322282A1 (ru) | 1986-03-26 | 1986-03-26 | Микропрограммное устройство управлени |
Country Status (1)
Country | Link |
---|---|
SU (1) | SU1322282A1 (ru) |
-
1986
- 1986-03-26 SU SU864043828A patent/SU1322282A1/ru active
Non-Patent Citations (1)
Title |
---|
Авторское свидетельство СССР № 1007106, кл. G 06 F 9/22, 1981. Авторское свидетельство СССР 1140121, кл. G 06 F 9/22, 1983. * |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
SU1322282A1 (ru) | Микропрограммное устройство управлени | |
SU1280629A1 (ru) | Микропрограммное устройство управлени с контролем | |
SU1495789A1 (ru) | Микропрограммное устройство управлени | |
SU1649539A1 (ru) | Устройство микропрограммного управлени | |
SU1273939A1 (ru) | Микропроцессор | |
SU1179338A1 (ru) | Микропрограммное устройство управлени | |
SU1310817A1 (ru) | Микропрограммное устройство управлени | |
SU1305679A1 (ru) | Микропрограммное устройство управлени с контролем | |
SU1238071A1 (ru) | Микропрограммное устройство управлени | |
SU1203525A1 (ru) | Микропрограммное устройство управлени | |
SU1118992A1 (ru) | Устройство дл обмена информацией | |
SU1410039A1 (ru) | Устройство адресации пам ти | |
SU1365091A1 (ru) | Микропрограммный процессор | |
SU1256024A1 (ru) | Микропрограммное устройство дл тестового диагностировани и управлени | |
SU1280574A1 (ru) | Устройство дл программного управлени и контрол | |
SU1476465A1 (ru) | Микропрограммное устройство управлени | |
SU1327103A1 (ru) | Микропрограммное устройство управлени | |
SU1256025A1 (ru) | Мультимикропрограммное устройство управлени | |
SU1200294A1 (ru) | Процессор | |
SU1115054A1 (ru) | Микропрограммное устройство управлени | |
SU1290317A1 (ru) | Адаптивное устройство микропрограммного управлени | |
SU802963A1 (ru) | Микропрограммное устройство управле-Ни | |
SU1429114A1 (ru) | Микропрограммное устройство управлени | |
RU2013803C1 (ru) | Микропрограммное устройство управления | |
SU1481712A1 (ru) | Асинхронное устройство дл программного управлени |