KR980700731A - 평활하게 개시하는 고주파용 비교기(Comparator with smooth start-up for high frequencies) - Google Patents

평활하게 개시하는 고주파용 비교기(Comparator with smooth start-up for high frequencies)

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KR980700731A
KR980700731A KR1019970703955A KR19970703955A KR980700731A KR 980700731 A KR980700731 A KR 980700731A KR 1019970703955 A KR1019970703955 A KR 1019970703955A KR 19970703955 A KR19970703955 A KR 19970703955A KR 980700731 A KR980700731 A KR 980700731A
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파르보드 베바하니
알리 포토와트-아마디
나스롤라 에스. 나비드
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요토. 게. 아. 롤페즈
필립스 일렉트로닉스 엔. 브이.
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Abstract

비교기는 출력 트랜지스터(Q8, Q3)에 각각 접속된 두 차동 접속된 트랜지스터(Q1, Q2)에 의해 형성되는 입력에서 출력으로의 간단한 고주파 신호 경로를 갖는다. 전류 제어 회로는 차동 접속된 트랜지스터(Q1, Q2)를 통해 흐르는 일정한 전체 전류를 유지한다. 차동 접속된 트랜지스터(Q1, Q2)를 통해 흐르는 전류의 비는 제어회로(11, 12)에 의해 초기에 설정되어, 전원이 인가되는 경우 비교기의 출력이 예상가능하도록 한다. 그 다음 제어 회로는 점차적으로 제어를 해제해서, 기준 신호에 의해 비교기로의 입력을 제어하는 평활한 전송이 있게 된다.

Description

평활하게 개시하는 고주파용 비교기(Comparator with smooth start-up for high frequencies)
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제3도는 본 발명에 따른 비교기의 실시예의 단순화된 회로도.

Claims (12)

  1. 적어도 하나의 입력 신호를 수신하도록 접속되고 상기 적어도 하나의 입력 신호에 기초해서 적어도 하나의 출력 신호를 발생하는 비교 회로(Q1, Q2); 및 상기 비교 회로(Q1, Q2)에 접속되고 상기 비교기의 개시를 나타내는 적어도 하나의 개시 신호(X1)를 수신하고, 상기 비교 회로(Q1, Q2)를 제어해서 상기 개시 신호의 수신에 따라 선정된 값을 갖는 출력 신호를 발생하고 상기 비교 회로의 제어를 점차적으로 해제하는 제어 회로(10)를 포함하는 것을 특징으로 하는 비교기.
  2. 제1항에 있어서, 상기 제어 회로(10)를 상기 비교 회로(Q1, Q2)에 접속하고 상기 제어 회로(10)가 상기 비교 회로(Q1, Q2)의 제어를 완전히 해제한 경우 상기 비교 회로(Q1, Q2)를 통과하는 일정한 전체 전류를 유지하는 전류 제어 회로(11, 12)를 더 포함하는 것을 특징으로 하는 비교기.
  3. 제2항에 있어서, 적어도 하나의 출력 신호를 출력하는 적어도 하나의 출력 신호 라인(VOUT)을 더 포함하고, 상기 비교 회로는, 적어도 하나의 입력 신호에 포함된 제1 및 제2의 입력 신호를 수신하도록 접속된 베이스와, 상기 전류 제어 회로(11, 12)에 접속된 에미터, 및 컬렉터를 구비하는 한 쌍의 차동 접속된 트랜지스터(Q1, Q2); 및 상기 한 쌍의 차동 접속된 트랜지스터(Q1, Q2)의 컬렉터에 각각 접속된 베이스를 구비하는 한 쌍의 출력 트랜지스터(Q8, Q3) (상기 출력 트랜지스터(Q8, Q3)의 적어도 하나는 상기 적어도 하나의 출력 신호 라인에 접속된다)를 포함하는 것을 특징으로 하는 비교기.
  4. 제3항에 있어서, 상기 출력 트랜지스터(Q8, Q3)의 베이스는 상기 한 쌍의 차동 접속된 트랜지스터(Q1, Q2)의 컬렉터에 직접 접속되고 상기 출력 트랜지스터(Q8, Q3)의 적어도 하나는 상기 출력 신호 라인의 적어도 하나에 직접 접속되는 것을 특징으로 하는 비교기.
  5. 제4항에 있어서, 상기 출력 트랜지스터(Q8, Q3)는 에미터를 구비하고, 상기 출력 신호 라인의 적어도 하나는 각각 상기 출력 트랜지스터의 에미터에 직접적으로 접속된 두 출력 신호 라인을 포함하는 것을 특징으로 하는 비교기.
  6. 제2항에 있어서, 상기 입력 신호의 적어도 하나는 제1 및 제2의 입력 신호(V)와 적어도 하나의 기준 신호(V)를 포함하고, 상기 비교 회로는 상기 제1 및 제2의 입력 신호를 수신하도록 접속된 트랜지스터(Q1, Q2)와 상기 전류 제어 회로(I1,I2)에 접속된 에미터를 구비하는 제1의 쌍의 차동 접속된 트랜지스터(Q1, Q2)를 포함하고, 상기 전류 제어 회로는, 상기 제어 회로에 접속되, 각각 컬렉터, 베이스 및 에미터를 구비하며, 베이스의 적어도 하나는 적어도 하나의 기준 신호(V)를 수신하도록 접속되는 제2의 쌍의 차동 접속된 트랜지스터(Q13, Q12) ; 및 상기 비교 회로의 상기 제1의 쌍의 차동 접속된 트랜지스터(Q1, Q2)의 에미터에 각각 접속된 컬렉터와 사이 전류 제어 회로의 상기 제2의 쌍의 차동 접속된 트랜지스터의 컬렉터에 각각 접속된 베이스를 구비하는 한 쌍의 전류 제어 트랜지스터(Q21, Q22)를 포함하는 것을 특징으로 하는 비교기.
  7. 제6항에 있어서, 상기 제어 회로는 상기 전류 제어 회로의 상기 제 2의 쌍의 차동 접속된 트랜지스터(Q13, Q12)에 접속되고, 개신 신호(X1)의 수신에 따라 상기 제2의 쌍의 차동 접속된 트랜지스터(Q13, Q12) 주위에 분로 경로를 제공하는 분로 회로(shunt circuit; Q29, Q28)를 포함하는 것을 특징으로 하는 비교기.
  8. 제7항에 있어서, 상기 제1(Q1, Q2) 및 제2(Q13, Q12)의 쌍이 차동 접속된 트랜지스터와, 상기 전류 제어 트랜지스터(Q21, Q22), 및 상기 분로 회로(Q29, Q28)에 접속된 제1 및 제2의 전원 공급 라인을 더 포함하고, 상기 분로 회로는, 상기 제1의 전원 공급 라인(VCC)과 상기 전류 제어 회로의 상기 제2의 쌍의 차동 접속된 트랜지스터(Q13, Q12)의 컬렌터 사이에 각각 접속되고 베이스를 구비하는 한 쌍의 분로 트랜지스터(Q29, Q28)와; 상기 제1의 전원 공급 라인(VCC)과 상기 전류 제어 회로의 상기 제2의 쌍의 차동 접속된 트랜지스터(Q13, Q12)의 에미터 사이에 접속되고 베이스를 구비하는 한 쌍의 공급 트랜지스터(supply transistor; Q20, Q19)를 구비하고, 상기 전류 제어 회로는, 제3의 차동 접속된 트랜지스터 쌍(Q24, 25)를 형성하는 제1의 트랜지스터(Q24)와 제2의 트랜지스터(Q25) (제 1의 트랜지스터(Q24)는 상기 공급 트랜지스터(Q20, Q19)의 베이스와 상기 제2의 전원 공급 라인 사이에 접속되고 제2의 제어 트랜지스터(Q25)는 상기 분로 트랜지스터(Q29, Q28)의 베이스와 상기 제2의 전원공급 라인 사이에 접속된다); 및 상기 제1(VCC) 및 제2의 공급 라인 및 상기 제2의 차동 접속된 트랜지스터 쌍(Q24, Q25)에 접속되고 개시 신호를 수신하고, 상기 개시 신호의 수신에 따라 상기 공급 트랜지스터(Q20, Q19)를 오프시키고 상기 분로 트랜지스터(Q29, Q28)를 온 시키며 점차적으로 상기 분로 트랜지스터(Q29,Q28)를 오프시키고 상기 공급 트랜지스터(Q20, Q19)를 온 시키는 지연 회로(X1, C3)를 더 포함하는 것을 특징으로 하는 비교기.
  9. 제1항에 있어서, 상기 제어 회로(10)는 개시 신호를 수신하도록 접속되고 지연 주기가 종료할 때까지 개시 신호의 수신으로부터 적어도 하나의 제어 신호를 발생하는 지연 회로(C3, Q30, Q32); 및 상기 비교 회로(Q1, Q2) 및 상기 지연 회로에 접속되어 제어 신호가 발생되는 동안 출력 신호의 선정된 값을 유지하는 레벨 제어 회로(Q21, Q22, Q14, Q14, Q29, Q28, Q27)를 포함하는 것을 특징으로 하는 비교기.
  10. 제9항에 있어서, 상기 지연 회로는 개시 신호의 수신에 따라 제1의 제어 신호를 발생하고 지연 주기 후에 제2의 제어 신호를 발생하며, 상기 제어 회로는 상기 레벨 제어 회로에 접속되고 상기 지연 회로로부터 제1 및 제2의 제어 신호를 수신하도록 각각 접속된 제1 및 제2의 베이스를 구비하는 한 쌍의 차동 접속된 트랜지스터(Q24, Q25)를 더 포함하는 것을 특징으로 하는 비교기.
  11. 제10항에 있어서, 상기 지연 회로는 상기 차동 접속된 트랜지스터(Q24, Q25)의 베이스에 접속되고, 개시 신호의 수신 후에 제2의 제어 신호를 변화시키는 커패시터(C3)를 포함하는 것을 특징으로 하는 비교기.
  12. 제11항에 있어서, 상기 지연 회로는 개시 신호의 수신 후에 지연 신호를 수신하도록 더 접속되며, 상기 커패시터(C3)는 지연 신호의 수신에 따라 제2의 제어 신호를 변화시키는 것을 특징으로 하는 비교기.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019970703955A 1995-10-10 1996-10-03 평활하게 개시하는 고주파용 비교기(Comparator with smooth start-up for high frequencies) KR980700731A (ko)

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