KR960036046A - Ic 디바이스용 온도 보정 회로 및 그 보정 방법 - Google Patents
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Abstract
히타를 온했을 때의 발열의 격차가 원인이 되어, CLKA의 주파수의 차이에 의해서 발생하는 발열량의 차이를 히타를 오프하는 시간을 제어하는 것을 보정하고, 온도 지터를 억제하며, 지연회로에서 지연시킨 CLKA의 시간 정밀도를 향상된 IC 디바이스용 온도 보정 회로 및 그 보정 방법을 실현한다. 때문에, INA에 CLKA 가 입력되었을 때 히타(10)를 오프하고,셀렉터 회로(13)에 의해서 선택한 지연된 CLKA의 출력으로 히타(10)를 온하는 S/R FF(11)를 설치하며, INA와 OUTA와의 사이에 지연량이 같은 지연회로 1(21)~지연회로 n(2n)를 직렬로 접속하여 설치하고, 지연회로 1(21)~지연회로 n(2n)의 각지연회로의 출력을 입력으로 하며, SEL 신호로 1출력을 선택하여 출력하는 셀렉터 회로(13)를 설치한다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 온도 보정 회로의 블록도.
Claims (2)
- 입력단자(INA)에 입력신호(CLKA)가 입력되었을 때 히타(10)를 오프하며, 셀렉터 회로(13)에 의해서 선택 지연된 CLKA 신호의 출력으로 히타(10)를 온하는 S/R FF(11)와; 입력단자(INA)와 출력단자(OUTA)와의 사이에 지연량이 같으며 서로 직렬 접속되는 복수의 지연회로인 지연회로1(21)~지연회로 n(2n)와; 상기 지연회로 1(21)~지연회로 n(2n)의 각 지연회로의 출력을 입력으로 하여 SEL 신호로 1출력을 선택하여 출력하는 회로(13)를 구비하는 것을 특징으로 하는 IC 디바이스용 온도 보정 회로.
- 입력단자(INA)에 입력신호(CLKA)가 입력되었을 때 S/R FF(11)를 통하여 히타(10)를 오프하며; 입력단자(INA)와 출력단자(OUTA)와의 사이에 지연량이 같은 복수의 지연회로인 지연회로 1(21)~지연회로 n(2n)를 통하여 CLKA 신호를 전파하고; 상기 지연회로 1(21)~지연회로 n(2n)의 각각의 출력신호인 지연된 CLKA 신호를 셀렉터 회로(13)로 선택하며; 상기 셀렉터 회로(13)로 선택 지연된 CLKA 신호로 S/R FF(11)를 통하여 히타(10)를 온하는 것을 특징으로 하는 IC 디바이스용 온도 보정 방법.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP7070825A JPH08242154A (ja) | 1995-03-03 | 1995-03-03 | Icデバイス用温度補正回路及びその補正方法 |
JP95-70825 | 1995-03-03 |
Publications (2)
Publication Number | Publication Date |
---|---|
KR960036046A true KR960036046A (ko) | 1996-10-28 |
KR100219342B1 KR100219342B1 (ko) | 1999-09-01 |
Family
ID=13442753
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1019960000180A KR100219342B1 (ko) | 1995-03-03 | 1996-01-08 | 아이씨 디바이스용 온도 보정 회로 및 그 보정 방법 |
Country Status (3)
Country | Link |
---|---|
JP (1) | JPH08242154A (ko) |
KR (1) | KR100219342B1 (ko) |
TW (1) | TW346734B (ko) |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100627368B1 (ko) * | 2005-01-05 | 2006-09-22 | 삼성에스디아이 주식회사 | 클럭 지연 모듈, 지연 클럭 생성 방법 및 이를 이용한플라즈마 표시 장치 |
-
1995
- 1995-03-03 JP JP7070825A patent/JPH08242154A/ja not_active Withdrawn
- 1995-12-29 TW TW084114126A patent/TW346734B/zh not_active IP Right Cessation
-
1996
- 1996-01-08 KR KR1019960000180A patent/KR100219342B1/ko not_active IP Right Cessation
Also Published As
Publication number | Publication date |
---|---|
JPH08242154A (ja) | 1996-09-17 |
KR100219342B1 (ko) | 1999-09-01 |
TW346734B (en) | 1998-12-01 |
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