KR980006946A - 직병렬형 a/d변환기 - Google Patents
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Abstract
직병렬형 A/D 변환기의 정밀도 및 변환 속도를 향상시킨다. 기준 저항 소자(R0∼R63)는, 풀스케일 전압을 분압한다. 상위 3비트 비교기(2)는 상위 비트 참조 전압(Vr8,…Vr56)과 입력 전압 Vin을 비교하는 동시에, 그 비교 결과에 기초하여 입력 전압 Vin 부근의 전압을 포함하는 1개의 블록을 선택한다. 스위치군(S0∼S7)은 선택된 1개의 블록의 기준 저항 소자의 접속점의 각 전압을 하위 비트 참조 전압으로서 하위 참조 전압 라인(L0∼L8)으로 유도한다. 여기서, 블록 BL0이 선택된 경우에는 라인 L0에는 Vr0, 라인 L8에는 Vr8이 유도되고, 블록 BL1이 선택된 경우에는 라인 L0에는 Vr16, 라인 L8에는 Vr8이 유도되며, 라인 L8의 전압 변화는 없다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제 1도는 본 발명의 실시 형태에 관한 직병렬형 A/D 변환기의 구성을 나타내는 도면이다.
Claims (5)
- 입력 전압이 인가되는 입력 단자와, 제 1 및 제 2 단자의 사이에 인가되는 전압을 분압하고, 복수의 블록을 구성하는 직렬접속된 복수개의 기준 저항 소자와, 상기 복수개의 기준 저항 소자에 의해 분압된 전압 중 각 블록의 접속점의 상위 비트 참조 전압과 상기 입력 전압을 비교하는 동시에, 그 비교 결과에 기초하여 상기 입력 전압 부근의 전압을 포함하는 1개의 블록을 선택하는 상위 비트 비교기와, 상기 상위 비트 비교기에 의해 선택된 1개의 블록의 기준 저항 소자의 접속점의 전압을 하위 비트 참조 전압으로서 하위 참조 전압 라인으로 유도하는 스위치군과, 상기 하위 참조 전압 라인으로 유도된 하위 비트 참조 전압과 상기 입력 전압을 비교하는 하위 비트 비교기와, 상기 상위 비트 비교기의 비교 결과 및 상기 하위 비트 비교기의 비교 결과에 기초하여 디지탈 데이터를 생성하는 인코드 수단을 구비하며, 상기 상위 비트 비교기에 의해 선택된 1개의 블록의 기준 저항 소자의 접속점의 전압을 Vri+0,…Vri+j(단, Vri+0…Vri+j)로 하고, 상기 하위 참조 전압 라인을 L0,…Lj로 한 경우(i,j는 블록마다 다른 임의의 정수)에, 상기 스위치군은, 상기 상위 비트 비교기에 의해 선택되는 블록이 전환될 때마다, 상기 하위 참조 전압 라인에 이하의 전압a) L0=Vri+0,…Lj=Vri+jb) L0=Vri+j,…Lj=Vri+0을 교대로 유도하도록 구성되어 있는 것을 특징으로 하는 직병렬형 A/D 변환기.
- 제 1 항에 있어서, 상기 복수개의 기준 저항 소자는 행렬형으로 배치되고, 상기 복수개의 기준 저항 소자가 작성하는 라인은 상기 복수개의 기준 저항 소자의 열방향으로 신장하는 직사각형파형이 되고, 상기 상위 비트 비교기는 상기 복수개의 기준 저항 소자의 행방향의 단부에 배치되며, 상기 하위 비트 비교기는 상기 복수개의 기준 저항 소자의 열방향의 단부에 배치되고, 상기 하위 참조 전압 라인은 상기 복수개의 기준 저항 소자의 열방향으로 신장하고 있는 것을 특징으로 하는 직병렬형 A/D 변환기.
- 제 1 항에 있어서, 상기 인코드 수단은 상기 상위 비트 비교기측에 설치된 상위 비트 인코더와 상기 하위 비트 비교기측에 설치된 하위 비트 인코더를 가지고 있는 것을 특징으로 하는 직병렬형 A/D 변환기.
- 제 3 항에 있어서, 상기 하위 비트 인코더는 2개의 인코더를 가지고, 상기 상위 비트 비교기에 의해 선택되는 블록이 전환할 때마다 인코드 처리에 사용하는 해당 인코더도 전환하는 것을 특징으로 하는 직병렬형 A/D 변환기.
- 제 1 항에 있어서, 상기 디지탈 데이터가 n비트인 경우에, 상기 복수개의 기준 저항 소자는, 2n개 존재하는 것을 특징으로 하는 직병렬형 A/D 변환기.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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FR2720570B1 (fr) * | 1994-05-24 | 1996-08-02 | Thomson Consumer Electronics | Convertisseur A/N de deux signaux analogiques utilisant un seul module convertisseur. |
US5726653A (en) * | 1996-01-22 | 1998-03-10 | Industrial Technology Research Institute | Tri-step analog-to-digital converter |
US5745067A (en) * | 1996-07-17 | 1998-04-28 | Industrial Technology Research Institute | Two stage analoge-to-digital converter having unique fine encoding circuitry |
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