KR980006904A - 반도체장치의 클럭동기회로 - Google Patents

반도체장치의 클럭동기회로 Download PDF

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KR980006904A
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이종협
신광섭
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    • H03ELECTRONIC CIRCUITRY
    • H03KPULSE TECHNIQUE
    • H03K19/00Logic circuits, i.e. having at least two inputs acting on one output; Inverting circuits
    • H03K19/01Modifications for accelerating switching
    • H03K19/017Modifications for accelerating switching in field-effect transistor circuits
    • H03K19/01728Modifications for accelerating switching in field-effect transistor circuits in synchronous circuits, i.e. by using clock signals

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Abstract

본 발명은 입력신호를 클럭신호의 인에이블 시점에 동기시켜 출력이 결정되는 반도체장치의 클럭동기회로에 관한 것으로, 클럭신호가 인에이블되어 있는 동안에 입력신호가 변화하더라도 출력단에서는 입력신호의 신호레벨을 그대로 출력하게 클럭동기회로를 구성하여 종래와 같이 클럭신호가 디스에이블될 때까지 입력신호를 유지시킬 필요가 없으며, 동기제품의 설계시 일정한 폭의 클럭신호에 입력신호를 동기시키지 않고 클럭신호의 인에이블 시점에 입력신호를 동기시키게 되므로 상기 펄스폭만큼의 셋업 및 홀드시간을 개선시킬 수 있게 된다.

Description

반도체장치의 클럭동기회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제3도는 본 발명에 따른 클럭동기회로도이다.

Claims (3)

  1. 소오스가 공급전원에 접속되고 공통접속된 게이트가 클럭단과 연결된 제1 및 제2 트랜지스터, 상기 제1 트랜지스터의 드레인은 제2 트랜지스터의 드레인 및 MN2 트랜지스터의 게이트에 접속됨과 동시에 인버터를 통해 출력단에 접속되고, 상기 제4 트랜지스터의 드레인은 제4 트랜지스터의 드레인 및 제3 트랜지스터의 게이트에 접속되어 있으며, 상기 제3 트랜지스터의 소오스에 드레인이 접속되고 게이트가 입력단에 연결된 제5 트랜지스터와, 상기 제5 트랜지스터의 드레인에 공통접속되고 상기 출력단이 게이트에 접속된 제6 트랜지스터와, 제2 트랜지스터의 드레인출력이 인버터를 통해 게이트에 접속되고 드레인은 상기 제3 트랜지스터 소오스에 연결된 제7 트랜지스터와, 제7 트랜지스터의 드레인에 공통접속되고 입력단의 신호가 인버터를 통해 게이트에 접속된 제8 트랜지스터와, 제5 트랜지스터 와 제6 트랜지스터와 제7 트랜지스터와 제8 트랜지스터의 소오스가 공통접속되어서 드레인에 접속되고 상기 클럭단이 게이트에 접속되며 소오스는 접지된 제9 트랜지스터를 구비하여 이루어진 것을 특징으로 하는 반도체장치의 클럭동기회로.
  2. 제1항에 있어서, 상기 제1 및 제2 트랜지스터는 P형 반도체소자인 것을 특징으로 하는 반도체장치의 클럭동기회로.
  3. 제1항에 있어서, 상기 제1 내지 제7 트랜지스터는 N형 반도체소자인 것을 특징으로 하는 반도체장치의 클럭동기회로.
    ※참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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