KR970055504A - 고속 저잡음 출력 버퍼 - Google Patents

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Abstract

본 발명에서는 외부의 공급전압이 높은 전원전압하에서만 선택적으로 작동하는 검출기를 사용하여 출력버퍼 입력단의 입력전압 기울기값을 줄임으로써 출력버퍼의 출업 및 풀다운트랜지스터를 통한 전류의 피크치를 줄여 노이즈를 방지하며, 정격 이하의 전압하에서는 종래의 회로가 그대로 동작하도록 하여 스피드를 위주로 출력이 가능하게 설계된 출력버퍼에 관한 것이다.

Description

고속 저잡음 출력 버퍼
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도는 본 발명의 일실시예에 따른 출력버퍼.

Claims (9)

  1. 반도체 메모리 소자를 구성하는 센스 증폭기로부터의 출력 값을 각각 게이트 단으로 입력받아 출력단을 풀업시키는 풀업트랜지스터 및 상기 출력단을 풀다운 시키는 풀다운트랜지스터를 구비하는 반도체 메모리 소자의 출력버퍼에 있어서; 외부의 공급전원단으로부터 불안정한 높은 전압이 인가되며 상기 센스증폭기의 출력값이 논리레벨 하이에서 로우로 전환될시 상기 풀업트랜지스터의 게이트 단의 전압을 일시적으로 충전시켜 풀업트랜지스터의 게이트 단 전압 기울기를 줄이는 제1수단; 외부의 공급전원단으로부터 불안정한 높은 전압이 인가되며 상기 센스증폭기의 출력값이 논리레벨 로우에서 하이로 전환될시 상기 풀다운트랜지스터의 게이트 단의 전압을 일시적으로 방전시켜 풀다운트랜지스터의 게이트 단의 전압 기울기를 줄이는 제2수단; 상기 충전수단에 연결되어 외부의 공급전원단으로부터 안정된 낮은 전압이 인가될 시 상기 충전수단이 오프되는 소정전압을 상기 충전수단으로 출력하는 제1전압발생수단; 및 상기 방전수단에 연결되어 외부의 공급전원단으로부터 안정된 낮은 전압이 인가될시 상시 방전수단이 오프되는 소정전압을 상기 방전수단으로 출력하는 제2전압발생수단을 포함하는 것을 특징으로 하는 출력버퍼.
  2. 제1항에 있어서; 상기 제1수단은 상기 센스증폭기의 출력값이 논리레벨 하이에서 로우로 전환될시 이를 검출하여 소정 펄스를 상기 충전수단으로 출력하는 하이/로우 검출수단; 및 상기 공급전원단 및 상기 풀업트랜지스터의 게이트 단 사이에 직렬 연결된 제1피모스트랜지스터 및 제2피모스트랜지스터로 구성된 충전수단을 구비하는 것을 특징으로 하는 출력버퍼.
  3. 제1항에 있어서; 상기 제2수단은 상기 센스증폭기의 출력값이 논리레벨 하이에서 로우로 전환될시 이를 검출하여 소정 펄스를 상기 충전수단으로 출력하는 하이/로우 검출수단; 및 상기 풀다운트랜지스터의 게이트 단 및 접지전원단 사이에 직렬 연결된 제1엔모스트랜지스터 및 제2엔모스트랜지스터로 구성된 방전수단을 구비하는 것을 특징으로 하는 출력버퍼.
  4. 제2항에 있어서; 상기 제1전압발생수단은 상기 공급전원단과 상기 충전수단의 제2피모스트랜지스터의 게이트 사이에 채널이 형성되고, 게이트로 접지전원을 공급받는 제3피모스트랜지스터; 상기 충전수단의 제2피모스트랜지스터의 게이트와 접지전원단 사이에 직렬연결된 다수의 다오드형 엔모스트랜지스터를 구비하는 것을 특징으로 하는 출력버퍼.
  5. 제3항에 있어서; 상기 제2전압발생수단은 접지전원단과 상기 방전수단의 제2엔모스트랜지스터의 게이트 사이에 채널이 형성되고, 게이트로 공급전원을 공급받는 제3엔모스트랜지스터; 공급전원단과 상기 방전수단의 제2엔모스트랜지스터의 게이트 사이에 직렬연결된 다수의 다이오드형 엔모스트랜지스터를 구비하는 것을 특징으로 하는 출력버퍼.
  6. 제2항에 있어서; 상기 하이/로우검출수단은 상기 센스증폭기의 출력값이 노리레벨 하이에서 로우로 전환될시 상기 충전수단의 제1피모스트내지스터의 게이트 단으로 로우펄스를 발생하는 논리회로로 구성되는 것을 특징으로 하는 출력버퍼.
  7. 제3항에 있어서; 상기 로우/하이검출수단은 상기 센스증폭기의 출력값이 노리레벨 로우에서 하이로 전환될시 상기 충전수단의 제1엔모스트내지스터의 게이트 단으로 하이펄스를 발생하는 논리회로로 구성되는 것을 특징으로 하는 출력버퍼.
  8. 제6항에 있어서; 상기 하이/로우검출수단은 일입력단으로 상기 센스증폭기의 반전된 신호를 입력받으며, 타입력단으로 상기 센스증폭기의 지연된 신호를 입력받는 낸드(NAND) 게이트를 구비하는 것을 특징으로 하는 출력버퍼.
  9. 제7항에 있어서; 상기 로우/하이검출수단은 일입력단으로 상기 센스증폭기의 반전된 신호를 입력받으며, 타입력단으로 상기 센스증폭기의 지연된 신호를 입력받는 노아(NOR) 게이트를 구비하는 것을 특징으로 하는 출력버퍼.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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