KR970013045A - 반도체소자의 저장전극 형성방법 - Google Patents
반도체소자의 저장전극 형성방법 Download PDFInfo
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Abstract
본 발명은 반도체소자의 저장전극 형성방법에 관한 것으로, 하부구조물이 형성된 반도체기판 상부에 제1절연막, 제2절연막 및 제3절연막을 형성하고 감광막패턴을 이용한 식각공정으로 제3절연막을 식각한 다음, 상기 제3절연막 식각면에 티타늄질화막 스페이서를 형성하고 상기 티타늄질화막 스페이서를 마스크로하여 식각선택비 차이를 이용한 식각공정으로 콘택홀을 형성한 다음, 상기 티타늄질화막 스페이서를 제거하고 전체표면상부에 제1도전층과 PSG막을 형성한 다음, 저장전극마스크를 이용한 식각공정으로 상기 PSG 막과 제1도전층을 식각하고 제2도전층 스페이서를 형성한 다음, 상기 PSG막을 제거하여 포면적이 증가된 저장전극을 형성함으로써 반도체소자의 특성 및 신뢰성을 향상시키며 반도체소자의 고집적화를 가능하게 하는 기술이다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1A도 내지 제1H도는 본 발명에 의한 따른 반도체소자의 저장전극 형성방법에 설명하기 위한 단면도.
Claims (7)
- 반도체기판 상부에 하부구조물을 형성하는 공정과, 전체표면상부에 제1절연막을 형성하는 공정과, 상기 제1절연막 상부에 제2절연막과 제3절연막을 순차적으로 형성하는 공정과, 상기 제3절연막 상부에 감광막패턴을 형성하는 공정과, 상기 감광막패턴을 마스크로하여 상기 제3절연막을 식각하는 공정과, 상기 제3절연막 식각면에 티타늄질화막 스페이서를 형성하는 공정과, 상기 티타늄질화막 스페이서를 마스크로하여 상기 콘택홀을 형성하는 동시에 상기 제1절연막 상부에 제2, 3절연막을 식각하는 공정과 상기 티타늄질막 스페이서를 제거하는 공정과, 전체표면상부에 제1도전층과 PSG막을 순타적으로 형성하는 공정과, 저장전극마스크를 이용한 식각공정으로 상기 PSG 막과 제1도전층을 식각하는 공정과, 상기 PSG 막과 제1도전층의 식각면에 제2도전층 스페이서를 형성하는 공정과, 상기 PSG 막을 제거하는 공정을 포함하는 반도체소자의 저장전극 형성방법.
- 제1항에 있어서, 상기 제1, 3절연막은 BPSG 산화막으로 형성되는 것을 특징으로 하는 반도체소자의 저장전극 형성방법.
- 제1항에 있어서, 상기 제2절연막은 TEOS 산화막으로 형성되는 것을 특징으로 하는 반도체소자의 저장전극 형성방법.
- 제1항에 있어서, 상기 티타늄질화막 스페이서는 130℃에서 H2SO4: H2O2를 3 : 1로 하는 혼합용액으로 식각되는 것을 특징으로 하는 반도체소자의 저장전극 형성방법.
- 제1항에 있어서, 상기 티타늄질화막 스페이서는 티타늄 실리사이드로 형성되는 것을 특징으로 하는 반도체소자의 저장전극 형성방법.
- 제5항에 있어서, 상기 티타늄질화막 스페이서 제거공정은 100 : 1의 HF 용액으로 실시되는 것을 특징으로 하는 반도체소자의 저장전극 형성방법.
- 제1항에 있어서, 상기 PSG 막은 8wt% 농도의 P2O5로 형성되는 것을 특징으로 하는 반도체소자의 저장전극 형성방법.
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KR1019950026727A KR970013045A (ko) | 1995-08-26 | 1995-08-26 | 반도체소자의 저장전극 형성방법 |
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KR (1) | KR970013045A (ko) |
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1995
- 1995-08-26 KR KR1019950026727A patent/KR970013045A/ko not_active Application Discontinuation
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