KR970013022A - 반도체장치의 콘택홀 형성방법 - Google Patents

반도체장치의 콘택홀 형성방법 Download PDF

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KR970013022A
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    • H01L21/311Etching the insulating layers by chemical or physical means
    • H01L21/31144Etching the insulating layers by chemical or physical means using masks

Abstract

본 발명은 반도체장치의 콘택홀 형성방법에 관한 것으로, 하지층의 손상을 최소화하기 위한 것이다. 본 발명은 기판상에 절연층에 형성하는 공정과, 상기 절연층을 소정두께만큼 남기고 선택적으로 소정깊이 식각하여 콘택홀을 형성하는 공정, 상기 콘택홀 측벽에 상기 절연층과의 식각선택비가 높은 절연물질로 된 스페이서를 형성한는 공정, 및 상기 스페이서와 절연층과의 높은 식각선택비를 이용하여 상기 남아 있는 절연층을 식각하여 최종적인 콘택홀을 형성하는 공정을 포함하여 이루어지는 반도체장치의 콘택홀 형성방법을 제공한다.

Description

반도체장치의 콘택홀 형성방법
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도는 본 발명에 의한 콘택홀 형성방법을 도시한 공정순서도.

Claims (6)

  1. 기판상에 절연층을 형성하는 공정과,
    상기 절연층을 소정두께만큼 남기고 선택적으로 소정깊이 식각하여 콘택홀을 형성하는 공정,
    상기 콘택홀 측벽에 상기 절연층과의 식각선택비가 높은 절연물질로 된 스페이서를 형성하는 공정, 및
    상기스페이서와 절연층과의 높은 식각선택비를 이용하여 상기 남아 있는 절연층을 식각하여 최종적인 콘택홀을 형성하는 공정을 포함하는 것을 특징으로 하는 반도체장치의 콘택홀 형성방법.
  2. 기판상에 제1절연층과 상기 제1절연층과의 식각선택비가 높은 제2절연층을 차례로 형성하는 공정과,
    상기 제2절연층상에 포토레지스트를 도포하는 공정,
    상기 포토레지스트를 소정의 콘택홀 패턴으로 패터닝하는 공정,
    상기 포토레지스트패턴을 마스크로하여 상기 제1절연층을 소정두께만큼 남기고 상기 제2절연층 및 제1절연층을 식각하여 콘택홀을 형성하는 공정,
    상기 포토제지스트패턴을 제거하는 공정,
    상기 콘택홀 측벽에 상기 제1절연층과의 식각선택비가 높은 절연물질로 된 스페이서를 형성하는 공정,
    상기 제2절연막 및 스페이서를 마스크로하여 상기 남아 있는 제1절연층을 식각하여 최종콘택홀을 형성하는 공정으로 이루어지는 것을 특징으로 하는 반도체장치의 콘택홀 형성방법.
  3. 제2항에 있어서, 상기 남아 있는 제1절연층을 식각하는 공정은 상기 제1절연층과 상기 제2절연층 및 스페이서와의 높은 식각선택비를 이용하여 행하는 것을 특징으로 하는 반도체장치의 콘택홀 형성방법.
  4. 제2항에 있어서, 상기 남아 있는 제1절연층을 식각하는 공정은 ICP방식을 이용한 고밀도 플라즈마 식각장비를 이용하여 행하는 것을 특징으로 하는 반도체장치의 콘택홀 형성방법.
  5. 제4항에 있어서, 식가가스로 C2F6,C3F8,C4F8중에서 선택한 어느 하나를 사용하고, 소오스 파워;1800-3000W, 하부(bottom) 파워;700-1500W의 식각조건으로 식각을 행하는 것을 특징으로 하는 반도체장치의 콘택홀 형성방법.
  6. 제2항에 있어서, 상기 제1절연층을 산화막이고, 제2절연층은 질화막임을 특징으로 하는 반도체장치의 콘택홀 형성방법.
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Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100648634B1 (ko) * 2005-01-21 2006-11-23 삼성전자주식회사 반도체 장치의 제조 방법
KR100759256B1 (ko) * 2001-06-30 2007-09-17 매그나칩 반도체 유한회사 감광막 스페이서를 이용한 듀얼 다마신 패턴 형성방법
KR100772077B1 (ko) * 2001-12-28 2007-11-01 매그나칩 반도체 유한회사 반도체 소자의 콘택홀 형성방법

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Publication number Priority date Publication date Assignee Title
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KR100648634B1 (ko) * 2005-01-21 2006-11-23 삼성전자주식회사 반도체 장치의 제조 방법

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