KR960019793A - 반도체 트렌지스터의 레이아웃과 그에 따른 반도체 트렌지스터소자 - Google Patents

반도체 트렌지스터의 레이아웃과 그에 따른 반도체 트렌지스터소자 Download PDF

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KR960019793A
KR960019793A KR1019940030996A KR19940030996A KR960019793A KR 960019793 A KR960019793 A KR 960019793A KR 1019940030996 A KR1019940030996 A KR 1019940030996A KR 19940030996 A KR19940030996 A KR 19940030996A KR 960019793 A KR960019793 A KR 960019793A
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KR
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semiconductor transistor
drain region
region
transistor device
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KR1019940030996A
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Inventor
심재광
Original Assignee
문정환
금성일렉트론 주식회사
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  • Insulated Gate Type Field-Effect Transistor (AREA)

Abstract

본 발명에 의한 반도체 트렌지스터 소자의 레이아웃은 판상에 제1패턴을 레이아웃하는 단계와, 제1패턴을 두개의 영역으로 분할하는 제2패턴을 형성하되, 제1패턴의 경계부위에서는 제2패턴의 길이가 더 길게 레이아웃하는 단계를 포함하여 이루어지며, 그에 따라 제조될 트랜지스터 소자에서 소자형성부위에서 소오스영역과 드레인영역으로 양분하는 게이트전극은 소오스영역과 드레인영역이 서로 마주보는 거리인 채널길이가 중앙부분에는 일정하고 양측 단부에서는 중앙부분보다 더 길게 형성되고, 또한 게이트전극도 이 채널길이를 덮도록 중앙보다 끝부분이 넓게 형성된다.

Description

반도체 트렌지스터의 레이아웃과 그에 따른 반도체 트렌지스터소자
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도는 본 발명에 의한 반도체 트랜지스터의 레이아웃과 그에 따른 트렌지스터소자를 설명하기 위한 도면으로,
제2도의 (가)는 본 발명에 의한 반도체 트랜지스터의 레이아웃을 도시한 도면,
제2도의 (나)는 제2도의 (가)의 등가적 회로도를 도시한 도면,
제2도의 (다)는 본 발명에 의한 반도체 트랜지스터의 레이아웃방법으로 제조된 게이트전극을 도시한 평면도.

Claims (3)

  1. 반도체 트렌지스터 소자의 레이아웃 방법에 있어서, 1) 기판상에 제1패턴을 레이아웃하는 단계와, 2) 상기 제1패턴을 두개의 영역으로 분할하는 제2패턴을 형성하되, 제1패턴의 경계부위에서는 제2패턴의 길이가 더 길게 레이아웃하는 단계를 포함하여 이루어진 반도체 트랜지스터의 레이아웃 방법.
  2. 제1항에 있어서, 상기 제1패턴은 트렌지스터 격리층인 필드산화막 사이의 소자형성부위의 패턴이고, 상기 제2패턴은 게이트의 패턴인 것을 특징으로 하는 반도체 트랜지스터의 레이아웃 방법.
  3. 소오스영역, 드레인 영역, 및 게이트 전극을 가지는 반도체 트렌지스터 소자에 있어서, 상기 소오스영역과 드레인 영역이 서로 마주보는 거리인 채널길이가 상기 소오스영역과 드레인 영역의 중앙부분에는 일정하고 양측 단부에서는 중앙부분보다 더 길게 형성되고, 또한 게이트 전극도 이 채널길이를 덮도록 중앙보다 끝부분이 넓게 형성된 것이 특징인 반도체 트렌지스터소자.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019940030996A 1994-11-24 1994-11-24 반도체 트렌지스터의 레이아웃과 그에 따른 반도체 트렌지스터소자 KR960019793A (ko)

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