KR960019597A - 반도체 장치의 소오스 드레인 형성방법 - Google Patents
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- 238000000034 method Methods 0.000 title claims abstract description 13
- 239000004065 semiconductor Substances 0.000 title claims abstract 6
- 230000015572 biosynthetic process Effects 0.000 title claims 2
- 150000002500 ions Chemical class 0.000 claims abstract 4
- 238000005468 ion implantation Methods 0.000 claims abstract 3
- 125000006850 spacer group Chemical group 0.000 claims abstract 2
- 239000000758 substrate Substances 0.000 claims 3
- 239000012535 impurity Substances 0.000 claims 2
- ZOXJGFHDIHLPTG-UHFFFAOYSA-N Boron Chemical group [B] ZOXJGFHDIHLPTG-UHFFFAOYSA-N 0.000 claims 1
- -1 LDD ions Chemical class 0.000 claims 1
- 238000000137 annealing Methods 0.000 claims 1
- 229910052796 boron Inorganic materials 0.000 claims 1
- 230000007547 defect Effects 0.000 claims 1
- 239000002019 doping agent Substances 0.000 claims 1
- 229920002120 photoresistant polymer Polymers 0.000 claims 1
- 230000001681 protective effect Effects 0.000 claims 1
- 239000000969 carrier Substances 0.000 abstract 1
- 238000004519 manufacturing process Methods 0.000 abstract 1
- 238000004904 shortening Methods 0.000 abstract 1
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- H01L29/66568—Lateral single gate silicon transistors
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- H01L29/76—Unipolar devices, e.g. field effect transistors
- H01L29/772—Field effect transistors
- H01L29/78—Field effect transistors with field effect produced by an insulated gate
- H01L29/7833—Field effect transistors with field effect produced by an insulated gate with lightly doped drain or source extension, e.g. LDD MOSFET's; DDD MOSFET's
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Abstract
본 발명은 반도체 장치에서 채널 길이가 감소함에 따르는 핫 캐리어를 방지하기 위한 LDD 구조를 갖는 소오스 드레인 형성방법에 관한 것으로, 게이트 양측의 소오스 및 드레인 영역에 고농도 도핑을 먼저 실시한 후, 고농도의 이온이 주입된 소오스 및 드레인 영역의 일부를 노출시켜 이 노출부에 LDD 이온주입을 수행하는 순서로 진행하여, 종래와 같은 게이트 측벽 스페이서 형성공정을 배제하는 등 그 공정을 간소화하고, 제조공정 시간을 단축할 수 있는 등의 효과가 있다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제5도 내지 제8도는 본 발명에 따른 LDD 구조의 소오스 드레인 형성방법을 설명하기 위한 공정도.
Claims (6)
- 웨이퍼 기판에 게이트 전극을 형성하여 소오스 및 드레인 영역을 설정하는 단계; 상기 소오스 및 드레인 영역 전체에 걸쳐 n형의 고농도 이온을 주입하는 단계; 상기 n형의 고농도 이온이 주입된 소오스 드레인 영역 중에서 게이트에 인접한 부분만을 노출시키는 단계; 상기 게이트 양측에 인접한 노출부에 LDD 이온을 주입하는 단계, 및 표면의 결함 방지 및 주입된 이온들의 특성을 향상시키기 위한 어닐링 단계로 이루어지는 반도체 장치의 소오스 드레인 형성방법.
- 제1항에 있어서, 상기 게이트 전극을 형성하는 단계와, 상기의 n형의 고농도 이온주입 단계 사이에 기판 보호를 위한 보호막의 일종인 쉐도우 산화막을 도포하는 단계를 포함하는 것을 특징으로 하는 반도체 장치의 소오스 드레인 형성방법.
- 제1항 또는 제2항에 있어서, 상기 노출단계는 웨이퍼 기판의 전면에 포토 레지스트를 도포한 후, 게이트 전극의 크기보다 큰 개구부를 갖는 마스크를 이용하여 노광 및 현상 공정을 진행함으로써, 게이트 전극이 측벽으로부터 일정거리까지의 부부을 노출시키는 것을 특징으로 하는 반도체 장치의 소오스 드레인 형성방법.
- 제1항 또는 제2항에 있어서, 상기 LDD 이온주입의 도펀트는 P형 불순물인 것을 특징으로 하는 반도체 장치의 소오스 드레인 형성방법.
- 제4항에 있어서, 상기 P형 불순물을 붕소인 것을 특징으로 하는 반도체 장치의 소오스 드레인 형성방법.
- 제3항에 있어서, 개구부의 크기는 게이트 전극의 측벽 스페이서로부터 반도체 소자 특성에 따라 0.2 내지 0.5㎛인 것을 특징으로 하는 반도체 장치의 소오스 드레인 형성방법.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019940030522A KR0137824B1 (ko) | 1994-11-19 | 1994-11-19 | 반도체 장치의 소오스 드레인 형성방법 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019940030522A KR0137824B1 (ko) | 1994-11-19 | 1994-11-19 | 반도체 장치의 소오스 드레인 형성방법 |
Publications (2)
Publication Number | Publication Date |
---|---|
KR960019597A true KR960019597A (ko) | 1996-06-17 |
KR0137824B1 KR0137824B1 (ko) | 1998-06-01 |
Family
ID=19398431
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1019940030522A KR0137824B1 (ko) | 1994-11-19 | 1994-11-19 | 반도체 장치의 소오스 드레인 형성방법 |
Country Status (1)
Country | Link |
---|---|
KR (1) | KR0137824B1 (ko) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100770809B1 (ko) * | 1997-12-26 | 2007-12-14 | 가부시키가이샤 히타치세이사쿠쇼 | 레벨변환회로및레벨변환회로를사용한반도체집적회로장치 |
-
1994
- 1994-11-19 KR KR1019940030522A patent/KR0137824B1/ko not_active IP Right Cessation
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Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100770809B1 (ko) * | 1997-12-26 | 2007-12-14 | 가부시키가이샤 히타치세이사쿠쇼 | 레벨변환회로및레벨변환회로를사용한반도체집적회로장치 |
Also Published As
Publication number | Publication date |
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KR0137824B1 (ko) | 1998-06-01 |
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