KR960015813A - 모스펫 형성방법 - Google Patents
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- 238000000034 method Methods 0.000 title claims abstract description 10
- 230000015572 biosynthetic process Effects 0.000 title 1
- 239000012535 impurity Substances 0.000 claims abstract 12
- 239000004065 semiconductor Substances 0.000 claims abstract 12
- 239000000758 substrate Substances 0.000 claims abstract 10
- 229910021420 polycrystalline silicon Inorganic materials 0.000 claims abstract 8
- 238000009792 diffusion process Methods 0.000 claims 6
- 229920002120 photoresistant polymer Polymers 0.000 claims 6
- 238000005530 etching Methods 0.000 claims 3
- 125000006850 spacer group Chemical group 0.000 claims 2
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 claims 1
- 238000005468 ion implantation Methods 0.000 claims 1
- 229920005591 polysilicon Polymers 0.000 claims 1
- 229910052710 silicon Inorganic materials 0.000 claims 1
- 239000010703 silicon Substances 0.000 claims 1
- 230000010354 integration Effects 0.000 abstract 1
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- H01L21/8232—Field-effect technology
- H01L21/8234—MIS technology, i.e. integration processes of field effect transistors of the conductor-insulator-semiconductor type
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- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/66007—Multistep manufacturing processes
- H01L29/66075—Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials
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- H01L29/66409—Unipolar field-effect transistors
- H01L29/66477—Unipolar field-effect transistors with an insulated gate, i.e. MISFET
- H01L29/66568—Lateral single gate silicon transistors
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- H01L29/66621—Lateral single gate silicon transistors with a gate recessing step, e.g. using local oxidation using etching to form a recess at the gate location
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Abstract
본 발명은 모스펫 형성방법에 관한 것으로, 반도체기판의 활성영역 상부에 트렌치를 형성하고 트랜치가 형성된 부분과 트렌치가 형성되지 않은 부분에 게이트전극을 형성하고 불순물을 이온주입시겨 모스펫을 형성하거나, 트랜치를 형성한 다음, 트랜치의 표면을 게이트산화막으로 형성하고 트렌치의 내부는 게이트전극용 다결정 실리콘막으로 형성한 다음, 불순물을 이온주입하여 모스펫을 형성함으로써 반도체소자가 고집적화됨에 따른 쇼트 채널의 문제점을 방지하여 반도체소자의 특성을 향상시켜 반도체소자의 신뢰성을 향상시킬 수 있는 기술이다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1A도 내지 제1C도는 본 발명의 제1실시예에 따른 모스펫 형성공정도,
제2A도 내지 제2F도는 본 발명의 제2실시예에 따른 모스펫 형성공정도.
Claims (8)
- 반도체기판 활성영역에 트렌치를 형성하고 상기 트렌치 상부에 게이트전극을 형성한 다음, 상기 트렌치 양측의 반도체기판에 불순물 확산영역을 형성하는 모스펫 형성방법.
- 반도체기판 활성영역 일정부분에 일정깊이 트렌치를 형성하는 공정과, 전표면상부에 게이트산화막을 일정두께 형성하는 공정과, 상기 게이트산화막 상부에 제이트전극용 다결정실리콘막을 일정두께 형성하는 공정과, 상기 케이트전극용 다진정실리콘막 상부에 게이트전극을 형성하기 위한 감광막패턴을 형성하는 공정과, 상기 감광막패턴을 마스크로하여 상기 게이트전극용 다결정실리콘막과 케이트산화막을 순차적으로 식각하여 게이트전극과 게이트산화막패틴을 형성하는 공정과, 상기 감광막패턴을 제거하는 공정과, 상기 게이트전극과 게이트산화막패턴을 마스크로하여 상기 반도체기판에 저농도의 불순물을 이온주입함으로써 저농도의 불순물 확산영역을 형성하는 공정과, 상기 게이트전극 측벽에 절연막 스페이서를 형성하는 공정과, 상기 게이트전극과 절연막 스페이서를 마스크로하여 상기 반도체기판에 고농도의 불순물을 이온주입함으로써 고농도의 불순물 확산영역을 형성하는 공정을 포함하는 모스펫 형성방법.
- 제2항에 있어서, 상기 트렌치는 0.1 내지 0.2㎛의 깊이로 형성하는 것을 특징으로 하는 모스펫 형성방법.
- 제2항에 있어서, 상기 감광막패턴은 상기 트렌치와 양측으로 일정폭 중첩되도록 형성하는 것을 특징으로 하는 모스펫 형성방법.
- 제4항에 있어서, 상기 일정폭은 0.1 내지 0.2㎛로 하는 것을 특징으로 하는 모스펫 형성방법.
- 제2항에 있어서, 상기 고농도의 불순물 확산영역은 상기 게이트전극의 저부면보다 0.1 내지 0.01㎛ 깊게 형성하는 것을 특징으로 하는 모스펫 형성방법.
- 반도체기판 활성영역 상부에 트렌치를 형성하는 공정과, 전표면상부에 게이트산화막을 일정두께 형성하는 공정과, 상기 게이트산화막 상부에 일정두께 게이트전극용 제1다결정실리콘막을 형성하는 공정과, 상기 게이트전극용 제1다결정실리콘막을 에치백하는 공정과, 전표면상부에 게이트전극용 제2다결정실리콘막을 일정두께 형성하는 공정과, 상기 게이트전극용 제2다결정실리콘막을 에치백하여 상기 트렌치를 매립하는 게이트산화막과 게이트전극을 형성하는 공정과, 상기 게이트전극과 게이트산화막을 마스크로하여 저농도의 불순물을 이온주입함으로써 저농도의 불순물 확산영역을 형성하는 공정과, 상기 케이트전극보다 양측으로 일정폭 큰 감광막패턴을 상기 게이트전극 상부에 형성하는 공정과, 상기 감광막패턴을 마스크로하여 상기 반도체기판에 고농도의 불순물을 이온주입함으로써 고농도의 불순물 확산영역을 형성하는 공정과, 상기 감광막패턴을 제거하는 공정을 포함하는 모스펫 형성방법.
- 제7항에 있어서, 상기 트렌치는 0.25 내지 0.4㎛의 깊이로 형성하는 것을 특징으로 하는 모스펫 형성방법.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019940028188A KR100337200B1 (ko) | 1994-10-31 | 1994-10-31 | 모스펫형성방법 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019940028188A KR100337200B1 (ko) | 1994-10-31 | 1994-10-31 | 모스펫형성방법 |
Publications (2)
Publication Number | Publication Date |
---|---|
KR960015813A true KR960015813A (ko) | 1996-05-22 |
KR100337200B1 KR100337200B1 (ko) | 2002-11-23 |
Family
ID=37479979
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1019940028188A KR100337200B1 (ko) | 1994-10-31 | 1994-10-31 | 모스펫형성방법 |
Country Status (1)
Country | Link |
---|---|
KR (1) | KR100337200B1 (ko) |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100781450B1 (ko) | 2006-10-27 | 2007-12-03 | 동부일렉트로닉스 주식회사 | 트렌치 구조의 폴리실리콘 게이트 전극 형성 방법 |
-
1994
- 1994-10-31 KR KR1019940028188A patent/KR100337200B1/ko not_active IP Right Cessation
Also Published As
Publication number | Publication date |
---|---|
KR100337200B1 (ko) | 2002-11-23 |
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