KR950019570A - 프레임 위상 정렬기 - Google Patents
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Abstract
Description
Claims (7)
- 디지탈 전송 장치의 다중화부에서 입력되는 신호 및 프레임 동기 신호들 간에 시간적 편차가 존재하여 이를 정확하게 리타이밍 하여 동기 출력할 수 없는 경우 이를 기준 프레임 동기 신호와 기준 리타이밍 동기 클럭에 재동기 시키기 위하여 입력 데이터, 입력 클럭, 입력 클럭역, 입력 프레임 싱크 신호들을 선택하는 단순 2:1 선택수단(8); 상기 단순 2:1 선택수단(8)으로부터 선택된 입력 데이터를 낮은 속도의 데이터로 역다중화 시키는 역다중화수단(10); 상기 단순 2:1 선택수단(8)으로부터 선택 입력된 데이터를 역다중화하기 위한 조절 신호를 발생 시키고 그 위상을 제어하는 조절 신호 발생수단(9); 상기 역다중화수단(10)에 연결되어 위상이 조절된 역다중화 데이터를 기준 프레임 동기 신호와 기준 클럭에 동기 시켜 다시 다중화 출력 시키는 다중화수단(12); 상기 다중화수단(12)에서 입력된 역다중 데이터를 동기 출력시키기 위해서 기준 프레임 동기신호와 기준 동기 클럭들을 제공하는 기준 신호 발생수단(11); 상기 단순 2:1 선택수단(8)에 연결되어 시스템 구성의 변경 및 감시를 위해서 입력되는 데이터, 클럭, 클럭역 및 프레임 싱크 신호를 선택하거나 구성 상태를 감시하는 선택 신호 발생수단(28); 을 구비하는 것을 특징으로 하는 프레임 위상 정렬기.
- 제1항에 있어서, 상기 단순 2:1 선택수단(8)은, 4개의 2:1 멀티플렉서(multiplexer)의 선택 단자가 공통으로 연결되어 입력 데이터, 클럭, 클럭역, 프레임 싱크 신호를 동시에 선택하도록 구성한 것을 특징으로 하는 프레임 위상 정렬기.
- 제1항에 있어서, 상기 역다중화수단(10)은, 6개의 플립플롭이 직렬로 연결되고 공통 연결된 선택클럭역으로 입력 데이터를 읽어들여 낮은 속도의 병렬 데이터를 만들고 이를 다시 6개의 플립플롭이 병렬로 연결되어 공통 연결된 6분주된 클럭으로 리타이밍시키고 이를 다시 위상이 제어된 시간적 간격이 있는 클럭들에 의해서 5개의 별도의 플립플롭들에 의해서 위상이 제어되고 낮은 속도의 병렬 데이터로 출력시키도록 구성한 것을 특징으로 하는 프레임 위상 정렬기.
- 제1항에 있어서, 상기 조절 신호 발생수단(9)은, 3개의 플립플롭이 체인의 형태로 직렬로 연결되고 공통 클럭으로 클럭킹되여 입력 클럭을 6분주 시키는 카운터회로와 이의 출력 조절 신호들을 별도의 3개의 플립플롭을 사용하여 위상이 다른 클럭 신호와 리타이밍 클럭 신호를 만드는 회로와 2개의 플립플롭과 개의 OR-게이트를 직렬로 연결시켜 상기 카운터 회로를 리셀 시키도록 구성한 것을 특징으로 하는 프레임 위상 정렬기.
- 제1항에 있어서, 상기 다중화수단(12)은, 6:1 멀티플렉서(multiplexer)와 리타이밍 플립플롭이 직렬로 연결되어 입력되는 병렬 역다중 데이터를 기준 조절 신호에 의해 다중화하고 기준 리타이밍 클럭에 의해 동기 출력시키도록 구성한 것을 특징으로 하는 프레임 위상 정렬기.
- 제1항에 있어서, 상기 기준 신호 발생수단(11)은, 3개의 플립플롭이 체인의 형태로 직렬로 연결되고 공통 기준 클럭으로 클럭킹되어 입력 기준 클럭을 6분주시키는 카운터 회로와 11개의 플립플롭과 1개의 NAND게이트로 구성되어 입력 기준 프레임 싱크 신호를 지연시켜 출력시키고 상기 카운터 회로를 리셀시키도록 구성한 것을 특징으로 하는 프레임 위상 정렬기.
- 제1항에 있어서, 상기 선택 신호 발생수단(28)은, 1개의 2:4 디코더와 인버터, 48비터 래치, 2개의 OR-게이트 및 1개의 3-상태 버퍼로 구성한 것을 특징으로 하는 프레임 위상 정렬기.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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US5940403A (en) * | 1996-11-07 | 1999-08-17 | Adtran, Inc. | Quarter-rate 2B1Q ISDN architecture with embedded differential delay compensation for extending range of DDS communications |
US6201843B1 (en) * | 1999-02-25 | 2001-03-13 | L-3 Communications, Inc. | Rapid acquisition dispersive channel receiver integrated circuit |
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US9270397B2 (en) * | 2012-10-24 | 2016-02-23 | Cisco Technology, Inc. | Cascaded communication of serialized data streams through devices and their resulting operation |
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