KR950004424A - 금속식각 방법 - Google Patents

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KR950004424A
KR950004424A KR1019930012948A KR930012948A KR950004424A KR 950004424 A KR950004424 A KR 950004424A KR 1019930012948 A KR1019930012948 A KR 1019930012948A KR 930012948 A KR930012948 A KR 930012948A KR 950004424 A KR950004424 A KR 950004424A
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KR1019930012948A
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Inventor
김상권
Original Assignee
김주용
현대전자산업 주식회사
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Publication date
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Abstract

본 발명은 금속표면 위에 형성된 자연 산화막을 제거하는 예비 식각 단계, 금속식각 단계인 주식각 단계, 금속 패턴의 윤곽 및 잔류 금속을 제거하는 과도식각 단계로 이루어지는 금속식각 공정 단계에 있어서, 상기 과도식각 단계 후 웨어퍼와 하부전극 사이의 정전기를 감소시키기 위한 후처리 식각 단계를 더 포함하여 이루어지는 것을 특징으로 하는 금속식각 공정 단계에 관한 것으로, 웨이퍼의 파손 및 손상을 방지하여 반도체 소자의 수율을 향상 시키는 효과가 있다.

Description

금속식각 방법
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 금속식각 장비의 챔버내부 주요부분을 나타내는 단면도

Claims (2)

  1. 금속표면 위에 형성된 자연 산화막을 제거하는 예비식각 단계, 금속식각 단계인 주식각 단계, 금속 패턴의 윤곽 및 잔류 금속을 제거하는 과도식각 단계로 이루어지는 금속식각 방법에 있어서, 상기 과도식각 단계 후 웨이퍼와 하부전극 사이의 정전기를 감소시키기 위한 후처리 식각 단계를 더 포함하여 이루어지는 것을 특징으로 하는 금속식각 방법
  2. 제1항에 있어서, 상기 후처리 식각 단계는 150∼200W(Watt)의 낮은 전력에서 2∼5초간 진행되는 것을 특징으로 하는 금속식각 공정 단계.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019930012948A 1993-07-09 1993-07-09 금속식각 방법 KR950004424A (ko)

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR20030097168A (ko) * 2002-06-19 2003-12-31 엘지.필립스 엘시디 주식회사 드라이 에칭 방법 및 그를 이용한 박막 트랜지스터 어레이기판 제조 방법

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR20030097168A (ko) * 2002-06-19 2003-12-31 엘지.필립스 엘시디 주식회사 드라이 에칭 방법 및 그를 이용한 박막 트랜지스터 어레이기판 제조 방법

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