KR940009845A - 시큐리티회로 - Google Patents

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KR940009845A
KR940009845A KR1019930022480A KR930022480A KR940009845A KR 940009845 A KR940009845 A KR 940009845A KR 1019930022480 A KR1019930022480 A KR 1019930022480A KR 930022480 A KR930022480 A KR 930022480A KR 940009845 A KR940009845 A KR 940009845A
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슈지 하야시
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사토 후미오
가부시키가이샤 도시바
오카모토 세이시
도시바 마이크로일렉트로닉스 가부시키가이샤
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    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F12/00Accessing, addressing or allocating within memory systems or architectures
    • G06F12/14Protection against unauthorised use of memory or access to memory
    • G06F12/1408Protection against unauthorised use of memory or access to memory by using cryptography
    • GPHYSICS
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  • General Physics & Mathematics (AREA)
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Abstract

본 발명은 시큐리티를 설정한 것을 다른 사람은 바로 알 수 없으므로, 메모리에 기억된 데이터를 확실히 보호하는 것이 가능한 시큐리티회로를 제공하고자 함에 그 목적이 있다. 이를 위해 본 발명에서는, 메모리(2)에는 시큐리티 데이터가 기억되고, 래치회로(4)에는 키데이터가 래치된다. 비교회로(6)에 의해 시큐리티 데이터와 키데이터가 일치하지 않는다고 판단되면, 변경비트 제어회로(20)의 출력신호(S13)는 "O"레벨로 되어 어드레스 변경회로(301∼30n)에 공급되는 어드레스신호는 메모리(2)로부터 공급되는 시큐리티 데이터에 따라 변환된다. 따라서, 이 어드레스 신호에 의해 메모리(1a)는 엑세스되지만 정상적인 데이터는 출력되지 않는다.

Description

시큐리티회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 제1실시예를 나타낸 구성도,
제2도는 본 발명의 제2실시예를 나타낸 주요부의 구성도.

Claims (6)

  1. 기밀을 유지해야 할 데이터를 기억하는 제1기억수단(1a)과, 시큐리티 데이터를 기억하는 제2기억수단(2), 상기 시큐리티 데이터에 의해 설정된 시큐리티를 해제하기 위한 키데이터를 래치하는 래치회로(4), 상기 제2기억수단(2)에 기억되어 있는 시큐리티 데이터와 상기 래치회로(4)에 의해 래치된 키데이터를 비교하여 이들이 일치하고 있는 경우에는 일치신호를 출력하고, 이들이 일치하지 않는 경우에는 불일치신호를 출력하는 비교회로(6) 및 상기 제1기억수단(1a)에 기억되어 있는 데이터를 독출하기 위한 어드레스신호 및 상기 비교회로(6)의 출력신호가 공급되어 이 비교회로(6)로부터 불일치신호가 공급된 경우에는 상기 어드레스신호를 변화시키고, 일치신호가 공급된 경우에는 상기 어드레스신호를 그대로 출력하는 어드레스 제어회로(301∼30n)를 구비한 것을 특징으로 하는 시큐리티회로.
  2. 제1항에 있어서, 상기 어드레스 제어회로는 어드레스신호, 상기 시큐리티 데이터 및 상기 비교회로(6)의 출력신호가 각각 공급되는 복수개의 어드레스 변경회로(301∼30n)을 갖추며, 이들 어드레스 변경회로(301∼30n)는 상기 비교회로(6)로부터 불일치신호가 공급된 경우에 상기 시큐리티 데이터에 따라 어드레스신호를 변화시키도록 되어 있는 것을 특징으로 하는 시큐리티회로.
  3. 제2항에 있어서, 상기 각 어드레스 변경회로(301∼30n)는 상기 어드레스신호를 임의로 변화시키는 스크램블 회로(32)를 포함하는 것을 특징으로 하는 시큐리티회로.
  4. 제3항에 있어서, 상기 스크램블회로(32)는 어드레스신호를 변화시키는 복수개의 인버터회로(32a,32b)를 포함하고 있는 것을 특징으로 하는 시큐리티회로.
  5. 제3항에 있어서, 상기 스크램블회로(32)는 한쪽 입력단에 상기 어드레스신호가 공급되고, 다른쪽 입력단에 상기 시큐리티 데이터가 공급되는 논리회로(32c)를 포함하고 있는 것을 특징으로 하는 시큐리티회로.
  6. 제1항에 있어서, 상기 제1기억수단(1a)의 출력단에는, 이 제1기억수단(1a)으로부터 독출된 데이터 및 상기 시큐리티데이터가 공급되고, 상기 비교회로(6)로부터 불일치신호가 공급된 경우에 상기 시큐리티 데이터에 따라 상기 독출된 데이터를 변경시키는 데이터 변경회로(401∼40n)가 설치된 것을 특징으로 하는 시큐리티회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019930022480A 1992-10-27 1993-10-27 시큐리티회로 KR960006485B1 (ko)

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Application Number Priority Date Filing Date Title
JP28856292 1992-10-27
JP92-288562 1992-10-27
JP93-251502 1993-10-07
JP5251502A JPH06208516A (ja) 1992-10-27 1993-10-07 セキュリティ回路

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Publication Number Publication Date
KR940009845A true KR940009845A (ko) 1994-05-24
KR960006485B1 KR960006485B1 (ko) 1996-05-16

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KR1019930022480A KR960006485B1 (ko) 1992-10-27 1993-10-27 시큐리티회로

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EP (1) EP0595288A1 (ko)
JP (1) JPH06208516A (ko)
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CN (1) CN1034448C (ko)

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Publication number Publication date
EP0595288A1 (en) 1994-05-04
JPH06208516A (ja) 1994-07-26
CN1034448C (zh) 1997-04-02
CN1086919A (zh) 1994-05-18
US5357467A (en) 1994-10-18
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