KR910014954A - 다포트메모리회로의 테스트장치 - Google Patents

다포트메모리회로의 테스트장치 Download PDF

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KR910014954A
KR910014954A KR1019910001009A KR910001009A KR910014954A KR 910014954 A KR910014954 A KR 910014954A KR 1019910001009 A KR1019910001009 A KR 1019910001009A KR 910001009 A KR910001009 A KR 910001009A KR 910014954 A KR910014954 A KR 910014954A
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KR
South Korea
Prior art keywords
write
test signal
memory circuit
write port
outputs
Prior art date
Application number
KR1019910001009A
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English (en)
Inventor
츠네오 하마이
Original Assignee
아오이 죠이치
가부시키가이샤 도시바
다케다이 마사다카
도시바 마이크로 일렉트로닉스 가부시키가이샤
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    • G11CSTATIC STORES
    • G11C8/00Arrangements for selecting an address in a digital store
    • G11C8/16Multiple access memory array, e.g. addressing one storage element via at least two independent addressing line groups
    • GPHYSICS
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    • G11C29/00Checking stores for correct operation ; Subsequent repair; Testing stores during standby or offline operation
    • GPHYSICS
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    • G11C29/00Checking stores for correct operation ; Subsequent repair; Testing stores during standby or offline operation
    • G11C29/04Detection or location of defective memory elements, e.g. cell constructio details, timing of test signals
    • G11C29/08Functional testing, e.g. testing during refresh, power-on self testing [POST] or distributed testing
    • G11C29/12Built-in arrangements for testing, e.g. built-in self testing [BIST] or interconnection details
    • GPHYSICS
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  • Engineering & Computer Science (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Techniques For Improving Reliability Of Storages (AREA)
  • For Increasing The Reliability Of Semiconductor Memories (AREA)
  • Tests Of Electronic Circuits (AREA)
  • Time-Division Multiplex Systems (AREA)

Abstract

내용 없음

Description

다포트메모리회로의 테스트장치
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 1실시예의 회로블록도.

Claims (3)

  1. 다포트메모리회로(1)의 기입포트중에서 1개의 기입포트를 선택하고, 선택된 기입포트의 기입데이터를 출력하는 기입포트선택회로(2), 이 기입포트선택회로(2)에 의해 출력되는 기입데이터를 일시 보존하는 레지스터(3), 이 레지스터(3)가 보존하고 있는 기입데이터 및, 상기 다포트메모리회로(1)의 모든 독출포트로 부터 출력되는 데이터를 비교하여 일치·불일치를 판정하고, 그 판정결과정보를 출력하는 비교회로(4)를 구비하여 구성된다는 것을 특징으로 하는 다포트메모리회로의 테스트장치.
  2. 제1항에 있어서, 상기 기입포트선택회로(2)가 테스트신호와 동기하여 동작하고, 테스트신호가 활성화상태일 때만 선택한 기입포트의 기입데이터를 출력하는 것을 특징으로 하는 다포트메모리회로의 테스트장치.
  3. 제1항에 있어서, 상기 비교회로(4)가 테스트신호와 동기하여 출력동작하고, 테스트신호가 활성화상태일 때만 불일치정보를 출력하는 것을 특징으로 하는 다포트메모리회로의 테스트장치.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019910001009A 1990-01-25 1991-01-22 다포트메모리회로의 테스트장치 KR910014954A (ko)

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JP2013574A JPH03219349A (ja) 1990-01-25 1990-01-25 多ポートメモリ回路のテスト装置
JP02-013574 1990-01-25

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KR1019910001009A KR910014954A (ko) 1990-01-25 1991-01-22 다포트메모리회로의 테스트장치

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JPH03219349A (ja) 1991-09-26
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