KR940008492B1 - 문자발생회로의 오동작 방지회로 - Google Patents

문자발생회로의 오동작 방지회로 Download PDF

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Abstract

내용 없음.

Description

문자발생회로의 오동작 방지회로
제1도는 본 발명에 따른 문자발생회로의 오동작 방지회로를 나타내는 것이다.
제2도는 본 발명에 따른 문자발생회로의 오동작 방지회로의 동작을 설명하기 위한 동작타이밍도를 나타내는 것이다.
본 발명은 문자발생회로의 오동작 방지회로에 관한 것으로, 특히 카피가이드 신호에 의하여 잘못된 수직동기펄스의 발생을 막기 위한 문자발생회로의 오동작 방지회로에 관한 것이다.
문자발생회로는 신호화면이나 블루화면위에 문자를 표시해 주는 회로이다. 그 회로의 구성은 신호의 유무를 판단하는 동기검출회로와 마이콤의 제어를 받아서 화면에 문자 및 블루화면을 만들어 주는 문자발생회로로 구성되어 있다.
문자를 표시할때에는 입력되는 비디오신호의 동기가 정상적인 경우는 화면위에 문자를 디스플레이하여 입력되는 신호가 아주 미약하거나 노이즈신호가 입력되면 블루화면을 출력하여 그 위에 문자를 표시한다. 그런데 비디오 테이프나 텔레비젼 송신신호에 카피를 방지하기 위하여 실어주는 카피가이드 신호가 실린 영상신호가 비디오 테이프 레코더(VRT :Video Tape Recorder)에 입력될때 상기 동기신호 검출회로가 카피가이드 신호를 수직동기신호로 오인하여 잘못된 수직동기신호를 상기 문자발생회로로 출력하여 문자발생회로가 오동작을 일으키게 된다. 일반적으로, 카피가이드 신호는 21 수평동기간내에 실린다.
본 발명의 목적은 카피가이드 신호가 살리는 기간을 무시하고 수직동기신호를 발생하여 문자발생회로의 오동작을 방지하기 위한 회로를 제공하는데 있다.
이와 같은 목적을 달성하기 위하여 본 발명에 따른 문자발생회로의 오동작방지회로는 동기신호 출력단자에서 정정된 수직동기신호를 발생하기 위하여 상기 비데오 신호로 부터 분리된 수직동기펄스에 응답하고 한쌍의 교차 결합된 플립플롭들을 포함하는 신호발생회로, 상기 신호발생회로가 최소한 상기 비데오 신호의 소정간격동안 상기 분리된 수직동기펄스에 응답하지 않도록 하기 위한 디스에이블수단을 구비하여 소정간격으로 삽입된 카피가이드 신호를 포함하는 비데오 신호에 포함된 수직동기펄스의 오류검출을 방지하는 것을 특징으로 한다.
첨부된 도면을 참고로 하여 본 발명에 따른 문자발생회로의 오동작 방지회로를 설명하면 다음과 같다.
제1도는 본 발명에 따른 문자발생회로의 오동작 방지회로를 나타내는 것이다. 제1도에 나타낸 회로는 앞서 설명한 동기신호분리회로 내부, 문자발생회로 내부 또는 상기 동기신호분리회로와 상기 문자발생회로 사이에 별도로 위치할 수도 있다. 또한, 제1도에 나타낸 회로는 카피가이드 신호가 31수평동기기간내에 존재한다고 하고 그 기간을 무시하는 회로이다.
제1도에 있어서, 수직동기신호(Vsync)가 반전클럭신호단자에 인가되고 인버터(11)에 의해서 반전된 수직동기신호(Vsync)가 클럭신호단자(CK)에 인가되고 데이타단자(D)에 전원전압(Vcc)가 인가되는 D플립플롭(D1)와, 상기 D플립플롭(D1)의 출력단자(Q)를 클럭신호단자(CK)에 연결하고 반전출력단자(Q)를 반전클럭신호단자()에 연결하고 반전출력단자()를 통하여 에러를 제거한 수직동기신호(Vsync)를 출력하는 D플립플롭(D2)와, 인버터(I2)에 의해서 반전된 수평동기신호(Hsync)가 클럭신호단자(CK)에 인가되고, 수평동기신호(Hsync)가 반전클럭신호단자()에 인가되는 T플립플롭(T1)와, 상기 T플립플롭(T1)의 출력 신호단자(Q)를 반전클럭신호단자()에 연결하고 반전출력신호단자()를 클럭신호단자(CK)에 연결하는 T플립플롭(T2)와, 상기 T플립플롭(T2)에 직렬로 연결된 T플립플롭들(T3,T4,T5,T6)로 이루어지고 T플립플롭(T2)의 반전출력단자()를 D플립플롭(D2)의 반전리세트단자()에 연결하고, T플립플롭(T6)의 반전출력단자()를 D플립플롭(D1)의 반전리세트단자()에 연결하고, D플립플롭(D1)의 반전출력단자()를 인버터(I3)에 의해서 반전하고 그 반전된 신호를 T플립플롭(T1,T2,T3,T4,T5,T6)에 연결하여 구성되어 있다. 상기 구성에서 T플립플롭(T1-T6)은 디스에이블 부이고, D플립플롭(D1,D2)는 신호발생부이다.
상기의 구성에 의거하여 그 동작을 설명하면 다음과 같다.
제2도는 본 발명에 따른 문자발생회로 오동작 방지회로의 동작을 설명하기 위한 동작타이밍도를 나타낸 것이다.
제2a도는 카피가이드 신호를 수직동기신호로 오인하여 발생된 수직동기신호를 나타내는 것이다. 펄스(P)는 수직동기펄스 분리기에 의해서 수직동기펄스로 잘못 인식한 비데오 신호내에 포함된 카피가이드 신호를 나타내는 것이다. 본 발명의 회로의 기본적인 목적은 모든 잘못 검출된 수직동기펄스가 제거된 정정된 수직 동기신호를 발생하는 것이다.
제2b도는 비데오 신호로 부터 분리된 수평동기펄스를 나타내는 것이다.
제1도에 나타낸 본 발명의 회로의 제어부는 최소한 카피가이드 신호 간격동안 회로의 신호발생부의 D플립플롭(D1)을 디스에이블하는 출력신호를 발생하는 기능을 하고 이와 같이 하여 이 시간주기동안 출력에서의 변화를 방지한다. 이 기간동안 D플립플롭(D1)의 출력이 발생하지 않기 때문에 D플립플롭(D2)의 출력 또한, 발생하지 않는다. 그래서, 이 간격동안, 신호발생부는 디스에이블된다. 즉, 신호발생부는 이 기간동안 수직동기펄스에 응답하지 않게 된다.
제2c도는 D플립플롭(D1)의 반전출력단자(Q)로부터 출력되는 출력신호를 나타내는 것이다. 그 출력신호는 제2a도의 수직동기신호가 "하이"레벨에서 "로우"레벨로 천이할때 "하이"레벨에서 "로우"레벨로 천이한다, 그 다음에 출력되는 신호는 입력신호의 상태에서 관계없이 그 이전의 출력신호상태를 그대로 유지하다가 리세트가 되면 출력신호는 "로우"레벨로 된다.
제2d-i도는 T플립플롭들(T1-T6)의 출력파형을 각각 나타내는 것으로, 각 T형 플립플롭들은 수직동기펄스(Vsync)에 응답하여 하이논리레벨에서 로우논리레벨로 가는 D형 플립플롭(D1)의 반전출력단자()로부터의 신호에 의해서 리세트된다. 그래서, D형 플립플롭(D1)의 수직동기펄스를 수신 후에 각 T형 플립플롭들(T1-T6)은 리세트된다. 32수평동기펄스(Hsync)가 계수된 후에 T형 플립플롭(T6)이 반전출력단자()는 로우레벨로 간다.
제2d는 T플릅플롭(T1)의 반전출력단자(Q)로부터 출력되는 출력신호를 나타내는 것이다. 그 출력신호는 수평동기신호(Vsync)가 "하이"레벨에서 "로우"레벨로 천이할 때 "하이"레벨에서 "로우"레벨로 또는 "로우"레벨에서 "하이"레벨로 토글한다.
제2e도는 T플립플롭(T3)의 반전출력단자(Q)로부터 출력되는 출력신호를 나타내는 것이다. 그 출력신호는 제2d도의 출력신호가 "하이"레벨에서 "로우"레벨로 천이할 때 "하이"레벨에서 "로우"레벨로 또는 "로우"레벨에서 "하이"레벨로 토글한다.
제2f는 T플립플롭(T3)의 반전출력단자(Q)로부터 출력되는 출력신호를 나타내는 것이고, 제2g도는 T플립플롭(T4)의 반전출력단자(Q)로부터 출력되는 출력신호를 나타내는 것이고 제2h도는 T플립플롭(T5)의 반전출력단자(Q)로부터 출력되는 출력신호를 나타내는 것이고, 제2i도는 T플립플롭(T6)의 반전출력단자(Q)로부터 출력되는 출력신호를 나타내는 것이고, 제2j도는 D플립플롭(D2)의 반전출력단자(Q)로부터 출력되는 에러를 제거한 수평동기신호를 나타내는 것으로, 제2e도에 나타낸 펄스가 "로우"레벨이면 D플립플롭(D2)는 리세트되어 반전출력단자(Q)로부터 출력되는 신호는 "하이"레벨이 된다. 그래서 다음 수직동기신호가 입력될때까지 "하이"레벨을 유지한다. D플립플롭(D1)은 제2i도에 나타낸 T플립플롭(T6)의 반전출력단자(Q)로부터 출력신호가 "로우"레벨이 되면 리세트되어 그 반전출력단자(Q)로부터 "하이"레벨의 신호를 출력한다. 그래서 다음 수직동기신호가 입력될때까지 "하이"레벨을 유지한다.
그리고 D플립플롭(D1)은 상기(P)로 표시한 펄스가 반전클럭신호단자(CK)에 입력되면 그 이전의 출력신호의 상태인 "로우"레벨을 계속해서 유지하게 된다. 이와 같은 동작을 수행하여 잘못된 수직동기펄스의 발생을 막고 정정된 수직동기펄스만을 발생하게 된다.
따라서, 본 발명에 따른 문자발생회로의 오동작 방지회로는 카피가이드 신호가 포함된 수직동기신호에서 정확한 수직동기신호를 검출하여 문자발생회로의 오동작을 방지할 수 있다.

Claims (6)

  1. 동기신호출력단자에서 정정된 수직동기신호를 발생하기 위하여 상기 비데오신호로부터 분리된 수직동기펄스에 응답하고 한쌍의 교차 결합된 플립플롭들을 포함하는 신호발생회로; 상기 신호발생회로가 최소한 상기 비데오 신호의 소정 간격동안 상기 분리된 수직동기펄스에 응답하지 않도록 하기 위한 디스에이블수단을 구비하여 소정간격으로 삽입된 카피가이드 신호를 포함하는 비데오 신호에 포함된 수직동기펄스의 오류검출을 방지하기 위한 문자발생회로의 오동작 방지회로.
  2. 제1항에 있어서, 상기 신호발생수단은 상기 분리된 수직동기펄스에 결합된 반전된 클럭신호단자; 상기 분리된 수직동기펄스의 반전에 결합된 비반전 클럭신호단자; 반전출력단자; 비반전 출력단자; 전원전압이 인가되는 데이타 입력단자; 디스에이블수단의 제1출력신호에 결합된 리세트단자를 가진 제1플립플롭; 상기 제1플립플롭수단의 상기 반전출력단자에 결합된 반전클럭신호단자; 상기 플립플롭수단의 상기 비반전 출력단자에 결합된 비반전 클럭신호단자; 전원전압이 인가되는 데이타 입력단자; 상기 디스에이블 수단의 제2출력신호에 결합된 리세트단자를 가진 제2플립플롭을 구비하여 동기신호 출력단자를 통하여 정정된 수직동기신호를 발생하기 위하여 비데오 신호로 부터 분리된 수직동기펄스에 응답하는 것을 특징으로 하는 문자발생회로의 오동작 방지회로.
  3. 제1항에 있어서, 상기 디스에이블수단은 상기 비데오 신호에 포함된 수평동기펄스에 응답하는 것을 특징으로 하는 문자발생회로의 오동작 방지회로.
  4. 제3항에 있어서, 상기 디스에이블수단은 상기 비데오 신호에 포함된 수평동기펄스를 계수하고 각 동작사이클의 시작에서 제1논리레벨을 가지는 제어신호를 발생하고, 상기 수평동기펄스의 소정수 n을 계수하여 상기 제어신호를 제2논리레벨로 하기 위한 계수기를 구비하여 상기 제어신호가 상기 제1논리레벨일때 상기 수직동기신호의 레벨이 변화하는 것을 방지하기 위한 문자발생회로의 오동작 방지회로.
  5. 제4항에 있어서, 상기 디스에이블수단은 상기 수평동기신호를 반전하기 위한 인버터; 상기 인버터의 출력신호가 인가되는 클럭신호단자와 상기 수평동기신호가 인가되는 반전클럭신호단자를 가진 제3플립플롭; 상기 제1플립플롭의 출력신호단자와 반전출력신호단자에 각각 연결된 반전클럭신호단자와 클럭신호단자를 가진 제4플립플롭; 상기 제2플립플롭의 출력단자에 직렬로 연결된 제5,6,7,8플립플롭들로 이루어지고 상기 제1플립플롭의 출력신호에 응답하여 상기 제3,4,5,6,7,8플립플롭들을 리세트하고 상기 제8플립플롭의 출력신호에 응답하여 상기 제1플릅플롭을 리세트하고 상기 제4플립플롭의 출력신호에 응답하여 상기 제2플립플롭을 리세트하는 것을 특징으로 하는 문자발생회로의 오동작 방지회로.
  6. 분리된 수직동기펄스에 결합된 반전된 클럭신호단자; 상기 분리된 수직동기펄스의 반전에 결합된 비반전 클럭신호단자; 반전출력단자; 비반전 출력단자; 전원전압이 인가되는 데이터 입력단자; 디스에이블수단의 제1출력신호에 결합된 리세트단자를 가진 제1플립플롭; 상기 제1플립플롭수단의 상기 반전출력단자에 결합된 반전클럭신호단자; 상기 플립플롭수단의 상기 비반전 출력단자에 결합된 비반전 클럭신호단자; 전원전압이 인가되는 데이타 입력단자; 상기 디스에이블수단의 제2출력신호에 결합된 리세트단자를 가진 제2플립플롭을 구비하고 동기신호 출력단자를 통하여 정정된 수직동기신호를 발생하기 위한 비데오 신호로 부터 분리된 수직동기펄스에 응답하는 신호발생수단; 및 상기 잘못 검출된 수직동기펄스가 상기 정정된 수직동기신호에 포함되는 것을 방지하기 위하여 상기 신호발생수단이 상기 비데오 신호의 최소한 소정간격동안 상기 분리된 수직동기펄스에 응답하지 않도록 하기 위한 디스에이블수단을 구비하여 소정간격으로 삽입된 카피가이드 신호를 포함하는 비데오 신호에 포함된 수직동기펄스의 오류검출을 방지하는 것을 특징으로 하는 문자발생회뢰의 오동작 방지회로.
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