JP2743041B2 - 画像表示装置 - Google Patents
画像表示装置Info
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- JP2743041B2 JP2743041B2 JP3331032A JP33103291A JP2743041B2 JP 2743041 B2 JP2743041 B2 JP 2743041B2 JP 3331032 A JP3331032 A JP 3331032A JP 33103291 A JP33103291 A JP 33103291A JP 2743041 B2 JP2743041 B2 JP 2743041B2
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- JP
- Japan
- Prior art keywords
- signal
- input
- circuit
- output
- recording prevention
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- Television Signal Processing For Recording (AREA)
Description
【０００１】
【産業上の利用分野】本発明は、ビデオテープからの録
画を防ぐ録画防止信号を含んでいるビデオ信号が入力さ
れても、録画防止信号を含まないビデオ信号が入力され
た場合と同様に画像を表示できる画像表示装置に関する
ものである。
画を防ぐ録画防止信号を含んでいるビデオ信号が入力さ
れても、録画防止信号を含まないビデオ信号が入力され
た場合と同様に画像を表示できる画像表示装置に関する
ものである。
【０００２】
【従来の技術】最近は、テレビジョンの画面にチャネル
番号又は音量の強弱を表す文字又はパターン等の画像を
表示するようにしている。図１はそのような画像表示を
行うための画像表示装置の構成を示すブロック図であ
る。ビデオ信号VTR は同期分離回路12へ入力される。同
期分離回路12はビデオ信号VTR の水平同期信号ＨSYC と
垂直同期信号ＶSYC とを分離して、同期信号入力回路15
へ入力する。この同期信号入力回路15の出力信号たる水
平同期信号ＨSYC はＨカウンタ16へ入力され、Ｈカウン
タ16がカウントした水平同期信号ＨSYC のカウント値は
表示位置検出回路17へ入力される。表示位置検出回路17
は、入力された水平同期信号ＨSYC のカウント値に基づ
いて表示すべき画像の文字又はパターンの表示位置を検
出する。そしてその検出位置に画像を表示する。
番号又は音量の強弱を表す文字又はパターン等の画像を
表示するようにしている。図１はそのような画像表示を
行うための画像表示装置の構成を示すブロック図であ
る。ビデオ信号VTR は同期分離回路12へ入力される。同
期分離回路12はビデオ信号VTR の水平同期信号ＨSYC と
垂直同期信号ＶSYC とを分離して、同期信号入力回路15
へ入力する。この同期信号入力回路15の出力信号たる水
平同期信号ＨSYC はＨカウンタ16へ入力され、Ｈカウン
タ16がカウントした水平同期信号ＨSYC のカウント値は
表示位置検出回路17へ入力される。表示位置検出回路17
は、入力された水平同期信号ＨSYC のカウント値に基づ
いて表示すべき画像の文字又はパターンの表示位置を検
出する。そしてその検出位置に画像を表示する。
【０００３】
【発明が解決しようとする課題】ところで、ビデオ信号
に含まれている録画防止信号は複数のパルスで水平同期
信号の休止期間に含まれている。そのため水平同期信号
をカウントするＨカウンタは、水平同期信号とともに録
画防止信号をもカウントすることになり、表示位置検出
回路は表示すべき画像の表示位置を正確に検出し得ず、
表示位置が大幅に狂って表示できず、またカウントした
水平同期信号が多いために水平同期が乱れて表示すべき
画像を安定に表示できないという問題がある。本発明は
斯かる問題に鑑み、録画防止信号を含んでいるビデオ信
号が入力されても、表示する画像を所定位置に、安定し
て表示できる画像表示装置を提供することを目的とす
る。
に含まれている録画防止信号は複数のパルスで水平同期
信号の休止期間に含まれている。そのため水平同期信号
をカウントするＨカウンタは、水平同期信号とともに録
画防止信号をもカウントすることになり、表示位置検出
回路は表示すべき画像の表示位置を正確に検出し得ず、
表示位置が大幅に狂って表示できず、またカウントした
水平同期信号が多いために水平同期が乱れて表示すべき
画像を安定に表示できないという問題がある。本発明は
斯かる問題に鑑み、録画防止信号を含んでいるビデオ信
号が入力されても、表示する画像を所定位置に、安定し
て表示できる画像表示装置を提供することを目的とす
る。
【０００４】
【課題を解決するための手段】本発明に係る画像表示装
置は、水平同期信号をカウントするカウンタのカウント
値に基づいて、表示すべき画像の位置を決定する画像表
示装置において、水平同期信号の休止期間に存在する録
画防止信号をマスクするためのパルスを出力するタイミ
ングジェネレータと、該タイミングジェネレータからの
出力パルス及び前記録画防止信号が存在する水平同期信
号を入力とし、出力信号を前記カウンタに与える論理和
回路とを備え、録画防止信号の存在期間でも水平同期信
号のカウントを禁止又は無効とすること無く水平同期信
号のみをカウントし、表示すべき画像の表示位置を決定
し得るようにしたことを特徴とする。
置は、水平同期信号をカウントするカウンタのカウント
値に基づいて、表示すべき画像の位置を決定する画像表
示装置において、水平同期信号の休止期間に存在する録
画防止信号をマスクするためのパルスを出力するタイミ
ングジェネレータと、該タイミングジェネレータからの
出力パルス及び前記録画防止信号が存在する水平同期信
号を入力とし、出力信号を前記カウンタに与える論理和
回路とを備え、録画防止信号の存在期間でも水平同期信
号のカウントを禁止又は無効とすること無く水平同期信
号のみをカウントし、表示すべき画像の表示位置を決定
し得るようにしたことを特徴とする。
【０００５】
【作用】水平同期信号の休止期間に存在する録画防止信
号をマスクするパルスを出力するタイミングジェネレー
タの出力パルスと、水平同期信号及びその休止期間に存
在する録画防止信号とを入力とし、その出力信号をカウ
ンタへ出力する論理和回路を備えることで、カウンタに
は録画防止信号が存在する間もカウンタは録画防止信号
をカウントすることなく水平同期信号のみをカウントす
ることとなり、カウント値に基づいて画像の表示位置を
決定し得る。
号をマスクするパルスを出力するタイミングジェネレー
タの出力パルスと、水平同期信号及びその休止期間に存
在する録画防止信号とを入力とし、その出力信号をカウ
ンタへ出力する論理和回路を備えることで、カウンタに
は録画防止信号が存在する間もカウンタは録画防止信号
をカウントすることなく水平同期信号のみをカウントす
ることとなり、カウント値に基づいて画像の表示位置を
決定し得る。
【０００６】
【実施例】以下本発明をその実施例を示す図面により詳
述する。図２は本発明に係る画像表示装置の構成を示す
ブロック図である。録画防止信号を含んでいるビデオ信
号VTR は、同期分離回路12へ入力される。同期分離回路
12で分離された水平同期信号ＨSYC 及び垂直同期信号Ｖ
SYC はともに同期信号入力回路15へ入力され、その出力
信号たる水平同期信号はタイミングジェネレータ13及び
OR回路18の一側入力端子へ入力される。タイミングジェ
ネレータ13の出力信号はOR回路18の他側入力端子へ入力
される。発振回路14は水平同期信号ＨSYC の周波数より
高い周波数の高周波信号を発振し、その発振出力信号は
タイミングジェネレータ13へ与えられる。
述する。図２は本発明に係る画像表示装置の構成を示す
ブロック図である。録画防止信号を含んでいるビデオ信
号VTR は、同期分離回路12へ入力される。同期分離回路
12で分離された水平同期信号ＨSYC 及び垂直同期信号Ｖ
SYC はともに同期信号入力回路15へ入力され、その出力
信号たる水平同期信号はタイミングジェネレータ13及び
OR回路18の一側入力端子へ入力される。タイミングジェ
ネレータ13の出力信号はOR回路18の他側入力端子へ入力
される。発振回路14は水平同期信号ＨSYC の周波数より
高い周波数の高周波信号を発振し、その発振出力信号は
タイミングジェネレータ13へ与えられる。
【０００７】タイミングジェネレータ13は、発振回路14
から入力された高周波信号の周波数を分周するようにな
っており、また水平同期信号ＨSYC の休止期間に含まれ
ている録画防止信号の信号期間より長い時間幅のパルス
信号を発生するように構成されており、このパルス信号
は水平同期信号ＨSYC の立上り時点に同期し、立上り時
点から所定時間遅れて立上るように構成されている。
から入力された高周波信号の周波数を分周するようにな
っており、また水平同期信号ＨSYC の休止期間に含まれ
ている録画防止信号の信号期間より長い時間幅のパルス
信号を発生するように構成されており、このパルス信号
は水平同期信号ＨSYC の立上り時点に同期し、立上り時
点から所定時間遅れて立上るように構成されている。
【０００８】OR回路18の出力信号はＨカウンタ16へ入力
されており、Ｈカウンタ16のカウント値たる出力信号は
表示位置検出回路17へ入力される。図３はタイミングジ
ェネレータ13の構成の一例を示すブロック図である。フ
リップフロップＦ1 （Ｆ2 ，Ｆ3 Ｆ4 …Ｆn-1 ，Ｆn ）
の出力Ｑ及び反転出力＃Ｑは、フリップフロップＦ
2 （Ｆ3 ，Ｆ4 …Ｆn-1 ，Ｆn ）のトリガ端子Ｔ及び反
転トリガ端子＃Ｔへ入力される。フリップフロップＦ1
のトリガ端子Ｔには、発振回路14の出力信号が、反転ト
リガ端子＃Ｔには、インバータIV1 を介して発振回路14
の出力信号が入力される。
されており、Ｈカウンタ16のカウント値たる出力信号は
表示位置検出回路17へ入力される。図３はタイミングジ
ェネレータ13の構成の一例を示すブロック図である。フ
リップフロップＦ1 （Ｆ2 ，Ｆ3 Ｆ4 …Ｆn-1 ，Ｆn ）
の出力Ｑ及び反転出力＃Ｑは、フリップフロップＦ
2 （Ｆ3 ，Ｆ4 …Ｆn-1 ，Ｆn ）のトリガ端子Ｔ及び反
転トリガ端子＃Ｔへ入力される。フリップフロップＦ1
のトリガ端子Ｔには、発振回路14の出力信号が、反転ト
リガ端子＃Ｔには、インバータIV1 を介して発振回路14
の出力信号が入力される。
【０００９】フリップフロップＦn の反転出力＃ＱはAN
D 回路Ａ1 の一入力端子へ入力され、その他入力端子に
はオートクリア信号ACが入力される。AND 回路Ａ1 の出
力信号はAND 回路Ａ2 の一入力端子へ入力され、その他
入力端子にはインバータIV2 を介して水平同期信号Ｈ
SYC が入力される。
D 回路Ａ1 の一入力端子へ入力され、その他入力端子に
はオートクリア信号ACが入力される。AND 回路Ａ1 の出
力信号はAND 回路Ａ2 の一入力端子へ入力され、その他
入力端子にはインバータIV2 を介して水平同期信号Ｈ
SYC が入力される。
【００１０】AND 回路Ａ2 の出力信号はフリップフロッ
プＦ1 ，Ｆ2 ，Ｆ3 …Ｆn-1 ，Ｆn の各リセット端子
Ｒ，Ｒ，Ｒ…へ入力される。フリップフロップＦn の反
転出力＃ＱはインバータIV3 を介して３入力NOR 回路NR
1 の第１入力端子へ入力され、その第２入力端子にはAN
D 回路Ａ2 の出力信号がインバータIV4 を介して入力さ
れ、その第３入力端子にはNOR 回路NR2 の出力信号が入
力される。NOR 回路NR1 の出力信号はNOR 回路NR2 の一
入力端子へ入力され、その他入力端子にはインバータIV
5 を介してフリップフロップＦ2 の反転出力＃Ｑが入力
される。NOR 回路NR1 はパルス信号を出力するようにな
っており、この出力パルスはOR回路18の他側入力端子へ
与えられる。
プＦ1 ，Ｆ2 ，Ｆ3 …Ｆn-1 ，Ｆn の各リセット端子
Ｒ，Ｒ，Ｒ…へ入力される。フリップフロップＦn の反
転出力＃ＱはインバータIV3 を介して３入力NOR 回路NR
1 の第１入力端子へ入力され、その第２入力端子にはAN
D 回路Ａ2 の出力信号がインバータIV4 を介して入力さ
れ、その第３入力端子にはNOR 回路NR2 の出力信号が入
力される。NOR 回路NR1 の出力信号はNOR 回路NR2 の一
入力端子へ入力され、その他入力端子にはインバータIV
5 を介してフリップフロップＦ2 の反転出力＃Ｑが入力
される。NOR 回路NR1 はパルス信号を出力するようにな
っており、この出力パルスはOR回路18の他側入力端子へ
与えられる。
【００１１】次にこのように構成した画像表示装置の動
作を各部信号のタイミングチャートを示す図４とともに
説明する。録画防止信号を含んでいるビデオ信号VTR が
同期分離回路12へ入力されると水平同期信号ＨSYC 及び
垂直同期信号ＶSYC がビデオ信号VTR から分離される。
そして水平同期信号ＨSYC 及び垂直同期信号ＶSYC は同
期信号入力回路15へ入力され、その水平同期信号ＨSYC
がタイミングジェネレータ13へ入力される。
作を各部信号のタイミングチャートを示す図４とともに
説明する。録画防止信号を含んでいるビデオ信号VTR が
同期分離回路12へ入力されると水平同期信号ＨSYC 及び
垂直同期信号ＶSYC がビデオ信号VTR から分離される。
そして水平同期信号ＨSYC 及び垂直同期信号ＶSYC は同
期信号入力回路15へ入力され、その水平同期信号ＨSYC
がタイミングジェネレータ13へ入力される。
【００１２】同期信号入力回路15から出力される水平同
期信号ＨSYC は、図４(a) に示すように水平同期信号Ｈ
SYC の休止期間に録画防止信号NRが存在している。タイ
ミングジェネレータ13は、発振回路14からの高周波信号
を分周して、水平同期信号ＨSYC の立上り時点に同期
し、立上り時点から僅かに遅延して立上る図４(b) に示
す如きパルス信号を出力する。そして録画防止信号NRと
ともに水平同期信号ＨSYC が、OR回路18の一側入力端子
に、タイミングジェネレータ13からのパルス信号が他側
入力端子に入力されて、OR回路18の出力信号は図４(c)
に示す如く録画防止信号NRがパルス信号によりマスクさ
れて、水平同期信号ＨSYC のみが出力されＨカウンタ16
へ入力される。
期信号ＨSYC は、図４(a) に示すように水平同期信号Ｈ
SYC の休止期間に録画防止信号NRが存在している。タイ
ミングジェネレータ13は、発振回路14からの高周波信号
を分周して、水平同期信号ＨSYC の立上り時点に同期
し、立上り時点から僅かに遅延して立上る図４(b) に示
す如きパルス信号を出力する。そして録画防止信号NRと
ともに水平同期信号ＨSYC が、OR回路18の一側入力端子
に、タイミングジェネレータ13からのパルス信号が他側
入力端子に入力されて、OR回路18の出力信号は図４(c)
に示す如く録画防止信号NRがパルス信号によりマスクさ
れて、水平同期信号ＨSYC のみが出力されＨカウンタ16
へ入力される。
【００１３】それによりＨカウンタ16は水平同期信号Ｈ
SYC のみをカウントし、そのカウント値たる出力信号を
表示位置検出回路17へ入力し、その出力信号に応じて画
像を表示すべき位置を決定する。このようにして録画防
止信号NRが水平同期信号ＨSYC の休止期間に存在してい
てもタイミングジェネレータ13の出力信号によりマスク
されるから、Ｈカウンタ16はビデオ信号VTR の水平同期
信号ＨSYC のみをカウントすることになり、録画防止信
号が存在しないビデオ信号VTR と同様に水平同期信号を
カウントすることになる。そのため録画防止信号を含ま
ない水平同期信号ＨSYC をカウントした場合と同様にし
て画像の表示位置を決定でき、また水平同期を乱さず、
安定に画像を表示できる。
SYC のみをカウントし、そのカウント値たる出力信号を
表示位置検出回路17へ入力し、その出力信号に応じて画
像を表示すべき位置を決定する。このようにして録画防
止信号NRが水平同期信号ＨSYC の休止期間に存在してい
てもタイミングジェネレータ13の出力信号によりマスク
されるから、Ｈカウンタ16はビデオ信号VTR の水平同期
信号ＨSYC のみをカウントすることになり、録画防止信
号が存在しないビデオ信号VTR と同様に水平同期信号を
カウントすることになる。そのため録画防止信号を含ま
ない水平同期信号ＨSYC をカウントした場合と同様にし
て画像の表示位置を決定でき、また水平同期を乱さず、
安定に画像を表示できる。
【００１４】
【発明の効果】以上詳述したように、本発明によれば、
水平同期信号の休止期間に存在する録画防止信号をマス
クするパルスを出力するパルスジェネレータの出力及び
録画防止信号が存在する水平同期信号を入力とし、その
出力を水平同期信号のカウンタへ出力する論理和回路を
備えることで、録画防止信号が存在するビデオ信号が入
力されても、画像の表示位置が狂うことがなく、また水
平同期を乱さず本来表示すべき位置に安定に画像を表示
できる画像表示装置を提供できる優れた効果を奏する。
水平同期信号の休止期間に存在する録画防止信号をマス
クするパルスを出力するパルスジェネレータの出力及び
録画防止信号が存在する水平同期信号を入力とし、その
出力を水平同期信号のカウンタへ出力する論理和回路を
備えることで、録画防止信号が存在するビデオ信号が入
力されても、画像の表示位置が狂うことがなく、また水
平同期を乱さず本来表示すべき位置に安定に画像を表示
できる画像表示装置を提供できる優れた効果を奏する。
【図１】従来の画像表示装置の構成を示すブロック図で
ある。
ある。
【図２】本発明に係る画像表示装置の構成を示すブロッ
ク図である。
ク図である。
【図３】タイミングジェネレータの実回路図である。
【図４】各部信号のタイミングチャートである。
12 同期分離回路 13 タイミングジェネレータ 14 発振回路 16 Ｈカウンタ 18 OR回路
Claims (1)
- 【請求項１】 水平同期信号をカウントするカウンタの
カウント値に基づいて、表示すべき画像の位置を決定す
る画像表示装置において、水平同期信号の休止期間に存
在する録画防止信号をマスクするためのパルスを出力す
るタイミングジェネレータと、該タイミングジェネレー
タからの出力パルス及び前記録画防止信号が存在する水
平同期信号を入力とし、出力信号を前記カウンタに与え
る論理和回路とを備え、録画防止信号の存在期間でも水
平同期信号のカウントを禁止又は無効とすること無く水
平同期信号のみをカウントし、表示すべき画像の表示位
置を決定し得るようにしたことを特徴とする画像表示装
置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3331032A JP2743041B2 (ja) | 1991-12-16 | 1991-12-16 | 画像表示装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3331032A JP2743041B2 (ja) | 1991-12-16 | 1991-12-16 | 画像表示装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH05167943A JPH05167943A (ja) | 1993-07-02 |
| JP2743041B2 true JP2743041B2 (ja) | 1998-04-22 |
Family
ID=18239066
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3331032A Expired - Fee Related JP2743041B2 (ja) | 1991-12-16 | 1991-12-16 | 画像表示装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2743041B2 (ja) |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63166372A (ja) * | 1986-12-27 | 1988-07-09 | Nec Home Electronics Ltd | オンスクリ−ン表示回路 |
-
1991
- 1991-12-16 JP JP3331032A patent/JP2743041B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH05167943A (ja) | 1993-07-02 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| S111 | Request for change of ownership or part of ownership |
Free format text: JAPANESE INTERMEDIATE CODE: R313111 |
|
| R350 | Written notification of registration of transfer |
Free format text: JAPANESE INTERMEDIATE CODE: R350 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20080206 Year of fee payment: 10 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
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| FPAY | Renewal fee payment (event date is renewal date of database) |
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