KR940006187A - 반도체결정의 형성방법 및 반도체소자 - Google Patents

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Abstract

간단한 방법으로, 어떠한 복잡한 구조를 기체(基體) 또는 반도체 박막에 형성하지 않고, 용이하게 대입경(大粒經)의 반도체결정을 형성하는 방법 및 이러한 형성방법에 기초한 반도체소자를 제공한다.
반도체결정(20)의 형성방법은, (가)기체상 (10)에 기체와 다른 재료로 이루어지고 또한 에지부분(14)을 가진 반도체박막(12)을 형성하는 공정과, (나)에지부분을 포함하는 반도체박막에 에너지를 단시간 조사(照射)하여, 에지부분을 포함하는 반도체박막을 완전히 용융시킨 후, 고화시켜 결정화하는 공정으로 이루어진다. 이와 같은 방법에 의해 형성된 반도체결정으로 제작된 반도체소자는 이 반도체소자를 구성하는 결정중에 결정입계(結晶粒界)가 존재하지 않는, 또는 반도체소자를 구성하는 결정의 입경이 0.2㎛이상 10㎛이하인 것을 특징으로 한다.

Description

반도체결정의 형성방법 및 반도체소자
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 제1의 양태에 관한 반도체결정의 형성방법의 공정을 설명하기 위한 도면,
제2도는 본 발명의 제1의 양태에 관한 반도체결정의 형성방법의 공정을 설명하기 위한 도면,
제3도는 본 발명의 제2의 양태에 관한 반도체결정의 형성방법의 공정을 설명하기 위한 도면,
제4도는 본 발명의 제2의 양태에 관한 반도체결정의 형성 방법의 공정을 설명하기 위한 도면,
제5도는 본 발명의 제2의 양태에 관한 반도체결정의 형성방법에 있어서의 반사막의 다른 형태를 모식적으로 도시한 단면도.

Claims (7)

  1. (가)기체(基體)상에 기체와 다른 재료로 이루어지고 또한 에지부분을 가진 반도체박막을 형성하는 공정과, (나)에지부분을 포함하는 반도체박막에 에너지를 단시간 조사(照射)하여, 이 에지부분을 포함하는 반도체박막을 완전히 용융시킨 후, 고화시켜 결정화하는 공정으로 이루어지는 것을 특징으로 하는 반도체결정의 형성방법.
  2. 제1항에 있어서, 상기 반도체박막의 두께는 3nm 내지 10㎛인 것을 특징으로 하는 반도체결정의 형성방법.
  3. (가)기체상에 기체와 다른 재료로 이루어지고 또한 에지부분을 가진 반도체박막을 형성하는 공정과, (나)이 반도체박막상의 일부에 에너지를 반사하는 반사막을 형성하는 공정과, (다)에지부분을 포함하는 반도체박막에 에너지를 단시간 조사하여, 이 반사막에 의해 피복된 반도체박막의 부분을 완전히는 용융시키지 않고 또한 이 에지부분을 포함하는 반사막에 의해 피복되어 있지 않은 반도체박막의 부분을 완전히 용융시킨 후, 고화시켜 결정화하는 공정으로 이루어지는 것을 특징으로 하는 반도체결정의 형성방법.
  4. 제3항에 있어서, 상기 반도체박막의 두께는 3nm 내지 10㎛이며, 상기 반사막의 최대치수는 10nm 내지 10㎛이며, 이 반사막의 융점은 반도체박막의 융점보다 높은 것을 특징으로 하는 반도체결정의 형성방법.
  5. 제3항에 있어서, 상기 반도체박막의 두께는 3nm 내지 10㎛이며, 상기 반사막은 제1의 박막 및 그위에 형성된 제2의 박막으로 구성되어 있으며, 이 반사막의 최대길이는 10nm 내지 10㎛이며, 이 제1의 박막의 융점은 반도체박막의 융점보다 높은 것을 특징으로 하는 반도체결정의 형성방법.
  6. 제1항 내지 제5항중 어느 한항에 기재된 반도체결정의 형성방법에 의해 형성된 반도체결정으로 제작된 반도체소자로서, 이 반도체소자를 구성하는 결정중에 결정입계(結晶粒界)가 존재하지 않은 것을 특징으로 하는 반도체 소자.
  7. 제1항 내지 제5항중 어느 한 항에 기재된 반도체결정의 형성방법에 의해 형성된 반도체결정으로 제작된 반도체소자로서, 이 반도체소자를 구성하는 결정의 입경이 0.2㎛ 이상 10㎛이하인 것을 특징으로 하는 반도체소자.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019930011301A 1992-06-23 1993-06-21 반도체결정의 형성방법 및 반도체소자 KR100250182B1 (ko)

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Families Citing this family (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5976959A (en) * 1997-05-01 1999-11-02 Industrial Technology Research Institute Method for forming large area or selective area SOI
JP4836333B2 (ja) * 2000-01-28 2011-12-14 株式会社半導体エネルギー研究所 半導体装置
US6642085B1 (en) 2000-11-03 2003-11-04 The Regents Of The University Of California Thin film transistors on plastic substrates with reflective coatings for radiation protection
JP2004207691A (ja) * 2002-12-11 2004-07-22 Sharp Corp 半導体薄膜の製造方法、その製造方法により得られる半導体薄膜、その半導体薄膜を用いる半導体素子および半導体薄膜の製造装置
US7402445B2 (en) * 2005-05-16 2008-07-22 Wayne State University Method of forming micro-structures and nano-structures
US20090218732A1 (en) * 2008-02-29 2009-09-03 David Cron System and method for edge heating of stretch film
JP5669439B2 (ja) * 2010-05-21 2015-02-12 株式会社半導体エネルギー研究所 半導体基板の作製方法

Family Cites Families (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4262411A (en) * 1977-09-08 1981-04-21 Photon Power, Inc. Method of making a solar cell array
DE2831819A1 (de) * 1978-07-19 1980-01-31 Siemens Ag Verfahren zum abscheiden von silicium in feinkristalliner form
US4388145A (en) * 1981-10-29 1983-06-14 Xerox Corporation Laser annealing for growth of single crystal semiconductor areas
JPS61108121A (ja) * 1984-11-01 1986-05-26 Sharp Corp 半導体装置の製造方法
US4751193A (en) * 1986-10-09 1988-06-14 Q-Dot, Inc. Method of making SOI recrystallized layers by short spatially uniform light pulses
US4897366A (en) * 1989-01-18 1990-01-30 Harris Corporation Method of making silicon-on-insulator islands
US5256562A (en) * 1990-12-31 1993-10-26 Kopin Corporation Method for manufacturing a semiconductor device using a circuit transfer film
JP3213338B2 (ja) * 1991-05-15 2001-10-02 株式会社リコー 薄膜半導体装置の製法

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JPH06168876A (ja) 1994-06-14
EP0575965B1 (en) 2001-08-16

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