KR920022290A - 데이타 전송방법 및 반도체 메모리 - Google Patents

데이타 전송방법 및 반도체 메모리 Download PDF

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Abstract

내용 없음.

Description

데이타 전송방법 및 반도체 메모리
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명을 설명하기위해 사용된 장치의 블록 회로도,
제2도는 출력 인에이블 제어신호로부터 내부 제어신호를 발생하기 위한 장치의 기존 회로도.

Claims (10)

  1. 메모리 셀 어드레스가 데이타 전송을 제어 신호에 의해 규정되며, 다수의 메모리 셀과 반도체 메모리중 적어도 하나의 입/출력 단자 사이에 데이타 전송 방법에 있어서, 메모리 셀 어드레스를 규정하기위한 어드레스 제어신호 및 출력 인에이블 제어신호로 메모리 셀들간에 데이타 전송 동작을 제어하며, 상기 두개의 제어 신호들의 주어진 연계로 데이타 전송 동작을 계속해서 개시시키며, 상기 두개의 제어 신호중 다른 것을 계속되는 데이타 전송을 제어하는 단계를 포함하는 것을 특징으로 하는 데이타 전송방법.
  2. 제1항에 있어서, 상기 규정된 메모리 셀 어드레스에서 다수의 메모리셀에 하나의 데이타 엑세스를 수행하는 단계를 포함하는 것을 특징으로 하는 데이타 전송방법.
  3. 제1항에 있어서, 상기 어드레스 제어신호의 한 신호 에지로 메모리 셀 어드레스를 규정하며, 출력 인에이블 제어 신호의 한 신호 에지로 데이타 전송을 제어하는 단계를 포함하는 것을 특징으로 하는 데이타 전송방법.
  4. 제1항에 있어서, 상기 어드레스 제어 신호의 각 신호 에지로 메모리 셀 어드레스를 규정하여, 출력 인에이블 제어 신호의 각 신호 에지로 데이타 전송을 제어하는 단계를 포함하는 것을 특징으로 하는 데이타 전송방법.
  5. 제1항에 있어서, 어드레스 제어 신호의 한 펄스 에지로, 규정된 메모리 셀 어드레스와 관련된 데이타 전송작용을 종결시키는 단계를 포함하는 것을 특징으로 하는 데이타 전송방법.
  6. 어드레스 수단과, 메모리 셀을 규정하기 위한 수단과 메모리 셀들간에 데이타 전송을 제어하기 위한 수단을 포함하며, 다수의 메모리 셀과 적어도 하나의 입/출력 단자를 갖는 반도체 메모리에 있어서, 어드레스 제어 신호와 출력 인에이블 제어 신호로 데이타 전송 작용을 연계적으로 제어하기 위한 수단과, 상기 두개의 신호중 하나로 메모리 셀 어드레스를 규정하기 위한 수단과, 상기 두개의 신호중 다른 것으로 데이타 전송을 제어하며, 상기 두개의 제어 신호중 주어진 논리 연계로 데이타 전송작용을 개시하기 위한 수단을 포함하는 것을 특징으로 하는 반도체 메모리.
  7. 제6항에 있어서, 메모리 셀을 어드레스하기 위한 상기 수단은 각각의 규정된 메모리 셀 어드레스로 다수의 메모리 셀을 엑세스 하는 것을 특징으로 하는 반도체 메모리.
  8. 제6항에 있어서, 상기 어드레스 제어 신호는 메모리 셀 어드레스를 규정하고, 입력 인에이블 제어 신호는 한번에 두개의 신호 에지중 하나로 데이타 전송을 제어하는 것을 특징으로 하는 반도체 메모리.
  9. 제6항에 있어서, 상기 어드레스 제어 신호는 메모리 셀 어드레스를 규정하며, 출력 인에이블 제어 신호는 각각의 신호 에지로 데이타 전송을 제어하는 것을 특징으로 하는 반도체 메모리.
  10. 제6항에 있어서, 규정될 메모리 셀 어드레스와 관련된 데이타 전송 작용은 어드레스 제어 신호중 하나의 클럭 에지로 인터럽트 될 수 있는 것을 특징으로 하는 반도체 메모리.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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