KR910015014A - 반도체기판의 매엽식 표면처리방식 - Google Patents

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미츠토시 고야마
고이치 다카하시
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아오이 죠이치
가부시키가이샤 도시바
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    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
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    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
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Abstract

내용 없음

Description

반도체기판의 매엽식 표면처리방식
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제3도는 본 발명의 웨이퍼로드(wafer load)실을 포함한 전체에 N-퍼지(purge)기구를 구비한 무수불산처리 장치의 종단면도, 제4도는 본 발명에서 사용되는 반도체기판·로드(load)실에 N-퍼지(purge)기구를 구비한 무수불산처리장치의 종단면도, 제5도는 본 발명에 이용되는 무수불산처리장치에서의 2개의 다른 무수불산처리조건에서의 각각의 롯트(lot)내 및 롯트사이의 열산화막 에칭량의 균일성을 나타낸 그래프이다.

Claims (1)

  1. 일정한 수증기 농도로 제어되는 질소·산소 및 아르곤으로 이루어진 무리로 부터 선정되는 한 종류 또는 복수의 가스 분위기내에서 퍼지한 반도체기판을 적어도 불산가스가 포함된 기상분위기중에서 처리하는 것을 특징으로 하는 반도체기판의 매엽식표면 처리방식.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019910001532A 1990-01-30 1991-01-30 반도체기판의 매엽식 표면처리방식 KR940000917B1 (ko)

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JPS60150633A (ja) * 1984-01-18 1985-08-08 Kokusai Electric Co Ltd プラズマエツチング装置のロ−ドロツク室
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