KR910006819A - 전류 미러 - Google Patents
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Abstract
내용 없음
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 바람직한 실시예의 전류 미러를 도시한 개요도.
Claims (2)
- 전류 미러로서, 제1단자에 인가된 입력 전류에 응답하여 상기 입력 전류의 크기와 동일한 전류를 제2단자에 공급하는 제1회로 수단, 제1단자에 공급된 전류에 응답하여 상기 공급된 전류의 크기와 실질적으로 같은 전류를 출력 단자에 제공하는 제2회로 수단, 상기 제2단자에 제공된 상기 전류에 응답하여 상기 입력 전류에 대해 스케일 되어 상기 제2회로 수단에 공급되는 전류를 제공하는 회로 스케일링 수단을 구비하며, 상기 회로 스케일링 수단은 서로에 대해 스케일되는 에미터 영역을 갖는 다수의 트랜지스터를 포함하며, 상기 다수의 트랜지스터중 한쌍의 트랜지스터는 대향하는 콜렉터에 결합된 베이스와 제1 및 제2회로수단의 상기 제1단자와 직렬로 결합된 콜렉터-에미터 도전 경로를 갖는 전류 미러.
- 제1항에 있어서, 상기 한쌍의 트랜지스터는 에미터, 베이스 및 콜렉터를 각각 갖는 제5 및 제6트랜지스터와 제7 및 제8트랜지스터를 구비하며, 상기 베이스는 대향하는 트랜지스터의 콜렉터에 교차되어 연결되어 있으며 상기 에미터는 상기 제1과 제2트랜지스터의 상기 베이스에 각각 연결되고 상기 제1과 제2트랜지스터의 상기 에미터 영역에 대해 소정의 계수로 스케일되는 영역을 갖으며, 제7 및 제8트랜지스터 각각은 상기 제1트랜지스터의 상기 콜렉터에 연결된 베이스와 상기 제5 및 제6트랜지스터의 상기 콜렉터에 직렬 결합된 콜렉터-에미터 도전경로를 갖으며, 상기 제7 및 제8트랜지스터의 에미터 영역은 상기 제1 및 제2트랜지스터의 상기 에미터 영역에 대해 소정의 계수로 스케일되는 전류 미러.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Applications Claiming Priority (2)
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Family Applications (1)
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