KR890016566A - 반도체 기억장치 - Google Patents
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Abstract
내용 없음
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제6도는 본 발명의 실시예 2에 의한 멀티포트메모리의 SAM의 구성을 표시하는 회로도. 제7도는 실시예 2의 멀티포트메모리의 전체 구성을 표시하는 블럭도. 제8도는 제6도의 SAM의 동작을 설명하기 위한 타이밍챠트.
Claims (2)
- 복수의 메모리셀이 행방향 및 열방향을 따라 배치되어 이들 각 메모리셀에 대하여 수시로 기입·기록된 정보를 읽어내는 것이 가능한 랜덤 액세스 메모리와 상기 램덤 액세스 메모리에 기억된 데이터를 행단위로서 기록된 정보를 읽어내게하여 시리얼로 출력하는 시리얼 액세스메모리와를 구비하는 반도체 기억장치이며 상기 시리얼 액세스 메모리는 복수의 1비트 레지스터를 줄지워서 구성된 상기 랜덤액세스 메모리로부터 행단위로 기록된 정보를 읽어내게되는 기억데이터를 각 1비트레지스터로 유지하는 데이터레지스터 수단 소정의 주기에서 입력되는 쉬프트 클럭펄스에 응답하여 동작하고 해당 쉬프트 클럭펄스가 소정 갯수로 부여될때마다 상기 1비트 레지스터를 소정 갯수씩 순번으로 선택하는 선택수단과 상기 선택수단에 의하여 선택된 상기 1비트 레지스터의 출력을 유지하는 복수의 래치수단과 각 상기 래치수단 마다에 설치되고 각각이 상기 쉬프트 클럭펄스에 동기하여 동작하고, 각 상기 래치수단에 유지된 데이터를 순차적이며 또한 선택적으로 외부에 도출시키는 복수의 게이트 수단과를 포함하는 반도체 기억장치.
- 정보를 기억하는 복수의 기억수단 상기 복수의 기억수단중 2 이상의 기억수단을 동시에 선택하는 선택수단, 상기 선택수단에 의하여 선택된 상기 2 이상의 기억수단으로부터 기억된 정보를 읽어내게 되는 정보를 유지하는 2이상의 유지수단 및 상기 2 이상의 유지수단의 각각을 순서있게 선택한 후에 상기 선택수단을 형성화시키는 제어수단을 구비한 반도체 기억장치.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Applications Claiming Priority (6)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP88-89424 | 1988-04-12 | ||
| JP63089424A JPH0713855B2 (ja) | 1988-04-12 | 1988-04-12 | 半導体記憶装置 |
| JP63-89424 | 1988-04-12 | ||
| JP88-154110 | 1988-06-21 | ||
| JP154110 | 1988-06-21 | ||
| JP63154110A JPH025283A (ja) | 1988-06-21 | 1988-06-21 | 半導体記憶装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| KR890016566A true KR890016566A (ko) | 1989-11-29 |
| KR930000960B1 KR930000960B1 (ko) | 1993-02-11 |
Family
ID=26430843
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| KR1019890002673A KR930000960B1 (ko) | 1988-04-12 | 1989-03-03 | 반도체 기억장치 |
Country Status (1)
| Country | Link |
|---|---|
| KR (1) | KR930000960B1 (ko) |
-
1989
- 1989-03-03 KR KR1019890002673A patent/KR930000960B1/ko not_active IP Right Cessation
Also Published As
| Publication number | Publication date |
|---|---|
| KR930000960B1 (ko) | 1993-02-11 |
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