KR890002991A - 씨모오스 반도체장치의 제조방법 - Google Patents
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- 239000004065 semiconductor Substances 0.000 title claims description 6
- 238000004519 manufacturing process Methods 0.000 title description 2
- 241000206672 Gelidium Species 0.000 title 1
- 238000005468 ion implantation Methods 0.000 claims 6
- 239000000758 substrate Substances 0.000 claims 5
- 238000000034 method Methods 0.000 claims 2
- 229910021420 polycrystalline silicon Inorganic materials 0.000 claims 2
- 229920005591 polysilicon Polymers 0.000 claims 2
- 238000005530 etching Methods 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 1
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Abstract
내용 없음
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제 1 도는 씨모오스 반도체장치의 일실시예도. 제 2 도는 본 발명에 따른 씨모오스 반도체장치의 드레인 및 소오스의 제조공정도.
Claims (1)
- 제 1 도 전형의 반도체기판(11)상부에 제 2 도 전형의 기판(12)을 형성하고 제 1 도 전형의 기판(11)과 제 2 도 전형의 기판(12)상의 소정부위에 필드산화막(15)으로 분리한 제 1 트랜지스터영역(13)과 제 2 트랜지스터영역(14)을 형성하고 상기 제 1 및 제 2 트랜지스터영역 상부에 게이트 산화막(16)과 폴리실리콘 게이트(17)를 형성한 씨모오스 반도체장치의 드레인 및 소오스 영역 형성방법에 있어서, 상기 제 2 트랜지스터영역(14)(또는 제 1 트랜지스터영역(13))상부에 제 1 이온주입용 마스크(18)를 형성하고 제 1 이온주입을 하는 제 1 공정과, 상기 제 1 이온주입용 마스크(18)를 제거한 반도체기판 전면에 제 2 이온주입 마스크용 열산화막(19 )(19')을 성장하는 제 2 공정과, 상기 제 1 이온주입을 한 트랜지스터영역(13)(또는(14))상부에 두껍게 자란 제 2 이온주입 마스크용 산화막(19')을 마스크로 하여 제 2 이온주입을 하고 상기 산화막(19)(19')을 에칭한후 폴리실리콘게이트(17)상에 열산화막(22)을 형성하는 제 3 공정을 구비하여 상기 공정들의 연속으로 드레인 및 소오스영역을 형성함을 특징으로 하는 씨모오스 반도체장치의 제조방법.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019870008417A KR890005197B1 (ko) | 1987-07-31 | 1987-07-31 | 씨모오스 반도체장치의 제조방법 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019870008417A KR890005197B1 (ko) | 1987-07-31 | 1987-07-31 | 씨모오스 반도체장치의 제조방법 |
Publications (2)
Publication Number | Publication Date |
---|---|
KR890002991A true KR890002991A (ko) | 1989-04-12 |
KR890005197B1 KR890005197B1 (ko) | 1989-12-16 |
Family
ID=19263487
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1019870008417A KR890005197B1 (ko) | 1987-07-31 | 1987-07-31 | 씨모오스 반도체장치의 제조방법 |
Country Status (1)
Country | Link |
---|---|
KR (1) | KR890005197B1 (ko) |
-
1987
- 1987-07-31 KR KR1019870008417A patent/KR890005197B1/ko not_active IP Right Cessation
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Publication number | Publication date |
---|---|
KR890005197B1 (ko) | 1989-12-16 |
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