KR880009440A - 선택적 웰 바이어스가 되는 다이나믹 랜덤 액세스 메모리 - Google Patents
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Abstract
내용 없음.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제 1 도는 기판의 각 웰(well)들이 이 발명에 따라 선택적으로 바이어스 되는 CMOS기술을 이용하는 집적 회로 구조를 나태내는 도면.
제 2 도는 제 1 도에서의 집적회로의 회로이다.
Claims (4)
- 기판상에 집적회로로 제조되고 적어도 하나의 스토리지 셀들의 어레이와 상기 어레이와의 데이터 전달을 위한 적어도 하나의 주변 제어회로를 포함하는 다이나믹 랜덤 액세스 메모리에 있어서, 상기 스토리지 셀들의 어레이를 보유하는 도우핑된 영역을 제공하는 제 1 웰 수단과, 상기 주변 제어회로를 보유하는 도우핑된 영역을 제공하는 제 2 웰 수단으로서, 상기 제1웰수단으로부터 실질적으로 전기 절연된 제 2 웰수단과, 제 1 웰 수단에 일정한 바이어스 전위를 제공하는 어레이 바이어스수단, 상기 제 2 웰 수단에 따른 바이어스 진위를 제공하는 주변 바이어스 수단과, 로 구성되는 것을 특징으로 하는 DRAM.
- n형 기판상에 집적회로로 제조되고 적어도 하나의 스토리지 셀들의 어레이와 상기 어레이와의 데이터 전달을 위한 적어도 하나의 주변 제어회로를 포함하는 DRAM에 있어서, 상기 스토리지 셀들의 어레이가 제조되어 있는 도우핑된 영역을 제공하는 상기 기판내의 제 1 웰 수단과, 상기 주변 제어회로를 보유하는 도우핑된 영역을 제공하는 제 2 웰 수단으로서, 상기 제 1 웰 수단으로부터 실질적으로 전기 절연된 제 2 웰수단과, 상기 제 1 웰 수단에 접지전위를 인가하는 접지수단과, 상기 제 2 웰 수단에 소정 바이어스 전위를 인가하는 바이어스 수단과, 로 구성되는 것을 특징으로 하는 DRAM.
- n형 기판상에 집적회로로 제조되고 다수의 스토리지 셀들의 어레이들과 상기 스토리지 셀들의 어레이들과의 데이터 전달을 위해 그와 각기 연결된 다수의 CMOS 주변 제어회로들을 포함하는 DRAM에 있어서, 상기 스토리지 셀들의 어레이들을 보유하는 제1 p형 도핑 영역을 제공하는 제1 p웰과, 상기 CMOS주변 제어회로들을 보유하는 상보형 도핑 영역들을 제공하는 제2 p웰 및 상보형 n웰로서, 실질적으로 전기절연된 제2 p웰 및 상보형 n웰과, 상기 제 1 P웰에 접지전위를 인가하는 접지수단과, 상기 상보형 영역들에 소정 바이어스 전위들을 인가하는 바이어스수단과 , 로 구성되는 것을 특징으로 하는 DRAM.
- 기판상에 집적회로로 제조되고 적어도 하나의 스토리지 셀들의 어레이와 상기 스토리지 셀들과의 데이터 전달을 위한 주변 제어회로들의 적어도 한 영역을 포함하는 DRAM에 있어서, 하나의 웰이 상기 주변 제어회로들을 보유하고 제 2 웰이 상기 멤모리 스토리지 어레이들을 보유하게 된 기판의 도우핑된 불순물들의 적어도 2개의 전기절연된 웰들로서, 상기 도우핑 불순물 영역들이 실질적으로 전기절연된 적어도 2개의 웰들과, 스토리지 어레이를 보유하는 도우핑된 불순물 영역들에 접지전위를 인가하는 접지수단과, 주변 제어회로들을 보유하는 상기 도우핑된 불순물 영역들중 다른 것에 소정 바이어스 전위를 인가하는 역바이어스 수단과, 로 구성되는 것을 특징으로 하는 DRAM.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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