KR880008154A - 마이크로 컴퓨터 시스템 및 그 메모리 관리장치 - Google Patents
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Abstract
내용 없음.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명이 적용된 메모리 관리장치를 포함하는 마이크로 컴퓨터 시스템의 1실시예를 도시하는 접속도,
제2도는 본 발명이 적용된 메모리 관리장치를 포함하는 마이크로 컴퓨터 시스템의 또 다른 실시예를 도시하는 접속도.
제3도는, 제1도 및 제2도의 메모리 관리장치에 있어서의 어드레스 변환 처리의 1실시예를 도시하는 플로우 챠트.
Claims (12)
- 어드레스 버스, 상기 어드레스 버스에 결합되어 버스 마스터로 될 수 있는 제1의 디바이스, 상기 어드레스 버스에 결합되어 버스 마스터로 될 수 있는 제2의 디바이스 및 상기 어드레스 버스에 결합되는 메모리 관리장치를 가지며, 상기 메모리 관리장치는 상기 제2의 디바이스에서 송출되는 버스요구신호를 검출하는 검출수단을 포함하고 있는 마이크로 컴퓨터 시스템.
- 특허 청구의 범위 제1항에 있어서, 상기 제1의 디바이스 버스제어 수단을 가지며, 상기 검출수단에 의한 검출결과에 따라서 상기 버스 제어수단은 상기 제2의 디바이스가 버스 마스터로 되도록 제어하는 마이크로 컴퓨터 시스템.
- 특허 청구의 범위 제2항에 있어서, 상기 제1의 디바이스는 마이크로 프로세서이며, 상기 제2의 디비이스는 직접 메모리 액세스 제어장치이고, 상기 메모리 관리장치는 메모리 관리 유니트인 마이크로 컴퓨터 시스템.
- 특허 청구의 범위 제3항에 있어서, 상기 메모리 관리 유니트는 상기 검출결과에 따라서 실행중의 어드레스 변환처리를 중단하는 기능을 갖고 있는 마이크로 컴퓨터 시스템.
- 특허 청구의 범위 제4항에 있어서, 상기 어드레스 버스는 논리 어드레스 버스인 마이크로 컴퓨터 시스템.
- 물리 어드레스 버스, 상기 물리 어드레스 버스에 결합되어 버스 마스터로 될 수 있는 제1의 디바이스, 상기 물리 어드레스 버스에 결합되어 버스 마스터로 될 수 있는 제2의 디바이스, 상기 물리 어드레스 버스에 결합되는 메모리 관리장치 및 상기 물리 어드레스 버스에 결합되는 메모리를 가지며, 상기 메모리 관리장치는 상기 제2의 디바이스에서 송출되는 버스요구 신호를 검출하는 검출수단을 포함하고 있는 마이크로 컴퓨터 시스템.
- 특허청구의 범위 제6항에 있어서, 상기 메모리 관리장치는 상기 검출수단에 의한 검출결과에 따라서 실행중의 처리를 중지하기 위한 처리 제어수단을 갖고 있는 마이크로 컴퓨터 시스템.
- 특허청구의 범위 제7항에 있어서, 상기 제1의 디바이스 및 상기 제2의 디바이스는 버스제어수단을 가지며, 상기 버스제어수단은 상기 검출수단에 의한 검출결과에 따라서 상기 제2의 디바이스가 버스 마스터로 되도록 제어하는 마이크로 컴퓨터 시스템.
- 특허청구의 범위 제8항에 있어서, 상기 제1의 디바이스는 마이크로 프로세서며, 상기 제2의 디바이스는 직접 메모리 액세스 제어장치이고, 상기 메모리 관리장치는 메모리 관리 유니트인 마이크로 컴퓨터 시스템.
- 특허청구의 범위 제8항에 있어서, 상기 제1의 디바이스는 상기 메모리 관리장치를 거쳐서 상기 물리 어드레스 버스에 결합되는 마이크로 컴퓨터 시스템.
- 특허청구의 범위 제8항에 있어서, 상기 메모리 관리장치는 상기 제1의 디바이스의 내부에 마련되어 있는 마이크로 컴퓨터 시스템.
- 버스 마스터로 될 수 있는 다른 디바이스와 함께 논리 어드레스 공간 또는 물리 어드레스 공간에 접속되며, 상기 디바이스의 버스요구 신호를 검출해서 실행중의 어드레스 변환처리를 중단하여 처리장치에 버스를 해방시키는 수단을 가지고 있는 메모리 관리장치.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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