KR880001130A - 디지탈 블럭 멀티플렉서와 디멀티플렉서 및 디지탈 전송 시스템 - Google Patents
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Abstract
내용 없음
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명에 따른 블럭 멀티플렉싱을 위해 배열된 디지탈 전송 시스템의 블럭도. 제7도는 패피티 블럭 멀티플렉서의 상세한 블럭도. 제8도는 패리티 블럭 디멀티플렉서의 상세한 블럭도.
Claims (6)
- 다수의 입력 단국 라인 각각으로부터의 비트의 블럭을 삽입하기 위한 디지탈 블럭 멀티플렉서에 있어서, 상기 디지탈 블럭 멀티플렉서는 각각의 제1 및 제2 단국 라인으로부터의 프레임내에 디지탈 비트 스트림의 블럭열을 수용하기 위한 수단과, 상기 제1 및 제2 단국 라인 수단으로부터의 디지탈 비트 스트림의 블럭을 멀미플렉스된 비트 스트림에 삽입하기 위한 수단을 수비하며, 각각의 프레임은 단국 라인 식별 정보와 디지탈 비트의 복수 블럭을 포함하고, 각각의 디지탈 비트 블럭은 복수 데이타 비트와 하나의 패리티 비트를 포함하고, 상기 제2 단국 라인 수단으로 부터의 블럭열은 상기 패리티 비트 자리의 주기적인 자리에 제어 정보를 포함한 한 비트를 포함하는 것을 특징으로 하는 디지탈 블럭 멀티플렉서.
- 제1항에 있어서, 멀티플렉스된 비트 스트림에 대해 위상 변조를 행하기 위하여 상기 제1 단국 라인으로부터의 위상 변조된 라인 신호에 응답하는 수단을 더 구비하는 것을 특징으로 하는 디지탈 블럭 멀티플렉서.
- 제1항에 있어서, 멀티플렉스된 비트 스트림에 대해 위상 변조를 행하기 위하여 상기 제2 단국 라인으로부터의 위상 변조된 라인 신호에 응답하는 수단을 더 구비하는 것을 특징으로 하는 디지탈 블럭 멀티플렉서.
- 다수의 입력 단국 라인 각각으로부터의 비트의 블럭을 삽입하기 위한 디지탈 전송 시스템에 있어서, 상기 디지탈 전송 시스템은 프레임에 디지탈 비트 스트림이 블럭열을 발생시키기 위한 각각의 제1 및 제2 송신 단국 라인 수단과, 상기 제1 및 제2 단국 라인으로부터의 디지탈 비트 스트림의 블럭을 멀티플렉스된 비트 스트림에 삽입하기 위한 수단과, 상기 디지탈 비트 스트림의 블럭을 제1 및 제2 수신 단국 라인에 대한 프레임에서의 디지탈 비트 스트림의 식별로 블럭열로 디멀티플렉싱하기 위하여, 멀티플렉스된 비트 스트림에 있는 상기 단국 라인 식별 정보와 상기 패리티 비트에 응답하는 수단을 구비하고, 상기 각각의 프레임은 단국 라인 식별 정보와 복수의 디지탈 비트 블럭을 포함하고, 상기 디지탈 비트 블럭은 복수 데이타 비트와 하나의 패리티 비트를 포함하고, 상기 제2 단국 라인 수단으로 부터의 디지탈 비트 스트림의 블럭열은제어 정보를 포함한 상기 패리티 비트 중 주기적인 하나의 비트를 포함하는 것을 특징으로 하는 디지탈 전송 시스템.
- 멀티플렉스된 비트 스트림으로부터 비트의 블럭을 분리하기 위한 디지탈 블럭 디멀티플렉서에 있어서, 상기 디지탈 블럭 디멀티플렉서는 상기 제1 및 제2 단국 라인으로부터 프레임에 삽입된 디지탈 비트 스트림의 블럭을 포함하는 멀티플렉스된 비트 스트림을 수시하기 위한 수단과, 상기 제1 및 제2 단국 라인 수단으로부터의 디지탈 비트 스트림의 블럭을 패리티 비트와 제어 정보를 포함하는 분리 단국 라인 신호로 분리하기 위한 수단을 구비하고, 상기 각각의 프레임은 단국 라인 식별 정보와 복수의 디지탈 비트 블럭을 포함하고, 디지탈 비트의 각각의 블럭은 복수 데이타 비트와 하나의 패리티 비트를 포함하고, 상기 제2 단국 라인으로부터의 블럭 열이 상기 패리티 비트 자리중 주기적인 한 자리에 제어 정보를 포함한 비트를 포함하는 것을 특징으로 하는 디지탈 블럭 디멀티플렉서.
- 제5항에 있어서, 상기 제1 및 제2 수신 단국 라인에 대한 프레임에서의 디지탈 비트 스트림의 블럭 열에 대해 위상 변조를 행하기 위하여, 멀티플렉스된 비트 스트림에 대해 위상 변조된 신호에 응답하는 수단을 구비하는 것을 특징으로 하는 디지탈 블럭 디멀티플렉서.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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