KR870001716A - 순환디지탈정보 전송시스템 - Google Patents

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KR870001716A
KR870001716A KR1019860006091A KR860006091A KR870001716A KR 870001716 A KR870001716 A KR 870001716A KR 1019860006091 A KR1019860006091 A KR 1019860006091A KR 860006091 A KR860006091 A KR 860006091A KR 870001716 A KR870001716 A KR 870001716A
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미추루 야마우라
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와타리 스기이찌로
가부시끼가이샤 도오시바
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    • H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
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    • H04L25/38—Synchronous or start-stop systems, e.g. for Baudot code
    • H04L25/40—Transmitting circuits; Receiving circuits
    • H04L25/49—Transmitting circuits; Receiving circuits using code conversion at the transmitter; using predistortion; using insertion of idle bits for obtaining a desired frequency spectrum; using three or more amplitude levels ; Baseband coding techniques specific to data transmission systems
    • H—ELECTRICITY
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    • H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
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    • H04L7/00—Arrangements for synchronising receiver with transmitter

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Abstract

내용 없음.

Description

순환디지탈정보 전송시스템
제1도는 본 발명에 따른 장치의 제1실시예를 나타낸 블록도.
제10도는 본 발명을 채택하지 않은 종래방법의 데이터 포맷.
제15도는 본 발명에 따른 장치의 제2실시예를 나타낸 블록도.

Claims (7)

  1. L비트의 동기신호(F P)와 M비트의 제1피일드(A) 및 N비트의 제2피일드(B)로 1프레임의 데이터 포맷을 구성하되 L+N＞M의 관계를 만족시키도록 데이터포맷을 구성하고, 모두“0”의 논리로 된(또는 모두“1”의 논리로 된)연속적인 비트로 상기 L비트의 동기신호(F P)를 구성하며 상기 제1피일드(A)에 인접하는 제2피일드(B)의 양쪽 종단을 포함한 복수의 장소에“1”의 논리로된 (또는 “0”의 논리로 된)고정비트를 삽입하되 상기 고정비트의 간격이 L-1을 초과하지 않도록 삽입하여서 1프레임의 구조를 완성시키도록 된것을 특징으로 하는 순환 디지탈정보 전송시스템의 프레임 동기방법.
  2. 제1항에 있어서, 제1, 제2피일드(A,B)를 교번적으로 포함하는 전송데이터(E27)를 생성해내기 위한 데이터 결합수단(21-27)과, 전송되는 데이터로부터 동기신호(F P)를 검출하기 위해 상기 전송데이터(E 27)에 응답하여 동작하는 프레임동기 검출수단(29 또는 1-6)을 구비하여 이루어진 것을 특징으로 하는 프레임 동기장치.
  3. 제2항에 있어서, 프레임 동기 검출수단(29)은 전송데이터(E 27)에 대응되는 코오드(E 28)로부터 동기신호(F P)와 같은 패턴(연속적인 “0”의 L 비트)을 가지는 동기코오드(AFP=PFP 나 FP)를 검출해내기 위한 동기코오드 검출수단(1,2)과, M비트이후에 나타나는 데이터열내에 포함된 동기코오드(AFP=FP)를 동기신호(SY=FP)로 판별해내기 위해서 M비트이내의 동기코오드(AFP)에 포함된 의사 동기코오드(AFP=PFP)에 대해서는 응답하지 않도록 된 판별수단(3-6)등을 구비하여 구성된것을 특징으로 하는 프레임 동기장치.
  4. 제3항에 있어서, 판별수단(3-6)은 동기코오드(AFP)의 검출에 의해 클리어되는 한편 클리어된 후에는 전송데이터(E 27)의 전송속도에 대응되는 주파수로 된 클록(CK)을 계수하도록 된 카운터수단(3)과, 상기 카운타수단(3)의 계수출력(E 3)이 M비트에 대응되는 값에 도달하여 출력될 때에만 동기코오드(AFP)를 동기신호(FP)로서 출력하는 게이트수단(제4도의 4-6, 제8도의 5A-6A, 12-13)으로 구성된것을 특징으로 하는 프레임 동기장치.
  5. 제2항에 있어서, 데이터 결합수단(21-27)은 동기신호(FP=E21)를 발생시키기 위한 동기발생수단(21)과, 1프레임내에 포함될 정보 피트신호(E22)를 발생시키기 위한 정보비트 발생수단(22), 1프레임내 제2피일드(B)의 위치를 나타내는 피일드 위치신호(E 23)를 발생시키기 위한 위치신호 발생수단(20,23) 및, 피일드위치신호(E 23)가 발생될 때에만 소정의 비트간격으로 정보 비트내에 고정비트(FB1-FB3; 제24E도)를 삽입하기 위한 고정비트 삽입수단(24)등을 포함해서 구성된 것을 특징으로 하는 프레임 동기장치.
  6. 제5항에 있어서, 데이터 결합수단(21-27)은 정보비트(E 22)가 발생되지 않는 프레임의 내부에 점검비트(E 25)를 발생시키기 위한 정검비트 발생수단(25)과, 피일드 위치신호(E 23)가 발생되는 동안 소정의 비트간격으로 상기 점검비트(E 25)의 사이에다 고정비트(FB4,FB5; 제24G도)를 삽입하기 위한 고정비트 삽입수단(26)을 더 구비하여 구성된것을 특징으로 하는 프레임 동기장치.
  7. L비트의 동기신호(F P 2)와 M비트의 제1피일드(A) 및 N비트의 제2피일드(B2)로 1프레임의 데이터포맷을 구성하고, 상기 동기신호(FP2)중 제1피일드(A)와 맞닿는 곳에 논리“1”(또는 “0”)의 1비트를 설정하고, 나머지 L-1 비트의 위치에 논리 “0”(또는 “1”)의 비트를 설정하며, 제2피일드(B2)와 제1피일드(A)의 경계에 “1”(또는 “0”)의 고정비트 1비트를 삽입하는 한편 제2피일드(B2)와 동기신호(FP2)의 경계로부터 L비트 이내의 위치에 “1”(또는 “0”)의 고정비트 1비트를 삽입하고, 제2피일드(B2)와 동기신호(FP2)간의 경계를 제외한 최소한 L-2비트의 간격으로 제2피일드(B2)내에 “1”(또는 “0”)의 고정비트 1를 삽입하며, L+N＞M+2의 관계를 만족시키도록 해서 1프레임의 데이터구조를 완성시키게 된것을 특징으로 하는 프레임 동기장치.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019860006091A 1985-07-30 1986-07-25 순환디지탈정보 전송시스템의 프레임 동기방법 및 그 프레임 동기장치 KR910000695B1 (ko)

Applications Claiming Priority (3)

Application Number Priority Date Filing Date Title
JP60166794A JPS6229239A (ja) 1985-07-30 1985-07-30 サイクリツク情報伝送装置におけるフレ−ム同期方式
JP166794 1985-07-30
JP60-166794 1985-07-30

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KR870001716A true KR870001716A (ko) 1987-03-17
KR910000695B1 KR910000695B1 (ko) 1991-01-31

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ID=15837796

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EP (1) EP0216066A3 (ko)
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EP0216066A2 (en) 1987-04-01
CN1004043B (zh) 1989-04-26
JPH0457261B2 (ko) 1992-09-11
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