KR860000592A - 정상 및 고속실행 모우드를 가진 퍼스널 컴퓨터 - Google Patents

정상 및 고속실행 모우드를 가진 퍼스널 컴퓨터 Download PDF

Info

Publication number
KR860000592A
KR860000592A KR1019850004502A KR850004502A KR860000592A KR 860000592 A KR860000592 A KR 860000592A KR 1019850004502 A KR1019850004502 A KR 1019850004502A KR 850004502 A KR850004502 A KR 850004502A KR 860000592 A KR860000592 A KR 860000592A
Authority
KR
South Korea
Prior art keywords
speed microprocessor
high speed
microprocessor
normal
mode
Prior art date
Application number
KR1019850004502A
Other languages
English (en)
Other versions
KR920006767B1 (ko
Inventor
알. 쿨리 포올
Original Assignee
제임스 엠. 해리스
콤퍀 컴퓨터 코오포레이숀
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by 제임스 엠. 해리스, 콤퍀 컴퓨터 코오포레이숀 filed Critical 제임스 엠. 해리스
Publication of KR860000592A publication Critical patent/KR860000592A/ko
Application granted granted Critical
Publication of KR920006767B1 publication Critical patent/KR920006767B1/ko

Links

Classifications

    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F9/00—Arrangements for program control, e.g. control units
    • G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
    • G06F9/22—Microcontrol or microprogram arrangements
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F9/00—Arrangements for program control, e.g. control units
    • G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
    • G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
    • G06F9/38—Concurrent instruction execution, e.g. pipeline or look ahead
    • G06F9/3802—Instruction prefetching
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F1/00—Details not covered by groups G06F3/00 - G06F13/00 and G06F21/00
    • G06F1/04—Generating or distributing clock signals or signals derived directly therefrom
    • G06F1/08—Clock generators with changeable or programmable clock frequency
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F9/00—Arrangements for program control, e.g. control units
    • G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
    • G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
    • G06F9/38—Concurrent instruction execution, e.g. pipeline or look ahead
    • G06F9/3867—Concurrent instruction execution, e.g. pipeline or look ahead using instruction pipelines
    • G06F9/3869—Implementation aspects, e.g. pipeline latches; pipeline synchronisation and clocking
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F9/00—Arrangements for program control, e.g. control units
    • G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
    • G06F9/44—Arrangements for executing specific programs
    • G06F9/455—Emulation; Interpretation; Software simulation, e.g. virtualisation or emulation of application or operating system execution engines
    • G06F9/45533—Hypervisors; Virtual machine monitors

Landscapes

  • Engineering & Computer Science (AREA)
  • Theoretical Computer Science (AREA)
  • Software Systems (AREA)
  • Physics & Mathematics (AREA)
  • General Engineering & Computer Science (AREA)
  • General Physics & Mathematics (AREA)
  • Microcomputers (AREA)
  • Executing Machine-Instructions (AREA)
  • Memory System (AREA)

Abstract

내용 없음

Description

정상 및 고속실행 모우드를 가진 퍼스널 컴퓨터
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 아키텍쳐(구조)에 대한 기능 블럭선도. 제2도, 제3도는 제1도에 도시된 본 발명의 아키텍쳐에 대한 어떤 부분에 있어서 제3도가 제2도의 우측단에 배치되고 하측단에 배치될 때를 도시하고, 8088 및 8087 마이크로프로세서 쌍과 클럭발생회로를 포함한 것을 도시하는 상세 회로도.
도면의 주요부분에 대한 부호의 설명
10:마이크로 프로세서 인텔 8086 12:공동 프로세서 인텔 8087 14:RAM 메모리 어레이 16,18:버퍼 22,24,26:어드레스 래치 28,32:데이타인 래치 30,34:데이타 아웃버퍼 38:DMA제어부 46:인터럽트 제어부 48:I/O제어부 50:DMA 어드레스 제어부 52:I/O데이타 버퍼 60:ROM 66:클록 발생기 68:요구/허가대기논리부(CPUPAL) 70:버스제어부(BSUPAL) 72:버퍼제어논리부(BUFPAL) 76:크리스탈 발진기 78:플립플롭 80,84,86:멀티플랙서 82:PCLK*플립플롭 90:MEMOAL 92:TTL 지연선 94,96:어드레스 멀티 플렉서

Claims (2)

  1. 저속 마이크로프로세서가 고속 마이크로프로세서의 소프트웨어 호환성이 있는 곳에서 상기 저속 마이크로프로세서를 위해 기록되는 응용 프로그램들을 FAST 모우드나 SLOW 모우드중 어느 하나로 실행하기 위한 모우드 선택신호에 응답하는 고속 마이크로 프로세서를 구비하는 것으로서 상기 저속 마이크로프로세서가 메모리의 첫번째 바이트들을 지닌 내부 선취를 대기행열을 구비하고 상기 고속 마이크로 프로세서가 메모리의 두번째 바이트들을 지닌 내부 선취출 대기행열을 구비하는데 상기 선취출 대기행열의 첫번째 바아트들은 선취술 대기행열의 두번째 바아트들 보다 더 적게 되어있는 퍼스널 컴퓨터에 있어서, 상기 퍼스널 컴퓨터가 (a) 복수의 바이트들로 구성된 어드레스 지정 가능한 각각의 메모리워어드 로케이션을 가진 RAM 메모리와, (b) (i) SLOW모우드에서는 클록킹 주파수가 상기 저속 마이크로 프로세서에 대한 정상 클록킹 주파수가 동일하게 하고, 그리고 (ii) FAST 모우드에서는 클록킹주파수가 저속 마이크로프로세서에 대한 정상 클록킹 주파수 보다 더 높게 하게끔, 클록킹 신호를 상기 고속 마이크로 프로세서에 발생시키기 위한 모우드 선택 신호에 응답하는 클록 발생기와, (c) SLOW 모우드에 있을 때 상기 고속 마이크로 프로세서의 대기상태를 제어하기 위한 상기 클록발생기와 모우드 선택신호에 응답하는 논리수단을 추가로 구비하여 상기 고속 마이크로프로세서로 부터 상기 RAM 메모리로 액세스 되는 모든 다른 워어드 액세스들이 어드레스 된 로케이션의 내용을 얻기 위한 동일 메모리 어드레스에 엑세스되는 2개의 연속 워어드 액세스들을 요구함으로 말미암아 상기 저속 마이크로 프로세서로 정상 실행하는 프로그램과 실질상 동일한 속도에서 상기 고속 마이크로프로세서가 상기 응용 프로그램을 실행하는 것을 특징으로 하는 정상 및 고속 실행 모우드 가진 퍼스널 컴퓨터.
  2. 제1항에 있어서, 상기 논리수단이 (a) 대기 상태를 제어하기 위하여 상기 고속 마이크로 프로세서에 제어신호를 발생하기 위한 요구/허가 대기 논리 수단과, (b) 고속 마이크로 프로세서에 대한 사이클 조작을 지시하는 제어신호를 발생하기 위한 상기 모우드 선택신호와 상기 고속 마이크로 프로세서에 응답하는 버스 콘트롤러와, (c) 상기 퍼스널 컴퓨터 내의 데이타 유동을 제어하기 위하여 인에이블 신호를 발생하기 위한 상기 버스 콘트롤러와 상기 요구/허가 대기 논리 수단에 응답하는 버퍼 제어부로 구성되는 것을 특징으로 하는 정상 및 고속실행모우드를 가진 퍼스너 컴퓨터.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019850004502A 1984-06-27 1985-06-25 정상 및 고속실행 모우드를 가진 퍼스널 컴퓨터 KR920006767B1 (ko)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
US626912 1984-06-27
US06/626,912 US4727491A (en) 1984-06-27 1984-06-27 Personal computer having normal and high speed execution modes

Publications (2)

Publication Number Publication Date
KR860000592A true KR860000592A (ko) 1986-01-29
KR920006767B1 KR920006767B1 (ko) 1992-08-17

Family

ID=24512388

Family Applications (1)

Application Number Title Priority Date Filing Date
KR1019850004502A KR920006767B1 (ko) 1984-06-27 1985-06-25 정상 및 고속실행 모우드를 가진 퍼스널 컴퓨터

Country Status (8)

Country Link
US (1) US4727491A (ko)
EP (1) EP0167853B1 (ko)
JP (1) JPS6182239A (ko)
KR (1) KR920006767B1 (ko)
CA (1) CA1232969A (ko)
DE (1) DE3581767D1 (ko)
ES (1) ES8609766A1 (ko)
MX (1) MX159550A (ko)

Families Citing this family (39)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4821229A (en) * 1985-12-12 1989-04-11 Zenith Electronics Corporation Dual operating speed switchover arrangement for CPU
EP0230960B1 (en) * 1986-01-20 1992-05-13 Nec Corporation Microcomputer having a highspeed operation mode and a low-speed operation mode
US5088033A (en) * 1986-04-28 1992-02-11 Xerox Corporation Data processing system emulation in a window with a coprocessor and I/O emulation
US5426767A (en) * 1987-08-03 1995-06-20 Compaq Computer Corporation Method for distinguishing between a 286-type central processing unit and a 386-type central processing unit
US5483659A (en) * 1987-09-14 1996-01-09 Yamamura; Kimio Apparatus for controlling a signal processing system to operate in high and low speed modes
US5305452A (en) * 1987-10-23 1994-04-19 Chips And Technologies, Inc. Bus controller with different microprocessor and bus clocks and emulation of different microprocessor command sequences
US5237676A (en) * 1989-01-13 1993-08-17 International Business Machines Corp. High speed data transfer system which adjusts data transfer speed in response to indicated transfer speed capability of connected device
US5109490A (en) * 1989-01-13 1992-04-28 International Business Machines Corporation Data transfer using bus address lines
US5113511A (en) * 1989-06-02 1992-05-12 Atari Corporation System for dynamically providing predicted high/slow speed accessing memory to a processing unit based on instructions
US5220651A (en) * 1989-10-11 1993-06-15 Micral, Inc. Cpu-bus controller for accomplishing transfer operations between a controller and devices coupled to an input/output bus
US5423021A (en) * 1989-11-03 1995-06-06 Compaq Computer Corporation Auxiliary control signal decode using high performance address lines
US5241681A (en) * 1989-11-03 1993-08-31 Compaq Computer Corporation Computer system having an internal cach microprocessor slowdown circuit providing an external address signal
JP2676966B2 (ja) * 1990-03-16 1997-11-17 日本電気株式会社 シングルチップマイクロコンピュータ
US5313621A (en) * 1990-05-18 1994-05-17 Zilog, Inc. Programmable wait states generator for a microprocessor and computer system utilizing it
US5247636A (en) * 1990-05-31 1993-09-21 International Business Machines Corporation Digital processor clock circuit
US5206944A (en) * 1990-06-07 1993-04-27 The United States Of America As Represented By The Secretary Of The Air Force High speed analog to digital converter board for an IBM PC/AT
JPH04130510A (ja) * 1990-09-21 1992-05-01 Hitachi Ltd 情報処理装置の省電力方式
US5935253A (en) * 1991-10-17 1999-08-10 Intel Corporation Method and apparatus for powering down an integrated circuit having a core that operates at a speed greater than the bus frequency
US5842029A (en) * 1991-10-17 1998-11-24 Intel Corporation Method and apparatus for powering down an integrated circuit transparently and its phase locked loop
GB2260631B (en) * 1991-10-17 1995-06-28 Intel Corp Microprocessor 2X core design
US5254888A (en) * 1992-03-27 1993-10-19 Picopower Technology Inc. Switchable clock circuit for microprocessors to thereby save power
US6343363B1 (en) 1994-09-22 2002-01-29 National Semiconductor Corporation Method of invoking a low power mode in a computer system using a halt instruction
JPH0581158U (ja) * 1992-04-06 1993-11-02 昭和電線電纜株式会社 テープ供給装置
US5537660A (en) * 1992-04-17 1996-07-16 Intel Corporation Microcontroller having selectable bus timing modes based on primary and secondary clocks for controlling the exchange of data with memory
US5485594A (en) * 1992-07-17 1996-01-16 International Business Machines Corporation Apparatus and method using an atomic fetch and add for establishing temporary ownership of a common system resource in a multiprocessor data processing system
US5473767A (en) * 1992-11-03 1995-12-05 Intel Corporation Method and apparatus for asynchronously stopping the clock in a processor
US5325491A (en) * 1993-04-13 1994-06-28 International Business Machines Corporation Method and apparatus for extending a computer bus
JPH07129456A (ja) * 1993-10-28 1995-05-19 Toshiba Corp コンピュータシステム
US5680556A (en) * 1993-11-12 1997-10-21 International Business Machines Corporation Computer system and method of operation thereof wherein a BIOS ROM can be selectively locatable on diffeent buses
IL110181A (en) * 1994-06-30 1998-02-08 Softchip Israel Ltd Install microprocessor and peripherals
US5623274A (en) * 1995-02-17 1997-04-22 Onspec Electronic, Inc. Front-panel indicator using a serial link for a PC
US5710892A (en) * 1995-07-19 1998-01-20 International Business Machines Corporation System and method for asynchronous dual bus conversion using double state machines
US5802132A (en) 1995-12-29 1998-09-01 Intel Corporation Apparatus for generating bus clock signals with a 1/N characteristic in a 2/N mode clocking scheme
US5794011A (en) * 1996-07-19 1998-08-11 Unisys Corporation Method of regulating the performance of an application program in a digital computer
US5805907A (en) * 1996-10-04 1998-09-08 International Business Machines Corporation System and method for reducing power consumption in an electronic circuit
US6314471B1 (en) * 1998-11-13 2001-11-06 Cray Inc. Techniques for an interrupt free operating system
US6611893B1 (en) * 1999-12-29 2003-08-26 Agere Systems Inc. Data bus method and apparatus providing variable data rates using a smart bus arbiter
DE602004029729D1 (de) * 2003-08-07 2010-12-02 Panasonic Corp Integrierte Prozessorschaltung mit mehreren Prozessoren welche lokale Speicher haben sowie Mittel um DMA-Zugriffe auf diese Speicher zu synchronisieren
JP4397858B2 (ja) * 2005-06-27 2010-01-13 株式会社ソニー・コンピュータエンタテインメント エミュレート装置及びエミュレート方法

Family Cites Families (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US3974479A (en) * 1973-05-01 1976-08-10 Digital Equipment Corporation Memory for use in a computer system in which memories have diverse retrieval characteristics
US3984812A (en) * 1974-04-15 1976-10-05 Burroughs Corporation Computer memory read delay
US4180854A (en) * 1977-09-29 1979-12-25 Hewlett-Packard Company Programmable calculator having string variable editing capability
US4218754A (en) * 1978-03-29 1980-08-19 Data Printer Corporation Control of high speed printer by low speed microprocessor
US4366540A (en) * 1978-10-23 1982-12-28 International Business Machines Corporation Cycle control for a microprocessor with multi-speed control stores
JPS5840214B2 (ja) * 1979-06-26 1983-09-03 株式会社東芝 計算機システム
US4435757A (en) * 1979-07-25 1984-03-06 The Singer Company Clock control for digital computer
JPS578849A (en) * 1980-06-18 1982-01-18 Fujitsu Ltd Adjusting system for instruction execution speed

Also Published As

Publication number Publication date
EP0167853A2 (en) 1986-01-15
JPS6359172B2 (ko) 1988-11-18
EP0167853A3 (en) 1987-02-25
ES544050A0 (es) 1986-07-16
CA1232969A (en) 1988-02-16
KR920006767B1 (ko) 1992-08-17
MX159550A (es) 1989-06-30
EP0167853B1 (en) 1991-02-20
DE3581767D1 (de) 1991-03-28
ES8609766A1 (es) 1986-07-16
US4727491A (en) 1988-02-23
JPS6182239A (ja) 1986-04-25

Similar Documents

Publication Publication Date Title
KR860000592A (ko) 정상 및 고속실행 모우드를 가진 퍼스널 컴퓨터
EP0426329B1 (en) Combined synchronous and asynchronous memory controller
US5737604A (en) Method and apparatus for independently resetting processors and cache controllers in multiple processor systems
US6463529B1 (en) Processor based system with system wide reset and partial system reset capabilities
KR950013257B1 (ko) 데이타 처리 시스템
US5303364A (en) Paged memory controller
US5870602A (en) Multi-processor system with system wide reset and partial system reset capabilities
KR960706658A (ko) 집적 메모리 시스템을 위한 그래픽 경로와 시스템 경로의 버스 인터페이스(a bus interface with graphics and system paths for an integrated memory system)
KR940012146A (ko) Cpu와 승산기를 갖는 반도체집적회로
US5625847A (en) High-speed ISA bus control system for changing command cycle execution speed by selectively using ISA bus controller and high-speed bus controller
KR930009768B1 (ko) 슬리프기능을 갖춘 컴퓨터 시스템 및 그 제어방법
US5481728A (en) Data processor having circuitry for high speed clearing of an interrupt vector register corresponding to a selected interrupt request
EP0290730A2 (en) Data transfer apparatus and method for use in a data processing system
KR960007833B1 (ko) 고속 페이지 모드 선택을 위한 방법 및 장치
JPH04323691A (ja) 表示制御装置
JPS6465617A (en) Logic circuit and computer
JPH07129462A (ja) メモリ制御装置
KR0149687B1 (ko) 멀티프로세서 시스템의 공통메모리 억세스 제어회로
KR960018958A (ko) 다중 프로세서 시스템에서 아토믹 명령어 수행시 데이타 버퍼를 사용한 메인 메모리 액세스 장치
KR100213801B1 (ko) 인터럽트 발생 회로
US5802548A (en) Software programmable edge delay for SRAM write enable signals on dual purpose cache controllers
KR930023840A (ko) 프로토콜이 개선된 시스템 버스 및 그것의 요청기 제어방법
KR930010727A (ko) 컴퓨터 시스템의 dma 어드레스 확장장치
JPH03282667A (ja) コンピュータ装置
JPH04343132A (ja) 中央演算処理装置

Legal Events

Date Code Title Description
A201 Request for examination
G160 Decision to publish patent application
E701 Decision to grant or registration of patent right
GRNT Written decision to grant
FPAY Annual fee payment

Payment date: 20040809

Year of fee payment: 13

EXPY Expiration of term