KR840003080A - 확장정수명령의 마이크로 프로그램제어 - Google Patents

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KR840003080A KR1019820005399A KR820005399A KR840003080A KR 840003080 A KR840003080 A KR 840003080A KR 1019820005399 A KR1019820005399 A KR 1019820005399A KR 820005399 A KR820005399 A KR 820005399A KR 840003080 A KR840003080 A KR 840003080A
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Abstract

내용 없음

Description

확장정수명령의 마이크로 프로그램제어
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 장치가 포함하는 시스템전체의 블럭다이아그램.
제2도는 본 발명의 중앙처리장치에 대한 상세한 블럭다이아그램.
제3도는 본 발명의 중앙처리장치에 있는 연산논리장치와의 상세한 접속도.

Claims (5)

  1. 명령과 오펴랜드를 저장하는 메모리부분 시스템과 상기 부분시스템으로 부터 상기 명령과 오퍼랜드를 받아서 상기 명령을 수행하는 중앙처리장치(CPU)를 포함하는 데이타처리 시스템에 있어서, 상기 명령중의 하나는 첫번째 워어드와 두번째워어드를 포함하고, 상기 첫번째워어드는 상기(CPU)가 수행할 명령중의 하나를 식별하기 위한 동작코우드와 확장 정수명령(EII)와 상업명령처리(CIP)명령을 포함하는 일종의 명령을 식별하기 위한 도피코우드를 포함하며, 상기 두번째 워어드는 상기 도피코우드와 관련해서 실효애드레스를 발생하는 애드레스 음절난과 동작코우드를 식별하기 위한 데이타종류난을 포함하며, 상기CPU는 제어저장수단,레지스터, ROM및 다중기로 구성되며, 상기 제어저장장치는 복수개의 마이크로워어드를 저장하기 위한 장소를 갖고, 상기 CPU의 동작을 제어하기 위해 상기 복수개의 마이크로 워어드 각각에 대한 복수개의 제어저장신호를 발생하며; 상기 레지스터는 상기 데이타종류난을 나타내는 신호들을 저장하기 위해 첫번째 상기 제어저장 신호들에 응답하고; 상기 ROM장치는 첫번째 동작 코우드, 첫번째 제어저장신호와 두번째 제어저장신호, 그리고 상기 데이타종류난 신호들에 복수개의 오퍼랜드 크기신호들을 발생하기 위해서 응답하고; 상기 다중기는 상기 복수개의 오퍼랜드크기 신호들중에서 선택된 하나를 나타내는 검사신호를 발생시키기 위해서 상기 복수개의 오퍼랜드 크기신호들과 두번째 복수개의 상기 제어저장신호에 응답하고; 상기 제어저장장치는 또한 상기 검사신호에 따라 상기 복수개의 제어저장신호들의 다음신호를 발생시키기 위해 상기 복수개의 마이크로워어드 중의 상기 하나의 다음 마이크로워어드를 저장하는 장소로 브랜치하는 것을 특징으로 하는 데이타처리시스템.
  2. 제1항에 있어서, ROM을 포함하는 프로세서의 상기 ROM은 복수개의 입력애드레스 단자와 인에이블단자를 갖으며, 상기 인에이블 단자는 상기 ROM을 인에이블시키기 위해 상기 EII와 CIP명령을 나타내는 3번째 제어저장신호에 응답하고; 상기 입력 애드레스 단자는 상기 EII오퍼랜드를 표현하는 상기 복수개의 오퍼랜드크기신호를 발생시키기위해 EII오퍼랜드를 나타내는 첫번째 상태에서 상기 데이타종류난 신호와 상기 첫번째 동작 코우드신호에 응답하고, 상기 CIP명령 오퍼랜드를 표현하는 상기 복수개의 오퍼랜드 신호를 발생시키기 위해 상기 데이타 종류난 신호와 CIP명령 오퍼랜드를 나타내는 두번째 상태에서 상기 첫번째 동작 코우드신호에 응답하는 것을 특징으로 하는 데이타처리시스템.
  3. 제2항에 있어서 프로세서의 상기 ROM입력 애드레스 단자들은 상기 메모리에 저장되어 있는 상기 오펴랜드를 나타내는 첫번째 상태에서 4번째 제어저장신호에 응답하고, 복수개의 레지스터에 저장되어 있는 상기 오퍼랜드를 나타내는 두번째 상태에서 상기 4번째 제어저장신호에 응답한다. 그리고 상기 오퍼랜드크기 신호들을 발생하기 위해 상기 데이타종류난 신호에 응답하는 것을 특징으로 하는 데이타처리시스템.
  4. 제3항에 있어서 프로세서의 상기 ROM입력 애드레스 단자는 상기 두번째 상태에서 상기4번째 제어저장신호에, 첫번째 상태에서 5번째 제어저장신호에 그리고 상기 데이타종류난 신호에 대해 첫번째 레지스터에 저장되어 있는 상기 오퍼랜드의 크기를 나타내는 상기 오퍼랜드 크기 신호를 발생하기 위해 응답하는 것을 특징으로하는 데이타처리시스템.
  5. 제4항에 있어서 프로세서의 상기 ROM입력애드레스 단자는 두번째레지스터에 저장되어 있는 상기 오퍼랜드의 크기를 나타내는 상기 오퍼랜드크기신호를 발생시키기 위해 상기 두번째 상태에서 상기 4번째 제어저장신호에, 두번째 상태에서 5번째 제어저장신호에 그리고 상기 데이타 종류난 신호에 응답하는 것을 특징으로 하는 데이타처리시스템.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR8205399A 1981-12-01 1982-12-01 데이타 처리 시스템 KR880000340B1 (ko)

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