KR20220009897A - 반도체 장치의 제조 방법, 기판 처리 방법, 기판 처리 장치, 및 프로그램 - Google Patents
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Abstract
Description
도 2는 본 개시의 일 양태에서 적합하게 사용되는 기판 처리 장치의 종형 처리로의 개략 구성도이며, 처리로(202) 부분을 도 1의 A-A선 단면도로 도시하는 도면이다.
도 3은 본 개시의 일 양태에서 적합하게 사용되는 기판 처리 장치의 컨트롤러(121)의 개략 구성도이며, 컨트롤러(121)의 제어계를 블록도로 도시하는 도면이다.
도 4는 본 개시의 일 양태에서의 에칭 처리의 가스 공급 시퀀스를 도시하는 도면이다.
도 5의 (a)는 표면에 하지(200a)가 노출된 웨이퍼(200)에 대하여 제1 가스(10)가 공급되어, 하지(200a)의 표면에 제1 가스(10)가 흡착해서 제1 개질층(200b)이 형성된 상태의 웨이퍼(200)에서의 단면 부분 확대도이다. 도 5의 (b)는 제1 개질층(200b)이 형성된 웨이퍼(200)에 대하여 제2 가스(20)가 공급된 상태의 웨이퍼(200)에서의 단면 부분 확대도이다. 도 5의 (c)는 제2 가스(20)에 의해 제1 개질층(200b)이 활성화되고, 에칭종(200c)이 생성된 상태의 웨이퍼(200)에서의 단면 부분 확대도이다. 도 5의 (d)는 에칭종(200c)에 의해 하지(200a)의 표면의 일부가 에칭되어, 에칭 시에 제1 생성물(12)과 제2 생성물(14)이 생성된 상태의 웨이퍼(200)에서의 단면 부분 확대도이다. 도 5의 (e)는 표면의 일부가 에칭된 하지(200a)의 표면에서의 제1 생성물(12) 및 제2 생성물(14)의 거동을 나타내는 웨이퍼(200)에서의 단면 부분 확대도이다. 도 5의 (f)는 제2 생성물(14)이 표면의 일부가 에칭된 하지(200a)의 표면에 잔류 및/또는 흡착된 상태의 웨이퍼(200)에서의 단면 부분 확대도이다. 도 5 (g)는 제2 생성물(14)과, 제2 가스(20)와, 표면의 일부가 에칭된 하지(200a) 중 적어도 어느 것이 반응하여, 표면의 일부가 에칭된 하지(200a)의 표면에 제2 개질층(200d)이 형성된 상태의 웨이퍼(200)에서의 단면 부분 확대도이다. 도 5의 (h)는 표면의 일부가 에칭된 하지(200a)의 표면에 제2 개질층(200d)이 형성된 웨이퍼(200)에 대하여 제1 가스(10)가 공급되어, 제2 개질층(200d)의 표면에 제1 가스가 흡착된 상태의 웨이퍼(200)에서의 단면 부분 확대도이다. 도 5의 (i)는 제1 가스(10)와 제2 개질층(200d)이 반응하여, 표면의 일부가 에칭된 하지(200a)의 표면에 생성물(30)이 생성된 상태의 웨이퍼(200)에서의 단면 부분 확대도이다. 도 5의 (j)는 표면의 일부가 에칭된 하지(200a)의 표면에서 생성된 생성물(30)이 하지(200a)의 표면으로부터 탈리한 상태의 웨이퍼(200)에서의 단면 부분 확대도이다. 도 5의 (k)는 표면의 일부가 에칭된 하지(200a)의 표면의 생성물(30)이 탈리한 후, 표면의 일부가 에칭된 하지(200a)의 표면이 다시 노출된 상태의 웨이퍼(200)에서의 단면 부분 확대도이다.
도 6은 참고예 1에서의 에칭 레이트의 측정 결과를 도시하는 도면이다.
도 7은 참고예 2에서의 에칭 레이트의 측정 결과를 도시하는 도면이다.
도 8은 실시예에서의 에칭 레이트의 측정 결과를 도시하는 도면이다.
도 9의 (a)는 표면에 하지(200a) 및 하지(200e)가 노출된 웨이퍼(200)에 대하여 에칭 처리를 행하기 전의 상태의 웨이퍼(200)에서의 단면 부분 확대도이다. 도 9의 (b)는 표면에 하지(200a) 및 하지(200e)가 노출된 웨이퍼(200)에 대하여 에칭 처리를 행한 경우의 에칭 처리의 도중 상태의 웨이퍼(200)에서의 단면 부분 확대도이다. 도 9의 (c)는 표면에 하지(200a) 및 하지(200e)가 노출된 웨이퍼(200)에 대하여 에칭 처리를 행한 후의 상태의 웨이퍼(200)에서의 단면 부분 확대도이다.
Claims (23)
- (a) 기판에 대하여 제1 가스를 공급함으로써, 상기 기판의 표면에 노출된 제1막의 표면의 적어도 일부에 제1 개질층을 형성하는 공정과,
(b) 상기 기판에 대하여 상기 제1 가스와는 분자 구조가 다른 제2 가스를 공급함으로써, 상기 제2 가스와 상기 제1 개질층을 반응시키는 것, 및 상기 제2 가스에 의해 상기 제1 개질층을 활성화시키는 것 중 적어도 한쪽에서 에칭종을 생성하여, 이 에칭종에 의해 상기 제1막의 적어도 일부를 에칭하는 공정
을 비동시에 행하는 사이클을 소정 횟수 행함으로써, 상기 제1막을 에칭하는 반도체 장치의 제조 방법. - 제1항에 있어서, (a)에서는, 상기 제1 가스의 분자의 적어도 일부를, 상기 제1막의 표면의 적어도 일부에 물리 흡착 또는 화학 흡착시켜서 상기 제1 개질층을 형성하는, 반도체 장치의 제조 방법.
- 제1항에 있어서, (a)에서는, 상기 제1 가스의 분자의 적어도 일부와, 상기 제1막의 표면의 적어도 일부의 원자 또는 분자의 화학 반응에 의해 화합물을 생성시켜서 상기 제1 개질층을 형성하는, 반도체 장치의 제조 방법.
- 제1항에 있어서, (b)에서는, 상기 제2 가스와 상기 제1 개질층의 반응이, 상기 제2 가스와 상기 제1막의 반응보다도 지배적으로 발생하는 조건 하에서, 상기 기판에 대하여 상기 제2 가스를 공급하는, 반도체 장치의 제조 방법.
- 제1항에 있어서, (b)에서는, 상기 제2 가스와 상기 제1 개질층의 반응이 진행되고, 상기 제2 가스와 상기 제1막의 반응이 진행되지 않는 조건 하에서, 상기 기판에 대하여 상기 제2 가스를 공급하는, 반도체 장치의 제조 방법.
- 제1항에 있어서, (b)에서는, 상기 제2 가스에 의한 상기 제1 개질층의 활성화가, 상기 제2 가스에 의한 상기 제1막의 활성화보다도 지배적으로 되는 조건 하에서, 상기 기판에 대하여 상기 제2 가스를 공급하는, 반도체 장치의 제조 방법.
- 제1항에 있어서, (b)에서는, 상기 제2 가스에 의한 상기 제1 개질층의 활성화가 진행되고, 상기 제2 가스에 의한 상기 제1막의 활성화가 진행되지 않는 조건 하에서, 상기 기판에 대하여 상기 제2 가스를 공급하는, 반도체 장치의 제조 방법.
- 제1항에 있어서, (b)에서는, 상기 에칭종에 의한 상기 제1막의 적어도 일부의 에칭이, 상기 제2 가스와 상기 제1막의 반응보다도 지배적으로 발생하는 조건 하에서, 상기 기판에 대하여 상기 제2 가스를 공급하는, 반도체 장치의 제조 방법.
- 제1항에 있어서, (b)에서는, 상기 에칭종에 의한 상기 제1막의 적어도 일부의 에칭이 진행되고, 상기 제2 가스와 상기 제1막의 반응이 진행되지 않는 조건 하에서, 상기 기판에 대하여 상기 제2 가스를 공급하는, 반도체 장치의 제조 방법.
- 제1항에 있어서, (b)에서는 추가로, 적어도 일부가 에칭된 상기 제1막의 표면의 적어도 일부에 제2 개질층을 형성하는, 반도체 장치의 제조 방법.
- 제10항에 있어서, 제2 사이클 이후에 있어서의 (a)에서는, 상기 기판에 대하여 상기 제1 가스를 공급함으로써, 상기 제1 가스와 상기 제2 개질층을 반응시켜서 상기 제2 개질층을 제거하고, 상기 제2 개질층이 제거된 상기 제1막의 표면의 적어도 일부에 상기 제1 개질층을 형성하는, 반도체 장치의 제조 방법.
- 제1항에 있어서, 상기 제1막은, 질소 함유막, 전이 금속막 또는 반도체막을 포함하는, 반도체 장치의 제조 방법.
- 제1항에 있어서, 상기 기판의 표면에는 추가로, 제2막이 노출되어 있고,
상기 사이클을 소정 횟수 행함으로써, 상기 제2막에 대하여 상기 제1막을 선택적으로 에칭하는, 반도체 장치의 제조 방법. - 제13항에 있어서, 상기 제1막은, 질소 함유막, 전이 금속막 또는 반도체막을 포함하고, 상기 제2막은, 산소 함유막 또는 비전이 금속막을 포함하는, 반도체 장치의 제조 방법.
- 제14항에 있어서, 상기 질소 함유막은, 실리콘계 질소 함유막, 보론계 질소 함유막 또는 금속계 질소 함유막을 포함하는, 반도체 장치의 제조 방법.
- 제14항에 있어서, 상기 산소 함유막은, 실리콘계 산소 함유막 또는 금속계 산소 함유막을 포함하는, 반도체 장치의 제조 방법.
- 제13항에 있어서, 상기 사이클을 소정 횟수 행함으로써, 상기 제1막을 상기 제2막에 대하여 5:1 이상의 선택성으로 에칭하는, 반도체 장치의 제조 방법.
- 제1항에 있어서, 상기 제1 가스는, 실리콘 함유 가스, 금속 함유 가스, 산소 함유 가스, 질소 및 수소 함유 가스, 보론 함유 가스, 인 함유 가스, 할로겐 함유 가스 중 1개 이상을 포함하고,
상기 제2 가스는, 할로겐 함유 가스, 아세틸아세톤계 가스 중 1개 이상을 포함하는, 반도체 장치의 제조 방법. - 제1항에 있어서, 논 플라스마의 분위기 하에서 상기 사이클을 소정 횟수 행하는, 반도체 장치의 제조 방법.
- 제1항에 있어서, 상기 제1 가스 및 상기 제2 가스 중 적어도 어느 것이 단독으로 존재한 경우에, 상기 제1막의 에칭 반응이 계속적으로 진행되기 어려운 조건 하에서, 상기 사이클을 소정 횟수 행하는, 반도체 장치의 제조 방법.
- (a) 기판에 대하여 제1 가스를 공급함으로써, 상기 기판의 표면에 노출된 제1막의 표면의 적어도 일부에 제1 개질층을 형성하는 공정과,
(b) 상기 기판에 대하여 상기 제1 가스와는 분자 구조가 다른 제2 가스를 공급함으로써, 상기 제2 가스와 상기 제1 개질층을 반응시키는 것, 및 상기 제2 가스에 의해 상기 제1 개질층을 활성화시키는 것 중 적어도 한쪽에서 에칭종을 생성하여, 이 에칭종에 의해 상기 제1막의 적어도 일부를 에칭하는 공정
을 비동시에 행하는 사이클을 소정 횟수 행함으로써, 상기 제1막을 에칭하는 기판 처리 방법. - 기판이 처리되는 처리실과,
상기 처리실 내의 기판에 대하여 제1 가스를 공급하는 제1 가스 공급계와,
상기 처리실 내의 기판에 대하여 상기 제1 가스와는 분자 구조가 다른 제2 가스를 공급하는 제2 가스 공급계와,
상기 처리실 내의 기판의 온도를 조정하는 온도 조정기와,
상기 처리실 내에서, (a) 기판에 대하여 상기 제1 가스를 공급함으로써, 상기 기판의 표면에 노출된 제1막의 표면의 적어도 일부에 제1 개질층을 형성하는 처리와, (b) 상기 기판에 대하여 상기 제2 가스를 공급함으로써, 상기 제2 가스와 상기 제1 개질층을 반응시키는 것, 및 상기 제2 가스에 의해 상기 제1 개질층을 활성화시키는 것 중 적어도 한쪽에서 에칭종을 생성하여, 이 에칭종에 의해 상기 제1막의 적어도 일부를 에칭하는 처리를 비동시에 행하는 사이클을 소정 횟수 행함으로써, 상기 제1막을 에칭하는 처리를 행하게 하도록, 상기 제1 가스 공급계, 상기 제2 가스 공급계 및 상기 온도 조정기를 제어하는 것이 가능하게 구성되는 제어부
를 갖는 기판 처리 장치. - 기판 처리 장치의 처리실 내에 있어서,
(a) 기판에 대하여 제1 가스를 공급함으로써, 상기 기판의 표면에 노출된 제1막의 표면의 적어도 일부에 제1 개질층을 형성하는 수순과,
(b) 상기 기판에 대하여 상기 제1 가스와는 분자 구조가 다른 제2 가스를 공급함으로써, 상기 제2 가스와 상기 제1 개질층을 반응시키는 것, 및 상기 제2 가스에 의해 상기 제1 개질층을 활성화시키는 것 중 적어도 한쪽에서 에칭종을 생성하여, 이 에칭종에 의해 상기 제1막의 적어도 일부를 에칭하는 수순
을 비동시에 행하는 사이클을 소정 횟수 행함으로써, 상기 제1막을 에칭하는 수순을 컴퓨터에 의해 상기 기판 처리 장치에 실행시키는, 컴퓨터 판독 가능한 기록 매체에 기록된 프로그램.
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