KR20180038618A - 표시 장치 - Google Patents

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Abstract

표시 장치는 표시 영역, 및 상기 표시 영역의 변에서 연장된 형상을 가지고 서로 이격되는 복수의 서브 비표시 영역들을 구비하는 비표시 영역을 포함하는 기판; 상기 표시 영역에서 상기 기판의 일면 상에 제공되고, 복수의 화소들을 포함하는 표시층; 및 상기 기판 상의 상기 서브 비표시 영역들에 제공되고, 상기 화소들에 전기적으로 연결되는 배선들을 포함할 수 있다. 상기 서브 비표시 영역들은 상기 표시 영역에 연결되는 표시 연결 영역; 및 상기 표시 연결 영역의 일부에서 연장된 형상을 가지는 적어도 하나의 연장 영역을 포함할 수 있다. 여기서, 상기 서브 비표시 영역들은 벤딩되어 상기 표시 영역에서 상기 표시층이 배치된 면의 반대 방향 면 상에 배치되고, 상기 서브 비표시 영역들이 벤딩되면, 서로 인접하는 서브 비표시 영역들 중 하나의 연장 영역은 다른 하나의 연장 영역와 중첩될 수 있다.

Description

표시 장치{DISPLAY DEVICE}
본 발명은 표시 장치에 관한 것이다.
일반적으로 유기 발광 표시 장치는 다수의 화소들을 포함하는 표시 영역, 상기 표시 영역로 구동 신호를 공급하는 구동 회로들, 및 상기 화소부로 화소 전원을 공급하는 전원 공급 회로를 포함한다.
상기 화소들은 각각 스캔 신호가 공급될 때, 상기 스캔 신호와 동기되어 공급되는 데이터 신호에 대응하는 휘도의 빛을 방출한다.
또한, 상기 유기 발광 표시 장치에서, 상기 화소들의 발광 휘도는 화소 전원의 전압에도 영향을 받는다. 상기 화소 전원은 데이터 신호와 더불어 화소들의 발광 휘도를 결정한다. 따라서, 유기 발광 표시 장치가 균일한 화질의 영상을 표시하기 위해서는 상기 화소들로 동일한 전압을 갖는 상기 화소 전원이 공급되어야 한다.
본 발명의 일 목적은 균일하게 공급되는 화소 전원을 통해 균일한 화질의 영상을 표시할 수 있는 표시 장치를 제공하는 것이다.
본 발명의 일 실시예에 따른 표시 장치는 표시 영역, 및 상기 표시 영역의 변에서 연장된 형상을 가지고 서로 이격되는 복수의 서브 비표시 영역들을 구비하는 비표시 영역을 포함하는 기판; 상기 표시 영역에서 상기 기판의 일면 상에 제공되고, 복수의 화소들을 포함하는 표시층; 및 상기 기판 상의 상기 서브 비표시 영역들에 제공되고, 상기 화소들에 전기적으로 연결되는 배선들을 포함할 수 있다. 상기 서브 비표시 영역들은 상기 표시 영역에 연결되는 표시 연결 영역; 및 상기 표시 연결 영역의 일부에서 연장된 형상을 가지는 적어도 하나의 연장 영역을 포함할 수 있다. 여기서, 상기 서브 비표시 영역들은 벤딩되어 상기 표시 영역에서 상기 표시층이 배치된 면의 반대 방향 면 상에 배치되고, 상기 서브 비표시 영역들이 벤딩되면, 서로 인접하는 서브 비표시 영역들 중 하나의 연장 영역은 다른 하나의 연장 영역와 중첩될 수 있다.
상기 연장 영역에 제공되고, 상기 배선들과 전기적으로 연결되는 연결 단자를 더 포함할 수 있다.
상기 서브 비표시 영역들은 서로 이격되는 두 개의 연장 영역들을 포함할 수 있다.
중첩하는 연장 영역들 중 하나의 연장 영역의 상기 연결 단자는 다른 하나의 연장 영역의 상기 연결 단자와 마주하고 전기적으로 연결될 수 있다.
상기 하나의 연장 영역의 상기 연결 단자는 상기 기판의 상기 배선들이 배치되는 면 상에 제공되고, 상기 다른 하나의 연장 영역의 상기 연결 단자는 상기 기판의 상기 배선들이 배치되는 면의 반대 방향 면 상에 제공될 수 있다.
상기 다른 하나의 연장 영역의 상기 연결 단자는 상기 기판을 관통하는 콘택 홀을 통해 상기 배선들과 전기적으로 연결될 수 있다.
상기 중첩하는 연장 영역들의 상기 연결 단자는 상기 기판의 상기 배선들이 배치되는 면 상에 제공되고, 상기 하나의 연장 영역은 절곡되며, 상기 하나의 연장 영역의 상기 연결 단자가 다른 하나의 연장 영역의 상기 연결 단자와 마주하고 전기적으로 연결될 수 있다.
상기 하나의 연장 영역은 상기 연결 단자를 커버하고 내부 공간을 제공하는 하우징을 구비하며, 상기 다른 하나의 연장 영역은 상기 내부 공간에 삽입될 수 있다.
상기 연결 단자들 사이에 배치되고, 이방성 도전 필름 또는 이방성 도전 접착제 중 하나를 포함하는 도전 부재를 더 포함할 수 있다.
서로 인접하는 서브 비표시 영역들의 배선은 전기적으로 연결될 수 있다.
상기 서브 비표시 영역들 중 적어도 하나와 연결되고, 상기 배선들에 신호를 인가하는 회로 기판을 더 포함할 수 있다.
상기 신호는 상기 화소들에 공급되는 화소 전원일 수 있다.
본 발명의 일 실시예에 따른 표시 장치는 표시 영역, 및 상기 표시 영역의 변에서 연장된 형상을 가지고 서로 이격된 복수의 서브 비표시 영역들을 구비하는 비표시 영역을 포함하는 기판; 상기 표시 영역에서 상기 기판의 일면 상에 제공되고, 복수의 화소들을 포함하는 표시층; 상기 기판 상의 상기 서브 비표시 영역들에 제공되고, 상기 화소들에 전기적으로 연결되는 배선들; 및 상기 서브 비표시 영역들 중 적어도 하나와 연결되고, 상기 배선들에 신호를 인가하는 적어도 하나의 회로 기판을 포함할 수 있다. 상기 서브 비표시 영역들은 상기 표시 영역에 접하는 표시 연결 영역; 및 상기 표시 연결 영역의 일부에서 연장된 형상을 가지는 적어도 하나의 연장 영역을 포함하고, 상기 서브 비표시 영역들은 벤딩되어 상기 표시 영역에서 상기 표시층이 배치된 면의 반대 방향 면 상에 배치되고, 상기 서브 비표시 영역들이 벤딩되면, 상기 배선들은 전기적으로 연결될 수 있다.
상기 연장 영역에 제공되고, 상기 배선들과 전기적으로 연결되는 연결 단자를 더 포함하고, 상기 표시 연결 영역은 일변이 상기 표시 영역에 접하는 사각 형상을 가질 수 있다.
상기 연장 영역은 상기 표시 연결 영역의 상기 일변에 마주하는 변에서 연장된 형상을 가질 수 있다.
상기 연장 영역은 상기 회로 기판에 직접 연결될 수 있다.
상기 서브 비표시 영역들은 상기 표시 연결 영역의 상기 일변의 양단에 접하는 변들 각각에서 연장된 형상을 가지는 두 개의 연장 영역들을 포함할 수 있다.
상기 표시 영역은 사각 형상을 가지고, 상기 비표시 영역은 상기 표시 영역의 각 변에서 연장된 형상을 가지는 제1 서브 비표시 영역, 제2 서브 비표시 영역, 제3 서브 비표시 영역 및 제4 서브 비표시 영역을 포함할 수 있다. 상기 서브 비표시 영역들 중 상기 제1 서브 비표시 영역은 상기 회로 기판에 연결되고, 상기 표시 연결 영역의 상기 일변의 양단에 접하는 변들 각각에서 연장된 형상을 가지는 두 개의 상기 연장 영역들을 구비할 수 있다. 상기 제3 서브 비표시 영역은 상기 제1 서브 비표시 영역와 마주하고, 상기 회로 기판에 연결되는 상기 표시 연결 영역의 상기 일변에 마주하는 변에서 연장된 형상을 가지는 적어도 하나의 상기 연장 영역을 구비할 수 있다. 상기 제3 서브 비표시 영역의 상기 연장 영역은 상기 회로 기판에 연결될 수 있다.
상기 제2 서브 비표시 영역 및 상기 제4 서브 비표시 영역은 상기 서브 비표시 영역들의 벤딩시 상기 제1 서브 비표시 영역의 상기 연장 영역들 중 하나와 중첩하는 하나의 연장 영역을 구비할 수 있다.
상술한 바와 같은 표시 장치는 표시 영역의 화소들로 균일한 화소 전원을 공급할 수 있다. 따라서, 상기 표시 장치는 균일한 화질의 영상을 표시할 수 있다.
또한, 상기 표시 장치는 비표시 영역이 상기 표시 영역의 배면으로 벤딩되므로, 비표시 영역의 노출되는 면적을 최소화할 수 있다.
도 1은 본 발명의 일 실시예에 따른 표시 장치를 설명하기 위한 블럭도이다.
도 2는 본 발명의 일 실시예에 따른 표시 장치를 설명하기 위한 평면도이다.
도 3은 도 2의 I-I' 라인에 따른 단면도이다.
도 4는 도 2의 II-II' 라인에 따른 단면도이다.
도 5는 도 2의 EA1 영역의 확대도이다.
도 6은 도 2의 EA2 영역의 확대도이다.
도 7은 도 2의 표시 장치에서 비표시 영역이 벤딩된 상태를 설명하기 위한 평면도이다.
도 8은 도 2의 표시 장치에서 비표시 영역이 벤딩된 상태를 설명하기 위한 저면도이다.
도 9는 도 8의 III-III' 라인에 따른 단면도이다.
도 10은 도 8의 IV-IV' 라인에 따른 단면도이다.
도 11은 도 8의 EA3 영역의 확대도이다.
도 12는 도 11의 V-V' 라인에 따른 단면도이다.
도 13은 서로 인접하는 서브 비표시 영역들의 연장 영역의 연결 관계의 다른 예를 설명하기 위한 단면도이다.
도 14는 서로 인접하는 서브 비표시 영역들의 연장 영역의 연결 관계의 또 다른 예를 설명하기 위한 단면도이다.
도 15는 도 8의 EA3 영역의 확대도이다.
도 16은 도 15의 VI-VI' 라인에 따른 단면도이다.
도 17은 본 발명의 다른 실시예에 따른 표시 장치를 설명하기 위한 평면도이다.
도 18은 도 17의 EA4 영역의 확대도이다.
도 19는 도 17의 EA5 영역의 확대도이다.
도 20은 비표시 영역이 벤딩된 상태의 표시 장치를 설명하기 위한 저면도이다.
도 21은 도 20의 VII-VII' 라인에 따른 단면도이다.
도 22는 도 20의 EA6 영역의 확대도이다.
도 23은 도 22의 VIII-VIII' 라인에 따른 단면도이다.
도 24는 본 발명의 또 다른 실시예에 따른 표시 장치를 설명하기 위한 평면도이다.
도 25는 도 24의 표시 장치에서 비표시 영역이 벤딩된 상태를 설명하기 위한 저면도이다.
도 26은 도 25의 IX-IX'라인에 따른 단면도이다.
도 27은 본 발명의 또 다른 실시예에 따른 표시 장치를 설명하기 위한 평면도이다.
도 28은 도 27의 표시 장치에서 비표시 영역이 벤딩된 상태를 설명하기 위한 저면도이다.
도 29는 도 28의 X-X'라인에 따른 단면도이다.
도 30은 도 28의 XI-XI'라인에 따른 단면도이다.
본 발명은 다양한 변경을 가할 수 있고 여러 가지 형태를 가질 수 있는 바, 특정 실시예들을 도면에 예시하고 본문에 상세하게 설명하고자 한다. 그러나, 이는 본 발명을 특정한 개시 형태에 대해 한정하려는 것이 아니며, 본 발명의 사상 및 기술 범위에 포함되는 모든 변경, 균등물 내지 대체물을 포함하는 것으로 이해되어야 한다.
각 도면을 설명하면서 유사한 참조부호를 유사한 구성요소에 대해 사용하였다. 첨부된 도면에 있어서, 구조물들의 치수는 본 발명의 명확성을 위하여 실제보다 확대하여 도시한 것이다. 제1, 제2 등의 용어는 다양한 구성요소들을 설명하는데 사용될 수 있지만, 상기 구성요소들은 상기 용어들에 의해 한정되어서는 안 된다. 상기 용어들은 하나의 구성요소를 다른 구성요소로부터 구별하는 목적으로만 사용된다. 예를 들어, 본 발명의 권리 범위를 벗어나지 않으면서 제1 구성요소는 제2 구성요소로 명명될 수 있고, 유사하게 제2 구성요소도 제1 구성요소로 명명될 수 있다. 단수의 표현은 문맥상 명백하게 다르게 뜻하지 않는 한, 복수의 표현을 포함한다.
본 출원에서, "포함하다" 또는 "가지다" 등의 용어는 명세서 상에 기재된 특징, 숫자, 단계, 동작, 구성요소, 부품 또는 이들을 조합한 것이 존재함을 지정하려는 것이지, 하나 또는 그 이상의 다른 특징들이나 숫자, 단계, 동작, 구성요소, 부분품 또는 이들을 조합한 것들의 존재 또는 부가 가능성을 미리 배제하지 않는 것으로 이해되어야 한다. 또한, 층, 막, 영역, 판 등의 부분이 다른 부분 "상에" 있다고 할 경우, 이는 다른 부분 "바로 위에" 있는 경우뿐만 아니라 그 중간에 또 다른 부분이 있는 경우도 포함한다. 또한, 본 명세서에 있어서, 어느 층, 막, 영역, 판 등의 부분이 다른 부분 상(on)에 형성되었다고 할 경우, 상기 형성된 방향은 상부 방향만 한정되지 않으며 측면이나 하부 방향으로 형성된 것을 포함한다. 반대로 층, 막, 영역, 판 등의 부분이 다른 부분 "아래에" 있다고 할 경우, 이는 다른 부분 "바로 아래에" 있는 경우뿐만 아니라 그 중간에 또 다른 부분이 있는 경우도 포함한다.
이하, 첨부된 도면을 참조하여 본 발명에 따른 바람직한 실시예를 상세히 설명하기로 한다.
도 1은 본 발명의 일 실시예에 따른 표시 장치를 설명하기 위한 블럭도이다.
도 1을 참조하면, 표시 장치는 스캔 라인들(S1 내지 Sn), 발광 제어 라인들(E1 내지 En) 및 데이터 라인들(D1 내지 Dm)과 접속되도록 위치되는 화소들(140)을 포함하는 화소부(130)와, 상기 스캔 라인들(S1 내지 Sn) 및 상기 발광 제어 라인들(E1 내지 En)을 구동하기 위한 스캔 드라이버(110)와, 상기 데이터 라인들(D1 내지 Dm)을 구동하기 위한 데이터 드라이버(120)와, 상기 스캔 드라이버(110) 및 상기 데이터 드라이버(120)를 제어하기 위한 타이밍 제어부(150)와, 상기 화소들(140)에 전원을 공급하는 전원 공급부(160)를 구비할 수 있다.
상기 타이밍 제어부(150)는 외부로부터 공급되는 동기 신호들에 대응하여 데이터 구동 제어 신호(DCS) 및 스캔 구동 제어 신호(SCS)를 생성할 수 있다. 상기 타이밍 제어부(150)에서 생성된 상기 데이터 구동 제어 신호(DCS)는 상기 데이터 드라이버(120)로 공급되고, 상기 스캔 구동 제어 신호(SCS)는 상기 스캔 드라이버(110)로 공급될 수 있다. 상기 타이밍 제어부(150)는 외부로부터 공급되는 데이터(Data)를 재정렬하여 상기 데이터 드라이버(120)로 공급할 수 있다.
상기 스캔 구동 제어 신호(SCS)에는 스타트 펄스들 및 제1 클럭 신호들이 포함될 수 있다. 상기 스타트 펄스들은 스캔 신호 및 발광 제어 신호의 첫 번째 타이밍을 제어할 수 있다. 상기 제1 클럭 신호들은 상기 스타트 펄스들을 쉬프트시키기 위하여 사용될 수 있다.
상기 데이터 구동 제어 신호(DCS)에는 소스 스타트 펄스 및 제2 클럭 신호들이 포함될 수 있다. 상기 소스 스타트 펄스는 상기 데이터의 샘플링 시작 시점을 제어할 수 있다. 상기 제2 클럭 신호들은 샘플링 동작을 제어하기 위하여 사용될 수 있다.
상기 스캔 드라이버(110)는 상기 타이밍 제어부(150)로부터 상기 스캔 구동 제어 신호(SCS)를 공급받을 수 있다. 상기 스캔 구동 제어 신호(SCS)를 공급받은 상기 스캔 드라이버(110)는 스캔 라인들(S1 내지 Sn)로 상기 스캔 신호를 공급할 수 있다. 일례로, 상기 스캔 드라이버(110)는 상기 스캔 라인들(S1 내지 Sn)로 상기 스캔 신호를 순차적으로 공급할 수 있다. 상기 스캔 라인들(S1 내지 Sn)로 상기 스캔 신호가 순차적으로 공급되면 상기 화소들(140)이 수평 라인 단위로 선택될 수 있다.
또한, 상기 스캔 구동 제어 신호(SCS)를 공급받은 상기 스캔 드라이버(110)는 발광 제어 라인들(E1 내지 En)로 상기 발광 제어 신호를 공급할 수 있다. 일례로, 상기 스캔 드라이버(110)는 상기 발광 제어 라인들(E1 내지 En)로 상기 발광 제어 신호를 순차적으로 공급할 수 있다. 상기 발광 제어 신호는 상기 화소들(140)의 발광 시간을 제어하기 위하여 사용될 수 있다. 이를 위하여, 상기 발광 제어 신호는 상기 스캔 신호보다 넓은 폭으로 설정될 수 있다. 예를 들어, 상기 스캔 드라이버(110)는 i(i는 자연수)번째 발광 제어 라인으로 공급되는 상기 발광 제어 신호와 중첩되도록 i-1번째 스캔 라인 및 i번째 스캔 라인으로 상기 스캔 신호를 공급할 수 있다.
상기 스캔 드라이버(110)는 박막 공정을 통해서 기판에 실장될 수 있다. 또한, 상기 스캔 드라이버(110)는 상기 화소부(130)를 사이에 두고 양측에 위치될 수도 있다.
또한, 도 1에서는 상기 스캔 드라이버(110)가 상기 스캔 신호 및 상기 발광 제어 신호를 공급하는 것으로 도시되었지만, 본원 발명이 이에 한정되지는 않는다. 일례로, 상기 표시 장치는 발광 제어 드라이버(미도시)를 더 포함하며, 상기 스캔 드라이버(110)은 상기 스캔 신호를 공급하고, 상기 발광 제어 드라이버는 상기 발광 제어 신호를 공급할 수 있다.
추가적으로, 상기 발광 제어 신호는 상기 화소들(140)에 포함된 트랜지스터가 턴-오프(turn-off)될 수 있는 게이트 오프 전압(예를 들면, 하이 전압), 상기 스캔 신호는 상기 화소들(140)에 포함된 상기 트랜지스터가 턴-온(turn-on)될 수 있는 게이트 온 전압(예를 들면, 로우 전압)으로 설정될 수 있다.
상기 데이터 드라이버(120)는 상기 데이터 구동 제어 신호(DCS)에 대응하여 상기 데이터 라인들(D1 내지 Dm)로 상기 데이터 신호를 공급할 수 있다. 상기 데이터 라인들(D1 내지 Dm)로 공급된 상기 데이터 신호는 상기 스캔 신호에 의하여 선택된 상기 화소들(140)로 공급될 수 있다. 이를 위하여, 상기 데이터 드라이버(120)는 상기 스캔 신호와 동기되도록 상기 데이터 라인들(D1 내지 Dm)로 상기 데이터 신호를 공급할 수 있다.
상기 화소부(130)는 상기 스캔 라인들(S1 내지 Sn), 상기 발광 제어 라인들(E1 내지 En) 및 상기 데이터 라인들(D1 내지 Dm)과 접속되는 상기 화소들(140)을 포함할 수 있다. 상기 화소들(140)은 외부로부터 제1 화소 전원(ELVDD) 및 제2 화소 전원(ELVSS)을 공급받을 수 있다.
상기 화소들(140) 각각은 도시되지 않은 구동 트랜지스터 및 유기 발광 다이오드를 구비할 수 있다. 상기 구동 트랜지스터는 상기 데이터 신호에 대응하여 상기 제1 화소 전원(ELVDD)으로부터 상기 유기 발광 다이오드를 경유하여 상기 제2 화소 전원(ELVSS)으로 흐르는 전류량을 제어할 수 있다.
한편, 도 1에서는 n개의 스캔 라인들(S1 내지 Sn) 및 n개의 발광 제어 라인들(E1 내지 En)이 도시되었지만, 본원 발명이 이에 한정되지는 않는다. 일례로, 상기 화소들(140)의 회로구조에 대응하여 i번째 수평 라인에 위치된 상기 화소들(140)은 이전 수평 라인에 위치된 스캔 라인(예를 들면, i-1번째 스캔 라인)과 추가로 접속될 수 있다. 이를 위하여, 상기 화소부(130)에는 도시되지 않은 더미 스캔 라인들 및/또는 더미 발광 제어 라인들이 추가로 형성될 수도 있다.
상기 전원 공급부(160)는 외부의 전원 공급 장치(미도시)로부터 공급되는 외부 전원을 이용하여 상기 제1 화소 전원(ELVDD) 및 상기 제2 화소 전원(ELVSS)을 생성할 수 있다. 상기 제1 화소 전원(ELVDD) 및 상기 제2 화소 전원(ELVSS)을 생성한 상기 전원 공급부(160)는 상기 제1 화소 전원(ELVDD) 및 상기 제2 화소 전원(ELVSS)을 상기 화소부(130)의 상기 화소들(140)로 공급할 수 있다.
도 2는 본 발명의 일 실시예에 따른 표시 장치를 설명하기 위한 평면도이며, 도 3은 도 2의 I-I' 라인에 따른 단면도이며, 도 4는 도 2의 II-II' 라인에 따른 단면도이며, 도 5는 도 2의 EA1 영역의 확대도이며, 도 6은 도 2의 EA2 영역의 확대도이며, 도 7은 도 2의 표시 장치에서 비표시 영역이 벤딩된 상태를 설명하기 위한 평면도이며, 도 8은 도 2의 표시 장치에서 비표시 영역이 벤딩된 상태를 설명하기 위한 저면도이며, 도 9는 도 8의 III-III' 라인에 따른 단면도이며, 도 10은 도 8의 IV-IV' 라인에 따른 단면도이며, 도 11은 도 8의 EA3 영역의 확대도이며, 도 12는 도 11의 V-V' 라인에 따른 단면도이다.
도 2 내지 도 12를 참조하면, 표시 장치는 표시 영역(DA)과 비표시 영역(NDA)을 포함하는 기판(SUB), 상기 기판(SUB) 상의 상기 표시 영역(DA)에 배치되는 표시층(DPL), 상기 기판(SUB) 상의 상기 비표시 영역(NDA)에 배치되고 상기 표시층(DPL)에 신호를 공급하기 위한 배선들(WL), 상기 배선들(WL)과 전기적으로 연결되는 회로 기판(CB), 및 상기 비표시 영역(NDA)의 벤딩시 상기 기판(SUB)과 상기 회로 기판(CB)을 지지하는 지지 부재(SPM)를 포함할 수 있다.
상기 기판(SUB)은 투명 절연 물질을 포함하여 광의 투과가 가능하다. 상기 기판(SUB)은 가요성(flexible) 기판일 수도 있다. 여기서, 상기 기판(SUB)은 고분자 유기물을 포함하는 필름 기판 및 플라스틱 기판 중 하나일 수 있다. 예를 들면, 상기 기판(SUB)은 폴리스티렌(polystyrene), 폴리비닐알코올(polyvinyl alcohol), 폴리메틸메타크릴레이트(Polymethyl methacrylate), 폴리에테르술폰(polyethersulfone), 폴리아크릴레이트(polyacrylate), 폴리에테르이미드(polyetherimide), 폴리에틸렌 나프탈레이트(polyethylene naphthalate), 폴리에틸렌 테레프탈레이트(polyethylene terephthalate), 폴리페닐렌 설파이드(polyphenylene sulfide), 폴리아릴레이트(polyarylate), 폴리이미드(polyimide), 폴리카보네이트(polycarbonate), 트리아세테이트 셀룰로오스(triacetate cellulose), 셀룰로오스아세테이트 프로피오네이트(cellulose acetate propionate) 중 적어도 어느 하나를 포함할 수 있다. 다만, 상기 기판(SUB)을 구성하는 재료는 다양하게 변화될 수 있으며, 섬유 강화플라스틱(FRP, Fiber reinforced plastic) 등을 포함할 수도 있다.
상기 표시 영역(DA)은 다양한 형상을 가질 수 있다. 예를 들면, 상기 표시 영역(DA)은 직선의 변들을 포함하는 다각형 형상을 가질 수 있다. 또한, 상기 표시 영역(DA)은 곡선으로 이루어진 변을 포함하는 원 또는 타원 형상을 가질 수 있다. 또한, 상기 표시 영역(DA)은 직선으로 이루어진 변 및 곡선으로 이루어진 변을 포함하는 반원 또는 반타원 형상을 가질 수도 있다. 본 실시예에서는 상기 표시 영역(DA)이 4 개의 직선의 변들을 포함하는 사각 형상인 경우를 예로서 설명한다.
상기 비표시 영역(NDA)은 상기 표시 영역(DA)에 인접하여 배치될 수 있다. 상기 비표시 영역(NDA)에는 적어도 하나의 구동 칩(IC)이 제공될 수 있다. 상기 구동 칩(IC)은 도 1에 도시된 스캔 드라이버(110) 및 데이터 드라이버(120) 중 하나일 수 있다.
한편, 본 실시예에서는 상기 구동 칩(IC)이 상기 비표시 영역(NDA)에 제공되는 것을 예로서 설명하였으나, 이에 한정되지는 않는다. 예를 들면, 상기 구동 칩(IC)은 상기 회로 기판(CB) 상에 제공될 수도 있다.
상기 비표시 영역(NDA)은 상기 표시 영역(DA)의 상기 변들 각각에서 연장된 형상을 가지는 복수의 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)을 포함할 수 있다. 예를 들면, 상기 표시 영역(DA)이 4 변들을 포함하는 사각 형상이므로, 상기 비표시 영역(NDA)은 상기 표시 영역(DA)의 4 변들 각각에서 연장된 형상을 가지는 제1 서브 비표시 영역(SNDA1), 제2 서브 비표시 영역(SNDA2), 제3 서브 비표시 영역(SNDA3) 및 제4 서브 비표시 영역(SNDA4)를 포함할 수 있다. 여기서, 상기 제1 서브 비표시 영역(SNDA1) 및 상기 제3 서브 비표시 영역(SNDA3)는 마주할 수 있으며, 상기 제2 서브 비표시 영역(SNDA2) 및 상기 제4 서브 비표시 영역(SNDA4)는 마주할 수 있다. 상기 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)은 벤딩되어 상기 기판(SUB)의 상기 표시층(DPL)이 배치된 면의 반대 방향의 면, 즉, 비발광면 상에 배치될 수 있다.
상기 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)이 벤딩되면, 상기 표시 장치의 데드 스페이스가 최소화될 수 있다. 상기 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)이 벤딩되면, 상기 표시 장치에서 외부로 노출되는 영역은 상기 비표시 영역(NDA)의 일부 및 상기 표시 영역(DA)일 수 있다. 따라서, 상기 표시 장치에서, 상기 비표시 영역(NDA)이 외부로 노출되는 것이 최소화될 수 있다. 특히, 상기 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)이 절곡되는 경우, 상기 표시 장치에서 외부로 노출되는 영역은 상기 표시 영역(DA)로 한정될 수도 있다. 따라서, 네로우 베젤(narrow bezel)을 가지는 표시 장치 또는 베젤리스(bezelless) 표시 장치의 구현이 가능하다.
상기 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4) 각각은 표시 연결 영역(DCA1, DCA2, DCA3, DCA4), 및 적어도 하나의 연장 영역(NDCA1, NDCA2, NDCA3, NDCA4)를 포함할 수 있다. 예를 들면, 상기 제1 서브 비표시 영역(SNDA1)는 제1 표시 연결 영역(DCA1) 및 제1 연장 영역(NDCA1)를 포함할 수 있다. 상기 제2 서브 비표시 영역(SNDA2)는 제2 표시 연결 영역(DCA2) 및 제2 연장 영역(NDCA2)을 포함할 수 있다. 상기 제3 서브 비표시 영역(SNDA3)는 제3 표시 연결 영역(DCA3) 및 제3 연장 영역(NDCA3)을 포함할 수 있다. 상기 제4 서브 비표시 영역(SNDA4)는 제4 표시 연결 영역(DCA4) 및 제4 연장 영역(NDCA4)을 포함할 수 있다. 상기 연장 영역들(NDCA1, NDCA2, NDCA3, NDCA4)은 상기 표시 연결 영역들(DCA1, DCA2, DCA3, DCA4)의 일변에서 연장된 형상을 가질 수 있다.
상기 표시 연결 영역들(DCA1, DCA2, DCA3, DCA4)은 상기 표시 영역(DA)에 연결될 수 있다. 상기 표시 연결 영역들(DCA1, DCA2, DCA3, DCA4)은 다양한 형상을 가질 수 있다. 예를 들면, 상기 표시 연결 영역들(DCA1, DCA2, DCA3, DCA4)은 직선의 변들을 포함하는 다각형 형상을 가질 수 있다. 또한, 상기 표시 연결 영역들(DCA1, DCA2, DCA3, DCA4)은 직선으로 이루어진 변 및 곡선으로 이루어진 변을 포함하는 반원 또는 반타원 형상을 가질 수도 있다. 본 실시예에서는 상기 표시 연결 영역들(DCA1, DCA2, DCA3, DCA4)이 4 개의 직선의 변들을 포함하는 사각 형상인 경우를 예로서 설명한다.
상기 표시 연결 영역들(DCA1, DCA2, DCA3, DCA4)에는 상기 배선들(WL)이 제공될 수 있다. 예를 들면, 상기 배선들(WL)은 상기 제1 서브 비표시 영역(SNDA1), 상기 제2 서브 비표시 영역(SNDA2), 상기 제3 서브 비표시 영역(SNDA3) 및 상기 제4 서브 비표시 영역(SNDA4) 모두의 상기 표시 연결 영역들(DCA1, DCA2, DCA3, DCA4)에 제공될 수 있다. 상기 배선들(WL)은 상기 화소들에 화소 전원을 공급할 수 있다. 여기서, 상기 화소 전원은 도 1에서 설명한 제1 화소 전원(ELVDD) 및 제2 화소 전원(ELVSS) 중 적어도 하나일 수 있다.
본 실시예에서는 상기 배선들(WL)이 상기 화소들에 화소 전원을 공급하는 것을 예로서 설명하였으나, 이에 한정되는 것은 아니다. 예를 들면, 상기 배선들(WL) 중 일부는 구동신호를 상기 화소들에 공급할 수도 있다. 여기서, 상기 구동 신호는 스캔 신호, 발광 제어 신호 및 데이터 신호 중 하나일 수 있다.
본 실시예에서는 상기 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4) 각각은 두 개의 연장 영역들(NDCA1, NDCA2, NDCA3, NDCA4)을 포함할 수 있다. 상기 연장 영역들(NDCA1, NDCA2, NDCA3, NDCA4)은 상기 표시 연결 영역들(DCA1, DCA2, DCA3, DCA4) 각각의 일변에서 연장된 형상을 가질 수 있다. 예를 들면, 상기 제1 연장 영역들(NDCA1)은 상기 제1 표시 연결 영역(DCA1)의 4 변 중 상기 표시 영역(DA)에 접하는 변에 마주하는 변에서 연장된 형상을 가질 수 있다. 또한, 상기 제1 연장 영역들(NDCA1)은 서로 이격되어 배치될 수 있다. 상기 제2 연장 영역들(NDCA2)은 상기 제2 표시 연결 영역들(DCA2)의 4 변 중 상기 표시 영역(DA)에 접하는 변에 마주하는 변에서 연장된 형상을 가질 수 있다. 또한, 상기 제2 연장 영역들(NDCA2)은 서로 이격되어 배치될 수 있다. 상기 제3 연장 영역들(NDCA3)은 상기 제3 표시 연결 영역(DCA3)의 4 변 중 상기 표시 영역(DA)에 접하는 변에 마주하는 변에서 연장된 형상을 가질 수 있다. 또한, 상기 제3 연장 영역들(NDCA3)은 서로 이격되어 배치될 수 있다. 상기 제4 연장 영역들(NDCA4)은 상기 제4 표시 연결 영역(DCA4)의 4 변 중 상기 표시 영역(DA)에 접하는 변에 마주하는 변에서 연장된 형상을 가질 수 있다. 또한, 상기 제4 연장 영역들(NDCA4)은 서로 이격되어 배치될 수 있다.
상기 연장 영역들(NDCA1, NDCA2, NDCA3, NDCA4)은 다양한 형상을 가질 수 있다. 예를 들면, 상기 연장 영역들(NDCA1, NDCA2, NDCA3, NDCA4)은 직선의 변들을 포함하는 다각형 형상을 가질 수 있다. 또한, 상기 연장 영역들(NDCA1, NDCA2, NDCA3, NDCA4)은 직선으로 이루어진 변 및 곡선으로 이루어진 변을 포함하는 반원 또는 반타원 형상을 가질 수도 있다. 본 실시예에서는 상기 연장 영역들(NDCA1, NDCA2, NDCA3, NDCA4)이 4 개의 직선의 변들을 포함하는 사각 형상인 경우를 예로서 설명한다.
상기 연장 영역들(NDCA1, NDCA2, NDCA3, NDCA4) 각각에는 상기 배선들(WL)과 연결되는 연결 단자(ECT1, ECT2, ECT3, ECT4)가 제공될 수 있다. 예를 들면, 상기 제1 연장 영역들(NDCA1)에는 제1 연결 단자(ECT1)가 제공될 수 있다. 상기 제2 연장 영역들(NDCA2)에는 제2 연결 단자(ECT2)가 제공될 수 있다. 상기 제3 연장 영역들(NDCA3)에는 제3 연결 단자(ECT3)가 제공될 수 있다. 상기 제4 연장 영역들(NDCA4)에는 제4 연결 단자(ECT4)가 제공될 수 있다.
동일한 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)에 제공된 상기 연결 단자들(ECT1, ECT2, ECT3, ECT4)은 서로 전기적으로 연결될 수 있다. 예를 들면, 상기 동일한 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)에 제공된 상기 연결 단자들(ECT1, ECT2, ECT3, ECT4)은 상기 배선들(WL) 중 적어도 하나를 통하여 전기적으로 연결될 수 있다.
상기 동일한 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)에 제공된 상기 연장 영역들(NDCA1, NDCA2, NDCA3, NDCA4) 중 하나의 연결 단자(ECT1, ECT2, ECT3, ECT4)와 다른 하나의 연결 단자(ECT1, ECT2, ECT3, ECT4)는 상기 기판(SUB)의 양 면 중 상기 배선들(WL)이 제공된 면 상에 제공될 수 있다.
또는 상기 동일한 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)에 제공된 상기 연장 영역들(NDCA1, NDCA2, NDCA3, NDCA4) 중 하나의 연결 단자(ECT1, ECT2, ECT3, ECT4)는 상기 기판(SUB)의 양 면 중 상기 배선들(WL)이 제공된 면 상에 제공될 수 있으며, 다른 하나의 연결 단자(ECT1, ECT2, ECT3, ECT4)는 상기 기판(SUB)의 양 면 중 상기 배선들(WL)이 제공된 면과 반대 방향의 면 상에 제공될 수도 있다. 여기서, 상기 배선들(WL)이 제공된 면과 반대 방향의 면 상에 제공된 상기 연결 단자(ECT1, ECT2, ECT3, ECT4)는 상기 기판(SUB)을 관통하는 콘택 홀(CH)을 통해 상기 배선들(WL)과 전기적으로 연결될 수 있다.
상기 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)이 벤딩되면, 서로 인접하는 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)의 상기 연장 영역들(NDCA1, NDCA2, NDCA3, NDCA4)은 중첩될 수 있다. 예를 들면, 상기 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)이 벤딩되면, 상기 제1 서브 비표시 영역(SNDA1)의 상기 제1 연장 영역들(NDCA1) 중 하나와 상기 제2 서브 비표시 영역(SNDA2)의 상기 제2 연장 영역들(NDCA2) 중 하나가 중첩될 수 있다. 상기 제2 서브 비표시 영역(SNDA2)의 상기 제2 연장 영역들(NDCA2) 중 다른 하나와 상기 제3 서브 비표시 영역(SNDA3)의 상기 제3 연장 영역들(NDCA3) 중 하나가 중첩될 수 있다. 상기 제3 서브 비표시 영역(SNDA3)의 상기 제3 연장 영역들(NDCA3) 중 다른 하나와 상기 제4 서브 비표시 영역(SNDA4)의 상기 제4 연장 영역들(NDCA4) 중 하나가 중첩될 수 있다. 상기 제1 서브 비표시 영역(SNDA1)의 상기 제1 연장 영역들(NDCA1) 중 다른 하나와 상기 제4 서브 비표시 영역(SNDA4)의 상기 제4 연장 영역들(NDCA4) 중 다른 하나가 중첩될 수 있다.
상기 연장 영역들(NDCA1, NDCA2, NDCA3, NDCA4)이 중첩되면, 중첩되는 연장 영역들(NDCA1, NDCA2, NDCA3, NDCA4) 중 하나의 상기 연결 단자(ECT1, ECT2, ECT3, ECT4)는 다른 하나의 상기 연결 단자(ECT1, ECT2, ECT3, ECT4)와 중첩될 수 있다. 또한, 상기 중첩되는 연장 영역들(NDCA1, NDCA2, NDCA3, NDCA4) 중 하나의 상기 연결 단자(ECT1, ECT2, ECT3, ECT4)는 상기 기판(SUB)의 양 면 중 상기 배선들(WL)이 배치된 면 상에 제공될 수 있다. 또한, 상기 중첩되는 연장 영역들(NDCA1, NDCA2, NDCA3, NDCA4) 중 다른 하나의 상기 연결 단자(ECT1, ECT2, ECT3, ECT4)는 상기 배선들(WL)이 배치된 면과 반대 방향의 면 상에 제공될 수 있다. 따라서, 상기 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)이 벤딩되면, 상기 중첩되는 연장 영역들(NDCA1, NDCA2, NDCA3, NDCA4)의 상기 연결 단자들(ECT1, ECT2, ECT3, ECT4)은 서로 마주하여 전기적으로 연결될 수 있다.
이를 보다 상세히 설명하면, 상기 제1 서브 비표시 영역(SNDA1)의 상기 제1 연장 영역(NDCA1)와 상기 제2 서브 비표시 영역(SNDA2)의 상기 제2 연장 영역(NDCA2)가 중첩되면, 상기 제1 서브 비표시 영역(SNDA1)의 상기 제1 연결 단자(ECT1)의 적어도 일부는 상기 제2 서브 비표시 영역(SNDA2)의 상기 제2 연결 단자(ECT2)의 적어도 일부와 중첩되고 전기적으로 연결될 수 있다. 상기 제2 서브 비표시 영역(SNDA2)의 상기 제2 연장 영역(NDCA2)와 상기 제3 서브 비표시 영역(SNDA3)의 상기 제3 연장 영역(NDCA3)가 중첩되면, 상기 제2 서브 비표시 영역(SNDA2)의 상기 제2 연결 단자(ECT2)의 적어도 일부는 상기 제3 서브 비표시 영역(SNDA3)의 상기 제3 연결 단자(ECT3)의 적어도 일부와 중첩되고 전기적으로 연결될 수 있다. 상기 제3 서브 비표시 영역(SNDA3)의 상기 제3 연장 영역(NDCA3)와 상기 제4 서브 비표시 영역(SNDA4)의 상기 제4 연장 영역(NDCA4)가 중첩되면, 상기 제3 서브 비표시 영역(SNDA3)의 상기 제3 연결 단자(ECT3)의 적어도 일부는 상기 제4 서브 비표시 영역(SNDA4)의 상기 제4 연결 단자(ECT4)의 적어도 일부와 중첩되고 전기적으로 연결될 수 있다. 상기 제4 서브 비표시 영역(SNDA4)의 상기 제4 연장 영역(NDCA4)와 상기 제1 서브 비표시 영역(SNDA1)의 상기 제1 연장 영역(NDCA1)가 중첩되면, 상기 제4 서브 비표시 영역(SNDA4)의 상기 제4 연결 단자(ECT4)의 적어도 일부는 상기 제1 서브 비표시 영역(SNDA1)의 상기 제1 연결 단자(ECT1)의 적어도 일부와 중첩되고 전기적으로 연결될 수 있다.
상기 제1 서브 비표시 영역(SNDA1)의 상기 배선들(WL)은 상기 제2 서브 비표시 영역(SNDA2)의 상기 배선들(WL)과 전기적으로 연결될 수 있다. 상기 제2 서브 비표시 영역(SNDA2)의 상기 배선들(WL)은 상기 제3 서브 비표시 영역(SNDA3)의 상기 배선들(WL)과 전기적으로 연결될 수 있다. 상기 제3 서브 비표시 영역(SNDA3)의 상기 배선들(WL)은 상기 제4 서브 비표시 영역(SNDA4)의 상기 배선들(WL)과 전기적으로 연결될 수 있다. 상기 제4 서브 비표시 영역(SNDA4)의 상기 배선들(WL)은 상기 제1 서브 비표시 영역(SNDA1)의 상기 배선들(WL)과 전기적으로 연결될 수 있다. 또한, 상기 제1 서브 비표시 영역들(SNDA1)의 상기 배선들(WL)은 상기 회로 기판(CB)과 전기적으로 연결되므로, 상기 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)의 상기 배선들(WL) 모두는 상기 제1 화소 전원(ELVDD) 및 상기 제2 화소 전원(ELVSS) 중 적어도 하나를 인가하는 상기 회로 기판(CB)과 전기적으로 연결될 수 있다.
상술한 바와 같이, 상기 동일한 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)에 제공된 상기 연결 단자들(ECT1, ECT2, ECT3, ECT4)이 서로 전기적으로 연결되고, 상기 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)의 상기 배선들(WL)은 상기 연결 단자들(ECT1, ECT2, ECT3, ECT4)에 전기적으로 연결될 수 있다. 또한, 상기 화소들은 상기 배선들(WL)을 통해 제1 화소 전원(ELVDD) 및 제2 화소 전원(ELVSS) 중 적어도 하나를 인가받으므로, 상기 화소들은 상기 제1 화소 전원(ELVDD) 및 상기 제2 화소 전원(ELVSS) 중 적어도 하나를 상기 표시 영역(DA)의 모든 방향에서 균일하게 인가받을 수 있다. 따라서, 상기 표시 장치는 상기 제1 화소 전원(ELVDD) 및 상기 제2 화소 전원(ELVSS)의 전압 강하에 따른 화질 불량을 방지할 수 있다.
상기 표시층(DPL)은 복수의 화소들을 포함할 수 있다. 상기 화소들은 도 1에 도시된 화소들(140)일 수 있다. 상기 화소들(140)은 상기 기판(SUB) 상의 상기 표시 영역(DA)에 배치되는 구동층(DVL), 및 상기 구동층(DVL) 상에 배치되는 발광 소자층(EDL)을 포함할 수 있다.
상기 구동층(DVL)은 적어도 하나의 박막 트랜지스터(TFT)를 포함할 수 있다.
상기 박막 트랜지스터(TFT)는 반도체층(SA), 상기 반도체층(SA)과 절연되는 게이트 전극(GE), 및 상기 반도체층(SA)에 접속하는 소스 전극(SE) 및 드레인 전극(DE)을 구비할 수 있다.
상기 반도체층(SA)은 상기 기판(SUB) 상에 배치될 수 있다. 상기 반도체층(SA)은 비정질 실리콘(a-Si), 다결정 실리콘(p-Si) 및 산화물 반도체, 유기 반도체 중 어느 하나를 포함할 수 있다. 여기서, 상기 산화물 반도체는 Zn, In, Ga, Sn 및 이들의 혼합물 중 적어도 하나를 포함할 수 있다. 예를 들면, 상기 산화물 반도체는 IGZO(Indium-Gallium-Zinc Oxide)를 포함할 수 있다.
상기 반도체층(SA)에서, 상기 소스 전극(SE) 및 상기 드레인 전극(DE)과 접속하는 영역은 불순물이 도핑 또는 주입된 소스 영역 및 드레인 영역일 수 있다. 또한, 상기 소스 영역 및 상기 드레인 영역 사이의 영역은 채널 영역일 수 있다.
한편, 도면 상에는 도시하지 않았으나, 상기 반도체층(SA)이 산화물 반도체를 포함하는 경우, 상기 반도체층(SA)의 상부 및 하부에 상기 반도체층(SA)으로 유입되는 광을 차단하기 위한 광 차단막이 배치될 수도 있다.
상기 기판(SUB) 및 상기 반도체층(SA) 사이에는 버퍼층(BUL)이 배치될 수 있다. 상기 버퍼층(BUL)은 실리콘 산화물(SiOx) 및 실리콘 질화물(SiNx) 중 적어도 하나를 포함할 수 있다. 예를 들면, 상기 버퍼층(BUL)은 실리콘 산화물을 포함하는 제1 막, 및 상기 제1 막 상에 배치되고 실리콘 질화물을 포함하는 제2 막을 구비할 수 있다. 상기 버퍼층(BUL)은 상기 기판(SUB)에서 상기 반도체층(SA)으로 불순물이 확산되어 침투하는 것을 방지하여, 상기 박막 트랜지스터의 전기적 특성 저하를 방지할 수 있다.
또한, 상기 버퍼층(BUL)은 외부에서 상기 유기 발광 소자(OLED)로 수분 및 산소가 침투하는 것을 방지할 수 있다. 상기 버퍼층(BUL)은 상기 베이스 기판(SUB)의 표면을 평탄화할 수도 있다.
상기 기판(SUB) 및 상기 반도체층(SA) 상에는 상기 반도체층(SA)을 커버하는 게이트 절연막(GI)이 배치될 수 있다. 상기 게이트 절연막(GI)은 상기 반도체층(SA) 및 상기 게이트 전극(GE)을 절연시킬 수 있다. 상기 게이트 절연막(GI)은 실리콘 산화물 및 실리콘 질화물 중 적어도 하나를 포함할 수 있다.
상기 게이트 절연막(GI) 상에는 상기 게이트 전극(GE)이 배치될 수 있다.
상기 게이트 절연막(GI) 및 상기 게이트 전극(GE) 상에는 층간 절연막(ILD)이 배치될 수 있다. 즉, 상기 층간 절연막(ILD)은 상기 게이트 전극(GE)을 커버할 수 있다. 상기 층간 절연막(ILD)은 상기 게이트 절연막(GI)과 같이, 실리콘 산화물 및 실리콘 질화물 중 적어도 하나를 포함할 수 있다. 또한, 상기 층간 절연막(ILD)의 일부는 제거되어, 상기 반도체층(SA)의 상기 소스 영역 및 상기 드레인 영역을 노출시킬 수 있다.
상기 층간 절연막(ILD) 상에는 상기 소스 전극(SE) 및 상기 드레인 전극(DE)이 배치될 수 있다. 상기 소스 전극(SE) 및 상기 드레인 전극(DE)은 상기 층간 절연막(ILD)에 의해 상기 게이트 전극(GE)과 절연될 수 있다. 또한, 상기 소스 전극(SE) 및 상기 드레인 전극(DE)은 상기 소스 영역 및 상기 드레인 영역과 접속될 수 있다.
한편, 본 실시예에서는 상기 박막 트랜지스터(TFT)가 탑 게이트(top gate) 구조의 박막 트랜지스터인 경우를 예로서 설명하였으나, 이에 한정되는 것은 아니다. 예를 들면, 상기 박막 트랜지스터(TFT)는 바텀 게이트(bottom gate) 구조의 박막 트랜지스터일 수 있다.
상기 구동층(DVL) 상에는 보호막(PSV)이 배치될 수 있다. 즉, 상기 보호막(PSV)은 상기 박막 트랜지스터(TFT)를 커버할 수 있다. 또한, 상기 보호막(PSV)은 상기 드레인 전극(DE)의 일부를 노출시킬 수 있다.
상기 보호막(PSV)은 적어도 하나의 막을 포함할 수 있다. 예를 들면, 상기 보호막(PSV)은 무기 보호막 및 유기 보호막 중 적어도 하나를 포함할 수 있다. 예를 들면, 상기 보호막(PSV)은 상기 박막 트랜지스터(TFT)를 커버하는 상기 무기 보호막 및 상기 무기 보호막 상에 배치되는 유기 보호막을 포함할 수 있다.
상기 무기 보호막은 실리콘 산화물 및 실리콘 질화물 중 적어도 하나를 포함할 수 있다. 또한, 상기 유기 보호막은 광을 투과시킬 수 있는 유기 절연 물질을 포함할 수 있다. 예를 들면, 상기 유기 보호막은 아크릴계 수지(polyacrylates resin), 에폭시계 수지(epoxy resin), 페놀 수지(phenolic resin), 폴리아미드계 수지(polyamides resin), 폴리이미드계 수지(polyimides rein), 불포화 폴리에스테르계 수지(unsaturated polyesters resin), 폴리페닐렌 에테르계 수지(poly-phenylene ethers resin), 폴리페닐렌 설파이드계 수지(poly-phenylene sulfides resin), 및 벤조사이클로부텐 수지(Benzocyclobutenes resin) 중 적어도 하나를 포함할 수 있다.
상기 보호막(PSV) 상에는 발광 소자층(EDL)이 배치될 수 있다. 상기 발광 소자층(EDL)은 상기 박막 트랜지스터(TFT)에 접속되는 상기 유기 발광 소자(OLED)를 포함할 수 있다.
상기 유기 발광 소자(OLED)는 상기 드레인 전극(DE)과 접속하는 제1 전극(AE), 상기 제1 전극(AE) 상에 배치되는 유기막(OL), 및 상기 유기막(OL) 상에 배치되는 제2 전극(CE)을 포함할 수 있다.
상기 제1 전극(AE) 및 상기 제2 전극(CE) 중 하나는 애노드(anode) 전극일 수 있으며, 다른 하나는 캐소드 전극(cathode) 전극일 수 있다. 예를 들면, 상기 제1 전극(AE)은 애노드 전극일 수 있으며, 상기 제2 전극(CE)은 캐소드 전극일 수 있다.
또한, 상기 제1 전극(AE) 및 상기 제2 전극(CE) 중 적어도 하나는 투과형 전극일 수 있다. 예를 들면, 상기 유기 발광 소자(OLED)가 배면 발광형 유기 발광 소자인 경우, 상기 제1 전극(AE)은 투과형 전극이며, 상기 제2 전극(CE)은 반사형 전극일 수 있다. 상기 유기 발광 소자(OLED)가 전면 발광형 유기 발광 소자인 경우, 상기 제1 전극(AE)은 반사형 전극이며, 상기 제2 전극(CE)은 투과형 전극일 수 있다. 상기 유기 발광 소자(OLED)가 양면 발광형 유기 발광 소자인 경우, 상기 제1 전극(AE) 및 상기 제2 전극(CE) 모두 투과형 전극일 수 있다. 본 실시예에서는 상기 제1 전극(AE)이 애노드 전극이며, 상기 유기 발광 소자(OLED)가 전면 발광형 경우를 예로서 설명한다.
상기 제1 전극(AE)은 상기 보호막(PSV) 상에 배치될 수 있다. 상기 제1 전극(AE)은 광을 반사시킬 수 있는 반사막(미도시), 및 상기 반사막의 상부 또는 하부에 배치되는 투명 도전막(미도시)을 포함할 수 있다. 상기 반사막 및 상기 투명 도전막 중 적어도 하나는 상기 드레인 전극(DE)과 접속할 수 있다.
상기 반사막은 광을 반사시킬 수 있는 물질을 포함할 수 있다. 예를 들면, 상기 반사막은 알루미늄(Al), 은(Ag), 크롬(Cr), 몰리브덴(Mo), 백금(Pt), 니켈(Ni) 및 이들의 합금 중 적어도 하나를 포함할 수 있다.
상기 투명 도전막은 투명 도전성 산화물을 포함할 수 있다. 예를 들어, 상기 투명 도전막은 ITO(Indium Tin Oxide), IZO(Indium Zinc Oxide), AZO(Aluminum Zinc Oxide), GZO(gallium doped zinc oxide), ZTO(zinc tin oxide), GTO(Gallium tin oxide) 및 FTO(fluorine doped tin oxide) 중 적어도 하나의 투명 도전성 산화물을 포함할 수 있다.
상기 제1 전극(AE) 및 상기 보호막(PSV) 상에는 화소 정의막(PDL)이 배치될 수 있다. 상기 화소 정의막(PDL)은 상기 제1 전극(AE)의 일부를 노출시킬 수 있다. 예를 들면, 상기 화소 정의막(PDL)은 상기 제1 전극(AE)의 에지 및 상기 보호막(PSV)을 커버하는 형상을 가질 수 있다.
상기 화소 정의막(PDL)은 유기 절연 물질을 포함할 수 있다. 예를 들면, 상기 화소 정의막(PDL)은 폴리스티렌(polystyrene), 폴리메틸메타아크릴레이트(PMMA, Polymethylmethacrylate), 폴리아크릴로니트릴(PAN, Polyacrylonitrile), 폴리아미드(PA, Polyamide), 폴리이미드(PI, Polyimide), 폴리아릴에테르(PAE, Polyarylether), 헤테로사이클릭 폴리머(Heterocyclic Polymer), 파릴렌(Parylene), 에폭시 수지(Epoxy resin), 벤조시클로부텐(BCB, Benzocyclobutene), 실록산계 수지(Siloxane based resin) 및 실란계 수지(Silane based resin) 중 적어도 하나를 포함할 수 있다.
상기 유기막(OL)은 적어도 발광층(emitting layer, EML)을 포함하는 다층 박막 구조를 가질 수 있다. 예를 들면, 상기 유기막(OL)은 정공을 주입하는 정공 주입층(hole injection layer, HIL), 정공의 수송성이 우수하고 상기 발광층에서 결합하지 못한 전자의 이동을 억제하여 정공과 전자의 재결합 기회를 증가시키기 위한 정공 수송층(hole transport layer, HTL), 주입된 전자와 정공의 재결합에 의하여 광을 발하는 상기 발광층, 전자를 상기 발광층으로 원활히 수송하기 위한 전자 수송층(electron transport layer, ETL), 및 전자를 주입하는 전자 주입층(electron injection layer, EIL)을 구비할 수 있다. 여기서, 상기 정공 주입층, 상기 정공 수송층, 상기 전자 수송층 및 상기 전자 주입층은 인접하는 화소 영역들(PXA)로 연장되어, 상기 화소 영역들(PXA)이 모두 공유하는 공통층일 수 있다. 한편, 상기 발광층에서 생성되는 광의 색상은 적색(red), 녹색(grean), 청색(blue) 및 백색(white) 중 하나일 수 있으나, 본 실시예에서 이를 한정하는 것은 아니다. 예를 들어, 상기 유기막(OL)의 상기 발광층에서 생성되는 광의 색상은 마젠타(magenta), 시안(cyan), 옐로(yellow) 중 하나일 수 있다.
상기 제2 전극(CE)은 상기 유기막(OL) 상에 배치될 수 있다. 상기 제2 전극(CE)은 반투과 반사막일 수 있다. 예를 들면, 상기 제2 전극(CE)은 광을 투과시킬 수 있을 정도의 두께를 가지는 박형 금속층일 수 있다. 상기 제2 전극(CE)은 상기 유기막(OL)에서 생성된 광의 일부는 투과시키고, 상기 유기막(OL)에서 생성된 광의 나머지는 반사시킬 수 있다. 상기 제2 전극(CE)에서 반사된 광은 상기 제1 전극(AE)의 상기 반사막에서 반사되어 보강 간섭에 의해 상기 제2 전극(CE)을 투과할 수 있다.
상기 제2 전극(CE)은 상기 제1 전극(AE)의 상기 투명 도전막에 비하여 일함수가 낮은 물질을 포함할 수 있다. 예를 들면, 상기 제2 전극(CE)은 몰리브덴(Mo), 텅스텐(W), 은(Ag), 마그네슘(Mg), 알루미늄(Al), 백금(Pt), 팔라듐(Pd), 금(Au), 니켈(Ni), 네오디뮴(Nd), 이리듐(Ir), 크롬(Cr), 니켈(Li), 칼슘(Ca) 및 이들의 합금 중 적어도 하나를 포함할 수 있다.
상기 제2 전극(CE) 상에는 봉지 부재(CPL)가 배치될 수 있다. 상기 봉지 부재(CPL)는 상기 유기 발광 소자(OLED)를 외부 환경과 격리시킬 수 있다. 예를 들면, 상기 봉지 부재(CPL)는 외부의 수분 및 산소가 상기 유기 발광 소자(OLED)로 침투하는 것을 방지할 수 있다.
상기 봉지 부재(CPL)는 상기 제2 전극(CE) 상에 배치되는 복수의 무기막(미도시) 및 복수의 유기막(미도시)을 포함하는 박막 봉지층일 수 있다. 예를 들면, 상기 봉지 부재(CPL)는 상기 무기막 및 상기 유기막이 교번 적층된 구조를 가질 수 있다.
경우에 따라, 상기 봉지 부재(CPL)는 상기 기판(SUB)과 합착되어 내부 공간을 밀봉하는 봉지 기판일 수도 있다. 상기 봉지 기판은 실런트를 통하여 상기 기판(SUB)과 합착될 수 있다.
상기 회로 기판(CB)은 상기 기판(SUB)의 상기 비발광면 상에 제공될 수 있다. 상기 회로 기판(CB)은 인쇄 회로 기판(Printed Circuit Board, PCB) 또는 연성 회로 기판(Flexible Printed Circuit Board, FPCB)으로 구현될 수 있다. 상기 회로 기판(CB)은 상기 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4) 중 적어도 하나에 연결될 수 있다. 예를 들면, 상기 회로 기판(CB)은 상기 제1 서브 비표시 영역(SNDA1)에 연결되고, 상기 제1 서브 비표시 영역(SNDA1)의 상기 배선들(WL)에 전기적으로 연결될 수 있다.
상기 회로 기판(CB)은 상기 배선들(WL)을 통해 상기 화소들(140)에 상기 제1 화소 전원(ELVDD) 및 제2 화소 전원(ELVSS)이 인가되도록 할 수 있다. 예를 들면, 상기 회로 기판(CB)은 외부 전원 공급 장치(미도시) 및 상기 배선들(WL)을 전기적으로 연결하여, 상기 화소들에 상기 제1 화소 전원(ELVDD) 및 제2 화소 전원(ELVSS)이 인가되도록 할 수 있다. 또는, 상기 회로 기판(CB)은 전원 공급부(미도시)를 구비하고 상기 전원 공급부 및 상기 배선들(WL)을 전기적으로 연결하여, 상기 화소들(140)에 상기 제1 화소 전원(ELVDD) 및 제2 화소 전원(ELVSS)이 인가되도록 할 수 있다.
상기 지지 부재(SPM)는 상기 기판(SUB) 및 상기 회로 기판(CB) 사이에 제공될 수 있다. 상기 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)이 벤딩되어 상기 기판(SUB)의 상기 비발광면 상에 배치될 때, 상기 지지 부재(SPM)는 상기 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)을 지지할 수 있다. 따라서, 상기 지지 부재(SPM)는 상기 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)이 벤딩 이전 상태로 회복되는 것을 방지할 수 있다.
또한, 상기 지지 부재(SPM)와 상기 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4) 사이, 및 상기 지지 부재(SPM)와 상기 회로 기판(CB) 사이에는 접착층(ASL)이 제공될 수 있다. 상기 접착층(ASL)은 상기 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4) 및 상기 회로 기판(CB)를 상기 지지 부재(SPM)에 고정시킬 수 있다.
도 13은 서로 인접하는 서브 비표시 영역들의 연장 영역의 연결 관계의 다른 예를 설명하기 위한 단면도이다.
도 2 내지 도 11, 및 도 13을 참조하면, 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)이 벤딩되면, 상기 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)은 벤딩되어 상기 기판(SUB)의 상기 표시층(DPL)이 배치된 면의 반대 방향의 면, 즉, 비발광면 상에 배치될 수 있다.
상기 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)이 벤딩되면, 서로 인접하는 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)의 상기 연장 영역들(NDCA1, NDCA2, NDCA3, NDCA4)은 중첩될 수 있다.
상기 연장 영역들(NDCA1, NDCA2, NDCA3, NDCA4)이 중첩되면, 중첩되는 연장 영역들(NDCA1, NDCA2, NDCA3, NDCA4) 중 하나의 연결 단자(ECT1, ECT2, ECT3, ECT4)는 다른 하나의 상기 연장 영역들(NDCA1, NDCA2, NDCA3, NDCA4)의 연결 단자(ECT1, ECT2, ECT3, ECT4)와 전기적으로 연결될 수 있다.
한편, 상기 서로 인접하는 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4) 중 하나의 연장 영역(NDCA1, NDCA2, NDCA3, NDCA4)는 상기 연결 단자(ECT1, ECT2, ECT3, ECT4)를 커버하고, 내부 공간을 제공하는 하우징(HOU)을 구비할 수 있다. 상기 서로 인접하는 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4) 중 다른 하나의 연장 영역(NDCA1, NDCA2, NDCA3, NDCA4)는 상기 하우징(HOU)이 제공하는 상기 내부 공간으로 삽입될 수 있다. 즉, 상기 서로 인접하는 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)의 연장 영역들(NDCA1, NDCA2, NDCA3, NDCA4)은 커넥터와 유사한 방식으로 연결될 수 있다.
도 14는 서로 인접하는 서브 비표시 영역들의 연장 영역의 연결 관계의 또 다른 예를 설명하기 위한 단면도이다.
도 2 내지 도 11, 및 도 14를 참조하면, 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)이 벤딩되면, 상기 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)은 벤딩되어 상기 기판(SUB)의 상기 표시층(DPL)이 배치된 면의 반대 방향의 면, 즉, 비발광면 상에 배치될 수 있다.
상기 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)이 벤딩되면, 서로 인접하는 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)의 상기 연장 영역들(NDCA1, NDCA2, NDCA3, NDCA4)은 중첩될 수 있다.
상기 연장 영역들(NDCA1, NDCA2, NDCA3, NDCA4)이 중첩되면, 중첩되는 연장 영역들(NDCA1, NDCA2, NDCA3, NDCA4) 중 하나의 상기 연결 단자(ECT1, ECT2, ECT3, ECT4)는 다른 하나의 상기 연결 단자(ECT1, ECT2, ECT3, ECT4)와 도전 부재(CM)를 통하여 전기적으로 연결될 수 있다. 상기 도전 부재(CM)는 이방성 도전 필름(Anisotropic Conductive Film, ACF) 또는 이방성 도전 수지(Anisotropic Conductive Adhesive, ACA))일 수 있다. 예를 들면, 서로 중첩하는 단자들(ECT1, ECT2, ECT3, ECT4) 사이에 상기 도전 부재(CM)가 배치되고, 상기 도전 부재(CM)는 상기 단자들(ECT1, ECT2, ECT3, ECT4)을 전기적으로 연결할 수 있다.
도 15 및 도 16은 서로 인접하는 서브 비표시 영역들의 연장 영역의 연결 관계의 또 다른 예를 설명하기 위한 일부 평면도 및 단면도로, 도 15는 도 8의 EA3 영역의 확대도이며, 도 16은 도 15의 VI-VI' 라인에 따른 단면도이다.
도 2 내지 도 10, 도 15 및 도 16을 참조하면, 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)이 벤딩되면, 상기 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)은 벤딩되어 상기 기판(SUB)의 상기 표시층(DPL)이 배치된 면의 반대 방향의 면, 즉, 비발광면 상에 배치될 수 있다.
상기 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)이 벤딩되면, 서로 인접하는 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)의 상기 연장 영역들(NDCA1, NDCA2, NDCA3, NDCA4)은 중첩될 수 있다.
한편, 상기 중첩되는 상기 연장 영역들(NDCA1, NDCA2, NDCA3, NDCA4)에 제공되는 연결 단자들(ETC1, ETC2, ETC3, ETC4)은 기판(SUB)의 서로 동일한 평면 상에 제공될 수 있다. 예를 들면, 상기 중첩되는 상기 연장 영역들(NDCA1, NDCA2, NDCA3, NDCA4)에 제공되는 연결 단자들(ETC1, ETC2, ETC3, ETC4)은 상기 기판(SUB)의 양 면 중 상기 배선들(WL)이 제공된 면 상에 제공될 수 있다.
여기서, 상기 중첩되는 상기 연장 영역들(NDCA1, NDCA2, NDCA3, NDCA4) 중 하나는 벤딩될 수 있다. 상기 벤딩에 의하여, 상기 중첩되는 상기 연장 영역들(NDCA1, NDCA2, NDCA3, NDCA4)의 상기 연결 단자들(ETC1, ETC2, ETC3, ETC4)은 서로 마주할 수 있다.
서로 마주하는 상기 연결 단자들(ECT1, ECT2, ECT3, ECT4)은 도전 부재(CM)를 통하여 전기적으로 연결될 수 있다. 상기 도전 부재(CM)는 이방성 도전 필름(Anisotropic Conductive Film, ACF) 또는 이방성 도전 수지(Anisotropic Conductive Adhesive, ACA))일 수 있다. 예를 들면, 서로 마주하는 단자들(ECT1, ECT2, ECT3, ECT4) 사이에 상기 도전 부재(CM)가 배치되고, 상기 도전 부재(CM)는 상기 단자들(ECT1, ECT2, ECT3, ECT4)을 전기적으로 연결할 수 있다.
이하, 도 17 내지 도 30을 통하여 본 발명의 다른 실시예들에 따른 표시 장치를 설명한다. 도 17 내지 도 30에 있어서, 도 1 내지 도 16에 도시된 구성 요소와 동일한 구성 요소는 동일한 참조번호를 부여하고, 그에 대하여 간략히 설명한다. 또한, 도 17 내지 도 30에서는 중복된 설명을 피하기 위하여 도 1 내지 도 16과 다른 점을 위주로 설명한다.
도 17은 본 발명의 다른 실시예에 따른 표시 장치를 설명하기 위한 평면도이며, 도 18은 도 17의 EA4 영역의 확대도이며, 도 19는 도 17의 EA5 영역의 확대도이며, 도 20은 비표시 영역이 벤딩된 상태의 표시 장치를 설명하기 위한 저면도이며, 도 21은 도 20의 VII-VII' 라인에 따른 단면도이며, 도 22는 도 20의 EA6 영역의 확대도이며, 도 23은 도 22의 VIII-VIII' 라인에 따른 단면도이다.
도 17 내지 도 23을 참조하면, 표시 장치는 표시 영역(DA)와 비표시 영역(NDA)을 포함하는 기판(SUB), 상기 기판(SUB) 상의 상기 표시 영역(DA)에 배치되는 표시층(DPL), 상기 기판(SUB) 상의 상기 비표시 영역(NDA)에 배치되고 상기 표시층(DPL)에 신호를 공급하기 위한 배선들(WL), 상기 배선들(WL)과 전기적으로 연결되는 회로 기판(CB), 및 상기 비표시 영역(NDA)의 벤딩시 상기 기판(SUB)과 상기 회로 기판(CB)을 지지하는 지지 부재(SPM)를 포함할 수 있다.
상기 표시 영역(DA)은 4개의 직선의 변들을 포함하는 사각 형상을 가질 수 있다.
상기 비표시 영역(NDA)은 상기 표시 영역(DA)에 인접하여 배치될 수 있다. 상기 비표시 영역(NDA)은 상기 표시 영역(DA)의 상기 변들 각각에 접하는 복수의 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)을 포함할 수 있다. 상기 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)은 벤딩되어 상기 기판(SUB)의 상기 표시층(DPL)이 배치된 면의 반대 방향의 면, 즉, 비발광면 상에 배치될 수 있다.
또한, 상기 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4) 중 적어도 하나, 예를 들면, 상기 제1 서브 비표시 영역(SNDA1)는 상기 회로 기판(CB)과 연결되고, 상기 제1 서브 비표시 영역(SNDA1)의 상기 배선들(WL)은 상기 회로 기판(CB)을 통해 신호를 인가받을 수 있다.
상기 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4) 각각은 상기 표시 영역(DA)에 접하는 표시 연결 영역(DCA1, DCA2, DCA3, DCA4), 및 상기 표시 연결 영역(DCA1, DCA2, DCA3, DCA4)의 일부에서 연장된 적어도 하나의 연장 영역(NDCA1, NDCA2, NDCA3, NDCA4)를 포함할 수 있다.
상기 표시 연결 영역들(DCA1, DCA2, DCA3, DCA4)은 다양한 형상을 가질 수 있다. 본 실시예에서는 표시 연결 영역들(DCA1, DCA2, DCA3, DCA4)이 4개의 직선의 변들을 포함하는 사각 형상인 경우를 예로서 설명한다.
상기 표시 연결 영역들(DCA1, DCA2, DCA3, DCA4)에는 상기 배선들(WL)이 제공될 수 있다. 상기 배선들(WL) 중 일부는 상기 화소들(도 1의 140 참조)에 적어도 화소 전원을 공급할 수 있다. 여기서, 상기 화소 전원은 제1 화소 전원(ELVDD) 및 제2 화소 전원(ELVSS) 중 하나일 수 있다. 상기 배선들(WL) 중 나머지는 타 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)에 상기 화소 전원을 전달할 수 있다.
상기 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4) 각각은 두 개의 연장 영역들(NDCA1, NDCA2, NDCA3, NDCA4)을 포함할 수 있다. 상기 연장 영역들(NDCA1, NDCA2, NDCA3, NDCA4)은 상기 표시 연결 영역들(DCA1, DCA2, DCA3, DCA4) 각각의 일변에서 연장된 형상을 가질 수 있다. 예를 들면, 상기 연장 영역들(NDCA1, NDCA2, NDCA3, NDCA4)은 상기 표시 연결 영역들(DCA1, DCA2, DCA3, DCA4)의 4 변 중 상기 표시 영역(DA)에 접하는 변에 접하는 변들에서 각각 연장된 형상을 가질 수 있다.
상기 연장 영역들(NDCA1, NDCA2, NDCA3, NDCA4) 각각에는 상기 배선들(WL)과 연결되는 연결 단자(ECT1, ECT2, ECT3, ECT4)가 제공될 수 있다.
상기 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)이 벤딩되면, 서로 인접하는 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)의 상기 연장 영역들(NDCA1, NDCA2, NDCA3, NDCA4)은 중첩될 수 있다.
상기 연장 영역들(NDCA1, NDCA2, NDCA3, NDCA4)이 중첩되면, 중첩되는 연장 영역들(NDCA1, NDCA2, NDCA3, NDCA4) 중 하나의 상기 연결 단자(ECT1, ECT2, ECT3, ECT4)는 다른 하나의 상기 연결 단자(ECT1, ECT2, ECT3, ECT4)와 중첩하고 전기적으로 연결될 수 있다. 따라서, 상기 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)의 상기 배선들(WL) 모두는 상기 제1 화소 전원(ELVDD) 및 상기 제2 화소 전원(ELVSS) 중 적어도 하나를 인가하는 상기 회로 기판(CB)과 전기적으로 연결될 수 있다.
상기 화소들(140)은 상기 배선들 통해 제1 화소 전원(ELVDD) 및 제2 화소 전원(ELVSS) 중 적어도 하나를 인가받으므로, 상기 화소들(140)은 상기 제1 화소 전원(ELVDD) 및 상기 제2 화소 전원(ELVSS) 중 적어도 하나를 상기 표시 영역(DA)의 모든 방향에서 균일하게 인가받을 수 있다. 따라서, 상기 표시 장치는 상기 제1 화소 전원(ELVDD) 및 상기 제2 화소 전원(ELVSS)의 전압 강하에 따른 화질 불량을 방지할 수 있다.
도 24는 본 발명의 또 다른 실시예에 따른 표시 장치를 설명하기 위한 평면도이며, 도 25는 도 24의 표시 장치에서 비표시 영역이 벤딩된 상태를 설명하기 위한 저면도이며, 도 26은 도 25의 IX-IX'라인에 따른 단면도이다.
도 24 내지 도 26을 참조하면, 표시 장치는 표시 영역(DA)와 비표시 영역(NDA)을 포함하는 기판(SUB), 상기 기판(SUB) 상의 상기 표시 영역(DA)에 배치되는 표시층(DPL), 상기 기판(SUB) 상의 상기 비표시 영역(NDA)에 배치되고 상기 표시층(DPL)에 신호를 공급하기 위한 배선들(WL), 상기 배선들(WL)과 전기적으로 연결되는 회로 기판(CB), 및 상기 비표시 영역(NDA)의 벤딩시 상기 기판(SUB)과 상기 회로 기판(CB)을 지지하는 지지 부재(SPM)를 포함할 수 있다.
상기 표시 영역(DA)은 4개의 직선의 변들을 포함하는 사각 형상을 가질 수 있다.
상기 비표시 영역(NDA)은 상기 표시 영역(DA)에 인접하여 배치될 수 있다. 상기 비표시 영역(NDA)은 상기 표시 영역(DA)의 상기 변들 각각에 접하는 복수의 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)을 포함할 수 있다. 상기 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)은 벤딩되어 상기 기판(SUB)의 상기 표시층(DPL)이 배치된 면의 반대 방향의 면, 즉, 비발광면 상에 배치될 수 있다. 또한, 상기 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4) 중 적어도 하나, 예를 들면, 상기 제1 서브 비표시 영역(SNDA1)는 상기 회로 기판(CB)과 연결되고, 상기 제1 서브 비표시 영역(SNDA1)의 상기 배선들(WL)은 상기 회로 기판(CB)을 통해 신호를 인가받을 수 있다.
상기 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4) 각각은 상기 표시 영역(DA)에 접하는 표시 연결 영역(DCA1, DCA2, DCA3, DCA4), 및 상기 표시 연결 영역(DCA1, DCA2, DCA3, DCA4)의 일부에서 연장된 적어도 하나의 연장 영역(NDCA1, NDCA2, NDCA3, NDCA4)를 포함할 수 있다.
상기 표시 연결 영역들(DCA1, DCA2, DCA3, DCA4)은 다양한 형상을 가질 수 있다. 본 실시예에서는 표시 연결 영역들(DCA1, DCA2, DCA3, DCA4)이 4개의 직선의 변들을 포함하는 사각 형상인 경우를 예로서 설명한다.
상기 표시 연결 영역들(DCA1, DCA2, DCA3, DCA4)에는 상기 배선들(WL)이 제공될 수 있다. 상기 배선들(WL) 중 일부는 상기 화소들(도 1의 140 참조)에 적어도 화소 전원을 공급할 수 있다. 여기서, 상기 화소 전원은 제1 화소 전원(ELVDD) 및 제2 화소 전원(ELVSS) 중 하나일 수 있다. 상기 배선들(WL) 중 나머지는 타 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)에 상기 화소 전원을 전달할 수 있다.
상기 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4) 중 상기 회로 기판(CB)이 연결되는 제1 서브 비표시 영역(SNDA1)는 두 개의 연장 영역들(NDCA1)을 포함하고, 상기 제2 서브 비표시 영역(SNDA2), 상기 제3 서브 비표시 영역(SNDA3) 및 상기 제4 서브 비표시 영역(SNDA4) 각각은 하나의 연장 영역(NDCA2, NDCA3, NDCA4)를 포함할 수 있다.
상기 연장 영역들(NDCA1, NDCA2, NDCA3, NDCA4) 각각에는 상기 배선들(WL)과 연결되는 연결 단자(ECT1, ECT2, ECT3, ECT4)가 제공될 수 있다.
상기 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)이 벤딩되면, 상기 제1 서브 비표시 영역(SNDA1)의 제1 연장 영역들(NDCA1)은 각각 상기 제2 서브 비표시 영역(SNDA2) 및 상기 제4 서브 비표시 영역(SNDA4)의 연장 영역들(NDCA2, NDCA4)과 중첩될 수 있다. 따라서, 상기 제1 서브 비표시 영역(SNDA1)의 상기 배선들(WL)은 상기 제2 서브 비표시 영역(SNDA2) 및 상기 제4 서브 비표시 영역(SNDA4)의 상기 배선들(WL)과 전기적으로 연결될 수 있다.
또한, 상기 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)이 벤딩되면, 상기 제3 서브 비표시 영역(SNDA3)는 상기 회로 기판(CB)의 일부와 중첩될 수 있다. 여기서, 상기 제3 서브 비표시 영역(SNDA3)의 상기 연결 단자(ECT3)는 상기 회로 기판(CB)과 전기적으로 연결될 수 있다. 따라서, 상기 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)의 상기 배선들(WL) 모두는 상기 제1 화소 전원(ELVDD) 및 상기 제2 화소 전원(ELVSS) 중 적어도 하나를 인가하는 상기 회로 기판(CB)과 전기적으로 연결될 수 있다.
상기 화소들(140)은 상기 배선들 통해 제1 화소 전원(ELVDD) 및 제2 화소 전원(ELVSS) 중 적어도 하나를 인가받으므로, 상기 화소들(140)은 상기 제1 화소 전원(ELVDD) 및 상기 제2 화소 전원(ELVSS) 중 적어도 하나를 상기 표시 영역(DA)의 모든 방향에서 균일하게 인가받을 수 있다. 따라서, 상기 표시 장치는 상기 제1 화소 전원(ELVDD) 및 상기 제2 화소 전원(ELVSS)의 전압 강하에 따른 화질 불량을 방지할 수 있다.
도 27은 본 발명의 또 다른 실시예에 따른 표시 장치를 설명하기 위한 평면도이며, 도 28은 도 27의 표시 장치에서 비표시 영역이 벤딩된 상태를 설명하기 위한 저면도이며, 도 29는 도 28의 X-X'라인에 따른 단면도이며, 도 30은 도 28의 XI-XI'라인에 따른 단면도이다.
도 27 내지 도 30을 참조하면, 표시 장치는 표시 영역(DA)와 비표시 영역(NDA)을 포함하는 기판(SUB), 상기 기판(SUB) 상의 상기 표시 영역(DA)에 배치되는 표시층(DPL), 상기 기판(SUB) 상의 상기 비표시 영역(NDA)에 배치되고 상기 표시층(DPL)에 신호를 공급하기 위한 배선들(WL), 상기 배선들(WL)과 전기적으로 연결되는 회로 기판(CB), 및 상기 비표시 영역(NDA)의 벤딩시 상기 기판(SUB)과 상기 회로 기판(CB)을 지지하는 지지 부재(SPM)를 포함할 수 있다.
상기 표시 영역(DA)은 다양한 형상을 가질 수 있다. 본 실시예에서는 상기 표시 영역(DA)이 4개의 직선의 변들을 포함하는 사각 형상인 경우를 예로서 설명한다.
상기 비표시 영역(NDA)은 상기 표시 영역(DA)에 인접하여 배치될 수 있다. 상기 비표시 영역(NDA)은 상기 표시 영역(DA)의 상기 변들 각각에 접하는 복수의 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)을 포함할 수 있다. 상기 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)은 벤딩되어 상기 기판(SUB)의 상기 표시층(DPL)이 배치된 면의 반대 방향의 면, 즉, 비발광면 상에 배치될 수 있다. 또한, 상기 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)은 상기 회로 기판(CB)과 직접 연결될 수 있다.
상기 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4) 각각은 상기 표시 영역(DA)에 접하는 표시 연결 영역(DCA1, DCA2, DCA3, DCA4)를 구비할 수 있다. 상기 표시 연결 영역(DCA1, DCA2, DCA3, DCA4)는 4 개의 직선의 변들을 포함하는 사각 형상을 가질 수 있다.
상기 표시 연결 영역들(DCA1, DCA2, DCA3, DCA4)에는 상기 배선들(WL)이 제공될 수 있다. 상기 배선들(WL) 중 일부는 상기 화소들(도 1의 140 참조)에 적어도 화소 전원을 공급할 수 있다. 여기서, 상기 화소 전원은 제1 화소 전원(ELVDD) 및 제2 화소 전원(ELVSS) 중 하나일 수 있다. 상기 배선들(WL) 중 나머지는 타 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)에 상기 화소 전원을 전달할 수 있다.
또한, 상기 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4) 중 일부, 예를 들면, 상기 제2 서브 비표시 영역(SNDA2), 상기 제3 서브 비표시 영역(SNDA3) 및 상기 제4 서브 비표시 영역(SNDA4)는 상기 표시 연결 영역(DCA1, DCA2, DCA3, DCA4)의 일부에서 연장된 적어도 하나의 연장 영역(NDCA2, NDCA3, NDCA4)를 더 포함할 수 있다. 상기 연장 영역들(NDCA2, NDCA3, NDCA4)에는 상기 배선들(WL)과 연결되는 연결 단자(ECT2, ECT3, ECT4가 제공될 수 있다.
상기 제2 서브 비표시 영역(SNDA2), 상기 제3 서브 비표시 영역(SNDA3) 및 상기 제4 서브 비표시 영역(SNDA4)의 상기 연장 영역(NDCA2, NDCA3, NDCA4)는 상기 회로 기판(CB)에 연결되고, 상기 연결 단자(ECT2, ECT3, ECT4를 통해 제1 화소 전원(ELVDD) 및 제2 화소 전원(ELVSS) 중 적어도 하나를 인가받을 수 있다. 따라서, 상기 서브 비표시 영역들(SNDA1, SNDA2, SNDA3, SNDA4)의 상기 배선들(WL) 모두는 상기 제1 화소 전원(ELVDD) 및 상기 제2 화소 전원(ELVSS) 중 적어도 하나를 인가하는 상기 회로 기판(CB)과 전기적으로 연결될 수 있다.
상기 화소들(140)은 상기 배선들 통해 제1 화소 전원(ELVDD) 및 제2 화소 전원(ELVSS) 중 적어도 하나를 인가받으므로, 상기 화소들(140)은 상기 제1 화소 전원(ELVDD) 및 상기 제2 화소 전원(ELVSS) 중 적어도 하나를 상기 표시 영역(DA)의 모든 방향에서 균일하게 인가받을 수 있다. 따라서, 상기 표시 장치는 상기 제1 화소 전원(ELVDD) 및 상기 제2 화소 전원(ELVSS)의 전압 강하에 따른 화질 불량을 방지할 수 있다.
이상의 상세한 설명은 본 발명을 예시하고 설명하는 것이다. 또한, 전술한 내용은 본 발명의 바람직한 실시 형태를 나타내고 설명하는 것에 불과하며, 전술한 바와 같이 본 발명은 다양한 다른 조합, 변경 및 환경에서 사용할 수 있으며, 본 명세서에 개시된 발명의 개념의 범위, 저술한 개시 내용과 균등한 범위 및/또는 당업계의 기술 또는 지식의 범위 내에서 변경 또는 수정이 가능하다. 따라서, 이상의 발명의 상세한 설명은 개시된 실시 상태로 본 발명을 제한하려는 의도가 아니다. 또한, 첨부된 청구범위는 다른 실시 상태도 포함하는 것으로 해석되어야 한다.
SUB: 기판
DA: 표시 영역
NDA: 비표시 영역
SNDA1, SNDA2, SNDA3, SNDA4: 서브 비표시 영역
DCA: 표시 연결 영역
NDCA: 연장 영역
WL: 배선
ECT1, ECT2, ECT3, ECT4: 연결 단자
IC: 구동 칩
CB: 회로 기판
DPL: 표시층
DVL: 구동층
EDL: 발광 소자층
SPM: 지지 부재
ASL: 접착층

Claims (35)

  1. 표시 영역, 및 상기 표시 영역의 변에서 연장된 형상을 가지고 서로 이격되는 복수의 서브 비표시 영역들을 구비하는 비표시 영역을 포함하는 기판;
    상기 표시 영역에서 상기 기판의 일면 상에 제공되고, 복수의 화소들을 포함하는 표시층; 및
    상기 기판 상의 상기 서브 비표시 영역들에 제공되고, 상기 화소들에 전기적으로 연결되는 배선들을 포함하며,
    상기 서브 비표시 영역들은
    상기 표시 영역에 연결되는 표시 연결 영역; 및
    상기 표시 연결 영역의 일부에서 연장된 형상을 가지는 적어도 하나의 연장 영역을 포함하고,
    상기 서브 비표시 영역들은 벤딩되어 상기 표시 영역에서 상기 표시층이 배치된 면의 반대 방향 면 상에 배치되고,
    상기 서브 비표시 영역들이 벤딩되면, 서로 인접하는 서브 비표시 영역들 중 하나의 연장 영역은 다른 하나의 연장 영역와 중첩되는 표시 장치.
  2. 제1 항에 있어서,
    상기 연장 영역에 제공되고, 상기 배선들과 전기적으로 연결되는 연결 단자를 더 포함하는 표시 장치.
  3. 제2 항에 있어서,
    상기 서브 비표시 영역들은 서로 이격되는 두 개의 연장 영역들을 포함하는 표시 장치.
  4. 제3 항에 있어서,
    중첩하는 연장 영역들 중 하나의 연장 영역의 상기 연결 단자는 다른 하나의 연장 영역의 상기 연결 단자와 마주하고 전기적으로 연결되는 표시 장치.
  5. 제4 항에 있어서,
    상기 하나의 연장 영역의 상기 연결 단자는 상기 기판의 상기 배선들이 배치되는 면 상에 제공되고,
    상기 다른 하나의 연장 영역의 상기 연결 단자는 상기 기판의 상기 배선들이 배치되는 면의 반대 방향 면 상에 제공되는 표시 장치.
  6. 제5 항에 있어서,
    상기 다른 하나의 연장 영역의 상기 연결 단자는 상기 기판을 관통하는 콘택 홀을 통해 상기 배선들과 전기적으로 연결되는 표시 장치.
  7. 제4 항에 있어서,
    상기 중첩하는 연장 영역들의 상기 연결 단자는 상기 기판의 상기 배선들이 배치되는 면 상에 제공되고, 상기 하나의 연장 영역은 절곡되며,
    상기 하나의 연장 영역의 상기 연결 단자가 다른 하나의 연장 영역의 상기 연결 단자와 마주하고 전기적으로 연결되는 표시 장치.
  8. 제4 항에 있어서,
    상기 하나의 연장 영역은 상기 연결 단자를 커버하고 내부 공간을 제공하는 하우징을 구비하며,
    상기 다른 하나의 연장 영역은 상기 내부 공간에 삽입되는 표시 장치.
  9. 제4 항에 있어서,
    상기 연결 단자들 사이에 배치되고, 이방성 도전 필름 또는 이방성 도전 접착제 중 하나를 포함하는 도전 부재를 더 포함하는 표시 장치.
  10. 제4 항에 있어서,
    서로 인접하는 서브 비표시 영역들의 배선은 전기적으로 연결되는 표시 장치.
  11. 제1 항에 있어서,
    상기 서브 비표시 영역들 중 적어도 하나와 연결되고, 상기 배선들에 신호를 인가하는 회로 기판을 더 포함하는 표시 장치.
  12. 제11 항에 있어서,
    상기 신호는 상기 화소들에 공급되는 화소 전원인 표시 장치.
  13. 표시 영역, 및 상기 표시 영역의 변에서 연장된 형상을 가지고 서로 이격된 복수의 서브 비표시 영역들을 구비하는 비표시 영역을 포함하는 기판;
    상기 표시 영역에서 상기 기판의 일면 상에 제공되고, 복수의 화소들을 포함하는 표시층;
    상기 기판 상의 상기 서브 비표시 영역들에 제공되고, 상기 화소들에 전기적으로 연결되는 배선들; 및
    상기 서브 비표시 영역들 중 적어도 하나와 연결되고, 상기 배선들에 신호를 인가하는 적어도 하나의 회로 기판을 포함하며,
    상기 서브 비표시 영역들은
    상기 표시 영역에 접하는 표시 연결 영역; 및
    상기 표시 연결 영역의 일부에서 연장된 형상을 가지는 적어도 하나의 연장 영역을 포함하고,
    상기 서브 비표시 영역들은 벤딩되어 상기 표시 영역에서 상기 표시층이 배치된 면의 반대 방향 면 상에 배치되고,
    상기 서브 비표시 영역들이 벤딩되면, 상기 배선들은 전기적으로 연결되는 표시 장치.
  14. 제13 항에 있어서,
    상기 연장 영역에 제공되고, 상기 배선들과 전기적으로 연결되는 연결 단자를 더 포함하는 표시 장치.
  15. 제14 항에 있어서,
    상기 표시 연결 영역은 일변이 상기 표시 영역에 접하는 사각 형상을 가지는 표시 장치.
  16. 제15 항에 있어서,
    상기 연장 영역은 상기 표시 연결 영역의 상기 일변에 마주하는 변에서 연장된 형상을 가지는 표시 장치.
  17. 제16 항에 있어서,
    상기 연결 단자는 상기 회로 기판에 직접 연결되는 표시 장치.
  18. 제16 항에 있어서,
    상기 서브 비표시 영역들은 서로 이격되는 두 개의 연장 영역들을 포함하는 표시 장치.
  19. 제18 항에 있어서,
    상기 서브 비표시 영역들이 벤딩되면, 상기 서로 인접하는 비표시 영역들 중 하나의 연장 영역은 다른 하나의 연장 영역와 중첩되고,
    중첩하는 연장 영역들 중 하나의 연장 영역의 상기 연결 단자는 상기 다른 하나의 연장 영역의 연결 단자와 전기적으로 연결되는 표시 장치.
  20. 제19 항에 있어서,
    상기 하나의 연장 영역의 상기 연결 단자는 상기 기판의 상기 배선들이 배치되는 면 상에 제공되고,
    상기 다른 하나의 연장 영역의 상기 연결 단자는 상기 기판의 상기 배선들이 배치되는 면의 반대 방향 면 상에 제공되는 표시 장치.
  21. 제20 항에 있어서,
    상기 다른 하나의 연장 영역의 상기 연결 단자는 상기 기판을 관통하는 콘택 홀을 통해 상기 배선들과 전기적으로 연결되는 표시 장치.
  22. 제19 항에 있어서,
    상기 중첩하는 연장 영역들의 상기 연결 단자는 상기 기판의 상기 배선들이 배치되는 면 상에 제공되고, 상기 하나의 연장 영역은 절곡되며,
    상기 하나의 연장 영역의 상기 연결 단자가 다른 하나의 연장 영역의 상기 연결 단자와 마주하고 전기적으로 연결되는 표시 장치.
  23. 제19 항에 있어서,
    상기 하나의 연장 영역은 상기 연결 단자를 커버하고 내부 공간을 제공하는 하우징을 구비하며,
    상기 다른 하나의 연장 영역은 상기 내부 공간에 삽입되는 표시 장치.
  24. 제19 항에 있어서,
    상기 연결 단자들 사이에 배치되고, 이방성 도전 필름 또는 이방성 도전 접착제 중 하나를 포함하는 도전 부재를 더 포함하는 표시 장치.
  25. 제19 항에 있어서,
    서로 인접하는 서브 비표시 영역들의 배선은 전기적으로 연결되는 표시 장치.
  26. 제15 항에 있어서,
    상기 서브 비표시 영역들은 상기 표시 연결 영역의 상기 일변의 양단에 접하는 변들 각각에서 연장된 형상을 가지는 두 개의 연장 영역들을 포함하는 표시 장치.
  27. 제26 항에 있어서,
    상기 서브 비표시 영역들이 벤딩되면, 상기 서로 인접하는 비표시 영역들 중 하나의 연장 영역은 다른 하나의 연장 영역와 중첩하고,
    상기 하나의 연장 영역은 상기 연결 단자는 상기 다른 하나의 연장 영역의 연결 단자와 전기적으로 연결되는 표시 장치.
  28. 제27 항에 있어서,
    상기 하나의 연장 영역의 상기 연결 단자는 상기 기판의 상기 배선들이 배치되는 면 상에 제공되고,
    상기 다른 하나의 연장 영역의 상기 연결 단자는 상기 기판의 상기 배선들이 배치되는 면의 반대 방향 면 상에 제공되는 표시 장치.
  29. 제28 항에 있어서,
    상기 다른 하나의 연장 영역의 상기 연결 단자는 상기 기판을 관통하는 콘택 홀을 통해 상기 배선들과 전기적으로 연결되는 표시 장치.
  30. 제27 항에 있어서,
    상기 하나의 연장 영역은 상기 연결 단자를 커버하고 내부 공간을 제공하는 하우징을 구비하며,
    상기 다른 하나의 연장 영역은 상기 내부 공간에 삽입되는 표시 장치.
  31. 제27 항에 있어서,
    상기 연결 단자들 사이에 배치되고, 이방성 도전 필름 또는 이방성 도전 접착제 중 하나를 포함하는 도전 부재를 더 포함하는 표시 장치.
  32. 제27 항에 있어서,
    서로 인접하는 서브 비표시 영역들의 배선은 전기적으로 연결되는 표시 장치.
  33. 제15 항에 있어서,
    상기 표시 영역은 사각 형상을 가지고,
    상기 비표시 영역은 상기 표시 영역의 각 변에서 연장된 형상을 가지는 제1 서브 비표시 영역, 제2 서브 비표시 영역, 제3 서브 비표시 영역 및 제4 서브 비표시 영역을 포함하며,
    상기 제1 서브 비표시 영역은 상기 회로 기판에 연결되고, 상기 표시 연결 영역의 상기 일변의 양단에 접하는 변들 각각에서 연장된 형상을 가지는 두 개의 상기 연장 영역들을 구비하며,
    상기 제3 서브 비표시 영역은 상기 제1 서브 비표시 영역와 마주하고, 상기 회로 기판에 연결되는 상기 표시 연결 영역의 상기 일변에 마주하는 변에서 연장된 형상을 가지는 적어도 하나의 상기 연장 영역을 구비하고,
    상기 제3 서브 비표시 영역의 상기 연장 영역은 상기 회로 기판에 연결되는 표시 장치.
  34. 제33 항에 있어서,
    상기 서브 비표시 영역들이 벤딩되면, 상기 제2 서브 비표시 영역 및 상기 제4 서브 비표시 영역은 상기 제1 서브 비표시 영역의 상기 연장 영역들 중 하나와 중첩하는 하나의 연장 영역을 구비하는 표시 장치.
  35. 제12 항에 있어서,
    상기 신호는 상기 화소들에 공급되는 화소 전원인 표시 장치.
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