KR20170142237A - 표시 장치 및 그 제조방법 - Google Patents

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KR20170142237A
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Abstract

표시 영역과 표시 영역의 외측에 배치되는 비표시 영역을 포함하는 제1 기판, 제1 기판의 비표시 영역에 배치되는 제1 게이트 신호 라인 및 제2 게이트 신호 라인, 제1 게이트 신호 라인 및 제2 게이트 신호 라인을 연결시키는 연결 전극 및 상기 연결 전극 상에 배치되는 정전기 방지 패턴을 포함한다.

Description

표시 장치 및 그 제조방법{DISPLAY DEVICE AND MANUFACTURING METHOD THEREOF}
본 발명은 표시 장치 및 그 제조방법에 관한 것이다.
액정 표시 장치는 현재 가장 널리 사용되고 있는 표시 장치 중 하나로서, 대향하는 2개의 전극(화소 전극 및 공통 전극)에 전압을 인가하여 그 사이에 개재된 액정층의 액정 분자들의 배열을 제어함으로써 투과되는 빛의 양을 조정하는 표시 장치이다.
통상적으로 액정 표시 장치는 두 기판과 액정층을 포함하는 형태로 제조되나, 최근에는 제조 공정의 단순화를 위해 하나의 기판과 액정층을 포함하는 형태로 제조되고 있다.
일례로, 액정 표시 장치는 하나의 기판에 희생층과 루프층을 형성한 후 희생층을 제거하고, 희생층 제거로 형성된 미세 공간층에 배향 물질과 액정을 주입하는 방식으로 제조되고 있다.
본 발명이 해결하고자 하는 과제는 신호선을 따라 제공되는 신호가 정전기에 의해 영향을 받아 표시 불량이 발생하는 것을 방지하는 표시 장치를 제공하는 것이다..
본 발명의 과제들은 이상에서 언급한 기술적 과제로 제한되지 않으며, 언급되지 않은 또 다른 기술적 과제들은 아래의 기재로부터 당업자에게 명확하게 이해될 수 있을 것이다.
본 발명의 일 실시예에 따른 표시 장치는 표시 영역과 표시 영역의 외측에 배치되는 비표시 영역을 포함하는 제1 기판, 제1 기판의 비표시 영역에 배치되는 제1 게이트 신호 라인 및 제2 게이트 신호 라인, 제1 게이트 신호 라인 및 제2 게이트 신호 라인을 연결시키는 연결 전극 및 상기 연결 전극 상에 배치되는 정전기 방지 패턴을 포함한다.
또한, 상기 제1 게이트 신호 라인과 상기 제2 게이트 신호 라인은 서로 다른 층에 배치될 수 있다.
또한, 상기 제1 게이트 신호 라인 상에 배치되는 제1 층간 절연막 및 상기 제2 게이트 신호 라인 상에 배치되는 제2 층간 절연막을 더 포함할 수 있다.
또한, 상기 제1 층간 절연막 및 상기 제2 층간 절연막을 관통하여 상기 제1 게이트 신호 라인을 노출시키는 제1 컨택홀 및 상기 제2 층간 절연막을 관통하여 상기 제2 게이트 신호 라인을 노출시키는 제2 컨택홀을 포함하되, 상기 연결 전극의 일단은 상기 제1 컨택홀을 통해 상기 제1 게이트 신호 라인과 접촉하고, 상기 연결 전극의 타단은 상기 제2 컨택홀을 통해 상기 제2 게이트 신호 라인과 접촉할 수 있다.
또한, 상기 정전기 방지 패턴은 상단, 상단 하부에 배치되며 상단과 일정 간격 이격되는 하단 및 상단과 하단을 잇는 측면을 포함하는 제1 금속 패턴을 포함할 수 있다.
또한, 상기 정전기 방지 패턴은 복수개이고 하나의 정전기 방지 패턴의 하단과 인접하는 다른 정전기 방지 패턴의 하단은 서로 접할 수 있다.
또한, 상기 상단과 하단 사이에 일정 공간이 형성될 수 있다.
또한, 상기 정전기 방지 패턴 상에 배치되는 봉지층을 더 포함하고, 상기 봉지층은 상기 일정 공간을 채울 수 있다.
또한, 상기 표시 영역은 상기 제1 기판 상에 배치되는 화소 전극, 상기 화소 전극 상에 배치되는 공통 전극 및 상기 공통 전극 사에 배치되는 봉지층을 포함하고, 상기 제1 금속 패턴은 상기 공통 전극과 동일한 물질로 이루어질 수 있다.
또한, 상기 비표시 영역의 끝단에 배치되는 블랙 매트릭스, 상기 블랙 매트릭스 상에 배치되는 금속층을 더 포함하되, 상기 금속층은 상기 제1 금속 패턴과 동일한 물질로 이루어질 수 있다.
또한, 상기 정전기 방지 패턴은 단면상에서 일정 간격 이격되는 제2 금속 패턴을 포함할 수 있다.
또한, 상기 제2 금속 패턴 사이에 배치되며 상기 제2 금속 패턴과 절연되는 제3 금속 패턴을 더 포함할 수 있다.
또한, 상기 제3 금속 패턴은 상기 연결 전극과 중첩될 수 있다.
본 발명의 실시예들에 의하면 적어도 다음과 같은 효과가 있다.
표시 장치의 비표시 영역에서 정전기가 신호선에 영향을 주는 것을 방지할 수 있다.
본 발명의 실시예들에 따른 효과는 이상에서 예시된 내용에 의해 제한되지 않으며, 더욱 다양한 효과들이 본 명세서 내에 포함되어 있다.
도 1은 본 발명의 일 실시예에 따른 표시 장치의 배치도이다.
도 2는 도 1의 일부분의 단면도이다.
도 3은 도 2의 일부 구성의 부분 확대도이다.
도 4는 도 1의 Ⅰ-Ⅰ'라인을 따라 절단한 단면도이다.
도 5는 본 발명의 다른 실시예에 따른 표시 장치의 단면도이다.
도 6은 본 발명의 다른 실시예에 따른 표시 장치의 단면도이다.
도 7은 본 발명의 일 실시예에 따른 표시 장치에서 표시 영역(DA)의 일 부분을 예시하는 단면도이다.
도 8은 본 발명의 일 실시예에 따른 표시 장치의 제조 방법을 설명하기 위한 단면도이다.
도 9는 본 발명의 일 실시예에 따른 표시 장치의 제조 방법을 설명하기 위한 단면도이다.
도 10은 본 발명의 일 실시예에 따른 표시 장치의 제조 방법을 설명하기 위한 단면도이다.
도 11은 본 발명의 일 실시예에 따른 표시 장치의 제조 방법을 설명하기 위한 단면도이다.
도 12는 본 발명의 일 실시예에 따른 표시 장치의 제조 방법을 설명하기 위한 단면도이다.
본 발명의 이점 및 특징, 그리고 그것들을 달성하는 방법은 첨부되는 도면과 함께 상세하게 후술되어 있는 실시예들을 참조하면 명확해질 것이다. 그러나 본 발명은 이하에서 개시되는 실시예들에 한정되는 것이 아니라 서로 다른 다양한 형태로 구현될 수 있으며, 단지 본 실시예들은 본 발명의 개시가 완전하도록 하며, 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자에게 발명의 범주를 완전하게 알려주기 위해 제공되는 것이며, 본 발명은 청구항의 범주에 의해 정의될 뿐이다.
제1, 제2 등이 다양한 구성요소들을 서술하기 위해 사용되나, 이들 구성요소들은 이들 용어에 의해 제한되지 않음은 물론이며, 단지 하나의 구성요소를 다른 구성요소와 구별하기 위해 사용하는 것이다. 따라서, 이하에서 언급되는 제1 구성요소는 본 발명의 기술적 사상 내에서 제2 구성요소일 수 있음은 물론이다.
이하, 첨부된 도면을 참조로 하여 본 발명의 실시예들에 대해 설명한다. 다만, 본 명세서에서는 본 발명에 따른 표시 장치를 액정 표시 장치를 예로 들어 설명하나, 이에 제한되는 것은 아니며 기술적으로 저촉하지 않는 범위내에서 다른 표시 장치의 경우에도 적용될 수 있다.
도 1은 본 발명의 일 실시예에 따른 표시 장치의 배치도이다. 도 2는 도 1의 일부분의 단면도이다. 도 3은 도 2의 일부 구성의 부분 확대도이다. 도 4는 도 1의 Ⅰ-Ⅰ'라인을 따라 절단한 단면도이다.
도 1 내지 도 4를 참조하면, 본 발명의 일 실시예에 따른 표시 장치는 표시 영역(DA)과 표시 영역(DA) 외측에 배치되는 비표시 영역(NDA)을 포함하는 제1 기판(500), 제1 기판(500)의 비표시 영역(NDA)에 배치되는 제1 게이트 신호 라인(GSL1) 및 제2 게이트 신호 라인(GSL2), 제1 게이트 신호 라인(GSL1) 및 제2 게이트 신호 라인(GSL2)을 연결시키는 연결 전극(CE) 및 연결 전극(CE) 상에 배치되는 정전기 방지 패턴(EP)을 포함한다.
먼저, 도 1을 참조하면, 제1 기판(500)은 내열성 및 투과성을 가진 물질로 형성될 수 있다. 제1 기판(500)은 예컨대, 투명 유리 또는 플라스틱으로 형성될 수 있으나, 이에 제한되는 것은 아니다. 제1 기판(500) 상에는 표시 영역(DA)과 비표시 영역(NDA)이 정의될 수 있다.
표시 영역(DA)은 디스플레이 장치에서 화상이 표시되는 영역이며, 비표시 영역(NDA)은 표시 영역(DA)에서 화상을 표시할 수 있게 하기 위해 각종 신호선들이 배치되는 영역이다.
비표시 영역(NDA) 상에는 표시 영역(DA)의 데이터 라인(DL) 및 또는 게이트 라인(GL)에 데이터 신호를 제공하는 복수의 구동부(DU), 및 구동부(DU)로부터 제공되는 신호를 데이터 라인(DL)에 전달하는 복수의 데이터 팬아웃 라인(DFL) 및 구동부(DU)로부터 제공되는 신호를 게이트 라인(GL)에 전달하는 제1 및 제2 게이트 신호 라인(GSL1, GSL2)이 배치될 수 있다. 도 1은 데이터 라인(DL)에 전달되는 신호와 게이트 라인(GL)에 전달되는 신호가 동일한 구동부(DU)에서 제공되는 경우를 예시하나 이에 제한되는 것은 아니다. 즉, 다른 실시예에서는 독립적으로 배치되는 별개의 구동부가 각각 독립적으로 데이터 라인(DL)과 게이트 라인(GL)에 신호를 제공할 수도 있다.
일 실시예에서 제1 게이트 신호 라인(GSL1)과 제2 게이트 신호 라인(GSL2)은 서로 다른 층에 배치될 수 있다. 다시 말하면, 제1 게이트 신호 라인(GSL1)과 제2 게이트 신호 라인(GSL2)은 서로 다른 레벨을 가질 수 있다.
서로 다른 층에 배치되는 제1 게이트 신호 라인(GSL1) 및 제2 게이트 신호 라인(GSL2)을 연결하기 위해 브릿지(BR)가 필요할 수 있다. 브릿지(BR)는 제1 게이트 신호 라인(GSL1) 및 제2 게이트 신호 라인(GSL2)을 연결할 수 있다.
이에 대한 자세한 설명은 도 2에서 이어하기로 한다.
표시 영역(DA)에 대해 더 구체적으로 설명하면, 표시 영역(DA)상에는 복수의 데이터 라인(DL)과 복수의 게이트 라인(GL)이 서로 교차하여 구획하는 복수의 화소가 배치될 수 있다.
표시 영역(DA)에서 게이트 라인(GL)은 제1 방향으로 연장될 수 있다. 제1 방향은 예컨대, 도 1에서 가로 방향일 수 있다. 하나의 화소마다 게이트 라인(GL)으로부터 분지된 게이트 전극(도시하지 않음)이 배치될 수 있다.
게이트 라인(GL)은 알루미늄 합금을 포함하는 알루미늄(Al) 계열의 금속, 은 합금을 포함하는 은(Ag) 계열의 금속, 구리 합금을 포함하는 구리(Cu)계열의 금속, 몰리브덴 합금을 포함하는 몰리브덴(Mo) 계열 금속, 크롬(Cr), 티타늄(Ti), 및 탄탈륨(Ta) 중 어느 하나 이상을 포함할 수 있다. 다만, 이는 예시적인 것으로 게이트 라인(GL)의 재질이 이에 제한되는 것은 아니며, 원하는 표시장치를 구현하기 위해 요구되는 성능을 가진 금속 또는 고분자 물질이 게이트 라인(GL)의 재료로서 이용될 수 있다.
게이트 라인(GL) 상에는 제1 층간 절연막(IL1)이 배치될 수 있다. 제1 층간 절연막(IL1)은 게이트 라인(GL)을 덮으며, 제1 기판(500)의 전면에 형성될 수 있다. 제1 층간 절연막(IL1)은 실리콘 산화물(SiOx), 실리콘 산화물(SiNx) 등의 무기 절연물질, BCB(BenzoCycloButene), 아크릴계 물질, 및 폴리이미드와 같은 유기 절연 물질로 이루어진 군에서 선택된 어느 하나 또는 하나 이상의 물질을 혼합하여 형성할 수 있다.
제1 층간 절연막(IL1) 상에는 데이터 라인(DL)이 배치될 수 있다. 데이터 라인(DL)은 표시 영역(DA)에서 제2 방향으로 연장될 수 있다. 제2 방향은 예컨대, 도 1에서 세로 방향일 수 있다.
데이터 라인(DL)은 니켈(Ni), 코발트(Co), 티탄(Ti), 은(Ag), 구리(Cu), 몰리브덴(Mo), 알루미늄(Al), 베릴륨(Be), 니오브(Nb), 금(Au), 철(Fe), 셀렌(Se) 또는 탄탈(Ta) 등으로 이루어진 단일막 또는 다중막 구조를 가질 수 있다. 또한, 상기 금속에 티탄(Ti), 지르코늄(Zr), 텅스텐(W), 탄탈(Ta), 니오브(Nb), 백금(Pt), 하프늄(Hf), 산소(O) 및 질소(N)로 이루어진 군에서 선택된 하나 이상의 원소를 포함시켜 형성한 합금도 적용할 수 있다
앞서 설명한 바와 같이 복수의 데이터 라인(DL)과 복수의 게이트 라인(GL)이 교차하여 복수의 화소를 정의할 수 있다. 즉, 표시 영역(DA)은 복수의 열과 복수의 행을 갖도록 배치되는 복수의 화소를 포함할 수 있다.
도 2는 도 1의 브릿지(BR)의 단면도이다. 도 2는 비표시 영역(NDA) 상에 하나의 브릿지(BR)가 배치되는 경우를 예시하지만 이는 예시적인 것으로, 브릿지의 개수가 이에 제한되는 것은 아니다. 즉, 일 실시예에서 브릿지(BR)는 복수의 게이트 신호 라인에 대응될 수 있도록 복수개 배치될 수 있다.
도 2를 참조하여 설명하면, 제1 기판(500) 상에 제1 게이트 신호 라인(GSL1)이 배치된다.
제1 게이트 신호 라인(GSL1) 상에는 제1 층간 절연막(IL1)이 배치된다. 제1 층간 절연막(IL1)은 표시 영역(DA)에 배치되는 제1 층간 절연막(IL1)과 실질적으로 동일할 수 있다.
제1 층간 절연막(IL1) 상에는 제2 게이트 신호 라인(GSL2)이 배치될 수 있다. 제2 게이트 신호 라인(GSL2)은 제1 게이트 신호 라인(GSL1)과 일정 간격 이격되며, 서로 중첩되지 않을 수 있다.
제2 게이트 신호 라인(GSL2) 상에는 제2 층간 절연막(IL2)이 배치될 수 있다. 제2 층간 절연막(IL2)은 표시 영역(DA)에 배치되는 제2 층간 절연막(IL2)와 동일할 수 있다.
일 실시예에서 제1 게이트 신호 라인(GSL1)은 게이트 라인(GL)과 동일층에 배치되고, 제2 게이트 신호 라인(GSL2)은 데이터 라인(DL)과 동일층에 배치될 수 있다.
또한, 일 실시예에서 제1 게이트 신호 라인(GSL1)과 게이트 라인(GL)은 서로 동일한 물질로 이루어지고, 제2 게이트 신호 라인(GSL2)은 데이터 라인(DL)과 서로 동일한 물질로 이루어질 수 있다.
제1 층간 절연막(IL1)과 제2 층간 절연막(IL2)에는 제1 층간 절연막(IL1)과 제2 층간 절연막(IL2)을 관통하는 제1 컨택홀(CNT1)이 형성될 수 있다. 제1 컨택홀(CNT1)은 제1 게이트 신호 라인(GSL1)의 상면을 적어도 부분적으로 노출시킬 수 있다.
제2 층간 절연막(IL2)에는 제2 층간 절연막(IL2)을 관통하는 제2 컨택홀(CNT2)이 형성될 수 있다. 제2 컨택홀(CNT2)은 제2 게이트 신호 라인(GSL2)의 상면을 적어도 부분적으로 노출시킬 수 있다.
제2 층간 절연막(IL2) 상에는 연결 전극(CE)이 배치될 수 있다. 연결 전극(CE)의 일단은 제1 컨택홀(CNT1) 상에 타단은 제2 컨택홀(CNT2) 상에 배치될 수 있다. 다시 말하면, 연결 전극(CE)의 일단은 제1 컨택홀(CNT1)과 접촉하고 타단은 제2 컨택홀(CNT2)과 접촉할 수 있다.
즉 연결 전극(CE)은 제1 컨택홀(CNT1)과 제2 컨택홀(CNT2)을 전기적으로 연결할 수 있다.
일 실시예에서 연결 전극(CE)은 화소 영역에 배치되는 화소 전극(도시하지 않음)과 동일한 물질로 형성될 수 있다. 즉, 연결 전극(CE)은 표시 영역(DA)에서 화소 전극(PE)을 형성함과 동시에 형성할 수 있다.
연결 전극(CE)과 제2 층간 절연막(IL2) 상에는 블랙 매트릭스(BM)가 배치될 수 있다. 블랙 매트릭스(BM)는 외부로부터 입사되는 광을 차단하거나, 내부로부터 퍼지는 빛을 막는 역할을 할 수 있다. 이를 위해 블랙 매트릭스는 검정색 안료를 포함하는 감광성 수지로 형성될 수 있다.
일 실시예에서 블랙 매트릭스(BM)는 표시 영역(DA)의 블랙 매트릭스(BM)로부터 연장되어 형성될 수 있다. 즉, 일 실시예에서 표시 장치는 블랙 매트릭스(BM)가 하부 기판 상에 배치되는 BCS 형 표시 장치 또는 BOA 형 표시 장치일 수 있다.
블랙 매트릭스(BM) 상에는 제1 정전기 방지 패턴(EP1)이 배치될 수 있다. 제1 정전기 방지 패턴(EP1)은 제1 금속 패턴(MP1) 및 제3 층간 절연막(IL3)을 포함할 수 있다.
제1 금속 패턴(MP1)에 대한 자세한 설명을 위해 도 3이 참조된다. 금속 패턴(MP1)은 상단(UP), 측면(SP) 및 하단(BP)을 포함할 수 있다. 상단(UP)은 기준면(도 2에서는 블랙 매트릭스(BM)의 상면)으로부터 일정 간격 이격되어 배치될 수 있다. 즉, 블랙 매트릭스(BM)와 상단(UP)은 일정 간격 이격되므로, 블랙 매트릭스(BM)와 상단(UP) 사이에는 일정 공간(ES)이 배치될 수 있다.
측면(SP)은 상단(UP)의 단부로부터 연장될 수 있다. 즉, 상단(UP)의 단부로부터 하부를 향해 연장될 수 있다. 이를 측면(SP) 기준으로 설명하면 측면(SP)의 일단은 상단(UP)과 접하고, 측면(SP)의 타단은 하단(BP)과 접할 수 있다.
도 3에서는 측면(SP)의 형상이 완만한 곡면을 포함하는 경우를 예시하나 측면(SP)의 형상이 이에 제한되는 것은 아니다. 즉, 측면은 수직으로 내려가는 평판 형상, 경사를 가지며 내려가는 평판 형상 및 계단 형상으로 이루어진 군 중 선택된 어느 하나 이상의 형상을 포함할 수 있다. 즉, 상단(UP)과 하단(BP)을 잇는 측면(SP)의 형상은 제한되지 않는다.
하단(BP)은 기준면 즉, 블랙 매트릭스(BM)의 상면과 직접 접할 수 있다. 하단(BP)은 인접하게 배치되는 제1 정전기 방지 패턴(EP1)과 연결될 수 있다. 즉, 도 2 및 도 3에서 도시하는 바와 같이 복수의 제1 정전기 방지 패턴(EP1)은 하단이 서로 연결되어 일체로 형성될 수 있다.
이와 같이 연결 전극(CE) 상에 정전기 방지 패턴이 형성되는 경우, 외부로부터 발생하는 정전기가 신호에 영향을 미쳐 신호 불량이 발생하는 것을 방지할 수 있다. 즉, 정전기 방지 패턴이 정전기를 분산시킴으로써, 정전기가 신호에 영향을 미치는 것을 차단할 수 있다.
또한, 하단(BP)과 상단(UP)은 서로 중첩되지 않을 수 있다.
상단(UP)과 하단(BP)이 수평 방향으로 이격되어 있으므로, 상단(UP) 하부에는 일정 공간(ES)이 배치될 수 있다. 이 빈 공간(ES)은 봉지층(EN)으로 채워질 수 있다.
다시 도 2를 참조하면, 제1 정전기 방지 패턴(EP1) 상에는 제3 층간 절연막(IL3)이 배치될 수 있다. 제3 층간 절연막(IL3)은 실리콘 산화물(SiOx), 실리콘 산화물(SiNx) 등의 무기 절연물질, BCB(BenzoCycloButene), 아크릴계 물질, 및 폴리이미드와 같은 유기 절연 물질로 이루어진 군에서 선택된 어느 하나 또는 하나 이상의 물질을 혼합하여 형성할 수 있다.
일 실시예에서 제3 층간 절연막(IL3)은 생략될 수도 있다.
제1 정전기 방지 패턴(EP1) 상에는 봉지층(EN)이 배치될 수 있다. 봉지층(EN)은 절연 물질로 형성될 수 있다. 일 실시예에서 봉지층(EN)은 표시 장치의 상부 기판(일반적인 액정 표시 장치의 상부 기판을 의미함)을 대체하는 봉지층(EN)일 수 있다.
봉지층(EN)은 제1 정전기 방지 패턴(EP1)의 상부에 배치됨과 동시에 상단(UP) 하부에 배치되는 일정 공간(ES)을 채울 수 있다.
도 4는 본 발명의 일 실시예에 따른 표시 장치의 테두리 부분 즉 비표시 영역(NDA)의 끝단을 보여주는 단면도이다.
도 4를 참조하면, 비표시 영역(NDA)의 끝단에는 블랙 매트릭스(BM), 금속층(300) 및 절연층(301)이 배치될 수 있다. 블랙 매트릭스(BM)는 앞서 도 2에서 설명한 블랙 매트릭스(BM)와 동일할 수 있다. 즉, 블랙 매트릭스(BM)는 표시 영역(DA)에서 비표시 영역(NDA)에 이르기까지 제1 기판(500) 상에 전면적으로 형성될 수 잇다.
블랙 매트릭스(BM) 상에는 금속층(300)이 배치될 수 있다. 금속층(300)은 블랙 매트릭스(BM)의 상면과 측벽을 덮을 수 있다. 즉, 금속층(300)의 측벽보다 블랙 매트릭스(BM)의 측벽이 상대적으로 내측에 배치될 수 있다. 금속층(300)은 도 2의 금속 패턴(MP1)과 실질적으로 동일한 물질로 형성될 수 있다. 즉, 일 실시예에서 금속층(300)과 금속 패턴(MP1)은 동일 공정에서 동시에 형성될 수 있다. 다만, 본 발명의 범위가 이와 같은 제조 방법에 의해 제한되지 않음은 물론이다.
금속층(300) 상에는 절연층(301)이 배치될 수 있다. 절연층(301)은 도 2의 제3 층간 절연막(IL3)과 실질적으로 동일한 물질로 형성될 수 있다. 즉, 일 실시예에서 절연층(301)은 제3 층간 절연막(IL3)과 동일 공정에서 동시에 형성될 수 있다. 절연층(301)은 금속층(300)의 상면 및 측벽을 덮을 수 있다. 즉, 금속층(300)의 측벽은 절연층(301)의 측벽에 비해 상대적으로 내측에 배치될 수 있다.
도 5는 본 발명의 다른 실시예에 따른 표시 장치의 단면도이다.
도 5를 참조하면, 본 발명의 다른 실시예에 따른 표시 장치는 제2 정전기 방지 패턴(EP2)이 형성되는 점이 도 2의 실시예와 다른 점이다.
제2 정전기 방지 패턴(EP2)은 제2 금속 패턴(MP2) 및 제3 층간 절연막(IL3)을 포함할 수 있다.
제2 금속 패턴(MP2)은 블랙 매트릭스(BM) 상에 배치될 수 있다. 제2 금속 패턴(MP2)은 일정 간격 이격되어 배치될 수 있다. 일 실시예에서 인접하는 제2 금속 패턴(MP2)은 서로 전기적으로 연결될 수 있으나, 이에 제한되는 것은 아니며 서로 절연될 수도 있다.
즉, 일 실시예에서 제2 금속 패턴(MP2)은 도 5에서 보는 바와 같이 단면상에서는 서로 이격되지만 평면 상에서는 서로 연결되도록 형성될 수도 있다.
일 실시예에서 제2 금속 패턴(MP2)은 연결 전극(CE)과 중첩되지 않도록 배치될 수 있다.
이는 전기적으로 연결된 제2 금속 패턴(MP2)이 연결 전극(CE)에 영향을 미치는 것을 방지하기 위함이다.
제2 금속 패턴(MP2) 상에는 제3 층간 절연막(IL3)이 배치될 수 있다. 제3 층간 절연막(IL3) 상에는 봉지층(EN)이 배치될 수 있다. 제3 층간 절연막(IL3) 및 봉지층(EN)은 앞서 설명한 바와 같으므로 이에 대한 자세한 설명은 생략하기로 한다.
도 6은 본 발명의 다른 실시예에 따른 표시 장치의 단면도이다.
도 6을 참조하면, 제2 정전기 방지 패턴(EP2) 사이에 제3 정전기 방지 패턴(EP3)이 더 배치될 수 있다.
제3 정전기 방지 패턴(EP3)은 제2 정전기 방지 패턴(EP2) 사이에 배치될 수 있다. 제3 정전기 방지 패턴(EP3)은 제2 정전기 방지 패턴(EP2)과 전기적으로 절연될 수 있다. 즉, 복수의 제2 정전기 방지 패턴(EP2)이 서로 전기적으로 연결되는 예시적인 실시예에서 제3 정전기 방지 패턴(EP3)은 제2 정전기 방지 패턴(EP2)과 절연될 수 있다.
제3 정전기 방지 패턴(EP3)은 연결 전극(CE)과 중첩되도록 배치될 수 있다.
도 7은 본 발명의 일 실시예에 따른 표시 장치에서 표시 영역(DA)의 일 부분을 예시하는 단면도이다.
도 7을 참조하면, 본 발명의 일 실시예에 따른 표시 장치는 상부 기판이 봉지층(EN)으로 대체된 표시 장치일 수 있다.
이에 대해 설명하면, 제1 기판(500) 상에 제1 층간 절연막(IL1)이 배치될 수 있다. 제1 층간 절연막(IL1)은 앞서 도 2에서 설명한 제1 층간 절연막(IL1)과 실질적으로 동일한 물질로 형성될 수 있다.
제1 층간 절연막(IL1) 상에는 데이터 라인(DL)이 배치될 수 있다. 데이터 라인(DL) 상에는 제2 층간 절연막(IL2)이 배치될 수 있다. 제2 층간 절연막(IL2)은 앞서 도 2에서 설명한 제2 층간 절연막(IL2)와 실질적으로 동일한 물질로 형성될 수 있다.
제2 층간 절연막(IL2) 상에는 블랙 매트릭스(BM)와 컬러 필터(CF)가 배치될 수 있다. 즉, 일 실시예에 따른 표시 장치는 블랙 매트릭스(BM)와 컬러 필터(CF)가 하부 기판 상에 형성되는 표시 장치일 수 있다.
블랙 매트릭스(BM)는 데이터 라인(DL) 및/또는 게이트 라인(GL)을 따라 연장될 수 있다. 앞서 설명한 바와 같이 블랙 매트릭스(BM)는 표시 영역(DA)에서부터 비표시 영역(NDA)까지 일체로 형성될 수 있다.
블랙 매트릭스(BM)와 컬러 필터(CF) 상에는 평탄화막(FL)이 배치될 수 있다. 평탄화막(FL)은 절연막으로서, 블랙 매트릭스(BM)와 컬러 필터(CF) 상면을 평탄화할 수 있다.
평탄화막(FL) 상에는 화소 전극(PE)이 배치될 수 있다. 일 실시예에서 화소 전극(PE)은 ITO(Indium Tin Oxide) 또는 IZO(Indium Zinc Oxide) 등의 투명 도전체 또는 알루미늄 등의 반사성 도전체로 형성될 수 있다.
일 실시예에서 화소 전극(PE)과 비표시 영역(NDA)의 연결 전극(CE)은 실질적으로 동일한 물질로 형성될 수 있다. 즉, 연결 전극(CE)과 화소 전극(PE)은 동일 공정에서 동시에 형성될 수 있다.
화소 전극(PE) 상에는 서포터(SU)가 배치될 수 있다. 서포터(SU)는 화소 전극(PE) 상에 복수개의 공간을 구획할 수 있다. 즉, 서포터(SU)의 상부와 하부는 서로 이격되며 그 사이에 복수개의 공간을 형성할 수 있다. 이하에서는 이 복수개의 공간을 캐비티(CV)라고 지칭하기로 한다.
하나의 캐비티(CV) 안에는 복수개의 액정 분자(LC)가 배치될 수 있다. 즉, 캐비티(CV) 내부에 복수의 액정 분자(LC)가 배치되는 액정층(LCL)이 배치될 수 있다.
서포터(SU)의 상부에는 공통 전극(COM)이 배치될 수 있다. 일 실시예에서 공통 전극(COM)은 패터닝되지 않은 전면 전극일 수 있다.
공통 전극(COM)에는 공통 전압이 인가될 수 있다. 공통 전극(COM)과 화소 전극(PE)에 서로 다른 전압이 인가되면, 공통 전극(COM)과 화소 전극(PE) 사이에 일정한 전계가 형성될 수 있다. 액정 분자(LC)들은 공통 전극(COM)과 화소 전극(PE) 사이에 형성된 전계에 의해 제어될 수 있으며, 액정층(LCL)에 배치되는 액정 분자(LC)의 움직임을 제어함으로써, 영상을 표시하는데 필요한 빛을 제어할 수 있다.
일 실시예에서 공통 전극(COM)은 비표시 영역(NDA)의 금속 패턴(MP1, MP2, MP3)와 실질적으로 동일한 물질로 형성될 수 있다. 즉 일 실시예에서 공통 전극(COM)과 금속 패턴(MP1, MP2, MP3)은 동일 공정에서 동시에 형성될 수 있다.
공통 전극(COM) 상에는 봉지층(EN)이 배치될 수 있다. 봉지층(EN)은 절연물질로 이루어질 수 있으며, 일 실시예에서 액정 표시 장치의 상부 기판을 대체할 수 있다.
이하에서는, 본 발명의 몇몇 실시예에 따른 표시 장치의 제조 방법에 대해 설명하기로 한다. 이하에서 설명하는 구성의 일부는 앞서 본 발명의 몇몇 실시예에 따른 액정 표시 장치의 구성과 동일할 수 있으며, 중복 설명을 피하기 위해 일부 구성에 대한 설명은 생략될 수 있다.
도 8 내지 도 12는 본 발명의 일 실시예에 따른 표시 장치의 제조 방법을 설명하기 위한 단면도이다.
도 8 내지 도 12를 참조하면, 본 발명의 일 실시예에 따른 표시 장치의 제조 방법은 표시 영역(DA)과 비표시 영역(NDA)을 포함하는 제1 기판(500)으로서, 비표시 영역(NDA)에 배치되는 제1 게이트 신호 라인(GSL1), 제1 게이트 신호 라인(GSL1) 상에 배치되는 제1 층간 절연막(IL1), 제1 층간 절연막(IL1) 상에 배치되는 제2 게이트 신호 라인(GSL2), 제2 게이트 신호 라인(GSL2) 상에 배치되는 제2 층간 절연막(IL2)을 포함하는 제1 기판(500)을 준비하는 단계, 제2 층간 절연막(IL2) 상에 제1 게이트 신호 라인(GSL1)과 제2 게이트 신호 라인(GSL2)을 연결하는 연결 전극(CE)을 형성하는 단계 및 연결 전극(CE) 및 제2 층간 절연막(IL2) 상에 정전기 방지 패턴(EP1)을 형성하는 단계를 포함한다.
먼저, 도 8을 참조하면, 표시 영역(DA)과 비표시 영역(NDA)을 포함하는 제1 기판(500)으로서, 비표시 영역(NDA)에 배치되는 제1 게이트 신호 라인(GSL1), 제1 게이트 신호 라인(GSL1) 상에 배치되는 제1 층간 절연막(IL1), 제1 층간 절연막(IL1) 상에 배치되는 제2 게이트 신호 라인(GSL2), 제2 게이트 신호 라인(GSL2) 상에 배치되는 제2 층간 절연막(IL2)을 포함하는 제1 기판(500)을 준비하는 단계가 진행된다. 제1 기판(500), 제1 게이트 신호 라인(GSL1), 제2 게이트 신호 라인(GSL2), 제1 층간 절연막(IL1), 제2 층간 절연막(IL2)은 앞서 본 발명의 몇몇 실시예에 따른 표시 장치에서 설명한 것과 실질적으로 동일할 수 있다. 따라서 이에 대한 자세한 설명은 생략하기로 한다. (자세한 것은 도 2에 대한 설명 참조)
이어서, 도 9를 참조하면, 제2 층간 절연막(IL2) 상에 제1 게이트 신호 라인(GSL1)과 제2 게이트 신호 라인(GSL2)을 연결하는 연결 전극(CE)을 형성하는 단계가 진행될 수 있다. 제2 층간 절연막(IL2) 상에 제1 게이트 신호 라인(GSL1)과 제2 게이트 신호 라인(GSL2)을 연결하는 연결 전극(CE)을 형성하는 단계가 진행되기 전에 제1 층간 절연막(IL1) 및 제2 층간 절연막(IL2)을 관통하여 제1 게이트 신호 라인(GSL1)을 노출시키는 제1 컨택홀(CNT1)을 형성하는 단계 및 제2 층간 절연막(IL2)을 관통하여 제2 게이트 신호 라인(GSL2)을 노출시키는 제2 컨택홀(CNT2)을 형성하는 단계가 진행될 수 있다.
즉, 연결 전극(CE)의 일단은 제1 컨택홀(CNT1) 상에 타단은 제2 컨택홀(CNT2) 상에 배치될 수 있다. 다시 말하면, 연결 전극(CE)의 일단은 제1 게이트 신호 라인(GSL1)과 접하고 타단은 제2 게이트 신호 라인(GSL2)과 접할 수 있다.
이어서, 도 10을 참조하면, 연결 전극(CE) 및 제2 층간 절연막(IL2) 블랙 매트릭스(BM)를 형성하는 단계가 진행될 수 있다. 블랙 매트릭스(BM)는 앞서 본 발명의 몇몇 실시예에 따른 표시 장치에서 설명한 것과 동일할 수 있다. 따라서 이에 대한 자세한 설명은 생략하기로 한다.
이어서 도 11을 참조하면, 연결 전극(CE) 및 제2 층간 절연막(IL2) 상에 정전기 방지 패턴(EP1)을 형성하는 단계가 진행된다.
정전기 방지 패턴은 앞서 본 발명의 몇몇 실시예에 따른 표시 장치에서 설명한 것과 동일할 수 있다. 즉, 정전기 방지 패턴은 앞서 도 2, 도 5 및 도 6에서 설명한 정전기 방지 패턴 중 어느 하나를 선택하여 형성할 수 있다.
즉, 도 11은 도 2의 정전기 방지 패턴(EP1)을 형성하는 경우를 예시하지만, 본 발명의 범위가 이에 제한되는 것은 아니다.
이어서, 도 12를 참조하면, 정전기 방지 패턴(EP1) 상에 봉지층(EN)을 형성하는 단계가 진행될 수 있다. 앞서 설명한 바와 같이(도 7 참조) 본 발명의 일 실시예에 따른 표시 장치는 상부 기판이 봉지층(EN)으로 대체될 수 있다. 이에 따라 정전기 방지 패턴(EP1) 상에 봉지층(EN)이 배치될 수 있다. 즉, 표시 영역(DA)의 봉지층(EN)이 비표시 영역(NDA)까지 연장되어 정전기 방지 패턴(EP1)과 접촉할 수 있다.
이상 첨부된 도면을 참조하여 본 발명의 실시예들을 설명하였지만, 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자는 본 발명의 그 기술적 사상이나 필수적인 특징을 변경하지 않고서 다른 구체적인 형태로 실시될 수 있다는 것을 이해할 수 있을 것이다. 그러므로 이상에서 기술한 실시예들은 모든 면에서 예시적인 것이며 한정적이지 않는 것으로 이해해야 한다.
DA: 표시 영역
NDA: 비표시 영역
DL: 데이터 라인
GL: 게이트 라인
500: 제1 기판
GSL: 게이트 신호 라인
BR: 브릿지
EP: 정전기 방지 패턴
MP: 금속 패턴
ES: 일정 공간
IL: 층간 절연막
BM: 블랙 매트릭스
EN: 봉지층
CE: 연결 전극
COM: 공통 전극
PE: 화소 전극
CV: 캐비티
SU: 서포터

Claims (20)

  1. 표시 영역과 상기 표시 영역의 외측에 배치되는 비표시 영역을 포함하는 제1 기판;
    상기 제1 기판의 비표시 영역에 배치되는 제1 게이트 신호 라인 및 제2 게이트 신호 라인;
    상기 제1 게이트 신호 라인 및 상기 제2 게이트 신호 라인을 연결시키는 연결 전극; 및
    상기 연결 전극 상에 배치되는 정전기 방지 패턴을 포함하는 표시 장치.
  2. 제1항에 있어서,
    상기 제1 게이트 신호 라인과 상기 제2 게이트 신호 라인은 서로 다른 층에 배치되는 표시 장치.
  3. 제1항에 있어서,
    상기 제1 게이트 신호 라인 상에 배치되는 제1 층간 절연막 및 상기 제2 게이트 신호 라인 상에 배치되는 제2 층간 절연막을 더 포함하는 표시 장치.
  4. 제3항에 있어서,
    상기 제1 층간 절연막 및 상기 제2 층간 절연막을 관통하여 상기 제1 게이트 신호 라인을 노출시키는 제1 컨택홀 및 상기 제2 층간 절연막을 관통하여 상기 제2 게이트 신호 라인을 노출시키는 제2 컨택홀을 포함하되, 상기 연결 전극의 일단은 상기 제1 컨택홀을 통해 상기 제1 게이트 신호 라인과 접촉하고, 상기 연결 전극의 타단은 상기 제2 컨택홀을 통해 상기 제2 게이트 신호 라인과 접촉하는 표시 장치.
  5. 제1항에 있어서,
    상기 정전기 방지 패턴은 상단, 상단 하부에 배치되며 상단과 일정 간격 이격되는 하단 및 상단과 하단을 잇는 측면을 포함하는 제1 금속 패턴을 포함하는 표시 장치.
  6. 제5항에 있어서,
    상기 정전기 방지 패턴은 복수개이고 하나의 정전기 방지 패턴의 하단과 인접하는 다른 정전기 방지 패턴의 하단은 서로 접하는 표시 장치.
  7. 제5항에 있어서,
    상기 상단과 하단 사이에 일정 공간이 형성되는 표시 장치.
  8. 제7항에 있어서,
    상기 정전기 방지 패턴 상에 배치되는 봉지층을 더 포함하고, 상기 봉지층은 상기 일정 공간을 채우는 표시 장치.
  9. 제5항에 있어서,
    상기 표시 영역은 상기 제1 기판 상에 배치되는 화소 전극, 상기 화소 전극 상에 배치되는 공통 전극 및 상기 공통 전극 사에 배치되는 봉지층을 포함하고, 상기 제1 금속 패턴은 상기 공통 전극과 동일한 물질로 이루어지는 표시 장치.
  10. 제1항에 있어서,
    상기 비표시 영역의 끝단에 배치되는 블랙 매트릭스, 상기 블랙 매트릭스 상에 배치되는 금속층을 더 포함하되, 상기 금속층은 상기 제1 금속 패턴과 동일한 물질로 이루어지는 표시 장치.
  11. 제1항에 있어서,
    상기 정전기 방지 패턴은 단면상에서 일정 간격 이격되는 제2 금속 패턴을 포함하는 표시 장치.
  12. 제11항에 있어서,
    상기 제2 금속 패턴 사이에 배치되며 상기 제2 금속 패턴과 절연되는 제3 금속 패턴을 더 포함하는 표시 장치.
  13. 제12항에 있어서,
    상기 제3 금속 패턴은 상기 연결 전극과 중첩되는 표시 장치.
  14. 제11항에 있어서,
    상기 제2 금속 패턴은 상기 연결 전극과 중첩되지 않는 표시 장치.
  15. 표시 영역과 비표시 영역을 포함하는 제1 기판으로서, 상기 비표시 영역에 배치되는 제1 게이트 신호 라인, 상기 제1 게이트 신호 라인 상에 배치되는 제1 층간 절연막, 상기 제1 층간 절연막 상에 배치되는 제2 게이트 신호 라인 및 상기 제2 게이트 신호 라인 상에 배치되는 제2 층간 절연막을 포함하는 제1 기판을 준비하는 단계;
    상기 제2 층간 절연막 상에 상기 제1 게이트 신호 라인과 상기 제2 게이트 신호 라인을 연결하는 연결 전극을 형성하는 단계; 및
    상기 연결 전극 및 상기 제2 층간 절연막 상에 정전기 방지 패턴을 형성하는 단계를 포함하는 표시 장치의 제조 방법.
  16. 제15항에 있어서,
    상기 연결 전극 상에 블랙 매트릭스를 형성하는 단계를 더 포함하는 표시 장치의 제조 방법.
  17. 제15항에 있어서,
    상기 제1 층간 절연막 및 상기 제2 층간 절연막을 관통하여 상기 제1 게이트 신호 라인을 노출하는 제1 컨택홀을 형성하는 단계 및 상기 제2 층간 절연막을 관통하여 상기 제2 게이트 신호 라인을 노출시키는 제2 컨택홀을 형성하는 단계를 더 포함하는 표시 장치의 제조 방법.
  18. 제15항에 있어서,
    상기 정전기 방지 패턴은 상단, 상단 하부에 배치되며 상단과 일정 간격 이격되는 하단 및 상단과 하단을 잇는 측면을 포함하는 제1 금속 패턴을 포함하는 표시 장치의 제조 방법.
  19. 제18항에 있어서,
    상기 정전기 방지 패턴은 복수개이고 하나의 정전기 방지 패턴의 하단과 인접하는 다른 정전기 방지 패턴의 하단은 서로 접하는 표시 장치의 제조 방법.
  20. 제18항에 있어서,
    상기 상단과 하단 사이에 일정 공간이 형성되는 표시 장치의 제조 방법.
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