KR20170112901A - 전자기파 신호 전송을 위한 도파관 - Google Patents

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Abstract

본 발명은 전자기파 신호 전송을 위한 도파관에 관한 것이다.
본 발명의 일 태양에 따르면, 전자기파 신호 전송을 위한 도파관(waveguide)으로서, 유전율이 서로 다른 둘 이상의 유전체를 포함하는 유전체부, 및 상기 유전체부의 적어도 일부를 둘러싸는 전도체부를 포함하는 도파관이 제공된다.

Description

전자기파 신호 전송을 위한 도파관{WAVEGUIDE FOR TRANSMISSION OF ELECTOMAGNETIC SIGNAL}
본 발명은 전자기파 신호 전송을 위한 도파관에 관한 것이다.
데이터 트래픽이 급격하게 증가함에 따라, 집적 회로(IC)를 연결하는 입력/출력 버스(I/O bus)의 데이터 송수신 속도도 빠르게 증가하고 있다. 지난 수십 년 동안, 비용 효율성 및 전력 효율성이 우수한 전도체 기반의 인터커넥트(interconnect)(예를 들면, 구리선 등)가 유선 통신 시스템에서 널리 적용되어 왔다. 하지만, 전도체 기반의 인터커넥트는, 전자기 유도에 기한 표피 효과(skin effect)로 인하여, 채널 대역폭(channel bandwidth)에 근본적인 한계를 가지고 있다.
한편, 전도체 기반의 인터커넥트에 대한 대안으로서, 데이터 송수신 속도가 빠른 광(optical) 기반의 인터커넥트가 소개되어 널리 사용되고 있지만, 광 기반의 인터커넥트는 설치 및 유지보수 비용이 매우 크기 때문에 전도체 기반의 인터커넥트를 완벽하게 대체하기 어렵다는 한계가 존재한다.
최근에는, 유전체로 이루어진 도파관으로 구성되는 새로운 인터커넥트가 소개된 바 있다. 이러한 새로운 인터커넥트(일명, 이-튜브(E-TUBE))는 금속과 유전체의 장점을 모두 가지고 있는 인터커넥트로서, 비용 및 전력 측면에서의 효율성이 높고 짧은 범위에서 빠른 속도의 데이터 통신을 가능하게 하는 장점을 가지고 있어서, 칩-대-칩(chip-to-chip) 통신에 활용될 수 있는 인터커넥트로서 각광을 받고 있다.
하지만, 종래에 소개된 유전체 도파관을 사용하는 경우에도, 비선형적인 위상 응답(non-linear phase response)으로 인하여 시간 도메인에서 발생하는 그룹 딜레이(group delay)의 변화 또는 편차(variation)가 크게 나타나는 문제점이나 실제 통신 환경에서 도파관의 길이(length)나 구부러짐(bending)으로 인하여 신호 손실(loss)이 크게 발생하는 문제점이 존재한다.
이에, 본 발명자는, 위상 응답의 비선형성을 개선하고 실제 통신 환경에서의 신호 손실을 완화시킬 수 있는 새로운 구조의 유전체 도파관에 관한 기술을 제안하는 바이다.
본 발명은 상술한 문제점을 모두 해결하는 것을 그 목적으로 한다.
또한, 본 발명은, 유전율이 서로 다른 둘 이상의 유전체를 포함하는 유전체부와 위의 유전체부의 적어도 일부를 둘러싸는 전도체부를 포함하는 도파관(waveguide)을 제공함으로써, 칩-대-칩(chip-to-chip) 통신에서 위상 응답의 비선형성을 개선하고 실제 통신 환경에서의 신호 손실을 완화시킬 수 있도록 하는 것을 다른 목적으로 한다.
상기 목적을 달성하기 위한 본 발명의 대표적인 구성은 다음과 같다.
본 발명의 일 태양에 따르면, 전자기파 신호 전송을 위한 도파관(waveguide)으로서, 유전율이 서로 다른 둘 이상의 유전체를 포함하는 유전체부, 및 상기 유전체부의 적어도 일부를 둘러싸는 전도체부를 포함하는 도파관이 제공된다.
이 외에도, 본 발명을 구현하기 위한 다른 도파관이 더 제공된다.
본 발명에 의하면, 도파관을 이용한 칩-대-칩 통신에서 위상 응답의 비선형성을 개선하여 주파수의 변화에 따라 시간 도메인에서 발생할 수 있는 그룹 딜레이의 변화 정도를 줄일 수 있게 되는 효과가 달성된다.
또한, 본 발명에 의하면, 도파관이 유전율이 서로 다른 둘 이상의 유전체로 구성되는 유전체부를 포함하도록 함으로써 도파관을 통해 전송되는 신호의 반송 주파수(carrier frequency)를 낮출 수 있으므로, 신호 전송 채널의 대역폭을 효과적으로 사용할 수 있게 되는 효과가 달성된다.
본 발명에 의하면, 도파관의 길이가 길어지거나 도파관이 휘어지는 실제 통신 환경에서 신호 전송 채널의 손실을 줄일 수 있게 되는 효과가 달성된다.
도 1은 본 발명의 일 실시예에 따라 2-포트(port) 네트워크로 상호 연결된 칩-대-칩 인터페이스(chip-to-chip interface) 장치의 구성을 개념적으로 나타내는 도면이다.
도 2는 종래 기술에 따른 도파관의 구성을 예시적으로 나타내는 도면이다.
도 3은 본 발명의 일 실시예에 따른 도파관의 구성을 예시적으로 나타내는 도면이다.
도 4는 종래 기술에 따른 도파관을 이용하여 신호를 송수신하는 경우와 본 발명의 일 실시예에 따른 도파관을 이용하여 신호를 송수신하는 경우 각각에 대하여 시간 도메인에서의 그룹 딜레이(group delay)를 측정한 실험의 결과를 나타내는 도면이다.
도 5는 본 발명의 일 실시예에 따른 도파관을 이용하여 신호를 송수신하는 경우에 활용될 수 있는 대역폭을 예시적으로 나타내는 도면이다.
도 6은 종래 기술에 따른 도파관을 이용하여 신호를 송수신하는 경우와 본 발명의 일 실시예에 따른 도파관을 이용하여 신호를 송수신하는 경우 각각에 대하여 신호 손실(loss)을 측정한 실험의 결과를 나타내는 도면이다.
도 7 및 도 8은 본 발명의 일 실시예에 따라 신호 전송 채널의 사이의 간섭을 시뮬레이션한 결과를 예시적으로 나타내는 도면이다.
도 9는 본 발명의 다른 실시예에 따른 도파관의 구성을 예시적으로 나타내는 도면이다.
후술하는 본 발명에 대한 상세한 설명은, 본 발명이 실시될 수 있는 특정 실시예를 예시로서 도시하는 첨부 도면을 참조한다. 이들 실시예는 당업자가 본 발명을 실시할 수 있기에 충분하도록 상세히 설명된다. 본 발명의 다양한 실시예는 서로 다르지만 상호 배타적일 필요는 없음이 이해되어야 한다. 예를 들어, 여기에 기재되어 있는 특정 형상, 구조 및 특성은 일 실시예에 관련하여 본 발명의 정신 및 범위를 벗어나지 않으면서 다른 실시예로 구현될 수 있다. 또한, 각각의 개시된 실시예 내의 개별 구성요소의 위치 또는 배치는 본 발명의 정신 및 범위를 벗어나지 않으면서 변경될 수 있음이 이해되어야 한다. 따라서, 후술하는 상세한 설명은 한정적인 의미로서 취하려는 것이 아니며, 본 발명의 범위는, 적절하게 설명된다면, 그 청구항들이 주장하는 것과 균등한 모든 범위와 더불어 첨부된 청구항에 의해서만 한정된다. 도면에서 유사한 참조부호는 여러 측면에 걸쳐서 동일하거나 유사한 기능을 지칭한다.
이하에서는, 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자가 본 발명을 용이하게 실시할 수 있도록 하기 위하여, 본 발명의 바람직한 실시예들에 관하여 첨부된 도면을 참조하여 상세히 설명하기로 한다.
칩-대-칩 인터페이스 장치의 구성
도 1은 본 발명의 일 실시예에 따라 2-포트(port) 네트워크로 상호 연결된 칩-대-칩 인터페이스(chip-to-chip interface) 장치의 구성을 개념적으로 나타내는 도면이다.
도 1을 참조하면, 본 발명의 일 실시예에 따른 칩-대-칩 인터페이스 장치에는, 물리적으로 분리되어 있는 두 보드(미도시됨)에 각각 존재하거나 하나의 보드(미도시됨)에 존재하는 두 칩(미도시됨) 사이의 전자기파 신호 전송(예를 들면, 데이터 통신 등)을 위한 상호 연결(즉, 인터커넥트) 수단인 도파관(100) 및 위의 두 칩으로부터의 신호를 도파관(100)으로 전달하거나 도파관(100)으로부터의 신호를 위의 두 칩으로 전달하는 수단인 마이크로스트립 회로(200a, 200b)가 포함될 수 있다. 본 발명에서 말하는 칩(chip)은, 트랜지스터와 같은 반도체 등이 여러 개 모여 구성되는 전통적인 의미의 전자 회로 부품을 의미할 뿐만 아니라, 서로 간에 전자기파 신호를 주고 받을 수 있을 수 있는 모든 유형의 구성요소 또는 소자(素子, element)를 포괄하는 최광의의 개념으로서 이해되어야 한다.
본 발명의 일 실시예에 따르면, 제1 칩으로부터 발생되는 신호는, 제1 마이크로스트립 회로(200a)의 피딩 라인(feeding line) 및 프로브(probe)를 따라 전파(propagate)될 수 있고, 제1 마이크로스트립 회로(200a)와 도파관(100) 사이의 임피던스 불연속면에서 트랜지션(transition)됨에 따라 도파관(100)을 통하여 제2 칩에 대하여 전송될 수 있다.
또한, 본 발명의 일 실시예에 따르면, 도파관(100)을 통하여 전송된 신호는 도파관(100)과 제2 마이크로스트립 회로(200b) 사이의 임피던스 불연속면에서 트랜지션됨에 따라 제2 마이크로스트립 회로(200b)를 통하여 제2 칩으로 전송될 수 있다.
도파관의 구성
이하에서는, 본 발명의 구현을 위하여 중요한 기능을 수행하는 도파관(100)의 내부 구성 및 각 구성요소의 기능에 대하여 살펴보기로 한다.
도 2는 종래 기술에 따른 도파관의 구성을 예시적으로 나타내는 도면이다.
도 2를 참조하면, 종래 기술에 따른 도파관(10)은 유전체 코어(dielectric core)(11) 및 유전체 코어(11)를 둘러싸는 금속 클래딩(metal cladding)(12)을 포함할 수 있다.
종래 기술에 따른 도파관을 이용하여 신호를 전송하는 경우에는, 비선형적인 위상 응답(non-linear phase response)으로 인하여 시간 도메인에서 발생하는 그룹 딜레이(group delay)의 변화 또는 편차(variation)가 크게 나타나는 문제점이 발생할 수 있고, 실제 통신 환경에서 도파관의 길이(length)나 구부러짐(bending)으로 인하여 신호 손실(loss)이 크게 발생하는 문제점도 발생할 수 있다.
도 3은 본 발명의 일 실시예에 따른 도파관의 구성을 예시적으로 나타내는 도면이다.
도 3을 참조하면, 본 발명의 일 실시예에 따른 도파관(100)은, 유전율이 서로 다른 둘 이상의 유전체를 포함하는 유전체부와 위의 유전체부의 적어도 일부를 둘러싸는 전도체부(130)를 포함할 수 있다.
구체적으로, 본 발명의 일 실시예에 따르면, 유전체부에 포함되는 둘 이상의 유전체에는 제1 유전체(dielectric)(110) 및 제2 유전체(120)가 포함될 수 있고, 제2 유전체(120)는 제1 유전체(110)의 적어도 일부를 둘러싸는 형상을 가질 수 있다. 예를 들면, 제2 유전체(120)는 제1 유전체(110)를 전부 둘러싸거나 제1 유전체를 부분적으로 둘러쌀 수 있다.
보다 구체적으로, 본 발명의 일 실시예에 따르면, 도 3에 도시된 바와 같이, 도파관(100)을 그 길이에 수직한 방향으로 자른 단면에서 보았을 때, 제1 유전체(110)는 원형의 코어(core)의 형상을 가질 수 있고, 제2 유전체(120) 및 전도체부(130)는 환형의 클래딩(cladding)의 형상을 가질 수 있다. 또한, 본 발명의 일 실시예에 따르면, 유전체부의 중심축(보다 구체적으로는, 제1 유전체(110)의 중심축 및 제2 유전체(120)의 중심축)과 전도체부(130)의 중심축은 서로 일치할 수 있다.
다만, 본 발명에 따른 도파관(100)의 내부 구성 또는 형상이 반드시 상기 열거된 바에 한정되는 것은 아니며, 본 발명의 목적을 달성할 수 있는 범위 내에서 얼마든지 변경될 수 있음을 밝혀 둔다.
한편, 본 발명의 일 실시예에 따르면, 전도체부(130)는 전기 전도성을 가지는 물질로 이루어질 수 있다. 예를 들면, 본 발명의 일 실시예에 따른 전도체부(130)는, 전통적으로 널리 사용되는 구리(Cu)와 같은 금속성 물질로 이루어지거나 그래핀(graphene)과 같은 비금속성 물질로 이루어질 수 있다.
도 9는 본 발명의 다른 실시예에 따른 도파관의 구성을 예시적으로 나타내는 도면이다.
도 9의 (a)를 참조하면, 본 발명의 다른 실시예에 따른 도파관(100)에 포함되는 제1 유전체(110)는 서로 분리된 둘 이상의 부분 유전체(110a. 110b)로 이루어질 수 있고, 제2 유전체(120)는 위의 둘 이상의 부분 유전체의 적어도 일부를 둘러싸는 형상을 가질 수 있다. 도 9의 (a)의 실시예에서, 제1 유전체(110)는 공기로 이루어질 수 있다.
도 9의 (b)를 참조하면, 본 발명의 다른 실시예에 따른 도파관(100)에는, 제1 유전체(110) 및 전도체부(130) 사이에 배치되고, 제1 유전체(110) 및 전도체부(130) 사이에서 제2 유전체(120)가 존재하는 공간이 유지되도록 하는 기능을 수행하는 지지부(140)가 더 포함될 수 있다. 도 9의 (b)의 실시예에서, 제2 유전체(120)는 공기로 이루어질 수 있다.
한편, 본 발명의 일 실시예에 따르면, 제1 유전체(110)의 유전율(permittivity)은 제2 유전체(120)의 유전율보다 크거나 작을 수 있다. 보다 구체적으로, 본 발명의 일 실시예에 따르면, 유전율이 서로 다른 제1 유전체(110) 및 제2 유전체(120)를 사용함으로써, 도파관(100)을 통한 신호 전송 채널에서 주파수의 변화에 따라 나타나는 그룹 딜레이의 변화 정도를 획기적으로 줄일 수 있게 된다. 특히, 도 3의 실시예에서, 제1 유전체(110)의 유전율이 제2 유전체(120)의 유전율보다 클수록 위의 그룹 딜레이의 변화 정도가 줄어들 수 있다. 그룹 딜레이에 관한 자세한 설명은 후술하기로 한다.
예를 들면, 제1 유전체(110)는 유전 상수(dielectric constant)가 약 2.0인 테프론(teflon)으로 이루어질 수 있고, 제2 유전체(120)는 유전 상수가 약 1.2인 폴리에틸렌(polyethylene)으로 이루어질 수 있다. 또한, 다른 예를 들면, 제1 유전체(110)는 유전 상수가 약 1.0인 공기로 이루어질 수 있고, 제2 유전체(120)는 유전 상수가 약 2.0인 테프론으로 이루어질 수 있다. 반대로, 제1 유전체(110)는 테프론으로 이루어지고, 제2 유전체(120)는 공기로 이루어질 수도 있다.
따라서, 본 발명의 일 실시예에 따르면, 도파관(100)을 통하여 전송되는 신호(즉, 전자기파)는, 유전율이 서로 다른 제1 유전체(110)와 제2 유전체(120) 사이의 경계(boundary)를 따라 가이드되거나 제1 유전체(110) 또는 제2 유전체(120)와 전도체부(130) 사이의 경계를 따라 가이드될(guided) 수 있다.
한편, 도면에 의하여 도시되어 있지는 않지만, 본 발명의 일 실시예에 따르면, 둘 이상의 도파관(100)(즉, 둘 이상의 도파관(100) 각각이 제1 유전체(110), 제2 유전체(120) 및 전도체부(130)를 포함함)이 둘 이상이 소정의 배열을 이룬 상태로 결합되어 다발을 형성할 수 있으며, 이러한 다발에 포함되는 둘 이상의 도파관(100) 각각은 서로 다른 신호 전송 채널을 통하여 신호를 전송하는 기능을 수행할 수 있다.
도 4는 종래 기술에 따른 도파관을 이용하여 신호를 송수신하는 경우와 본 발명의 일 실시예에 따른 도파관을 이용하여 신호를 송수신하는 경우 각각에 대하여 시간 도메인에서의 그룹 딜레이를 측정한 실험의 결과를 나타내는 도면이다.
먼저, 도 4의 (a)를 참조하면, 종래 기술에 따른 도파관(즉, 유전체 코어(11) 및 금속 클래딩(12)으로 구성되는 도파관)을 사용하는 경우에, 비선형적인 위상 응답(non-linear phase response)이 심하게 나타날 수 있고, 이로 인해 도파관을 통한 신호 전송 채널에서 주파수의 변화에 따른 그룹 딜레이의 변화 정도가 크게 나타날 수 있다. 실제로, 도 4의 (a)의 그래프를 참조하면, 50GHz의 주파수에서의 그룹 딜레이가 무한대에 가까운 반면에 73GHz의 주파수에서의 그룹 딜레이는 20ns일 정도로, 주파수 대역이 달라짐에 따라 나타나는 전송 신호의 시간 도메인에서의 그룹 딜레이의 편차(또는 변화)가 매우 큰 것을 확인할 수 있다.
다음으로, 도 4의 (b)를 참조하면, 본 발명의 일 실시예에 따른 도파관(즉, 제1 유전체(110), 제2 유전체(120) 및 전도체부(130)로 구성되는 도파관)을 사용하는 경우에, 비선형적인 위상 응답을 줄이고 그로 인해 도파관을 통한 신호 전송 채널에서 나타날 수 있는 주파수의 변화에 따른 그룹 딜레이의 변화 정도도 획기적으로 줄일 수 있다. 실제로, 도 4의 (b)의 그래프를 참조하면, 50GHz에서 73GHz까지의 주파수 대역 전체에 걸쳐서 그룹 딜레이가 7ns 내지 8ns의 수준을 일정하게 유지하는 것으로 나타났으며, 이러한 실험 결과로부터, 본 발명의 일 실시예에 따른 도파관(100)을 사용하면, 주파수 대역이 달라짐에 따라 나타나는 전송 신호의 시간 도메인에서의 그룹 딜레이의 편차(또는 변화)가 획기적으로 낮아질 수 있음을 확인할 수 있다.
도 5는 본 발명의 일 실시예에 따른 도파관을 이용하여 신호를 송수신하는 경우에 활용될 수 있는 대역폭을 예시적으로 나타내는 도면이다.
도 5를 참조하면, 본 발명의 일 실시예에 따른 도파관(100)은, 유전율이 서로 다른 제1 유전체(110) 및 제2 유전체(120)를 포함함으로써 도파관(100)을 통한 신호 전송 채널에서 주파수의 변화에 따라 나타날 수 있는 그룹 딜레이 변화가 획기적으로 낮아지도록 할 수 있고, 이에 따라 사용자(또는 설계자)로 하여금 도파관(100)을 통해 전송되는 신호의 반송 주파수(carrier frequency)를 어퍼 코너 주파수(upper corner frequency)(도 5의 (a)의 fc1)에서 로우어 코너 주파수(lower corner frequency)(도 5의 (a)의 fc2)로 낮출 수 있도록 할 수 있게 된다.
따라서, 본 발명의 일 실시예에 따른 도파관(100)에 의하면, 단측 파대 전송(single side band transmission)이 가능하게 되므로 신호 전송 채널의 대역폭을 효과적으로 사용할 수 있게 되고, 반송 주파수를 낮출 수 있으므로 도파관(100)을 비롯한 칩-투-칩 인터페이스(더 나아가, 신호 송수신기)가 신뢰성 있게 동작할 수 있게 되고 칩-투-칩 인터페이스의 저전력 설계가 가능하게 하는 효과가 달성된다.
이에 반하여, 제2 유전체(120)를 포함하지 않는 종래 기술에 따른 도파관을 사용하는 경우에는(도 4의 (a) 참조), 로우어 코너 주파수 부근에서 이미 상당히 비선형적인 위상 응답이 발생하기 때문에, 만약 반송 주파수를 로우어 코너 주파수로 낮추게 되면 전송 신호가 심하게 왜곡(distortion)되는 것을 피할 수 없게 된다.
도 6은 종래 기술에 따른 도파관을 이용하여 신호를 송수신하는 경우와 본 발명의 일 실시예에 따른 도파관을 이용하여 신호를 송수신하는 경우 각각에 대하여 신호 손실을 측정한 실험의 결과를 나타내는 도면이다. 도 6의 실시예에서, 본 발명의 일 실시예에 따른 도파관과 종래 기술에 따른 도파관은 그 길이가 모두 15cm이고, 위의 두 도파관은 동일한 정도로 휘어진 상태에서 신호를 전송하였다.
도 6의 (c)를 참조하면, 본 발명의 일 실시예에 따라 제1 유전체, 제2 유전체 및 전도체부를 모두 포함하는 도파관(도 6의 (a) 참조)의 신호 전송 채널 특성과 종래 기술에 따라 제1 유전체 및 제2 유전체만을 포함하는(즉, 전도체부를 포함하지 않는) 도파관(도 6의 (b) 참조)의 신호 전송 채널 특성을 각각 확인할 수 있다. 구체적으로, 도 6의 (c)를 참조하면, 본 발명의 일 실시예에 따른 도파관은, 종래 기술에 따른 도파관에 비하여 도파관 내에 신호를 가둘 수 있는 성능이 높기 때문에(high confinement), 넓은 주파수 대역(예를 들면, 70GHz 내지 100GHz)에 걸쳐서 종래 기술에 따른 도파관보다 신호 손실이 적게 나타나는 것(즉, 신호의 세기가 크게 나타나는 것)을 확인할 수 있다.
보다 구체적으로, 종래 기술에 따라 전도체부를 포함하지 않은 채 제1 유전체 및 제2 유전체만을 포함하는 도파관에서는, 제1 유전체 및 제2 유전체 사이의 경계에서 이루어지는 전반사에 의하여 신호가 가이드될 수 있는데, 만약 위와 같은 전반사가 발생하지 못하게 되는 정도까지 도파관이 심하게 휘어지면 신호가 도파관 내에서 제대로 가이드되지 못하고 도파관 밖으로 빠져나가게 될 수 있으며, 이로 인해 신호 손실이 발생하게 된다. 이와는 달리, 본 발명에 따라 제1 유전체, 제2 유전체 및 전도체부를 모두 포함하는 도파관에서는, 제1 유전체 및 제2 유전체 사이의 경계에 전반사가 이루어지지 못하게 될 정도로 도파관이 심하게 휘어지더라도, 제1 유전체 및 제2 유전체 사이의 경계에서 전반사되지 못하고 밖으로 빠져나간 신호가 제2 유전체 및 전도체부 사이의 경계를 따라 가이드될 수 있으므로, 신호가 도파관 밖으로 새어나가는 것을 방지하여 신호 손실을 줄일 수 있게 됩니다. 또한, 신호의 주파수가 낮을수록 신호의 파장은 길어지게 되므로, 종래 기술에 따른 도파관과 본 발명에 따른 도파관 사이의 성능(즉, 도파관의 휨으로 인한 신호 손실 방지 성능) 차이는 전송되는 신호의 주파수가 낮을수록 더 극명해질 수 있다.
따라서, 본 발명의 일 실시예에 따른 도파관에 의하면, 도파관의 길이가 길어지거나 도파관이 휘어지는 실제 통신 환경에서 신호 전송 채널의 손실을 줄일 수 있게 되는 효과가 달성된다.
도 7 및 도 8은 본 발명의 일 실시예에 따라 신호 전송 채널의 사이의 간섭을 시뮬레이션한 결과를 예시적으로 나타내는 도면이다.
도 7의 실시예에서, 0.5mm의 간격을 두고 가깝게 배치된 두 도파관(711, 721) 각각을 통하여 전자기파 신호를 전송하는 경우를 가정할 수 있다.
이러한 경우에, 도 8을 참조하면, 제1-1 마이크로스트립 회로(712) 및 제1 도파관(711) 사이의 트랜지션(714)과 제2-1 마이크로스트립 회로(722) 및 제2 도파관(721) 사이의 트랜지션(724) 사이의 신호 전달 계수(즉, 도 8의 S31 및 810)가 -30dB 이하로 매우 작게 나타나므로, 위의 두 트랜지션(714, 715) 사이의 간섭(즉, 도 7의 731)이 무시할 수 있을 정도로 작다는 것을 확인할 수 있다.
계속하여, 도 8을 참조하면, 제1-1 마이크로스트립 회로(712) 및 제1 도파관(711) 사이의 트랜지션(714)과 제2-2 마이크로스트립 회로(723) 및 제2 도파관(721) 사이의 트랜지션(725) 사이의 신호 전달 계수(즉, 도 8의 S41 및 820) 역시 -30dB 이하로 매우 작게 나타나므로, 위의 두 도파관(711, 721) 사이의 간섭(즉, 도 7의 732)도 무시할 수 있을 정도로 작다는 것을 확인할 수 있다.
따라서, 본 발명의 일 실시예에 따르면, 도 7 및 도 8의 실시예에서 확인할 수 있는 바와 같이, 인접한 두 도파관(711, 721)에 포함되는 전도체부가 인접한 두 도파관(711, 721) 상호 간의 신호 간섭을 방지하게 되는 현저한 효과가 달성된다고 할 수 있다.
이상에서, 본 발명에 따른 도파관에 포함되는 유전체부가 유전율이 서로 다른 두 유전체(즉, 제1 유전체(110) 및 제2 유전체)로 구성되는 경우에 대하여 주로 설명되었지만, 본 발명에 따른 도파관의 유전체부의 구성이 반드시 위의 설명에 한정되는 것은 아니며, 본 발명의 목적 또는 효과를 달성할 수 있는 범위 내에서 얼마든지 변경될 수 있음을 밝혀 둔다. 예를 들면, 본 발명의 다른 실시예에 따른 도파관의 유전체부에는, 유전율이 서로 다른 셋 이상의 유전체가 포함될 수도 있다.
이상에서, 본 발명에 따른 도파관에 포함되는 구성요소에 관한 세부 사양 또는 파라미터에 대하여 구체적으로 설명되었지만, 본 발명에 따른 마이크로스트립 회로의 구성이 반드시 상기 열거된 바에 한정되는 것은 아니며, 본 발명의 목적 또는 효과를 달성할 수 있는 범위 내에서 얼마든지 변경될 수 있음을 밝혀 둔다.
이상에서 본 발명이 구체적인 구성요소 등과 같은 특정 사항들과 한정된 실시예 및 도면에 의해 설명되었으나, 이는 본 발명의 보다 전반적인 이해를 돕기 위해서 제공된 것일 뿐, 본 발명이 상기 실시예들에 한정되는 것은 아니며, 본 발명이 속하는 기술분야에서 통상적인 지식을 가진 자라면 이러한 기재로부터 다양한 수정 및 변형을 꾀할 수 있다.
따라서, 본 발명의 사상은 상기 설명된 실시예에 국한되어 정해져서는 아니 되며, 후술하는 특허청구범위뿐만 아니라 이 특허청구범위와 균등하게 또는 등가적으로 변형된 모든 것들은 본 발명의 사상의 범주에 속한다고 할 것이다.
10, 20: 종래 기술에 따른 도파관
11: 종래 기술에 따른 도파관의 코어
12: 종래 기술에 따른 도파관의 클래딩
100: 도파관
110: 제1 유전체
120: 제2 유전체
130: 전도체부
200a 및 200b: 제1 마이크로스트립 회로 및 제2 마이크로스트립 회로

Claims (8)

  1. 전자기파 신호 전송을 위한 도파관(waveguide)으로서,
    유전율이 서로 다른 둘 이상의 유전체를 포함하는 유전체부, 및
    상기 유전체부의 적어도 일부를 둘러싸는 전도체부
    를 포함하는 도파관.
  2. 제1항에 있어서,
    상기 둘 이상의 유전체에는 제1 유전체 및 제2 유전체가 포함되고, 상기 제2 유전체는 상기 제1 유전체의 적어도 일부를 둘러싸는 도파관.
  3. 제2항에 있어서,
    상기 제1 유전체의 중심축, 상기 제2 유전체의 중심축 및 상기 전도체부의 중심축은 서로 일치하는 도파관.
  4. 제2항에 있어서,
    상기 제1 유전체 및 상기 전도체부 사이에 배치되고, 상기 제1 유전체 및 상기 전도체부 사이에서 상기 제2 유전체가 존재하는 공간이 유지되도록 하는 지지부
    를 더 포함하는 도파관.
  5. 제2항에 있어서,
    상기 제1 유전체는 서로 분리된 둘 이상의 부분 유전체로 이루어지고, 상기 제2 유전체는 상기 둘 이상의 부분 유전체의 적어도 일부를 둘러싸는 도파관
  6. 제1항에 있어서,
    상기 제1 유전체 및 상기 제2 유전체 중 어느 하나는 공기로 이루어지는 도파관.
  7. 제1항에 있어서,
    상기 도파관을 통하여 전송되는 신호는, 상기 제1 유전체와 상기 제2 유전체 사이의 경계(boundary)를 따라 가이드되거나 상기 제1 유전체 또는 상기 제2 유전체와 상기 전도체부 사이의 경계를 따라 가이드되는(guided) 도파관.
  8. 제1항에 있어서,
    상기 도파관을 통한 신호 전송 채널에서 주파수의 변화에 따라 나타나는 시간 도메인에서의 그룹 딜레이(group delay)의 변화 정도가 기설정된 수준 이하인 도파관.
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