KR20170100408A - 표시 장치 및 표시 장치의 구동 방법 - Google Patents

표시 장치 및 표시 장치의 구동 방법 Download PDF

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Abstract

프레임 레이트를 떨어뜨려 표시 처리를 행하는 경우에, 플리커 등의 발생을 방지하여 화질의 향상을 도모하는 것을 목적의 하나로 한다. 제1 영상 신호에 따라서 영상의 표시를 행하는 제1 프레임 기간과, 제1 영상 신호에 따라서 제1 프레임 기간 후에 영상의 표시를 행하는 제2 프레임 기간을 갖고, 제1 프레임 기간의 영상 신호의 기입이 완료된 후, 영상의 표시를 행하기 전에, 제1 프레임 기간보다 짧은 비표시 기간을 설치하고, 비표시 기간의 종료 후, 제1 프레임 기간의 영상의 표시를 행한다.

Description

표시 장치 및 표시 장치의 구동 방법{DISPLAY DEVICE AND DRIVING METHOD OF DISPLAY DEVICE}
본 발명의 일 실시 형태는, 표시 장치 및 표시 장치의 구동 방법에 관한 것이다.
액정 표시 장치는, 경량 또한 저소비 전력을 달성하는 플랫 패널 디스플레이로서 주목을 끌고 있다. 그 중에서도, 표시 화소마다 트랜지스터 등의 스위칭 소자가 설치되어 이루어지는 액티브 매트릭스형의 액정 표시 장치는, 크로스 토크가 없는 고정밀한 표시 화상이 얻어지기 때문에, 휴대 전화의 화면 용도를 비롯해 각종 디스플레이용으로서 이용되고 있다.
일본 특허 공개 제2009-229553호 공보에는, 액티브 매트릭스형의 액정 표시 장치에 있어서, 제1 프레임 기간의 후반에 흑색 신호를 기입하는 예가 개시되어 있다. 이렇게 하여 흑색 신호를 기입함으로써, 액티브 매트릭스형의 액정 표시 장치에 있어서도, CRT와 같은 임펄스형의 표시 장치와 마찬가지로, 흐릿함이 없는 영상을 얻는 것이 가능해진다.
본 발명의 일 실시 형태에 따른 표시 장치의 구동 방법은, 제1 영상 신호에 따라서 영상의 표시를 행하는 제1 프레임 기간과, 제1 영상 신호에 따라서 제1 프레임 기간 후에 영상의 표시를 행하는 제2 프레임 기간을 갖고, 제1 프레임 기간의 영상 신호의 기입이 완료된 후, 영상의 표시를 행하기 전에, 제1 프레임 기간보다 짧은 비표시 기간을 설치하고, 비표시 기간의 종료 후, 제1 프레임 기간의 영상의 표시를 행한다.
본 발명의 일 실시 형태에 따른 표시 장치의 구동 방법은, 제1 영상 신호에 따라서 영상의 표시를 행하는 제1 프레임 기간과, 제1 영상 신호에 따라서 제1 프레임 기간 후에 영상의 표시를 행하는 제2 프레임 기간을 갖고, 제1 프레임 기간은, 화소의 각각에 있어서, 트랜지스터의 제어 전위를 소정의 전위로 고정하는 초기화 기간과, 트랜지스터의 역치에 준한 전위차를 취득하는 오프셋 캔슬 기간과, 트랜지스터의 게이트ㆍ소스간 전압을, 제1 영상 신호에 따라서 결정하는 영상 신호 기입 기간과, 게이트ㆍ소스간 전압에 따라서 표시를 행하는 표시 기간을 갖고, 제1 프레임 기간의 영상 신호 기입 기간이 완료된 후, 제1 프레임 기간보다 짧은 비표시 기간을 설치하고, 비표시 기간의 종료 후, 제1 프레임 기간의 표시 기간을 개시한다.
본 발명의 일 실시 형태에 따르면, 표시 소자에 구동 전류를 공급하는 트랜지스터를 포함하는 화소가 배열된 표시 영역을 갖고, 제1 영상 신호에 따라서 제1 영상의 표시를 행하는 제1 프레임 기간과 제2 영상 신호에 따라서 제2 영상의 표시를 행하는 제2 프레임 기간을 포함하는 동화상 표시 모드와, 제3 영상 신호에 따라서 제3 영상의 표시를 행하는 제1 프레임 기간과 제3 영상 신호에 따라서 제1 프레임 기간 후에 제3 영상의 표시를 행하는 제2 프레임 기간을 포함하는 정지 화상 표시 모드를 갖고, 정지 화상 표시 모드는, 제1 프레임 기간의 영상 신호의 기입이 완료된 후, 영상의 표시를 행하기 전에, 제1 프레임 기간보다 짧은 비표시 기간을 갖고, 비표시 기간의 종료 후, 제1 프레임 기간의 영상의 표시가 행해지는 표시 장치가 제공된다.
본 발명의 일 실시 형태에 따르면, 표시 소자에 구동 전류를 공급하는 트랜지스터를 포함하는 화소가 배열된 표시 영역을 갖고, 제1 영상 신호에 따라서 제1 영상의 표시를 행하는 제1 프레임 기간과 제2 영상 신호에 따라서 제2 영상의 표시를 행하는 제2 프레임 기간을 포함하는 동화상 표시 모드와, 제3 영상 신호에 따라서 제3 영상의 표시를 행하는 제1 프레임 기간과 제3 영상 신호에 따라서 제1 프레임 기간 후에 제3 영상의 표시를 행하는 제2 프레임 기간을 포함하는 정지 화상 표시 모드를 갖고, 적어도 제1 프레임 기간은, 화소의 각각에 있어서, 트랜지스터의 제어 전위를 소정의 전위로 고정하는 초기화 기간과, 트랜지스터의 역치에 준한 전위차를 취득하는 오프셋 캔슬 기간과, 트랜지스터의 게이트ㆍ소스간 전압을, 영상 신호에 따라서 결정하는 영상 신호 기입 기간과, 게이트ㆍ소스간 전압에 따라서 표시를 행하는 표시 기간을 갖고, 정지 화상 표시 모드는, 제1 프레임 기간의 영상 신호의 기입이 완료된 후, 영상의 표시를 행하기 전에, 제1 프레임 기간보다 짧은 비표시 기간을 갖고, 비표시 기간의 종료 후, 제1 프레임 기간의 영상의 표시가 행해지는 표시 장치가 제공된다.
도 1은 본 발명의 일 실시 형태에 따른 표시 장치의 구성을 도시하는 모식도.
도 2는 도 1에 도시한 화소 PX의 내부 구성을 도시하는 도면.
도 3은 본 발명의 일 실시 형태에 따른 각 신호의 시간 변화를 나타내는 타이밍차트.
도 4는 본 발명의 일 실시 형태에 따른 각 신호의 시간 변화를 나타내는 타이밍차트.
도 5는 본 발명의 일 실시 형태에서 설명되는 각 신호의 시간 변화를 나타내는 타이밍차트.
도 6은 도 5에서 도시한 타이밍차트에 대해, 프레임 레이트를 저하시켜 표시 장치를 구동하는 경우의 각 신호의 시간 변화를 나타내는 타이밍차트.
이하, 도면을 참조하여, 본 발명에 따른 표시 장치의 구동 방법에 대하여 상세하게 설명한다. 또한, 본 발명에 따른 표시 장치의 구동 방법은 이하의 실시 형태에 한정되는 것은 아니고, 다양한 변형을 행하여 실시하는 것이 가능하다. 또한, 도면의 치수 비율은, 설명의 사정상, 실제의 비율과는 상이하거나, 구성의 일부가 도면으로부터 생략되거나 하는 경우가 있다.
최근, 프레임 레이트를 떨어뜨려 표시 처리를 행함으로써, 저소비 전력화를 실현하는 표시 장치가 주목받고 있다. 이러한 종류의 표시 장치에서는, 예를 들어 프레임 레이트를 통상의 1/2로 저하시키는 경우, 각 화소에의 영상 신호의 입력을 2회에 1회의 비율로 씨닝한다. 이에 의해, 영상 신호의 주파수가 통상의 1/2로 되게 되므로, 저소비 전력화가 실현된다.
그러나, 단순히 영상 신호의 입력을 씨닝한 것만으로는, 큰 플리커가 발생해 버린다. 즉, 프레임 기간의 개시 시점에서 영상 신호에 의해 각 화소 내의 축적 용량에 기입된 전하는, 누설 등에 의해 시간의 경과와 함께 감소한다. 따라서, 프레임 레이트를 저하시키지 않은 통상의 상태에서도, 프레임 기간의 종료 시점에서의 휘도는 프레임 기간의 개시 시점에서의 휘도에 비해 약간 저하된 것으로 되지만, 프레임 레이트를 예를 들어 1/2로 저하시키면, 2개의 프레임 기간에 1번밖에 각 화소 내의 축적 용량에 전하가 보충되지 않게 되므로, 축적 용량에 전하를 기입하고 나서부터 세어 제2 프레임 기간의 종료 시점에서의 휘도는, 제1 프레임 기간의 종료 시점에서의 휘도보다도 더욱 저하된 것으로 되어 버린다. 이 휘도의 큰 변화에 의해, 관찰자가 큰 플리커를 느껴 버리는 것이 문제로 된다.
본 발명의 일 실시 형태는, 프레임 레이트를 떨어뜨려 표시 처리를 행하는 경우에, 플리커 등의 발생을 방지하여 화질의 향상을 도모할 수 있는 표시 장치 및 표시 장치의 구동 방법에 대하여 개시한다.
도 1은 본 발명의 일 실시 형태에 따른 표시 장치(100)의 구성을 도시하는 모식도이다. 또한, 도 2는 도 1에 도시한 화소 PX의 내부 구성을 도시하는 도면이다.
도 1에 도시한 바와 같이, 표시 장치(100)는 화소 PX가 행 방향 및 열 방향으로 배열되는 표시 영역 R1과, 주사선 구동 회로 YDR1, YDR2와, 신호선 구동 회로 XDR을 포함하는 표시 패널 DP와, 표시 패널 DP의 동작을 제어하는 컨트롤러(12)를 포함하고 있다.
본 실시 형태에 있어서, 화소 PX에는 표시 소자로서 유기 일렉트로루미네센스 소자(이하, 「유기 EL 소자」라고도 함)가 설치되어 있는 것으로 한다.
표시 패널 DP는, 도 1에 도시한 바와 같이, 유리판 등의 광 투과성을 갖는 절연 기판 SUB와, 절연 기판 SUB에 설치되는 표시 영역 R1 상에 매트릭스 형상으로 배열된 m×n개의 화소 PX와, 복수개(m/2개)의 제1 주사선 Sga_1∼Sga_m/2와, 복수개(m개)의 제2 주사선 Sgb_1∼Sgb_m과, 복수개(m/2개)의 리셋 배선 Sgr_1∼Sgr_m/2와, 복수개(n개)의 영상 신호선 VL_1∼VL_n을 구비하여 구성된다. 또한, 이하의 설명에서는, 각 선에 붙인 일련 번호를 구별할 필요가 없는 경우에, 일련 번호를 생략하여 기술하는 경우가 있다. 또한, 표시 패널 DP는, 도 2에 도시한 바와 같이, 복수개(m/2개)의 리셋 배선 Sgr의 각각에 대응하는 복수개(m/2개)의 제3 주사선 Sgc를 더 구비하여 구성된다.
화소 PX는, 열 방향 Y를 따라서 m개, 행 방향 X를 따라서 n개 각각 배열되어 있다. 제1 주사선 Sga, 제2 주사선 Sgb 및 리셋 배선 Sgr은 각각, 행 방향 X로 연장되는 배선으로서 설치되어 있다. 리셋 배선 Sgr은, 서로 전기적으로 접속된 복수의 전극으로 형성되어 있다. 영상 신호선 VL은, 열 방향 Y로 연장되는 배선으로서 설치되어 있다.
도 2에 도시한 바와 같이, 표시 패널 DP는, 고전위 Pvdd로 고정되는 고전위 전원선 SLa와, 저전위 Pvss로 고정되는 저전위 전원 전극 SLb를 갖고 있다. 고전위 전원선 SLa는 도시하지 않은 고전위 전원에 접속되고, 저전위 전원 전극 SLb는 도시하지 않은 저전위 전원(기준 전위 전원)에 접속되어 있다.
표시 패널 DP는 또한, 주사선 구동 회로 YDR1, YDR2와, 신호선 구동 회로 XDR을 구비하고 있다. 주사선 구동 회로 YDR1은, 복수의 제1 주사선 Sga 및 복수의 제3 주사선 Sgc를 화소 PX의 행마다 순서대로 구동하는 회로이며, 주사선 구동 회로 YDR2는, 복수의 제2 주사선 Sgb를 화소 PX의 행마다 순서대로 구동하는 회로이고, 신호선 구동 회로 XDR은, 복수의 영상 신호선 VL을 구동하는 회로이다. 주사선 구동 회로 YDR1, YDR2 및 신호선 구동 회로 XDR은, 절연 기판 SUB의 표시 영역 R1의 주위에 위치하는 비표시 영역 R2 상에 일체적으로 형성되고, 컨트롤러(12)와 함께 구동부(10)를 구성하고 있다.
각 화소 PX는, 도 2에 도시한 바와 같이, 유기 EL 소자 EMD와, 유기 EL 소자에 구동 전류를 공급하는 화소 회로를 포함하여 구성된다. 또한, 화소 PX에는, 유기 EL 소자 외에도, 각종 발광 소자를 사용하는 것이 가능하다.
화소 PX는, 전압 신호를 포함하는 영상 신호에 따라서 유기 EL 소자 EMD의 발광을 제어하는 회로가 설치되어 있다. 도 2에 도시한 바와 같이, 화소 PX는, 제1 스위칭 소자 SST, 구동 트랜지스터 DRT, 축적 용량 Cs, 보조 용량 Cad, 용량부 Cel을 포함하고 있다. 축적 용량 Cs 및 보조 용량 Cad는 캐패시터이다. 보조 용량 Cad는 발광 전류량을 조정하기 위해 설치되는 소자이며, 경우에 따라서는 불필요하게 되는 경우도 있다. 용량부 Cel은, 유기 EL 소자 EMD 자체의 용량(유기 EL 소자 EMD의 기생 용량)이다. 유기 EL 소자 EMD는 캐패시터로서도 기능한다.
또한, 각 화소 PX는, 제2 스위칭 소자 BCT를 구비하고 있다. 도 1에 도시한 바와 같이, 이 제2 스위칭 소자 BCT는, 열 방향 Y로 인접하는 복수의 화소 PX에 의해 공용되고 있어도 된다. 본 실시 형태에 있어서는, 행 방향 X 및 열 방향 Y로 인접하는 4개의 화소 PX에 의해, 1개의 제2 스위칭 소자 BCT가 공용되는 예를 도시한다. 또한, 주사선 구동 회로 YDR2에는, 도 2에 도시한 바와 같이, 복수의 제3 스위칭 소자 RST가 설치되어 있다. 제3 스위칭 소자 RST와 리셋 배선 Sgr은 일대일로 접속되어 있다.
제1 스위칭 소자 SST, 구동 트랜지스터 DRT, 제2 스위칭 소자 BCT 및 제3 스위칭 소자 RST는, 여기에서는 동일 도전형, 예를 들어 N 채널형의 트랜지스터를 포함하고 있다. 이 경우에 있어서의 트랜지스터는, 아몰퍼스 실리콘, 폴리실리콘 또는 산화물 반도체로 채널이 형성되는 박막 트랜지스터이어도 된다. 예를 들어, 본 실시 형태에 따른 표시 장치(100)에 포함되는 각 구동 트랜지스터 및 각 스위칭 소자는 모두 반도체층에 폴리실리콘을 사용한 톱 게이트 구조의 박막 트랜지스터를 포함하고 있고, 서로 동일 공정, 동일 층 구조로 형성된다.
제1 스위칭 소자 SST, 구동 트랜지스터 DRT, 제2 스위칭 소자 BCT 및 제3 스위칭 소자 RST는 각각, 제1 단자, 제2 단자 및 제어 단자를 갖고 있다. 본 실시 형태에서는, 구동 트랜지스터 DRT에 있어서, 제1 단자를 소스 전극, 제2 단자를 드레인 전극, 제어 단자를 게이트 전극으로 하고 있다.
화소 PX의 화소 회로에 있어서, 구동 트랜지스터 DRT 및 제2 스위칭 소자 BCT는, 고전위 전원선 SLa와 저전위 전원 전극 SLb 사이에서 유기 EL 소자 EMD와 직렬로 접속되어 있다. 고전위 전원선 SLa(고전위 Pvdd)는 예를 들어 10V의 전위로 설정되고, 저전위 전원 전극 SLb(저전위 Pvss)는 예를 들어 1.5V의 전위로 설정되어 있다.
제2 스위칭 소자 BCT의 제2 단자는 고전위 전원선 SLa에 접속되고, 제1 단자는 구동 트랜지스터 DRT의 드레인 전극에 접속되고, 제어 단자는 제1 주사선 Sga에 접속되어 있다. 이에 의해, 제2 스위칭 소자 BCT는, 제1 주사선 Sga로부터의 제어 신호 BG에 의해 온(도통 상태) 또는 오프(비도통 상태) 중 어느 하나로 제어된다. 제2 스위칭 소자 BCT는, 이 온/오프 제어에 의해, 유기 EL 소자 EMD의 발광 시간/비발광 시간을 제어하는 역할을 한다. 또한, 제어 신호 BG는, 주사선 구동 회로 YDR2에 의해 제1 주사선 Sga마다 생성되는 신호이다.
구동 트랜지스터 DRT의 드레인 전극은 제2 스위칭 소자 BCT의 소스 전극 및 리셋 배선 Sgr에 접속되고, 소스 전극은 유기 EL 소자 EMD의 한쪽의 전극(여기서는 양극)에 접속되어 있다. 유기 EL 소자 EMD의 다른 쪽의 전극(여기서는 음극)은 저전위 전원 전극 SLb에 접속되어 있다. 구동 트랜지스터 DRT는, 영상 신호 Vsig에 따른 전류량의 구동 전류를 유기 EL 소자 EMD에 출력하는 역할을 한다.
제1 스위칭 소자 SST의 제1 단자는 영상 신호선 VL에 접속되고, 제2 단자는 구동 트랜지스터 DRT의 게이트 전극에 접속되고, 제어 단자는 신호 기입 제어용 게이트 배선으로서 기능하는 제2 주사선 Sgb에 접속되어 있다. 제1 스위칭 소자 SST는, 제2 주사선 Sgb로부터 공급되는 제어 신호 SG에 의해 온(도통 상태) 또는 오프(비도통 상태) 중 어느 하나로 제어된다. 제1 스위칭 소자 SST는, 이 온/오프 제어에 의해, 제어 신호 SG에 응답하여 화소 회로와 영상 신호선 VL의 접속 상태를 제어하고, 대응하는 영상 신호선 VL로부터 영상 신호 Vsig를 화소 회로 내에 도입하는 역할을 한다. 또한, 제어 신호 SG는, 주사선 구동 회로 YDR1에 의해 제1 주사선 Sga마다 생성되는 신호이다.
제3 스위칭 소자 RST는, 2행마다, 주사선 구동 회로 YDR2 내에 설치되어 있다. 제3 스위칭 소자 RST는, 구동 트랜지스터 DRT의 드레인 전극과 리셋 전원(도시하지 않음) 사이에 접속되어 있다. 제3 스위칭 소자 RST의 제1 단자는 리셋 전원에 접속된 리셋 전원선 SLc에 접속되고, 제2 단자는 리셋 배선 Sgr에 접속되고, 제어 단자는 리셋 제어용 게이트 배선으로서 기능하는 제3 주사선 Sgc에 접속되어 있다. 리셋 전원선 SLc의 전위는, 리셋 전원을 통해 정전위인 리셋 전위 Vrst로 고정된다. 리셋 전위 Vrst의 구체적인 값은, 예를 들어 -2V이다.
제3 스위칭 소자 RST는, 제3 주사선 Sgc를 통해 부여되는 제어 신호 RG에 따라서, 리셋 전원선 SLc 및 리셋 배선 Sgr 간을 도통 상태(온) 또는 비도통 상태(오프)로 전환한다. 또한, 제어 신호 RG는, 주사선 구동 회로 YDR2에 의해 제3 주사선 Sgc마다 생성되는 신호이다. 제3 스위칭 소자 RST가 온 상태로 전환됨으로써, 구동 트랜지스터 DRT의 소스 전극의 전위가 초기화된다.
도 1에 도시한 컨트롤러(12)는 표시 패널 DP의 외부에 배치된 프린트 회로 기판(도시하지 않음) 상에 형성되어 있고, 주사선 구동 회로 YDR1, YDR2 및 신호선 구동 회로 XDR을 제어하는 기능을 갖고 있다. 컨트롤러(12)는 외부로부터 공급되는 디지털 영상 신호 및 동기 신호를 수취하도록 구성된다. 컨트롤러(12)는 수취한 동기 신호에 기초하여, 수직 주사 타이밍을 제어하는 수직 주사 제어 신호와, 수평 주사 타이밍을 제어하는 수평 주사 제어 신호를 생성하도록 구성된다. 그리고, 생성한 수직 주사 제어 신호 및 수평 주사 제어 신호를 주사선 구동 회로 YDR1, YDR2 및 신호선 구동 회로 XDR에 공급함과 함께, 수평 및 수직 주사 타이밍에 동기하여, 디지털 영상 신호 및 초기화 신호를 신호선 구동 회로 XDR에 공급하도록 구성된다. 또한, 주사선 구동 회로 YDR1에 공급되는 수직 주사 제어 신호 및 수평 주사 제어 신호에는 스타트 신호 STVS 및 클럭 신호 CKV가 포함되고, 주사선 구동 회로 YDR2에 공급되는 수직 주사 제어 신호 및 수평 주사 제어 신호에는 동기 신호 Vsync, 스타트 신호 STVB 및 클럭 신호 CKV가 포함된다.
신호선 구동 회로 XDR은, 수평 주사 제어 신호의 제어에 의해 각 수평 주사 기간에 있어서 순차적으로 얻어지는 영상 신호를 아날로그 형식으로 변환하고, 계조에 따른 영상 신호 Vsig를 복수의 영상 신호선 VL에 병렬로 공급하도록 구성된다. 또한, 신호선 구동 회로 XDR은, 초기화 신호 Vini를 영상 신호선 VL에 공급하도록 구성된다. 영상 신호 Vsig 및 초기화 신호 Vini는, 클럭 신호 CKV에 동기한 타이밍에서 복수의 영상 신호선 VL의 각각에 공급된다. 초기화 신호 Vini의 구체적인 값은, 예를 들어 2V이다.
주사선 구동 회로 YDR1은 시프트 레지스터(도시하지 않음)를 갖고 있고, 컨트롤러(12)로부터 공급되는 스타트 신호 STVS를 순차적으로 다음 단에 전송함으로써, 순차적으로 각 행에 대응하는 제어 신호 SG를 생성하도록 구성된다. 생성된 제어 신호 SG는, 도시하지 않은 출력 버퍼를 통해, 대응하는 각 행 내의 각 화소 PX에 공급된다.
주사선 구동 회로 YDR2도 시프트 레지스터(도시하지 않음)를 갖고 있고, 컨트롤러(12)로부터 공급되는 동기 신호 Vsync 및 스타트 신호 STVB를 순차적으로 다음 단에 전송함으로써, 순차적으로 각 행에 대응하는 제어 신호 BG, RG를 생성하도록 구성된다. 생성된 제어 신호 BG는, 도시하지 않은 출력 버퍼를 통해, 대응하는 각 행 내의 각 화소 PX에 공급된다. 한편, 생성된 제어 신호 RG는, 대응하는 제3 스위칭 소자 RST의 게이트 전극에 공급된다. 이에 의해, 제어 신호 RG가 활성화된 타이밍에서 제3 스위칭 소자 RST가 온 상태로 되어, 리셋 전위 Vrst가 리셋 배선 Sgr에 공급된다.
다음에, 상기와 같이 구성된 표시 장치(100)의 구동 방법에 대하여 설명한다. 이하에서는, 처음에 도 5 및 도 6을 참조하여 통상의 구동 방법에 대하여 설명한 후, 도 3 및 도 4를 참조하여 본 실시 형태에 따른 구동 방법에 대하여 설명한다.
도 5는 각 화소 PX에 프레임 기간마다 영상 신호를 기입하는 동작을 할 때의, 각 신호의 시간 변화를 나타내는 타이밍차트이다. 또한, 도 5에는, 주사선 구동 회로 YDR1, YDR2가 생성하는 각 복수의 제어 신호 RG, BG, SG 중, 1행째에 대응하는 제어 신호 RG1, BG1, SG1만을 도시하고 있다. 이 점은, 후술하는 도 3 및 도 6에서도 마찬가지이다.
영상 신호선 VL에는, 1수평 주사 기간(1H)의 주기로, 신호선 구동 회로 XDR로부터 초기화 신호 Vini 및 영상 신호 Vsig가 순차적으로 공급된다. 또한, 초기화 신호 Vini 및 영상 신호 Vsig는 항상 공급되지만, 도 5에서는 그 일부만을 도시하고 있다. 또한, 초기화 신호 Vini 및 영상 신호 Vsig를 도시하고 있는 부분과 도시하지 않은 부분은, 타임 스케일이 상이하다. 이 점도, 후술하는 도 3 및 도 6에서도 마찬가지이다.
동기 신호 Vsync는, 도 5에 도시한 바와 같이, 일정한 주기로 활성화되는 펄스 형상의 신호이다. 컨트롤러(12)는 상술한 클럭 신호 CKV에 기초하여, 예를 들어 1초에 60회의 비율로 동기 신호 Vsync를 활성화하도록 구성된다. 동기 신호 Vsync의 활성화 주기는, 프레임 주기로 된다. 컨트롤러(12)는 이 동기 신호 Vsync에 기초하여, 상술한 스타트 신호 STVB, STVS를 생성하도록 구성된다.
구체적으로 설명하면, 컨트롤러(12)는, 도 5에 도시한 바와 같이, 동기 신호 Vsync의 활성화와 함께 스타트 신호 STVB를 비활성으로 하고, 거기로부터 세어 3수평 주사 기간(1H)째의 영상 신호 Vsig가 활성화되어 있는 시점에서, 스타트 신호 STVB를 재활성화하도록 구성된다. 또한, 컨트롤러(12)는, 도 5에 도시한 바와 같이, 동기 신호 Vsync가 활성화된 수평 주사 기간(1H)의 다음 수평 주사 기간(1H)에 있어서, 초기화 신호 Vini가 활성화되어 있는 동안만 스타트 신호 STVS를 일시적으로 비활성으로 하고, 또한, 그 다음 수평 주사 기간(1H)에 있어서, 초기화 신호 Vini가 활성화되어 있는 동안과, 영상 신호 Vsig가 활성화되어 있는 동안의 각각에 있어서, 스타트 신호 STVS를 일시적으로 비활성으로 하도록 구성된다.
주사선 구동 회로 YDR2는, 스타트 신호 STVB의 활성 상태에 기초하여, 복수의 제어 신호 BG 각각의 활성 상태를 순차적으로 제어하도록 구성된다. 이 제어에 의해, 1행째에 대응하는 제어 신호 BG1의 활성 상태는, 도 5에 도시한 바와 같이, 스타트 신호 STVB와 동일한 타이밍에서, 또한, 스타트 신호 STVB와 동일 방향으로 변화되게 된다. 또한, 다른 제어 신호 BG의 활성 상태는, 제어 신호 BG1에 지연되면서 제어 신호 BG1과 마찬가지로 변화되게 된다(후술하는 도 4 참조).
또한, 주사선 구동 회로 YDR2는, 동기 신호 Vsync의 활성화에 따라서 제어 신호 RG를 활성화하고, 이 활성화로부터 세어 3수평 주사 기간(1H)째에 들어간 시점까지 활성 상태를 유지하도록 구성된다. 또한, 수평 주사 기간(1H)의 카운트는, 컨트롤러(12)로부터 공급되는 클럭 신호 CKV에 기초하여 행하면 된다.
주사선 구동 회로 YDR1은, 스타트 신호 STVS의 활성 상태에 기초하여, 복수의 제어 신호 SG 각각의 활성 상태를 순차적으로 제어하도록 구성된다. 이 제어에 의해, 1행째에 대응하는 제어 신호 SG1의 활성 상태는, 도 5에 도시한 바와 같이, 스타트 신호 STVS와 동일한 타이밍에서, 또한, 스타트 신호 STVS와 역방향으로 변화되게 된다. 또한, 다른 제어 신호 SG의 활성 상태는, 제어 신호 SG1에 지연되면서 제어 신호 SG1과 마찬가지로 변화되게 된다.
여기까지 설명한 제어 신호 RG1, BG1, SG1의 변화에 의해, 도 5에 도시한 바와 같이, 소스 초기화 동작이 행해지는 소스 초기화 기간 Pis와, 게이트 초기화 동작이 행해지는 게이트 초기화 기간 Pig와, 오프셋 캔슬 동작이 행해지는 오프셋 캔슬 기간 Po와, 영상 신호 기입 동작이 행해지는 영상 신호 기입 기간 Pw가 정의된다. 이하, 각각에 대하여 상세하게 설명한다.
먼저, 소스 초기화 기간 Pis는, 동기 신호 Vsync의 활성화에 따라서 제어 신호 BG1이 비활성화되고 나서, 대응하는 수평 주사 기간(1H)의 종기에 이를 때까지의 기간이다. 이 기간에서는, 제어 신호 RG1이 활성화되어 있는 한편, 제어 신호 BG1, SG1이 비활성으로 되어 있으므로, 제2 스위칭 소자 BCT 및 제1 스위칭 소자 SST는 모두 오프(비도통 상태)이고, 제3 스위칭 소자 RST는 온(도통 상태)이다. 따라서, 구동 트랜지스터 DRT의 소스 전극이, 리셋 전위 Vrst와 동일 전위로 리셋된다.
게이트 초기화 기간 Pig는, 동기 신호 Vsync의 활성화 후에 비로소 제어 신호 SG1이 활성화되어 있는 기간이다. 이 기간에서는, 제어 신호 RG1, SG1이 활성화되어 있는 한편, 제어 신호 BG1이 비활성으로 되어 있으므로, 제2 스위칭 소자 BCT는 오프(비도통 상태)이고, 제1 스위칭 소자 SST 및 제3 스위칭 소자 RST는 모두 온(도통 상태)이다. 또한, 영상 신호선 VL에는 초기화 신호 Vini가 공급되고 있다. 따라서, 제1 스위칭 소자 SST를 통해, 초기화 신호 Vini가 구동 트랜지스터 DRT의 게이트 전극에 인가된다. 이에 의해, 구동 트랜지스터 DRT의 게이트 전극의 전위가 초기화 신호 Vini에 대응하는 전위로 리셋되고, 구동 트랜지스터 DRT의 게이트 전극으로부터 전의 프레임 기간의 정보가 초기화된다.
오프셋 캔슬 기간 Po는, 게이트 초기화 기간 Pig의 다음에 제어 신호 SG1이 활성화되어 있는 기간이다. 이 기간에서는, 제어 신호 SG1이 활성화되어 있으므로, 제1 스위칭 소자 SST는 온(도통 상태)이다. 또한, 제어 신호 RG1은, 이 기간 내에 활성 상태로부터 비활성 상태로 변화된다. 따라서, 제3 스위칭 소자 RST는, 이 기간 내에 온(도통 상태)으로부터 오프(비도통 상태)로 변화된다. 한편, 제어 신호 BG1은, 이 기간 내에 비활성 상태로부터 활성 상태로 변화된다. 따라서, 제2 스위칭 소자 BCT는, 이 기간 내에 오프(비도통 상태)로부터 온(도통 상태)으로 변화된다. 또한, 영상 신호선 VL에는 초기화 신호 Vini가 공급되고 있다.
따라서, 오프셋 캔슬 기간 Po에 있어서는, 구동 트랜지스터 DRT의 게이트 전극의 전위가 초기화 신호 Vini의 전위로 고정된다. 또한, 제2 스위칭 소자 BCT가 온으로 되기 때문에, 고전위 전원선 SLa로부터 구동 트랜지스터 DRT에 전류가 유입된다. 구동 트랜지스터 DRT의 소스 전극의 전위는, 소스 초기화 기간 Pis에 기입된 전위(리셋 전위 Vrst)를 초기값으로 하고, 드레인 전극-소스 전극간을 통해 흐르는 전류에 의해 서서히 감소하면서, 구동 트랜지스터 DRT의 TFT 특성 변동을 흡수ㆍ보상하면서, 고전위측으로 시프트해 간다.
오프셋 캔슬 기간 Po가 종료된 시점에서, 구동 트랜지스터 DRT의 소스 전극의 전위는 Vini-Vth로 된다. 또한, Vini는 초기화 신호 Vini의 전압값이고, Vth는 구동 트랜지스터 DRT의 역치 전압이다. 이에 의해, 구동 트랜지스터 DRT의 게이트 전극-소스 전극간의 전압 Vgs가 캔슬점(Vgs=Vth)에 도달하고, 이 캔슬점에 상당하는 전위차가 축적 용량 Cs에 축적된다(유지된다). 또한, 오프셋 캔슬 기간 Po의 시간 길이는, 예를 들어 1μsec 정도로 설정하는 것이 적합하다. 또한, 오프셋 캔슬 기간 Po는, 필요에 따라서 복수회 설치해도 된다.
영상 신호 기입 기간 Pw는, 오프셋 캔슬 기간 Po의 다음에 제어 신호 SG1이 활성화되어 있는 기간이다. 이 기간에서는, 제어 신호 SG1, BG1이 활성화되어 있는 한편, 제어 신호 RG1이 비활성으로 되어 있으므로, 제3 스위칭 소자 RST는 오프(비도통 상태)이고, 제1 스위칭 소자 SST 및 제2 스위칭 소자 BCT는 모두 온(도통 상태)이다. 또한, 영상 신호선 VL에는 영상 신호 Vsig가 공급되고 있다. 따라서, 구동 트랜지스터 DRT의 게이트 전극에 영상 신호 Vsig가 기입된다.
영상 신호 기입 기간 Pw에 있어서는, 고전위 전원선 SLa로부터 제2 스위칭 소자 BCT 및 구동 트랜지스터 DRT를 지나, 또한 유기 EL 소자 EMD의 용량부(기생 용량) Cel을 경유하여 저전위 전원 전극 SLb에 전류가 흐른다. 이에 의해, 구동 트랜지스터 DRT의 이동도의 변동이 보정된다.
제1 스위칭 소자 SST가 온한 직후에는, 구동 트랜지스터 DRT의 게이트 전극의 전위는 Vsig, 구동 트랜지스터 DRT의 소스 전극의 전위는 Vini-Vth+Cs(Vsig-Vini)/(Cs+Cel+Cad)로 된다. 또한, Vsig는 영상 신호 Vsig의 전압값이며, Cs는 축적 용량 Cs의 용량이고, Cel은 용량부 Cel의 용량이며, Cad는 보조 용량 Cad의 용량이다.
그 후, 유기 EL 소자 EMD의 용량부 Cel을 경유하여 저전위 전원 전극 SLb에 전류가 흐르고, 영상 신호 기입 기간 Pw 종료 시에는, 구동 트랜지스터 DRT의 게이트 전극의 전위는 Vsig, 구동 트랜지스터 DRT의 소스 전극의 전위는 Vini-Vth+ΔV1+Cs(Vsig-Vini)/(Cs+Cel+Cad)로 된다. 또한, 구동 트랜지스터 DRT에 흐르는 전류 Idrt와 용량 Cs+Cel+Cad의 관계는, 다음 식 (1)에 의해 나타내어진다. 또한, ΔV1은 다음 식 (1)로부터 결정되는 영상 신호 Vsig의 전압값, 영상 기입 기간 Pw, 트랜지스터의 이동도에 대응한 소스 전극의 전위 변위이다.
Figure pat00001
여기서, Idrt=β×(Vgs-Vth)2={(Vsig-Vini)×(Cel+Cad)/(Cs+Cel+Cad)}2이다. 또한, β는 β=μ×Cox×W/2L로 정의된다. W는 구동 트랜지스터 DRT의 채널 폭, L은 구동 트랜지스터 DRT의 채널 길이, μ는 캐리어 이동도, Cox는 단위 면적당의 게이트 정전 용량이다.
영상 신호 기입 기간 Pw 내에 있어서 구동 트랜지스터 DRT의 게이트 전극에 영상 신호 Vsig가 기입되어, 유기 EL 소자 EMD에 전류가 흐르기 시작하면, 영상의 표시가 개시된다. 도 5에서 도시한 타이밍차트에 의하면, 각 화소 PX는, 프레임 기간마다 영상 신호가 기입되어, 유기 EL 소자가 발광하는 표시 기간을 가짐으로써, 동화상을 표시하는 데 적합하다.
그러나, 구동 트랜지스터 DRT의 게이트 전압을 유지하는 축적 용량 Cs에 부여된 전하는, 누설에 의해 시간의 경과와 함께 감소한다. 즉, 이 표시에 의한 휘도는, 도 5에 도시한 바와 같이, 영상 신호 기입 기간 Pw로부터 시간이 경과함에 따라, 서서히 저하된다. 이것은, 축적 용량 Cs 내에 유지되어 있는 전하가 누설 등에 의해 상실되어 가기 때문이다. 축적 용량 Cs 내에 유지되어 있는 전하는, 도 5에 도시한 바와 같이, 표시 개시 직후에 일단 크게 감소하고, 그 후는 직선적으로 감소되어 가게 된다.
영상 신호 기입 기간 Pw 다음에 도래하는 수평 주사 기간(1H)으로부터, 다음 프레임 기간에 대응하는 동기 신호 Vsync가 활성화되는 수평 주사 기간(1H)까지를 표시 기간 Pd로 정의하면, 컨트롤러(12)는, 도 5에 도시한 바와 같이, 이 표시 기간 Pd를 복수(도 5에서는 4개)의 기간 T로 분할하고, 각 기간 T의 종단에 이르는 소정의 기간에 있어서 스타트 신호 STVB를 비활성으로 하도록 구성된다. 이에 의해, 각 기간 T의 개시로부터 소정의 기간은 발광 기간(표시 기간)으로 되고, 발광 기간(표시 기간)의 종료 후, 각 기간 T의 종단에 이르는 소정의 기간은, 도 5에 도시한 바와 같이, 제어 신호 BG1이 비활성으로 되어 영상이 표시되지 않는 비발광 기간(비표시 기간) B로 된다.
도 6은 이상과 같은 구동 방법을 채용하는 배경 기술에 의한 표시 장치에 있어서 프레임 레이트를 떨어뜨려 표시 처리를 행하는 경우의, 각 신호의 시간 변화를 나타내는 타이밍차트이다.
도 6의 예에서는, 도 5와 비교하면 이해되는 바와 같이, 제2 프레임 기간의 스타트 신호 STVB, STVS의 변화가 억제되어 있다. 이 경우, 제2 프레임 기간에서는 영상 신호 기입 기간 Pw가 도래하지 않고, 영상 신호 Vsig가 화소 PX 내에 입력되지 않게 된다. 즉, 영상 신호 Vsig의 입력이 2회에 1회의 비율로 씨닝되고 있다.
영상 신호 Vsig의 입력을 씨닝한 결과, 도 6에 도시한 바와 같이, 제2 프레임 기간에 있어서의 휘도는, 영상 신호 Vsig의 입력을 씨닝하지 않은 경우에 비해 ΔS만큼 저하된다. 그 결과, 제2 프레임 기간의 종료 시점에서의 휘도는, 제1 프레임 기간의 종료 시점에서의 휘도보다도 더욱 저하된 것으로 된다. 시청자는 발광 시간×휘도의 값을 화면의 밝기로 느끼기 때문에, 휘도가 저하된 제2 프레임 기간을 제1 프레임 기간에 비해 어둡게 느끼게 된다.
이것을 방지하기 위해, 도 6의 예에서는, 제1 프레임 기간에 있어서, 비발광 기간(비표시 기간) B 전에, 비발광 기간(비표시 기간) B와 연속하는 비발광 기간(비표시 기간) Ba를 설치하고 있다. 구체적인 처리로서는, 컨트롤러(12)가 표시 기간 Pd를 복수로 분할하여 이루어지는 각 기간 T의 말미에 설치하는 스타트 신호 STVB의 비활성 기간을 전방 방향으로 연장한다. 이에 의해, 제1 프레임 기간에 있어서의 발광 시간×휘도의 값이 제2 프레임 기간에 있어서의 발광 시간×휘도의 값에 가까워지므로, 사람의 눈에 느껴지는 밝기의 차를 작게 하는 것이 가능해진다.
그러나, 상술한 바와 같이, 휘도는 표시 개시 직후의 단계에서 특히 크게 감소하기 때문에, 도 6과 같이 해도, 제1 프레임 기간과 제2 프레임 기간 동안에서 발광 시간×휘도의 값의 차가 잔존한다. 본 발명의 일 실시 형태는, 이 차를 없애고, 제1 프레임 기간과 제2 프레임 기간의 밝기의 차(발광 시간×휘도의 값의 차)를 더욱 저감하려고 하는 것이다. 이하, 도 3을 참조하면서 상세하게 설명한다.
도 3은 본 발명의 일 실시 형태에 따른 각 신호의 시간 변화를 나타내는 타이밍차트이다. 도 3에 도시한 바와 같이, 본 실시 형태에 따른 표시 장치(100)의 구동 방법은, 영상 신호 Vsig의 기입에 의해 제1 프레임 기간이 개시된 시점을 포함하는 일정 기간에 걸치는 제1 프레임 기간 내의 기간을 비발광 기간(비표시 기간) B(제1 비발광 기간)로 하는 점에 있다. 또한, 표시 기간 Pd를 복수로 분할하여 이루어지는 각 기간 T의 종단이 아니라, 선단에 비발광 기간(비표시 기간) B를 설치하는 점에서도, 도 5 및 도 6에 도시한 구동 방법과 상이하다. 또한, 영상 신호 Vsig의 입력을 씨닝하는 경우의 제1 프레임 기간에 있어서는, 각 기간 T의 선단에 설치하는 비발광 기간(비표시 기간) B의 직후에, 비발광 기간(비표시 기간) B와 연속하는 비발광 기간(비표시 기간) Ba를 설치하고 있다.
구체적인 처리로서는, 먼저 컨트롤러(12)는 오프셋 캔슬 기간 Po의 종료 후, 영상 신호 기입 기간 Pw의 개시 전에, 스타트 신호 STVB를 일단 비활성으로 한다. 그리고, 복수의 기간 T 중의 최초의 기간의 선두까지, 스타트 신호 STVB를 비활성 상태 그대로 유지한다. 이에 의해, 도 5에 도시한 바와 같이, 각 프레임 기간의 선두에 비발광 기간(비표시 기간) B가 설치되게 된다.
계속해서 컨트롤러(12)는 표시 기간 Pd를 분할하여 이루어지는 각 기간 T의 선단으로부터 일정한 기간에 있어서, 스타트 신호 STVB를 비활성으로 한다. 이에 의해, 도 5에 도시한 바와 같이, 각 기간 T의 종단이 아니라 선단에, 비발광 기간(비표시 기간) B가 배치된다.
또한, 영상 신호 Vsig의 입력을 씨닝하는 경우의 제1 프레임 기간에 있어서는, 컨트롤러(12)는 표시 기간 Pd를 등분할하여 이루어지는 각 기간 T의 선두에 설치하는 스타트 신호 STVB의 비활성 기간을 후방 방향으로 연장한다. 이에 의해, 각 기간 T의 선단에 위치하는 비발광 기간(비표시 기간) B의 직후에, 비발광 기간(비표시 기간) B와 연속하는 비발광 기간(비표시 기간) Ba가 배치된다. 또한, 각 비발광 기간(비표시 기간) Ba의 시간 길이는, 1개의 프레임 기간 내에서 동일하게 해도 된다. 또한, 비발광 기간(비표시 기간) B의 개시 및 종료의 타이밍은, 표시 화면에 있어서의 어느 1행과, 다른 1행에서 상이하게 하도록 해도 된다.
이상 설명한 바와 같이, 본 실시 형태에 따른 표시 장치(100)의 구동 방법에 의하면, 표시 개시 직후의 전하가 크게 감소하는 기간을 비발광 기간(비표시 기간) B로 하고 있으므로, 각 프레임 기간에 있어서의 발광 시간×휘도의 값이 직선 형태로 감소하는 휘도에 의해 산출되게 된다. 따라서, 비발광 기간(비표시 기간) B의 직후에 소정 길이의 비발광 기간(비표시 기간) Ba를 배치하는 제어를 행함으로써, 각 프레임 기간에 있어서의 발광 시간×휘도의 값을 일치시킴과 함께, 플리커를 억제하여 표시 품위를 향상시키는 것이 가능해진다.
여기서, 도 3에 도시한 제어 신호 BG1 이외의 제어 신호 BG의 변화에 대하여, 도 4를 참조하면서 설명한다.
도 4는 본 발명의 실시 형태에 따른 각 신호의 시간 변화를 나타내는 타이밍차트이다. 도 4에는, 도 3에 도시한 제어 신호 BG1 이외의 제어 신호 BG의 예로서, 각각 화소 PX의 매트릭스의 3, 5, 7, 9행째에 대응하는 4개의 제어 신호 BG2∼BG5를 나타내고 있다. 또한, 도 4에서는, 도 3에 도시한 동기 신호 Vsync의 비활성화로부터 영상 신호 기입 기간 Pw에 이르는 3수평 주사 기간(3H)분의 각 신호의 시간 변화를, 일부 간략화하여 모식적으로 도시하고 있다.
도 4에 도시한 바와 같이, 제어 신호 BG1 이외의 제어 신호 BG2∼BG5는, 상술한 주사선 구동 회로 YDR2 내의 시프트 레지스터의 처리에 의해, 제어 신호 BG2에 비해 일정 시간씩 순차적으로 지연되어 변화되도록 구성된다. 이에 의해, 도시하지 않지만, 각 화소 PX의 휘도도, 1행째에 대응하는 화소 PX에 비해 일정 시간씩 순차적으로 지연되어 변화되게 된다. 이에 의해, 어느 행에 속하는 화소 PX에 대해서도, 1행째에 속하는 화소 PX와 마찬가지로, 비발광 기간(비표시 기간) B, Ba를 설치하는 것이 가능해진다.
이와 같이, 도 3에 의하면, 어느 프레임 기간에서 각 화소 PX에 기입된 영상 신호에 의해 영상의 표시를 행하고, 다음 프레임 기간에 있어서도 영상 신호를 각 화소 PX에 기입하지 않고, 전의 프레임 기간과 동일한 영상을 표시하는 구동 방법이 제공된다. 이와 같은 구동 방법은, 표시 장치에 있어서 정지 화상을 표시하는 경우에 적합하다. 도 3에서 도시한 구동 방법에 의하면, 표시 장치는 프레임 레이트를 저하시켜 구동되므로, 소비 전량을 저감할 수 있다.
이상, 본 발명의 바람직한 실시 형태에 대하여 설명하였지만, 본 발명은 이러한 실시 형태에 전혀 한정되는 것은 아니고, 본 발명이, 그 요지를 일탈하지 않는 범위에서, 다양한 형태로 실시될 수 있는 것은 물론이다.
예를 들어, 상기 실시 형태에서는, 프레임 레이트를 통상의 1/2로 하는 예를 들어 설명하였지만, 프레임 레이트를 더 저하시키는 것도 가능하다. 그 경우, 영상 신호 Vsig를 기입한 직후의 프레임 기간으로부터, 다음에 영상 신호 Vsig 기입 직전에 위치하는 프레임 기간까지, 추가하는 비발광 기간(비표시 기간) Ba의 시간 길이를 서서히 짧게 해 가도록, 컨트롤러(12)에 스타트 신호 STVB를 제어시키는 것이 바람직하다. 이렇게 함으로써, 프레임 레이트를 통상의 1/2 미만으로 한 경우에 있어서도, 프레임간에서 발광 시간×휘도의 값을 일치시시킴과 함께, 플리커를 억제하여 표시 품위를 향상시키는 것이 가능해진다. 또한, 프레임 레이트를 통상의 1/2 미만으로 하는 다른 방법으로서, Vsync의 주기를 길게 하는 방법도 있다. 이 경우, 도 3, 도 4, 도 6의 도면 중앙의 3H의 기간이 없어져, 제1 프레임 기간과 제2 프레임 기간 사이의 흑색 삽입을 없앨 수 있다.
또한, 도 3에 있어서, 제2 프레임 기간의 영상 신호 Vsig의 씨닝을 행할 때, 동기 신호 Vsync는 그대로 입력되는 한편, 스타트 신호 STVB, STVS를 출력하지 않도록 하는 제어로 하는 예가 도시되어 있지만, 동기 신호 Vsync 자체를 컨트롤러(12)측에 입력시키지 않도록 함으로써, 컨트롤러(12)측에서 스타트 신호 STVB, STVS를 생성하지 않도록 해도 된다.
또한, 본 발명의 일 실시 형태에 따르면, 표시 패널 DP의 회로 구성을 변화시키지 않고, 표시 패널 DP에 입력하는 각 신호의 타이밍을 변화시킴으로써, 동화상 표시에 적합한 구동과, 정지 화상 표시에 적합한 구동을 행할 수 있다. 환언하면, 본 발명의 일 실시 형태에 따르면, 프레임 기간마다 각 화소에 영상 신호를 기입하고, 그 영상 신호에 대응하는 영상을 표시하는 동화상 표시 모드와, 전의 프레임 기간에서 각 화소에 기입된 영상 신호에 기초하는 영상과 동일한 영상을 표시하는 정지 화면 모드를 갖는 표시 장치가 제공된다. 그리고, 정지 화상 표시가 행해지는 경우에도, 플리커가 적은 고품질의 화상을 표시할 수 있다.
100 : 표시 장치
10 : 구동부
12 : 컨트롤러
B, Ba : 비발광 기간(비표시 기간)
BCT : 제2 스위칭 소자
BG, RG, SG : 제어 신호
Cad : 보조 용량
Cel : 용량부
CKV : 클럭 신호
Cs : 축적 용량
DP : 표시 패널
DRT : 구동 트랜지스터
EMD : 유기 EL 소자
Pd : 표시 기간
Pig : 게이트 초기화 기간
Pis : 소스 초기화 기간
Po : 오프셋 캔슬 기간
Pw : 영상 신호 기입 기간
PX : 화소
R1 : 표시 영역
R2 : 비표시 영역
RST : 제3 스위칭 소자
Sga : 제1 주사선
Sgb : 제2 주사선
Sgc : 제3 주사선
Sgr : 리셋 배선
SLa : 고전위 전원선
SLb : 저전위 전원 전극
SLc : 리셋 전원선
SST : 제1 스위칭 소자
STVB, STVS : 스타트 신호
SUB : 절연 기판
Vini : 초기화 신호
VL : 영상 신호선
Vrst : 리셋 전위
Vsig : 영상 신호
Vsync : 동기 신호
XDR : 신호선 구동 회로
YDR1, YDR2 : 주사선 구동 회로

Claims (14)

  1. 제1 영상 신호에 따라서 영상의 표시를 행하는 제1 프레임 기간과,
    상기 제1 영상 신호에 따라서, 상기 제1 프레임 기간 후에 상기 영상의 표시를 행하는 제2 프레임 기간을 갖고,
    상기 제1 프레임 기간의 영상 신호의 기입이 완료된 후, 상기 영상의 표시를 행하기 전에, 상기 제1 프레임 기간보다 짧은 비표시 기간을 설치하고, 상기 비표시 기간의 종료 후, 상기 제1 프레임 기간의 상기 영상의 표시를 행하는 표시 장치의 구동 방법.
  2. 제1항에 있어서,
    상기 비표시 기간의 개시 및 종료의 타이밍은, 표시 화면의 어느 1행과, 다른 1행에서 상이하게 하는 표시 장치의 구동 방법.
  3. 제1항에 있어서,
    상기 제1 프레임 기간 내에, 상기 비표시 기간을 복수회 삽입하는 표시 장치의 구동 방법.
  4. 제1 영상 신호에 따라서 영상의 표시를 행하는 제1 프레임 기간과,
    상기 제1 영상 신호에 따라서, 상기 제1 프레임 기간 후에 상기 영상의 표시를 행하는 제2 프레임 기간을 갖고,
    상기 제1 프레임 기간은,
    상기 화소의 각각에 있어서, 상기 트랜지스터의 제어 전위를 소정의 전위로 고정하는 초기화 기간과,
    상기 트랜지스터의 역치에 준한 전위차를 취득하는 오프셋 캔슬 기간과,
    상기 트랜지스터의 게이트ㆍ소스간 전압을, 상기 제1 영상 신호에 따라서 결정하는 영상 신호 기입 기간과,
    상기 게이트ㆍ소스간 전압에 따라서 표시를 행하는 표시 기간을 갖고,
    상기 제1 프레임 기간의 상기 영상 신호 기입 기간이 완료된 후, 상기 제1 프레임 기간보다 짧은 비표시 기간을 설치하고, 상기 비표시 기간의 종료 후, 상기 제1 프레임 기간의 표시 기간을 개시하는 표시 장치의 구동 방법.
  5. 제4항에 있어서,
    상기 비표시 기간의 개시 및 종료의 타이밍은, 상기 표시 영역의 어느 1행과, 다른 어느 1행에서 상이한 표시 장치의 구동 방법.
  6. 제4항에 있어서,
    상기 제1 프레임 기간 내에, 상기 비표시 기간을 복수회 삽입하는 표시 장치의 구동 방법.
  7. 표시 소자에 구동 전류를 공급하는 트랜지스터를 포함하는 화소가 배열된 표시 영역을 갖고,
    제1 영상 신호에 따라서 제1 영상의 표시를 행하는 제1 프레임 기간과, 제2 영상 신호에 따라서 제2 영상의 표시를 행하는 제2 프레임 기간을 포함하는 동화상 표시 모드와,
    제3 영상 신호에 따라서 제3 영상의 표시를 행하는 제1 프레임 기간과, 상기 제3 영상 신호에 따라서, 상기 제1 프레임 기간 후에 상기 제3 영상의 표시를 행하는 제2 프레임 기간을 포함하는 정지 화상 표시 모드를 갖고,
    상기 정지 화상 표시 모드는, 상기 제1 프레임 기간의 영상 신호의 기입이 완료된 후, 상기 영상의 표시를 행하기 전에, 상기 제1 프레임 기간보다 짧은 비표시 기간을 갖고, 상기 비표시 기간의 종료 후, 상기 제1 프레임 기간의 상기 영상의 표시가 행해지는 표시 장치.
  8. 제7항에 있어서,
    상기 정지 화상 표시 모드에 있어서, 상기 비표시 기간의 개시 및 종료의 타이밍은, 표시 화면의 어느 1행과, 다른 1행에서 상이한 표시 장치.
  9. 제7항에 있어서,
    상기 정지 화상 표시 모드에 있어서, 상기 제1 프레임 내에, 상기 비표시 기간이 복수회 삽입되는 표시 장치.
  10. 제7항에 있어서,
    상기 표시 소자는 유기 일렉트로루미네센스 소자인 표시 장치.
  11. 표시 소자에 구동 전류를 공급하는 트랜지스터를 포함하는 화소가 배열된 표시 영역을 갖고,
    제1 영상 신호에 따라서 제1 영상의 표시를 행하는 제1 프레임 기간과, 제2 영상 신호에 따라서 제2 영상의 표시를 행하는 제2 프레임 기간을 포함하는 동화상 표시 모드와,
    제3 영상 신호에 따라서 제3 영상의 표시를 행하는 제1 프레임 기간과, 상기 제3 영상 신호에 따라서, 상기 제1 프레임 기간 후에 상기 제3 영상의 표시를 행하는 제2 프레임 기간을 포함하는 정지 화상 표시 모드를 갖고,
    적어도 상기 제1 프레임 기간은,
    상기 화소의 각각에 있어서, 상기 트랜지스터의 제어 전위를 소정의 전위로 고정하는 초기화 기간과,
    상기 트랜지스터의 역치에 준한 전위차를 취득하는 오프셋 캔슬 기간과,
    상기 트랜지스터의 게이트ㆍ소스간 전압을, 영상 신호에 따라서 결정하는 영상 신호 기입 기간과,
    상기 게이트ㆍ소스간 전압에 따라서 표시를 행하는 표시 기간을 갖고,
    상기 정지 화상 표시 모드는, 상기 제1 프레임 기간의 영상 신호의 기입이 완료된 후, 상기 영상의 표시를 행하기 전에, 상기 제1 프레임 기간보다 짧은 비표시 기간을 갖고, 상기 비표시 기간의 종료 후, 상기 제1 프레임 기간의 상기 영상의 표시가 행해지는 표시 장치.
  12. 제11항에 있어서,
    상기 정지 화상 표시 모드에 있어서, 상기 비표시 기간의 개시 및 종료의 타이밍은, 표시 화면의 어느 1행과, 다른 1행에서 상이한 표시 장치.
  13. 제11항에 있어서,
    상기 정지 화상 표시 모드에 있어서, 상기 제1 프레임 기간 내에, 상기 비표시 기간이 복수회 삽입되는 표시 장치.
  14. 제11항에 있어서,
    상기 표시 소자는 유기 일렉트로루미네센스 소자인 표시 장치.
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