KR20170042479A - 발진기용 구동 회로 - Google Patents

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마씨밀리아노 브라코
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더 스와치 그룹 리서치 앤 디벨롭먼트 엘티디
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Abstract

본 발명은 발진기 (3) 를 구동하기 위한 구동 회로 (11) 에 관한 것이다. 구동 회로 (11) 는, 제 1 단자 및 제 2 단자를 포함하는 제 1 인덕터 (LD); 제 1 단자에 접속된 전기 에너지 소스 (13); 및 제 2 단자 및 발진기에 접속된 스위칭 회로를 포함한다. 스위칭 회로는 적어도, 전기 에너지를 발진기 (3) 에 공급하지 않도록 구성되는 오프 상태 및 전기 에너지를 발진기 (3) 에 공급하도록 구성되는 온 상태에서 동작하도록 구성된다. 제 1 인덕터 (LD) 는 스위칭 회로가 오프 상태에 있는 동안 에너지를 자기장에 저장하도록 배열되고, 스위칭 회로가 온 상태에 있을 경우, 스위칭 회로는 자기장에 저장된 에너지의 일부를 사용하여 전기 에너지 소스 (13) 로부터 발진기 (3) 로 전류의 서지를 전달하도록 배열된다.

Description

발진기용 구동 회로{DRIVE CIRCUIT FOR AN OSCILLATOR}
본 발명은 예를 들어, 시계들에서 사용되는 수정 발진기와 같은 발진기 회로를 구동하기 위한 구동 회로들의 분야에 관한 것이다. 본 발명은 또한, 구동 회로 및 발진기를 포함하는 전자 회로 및 발진기를 구동하기 위한 방법에 관한 것이다.
도 1 의 회로도는 수정 발진기를 나타내는 회로 (3) 및 수정 발진기 (3) 를 구동하기 위한 종래 기술의 구동 회로 (5) 를 포함하는 전자 회로 (1) 를 도시한다. 도시될 수도 있는 것과 같이, 수정 발진기는 제 1 커패시터 (C1), 제 2 커패시터 (C2), 발진기 인덕터 (LO), 저항기 (RO), 제 3 커패시터 (C3), 제 2 커패시터, 코일 및 저항기와 병렬로 접속되는 제 4 커패시터 (C4) 에 의해 모델링된다. 제 1 및 제 3 커패시터들의 전극들 중 하나는 접지에 접속된다. 도 1 의 회로에서, 구동 회로는 인버터 회로 (7) 에 의해 모델링된다. 이러한 종류의 구동 회로는 현재, 예컨대 수정 발진기들을 구동하기 위해 광범위하게 사용되고 있다. 인버터 회로 (7) 는 예컨대, 적어도 n-타입 금속 산화물 반도체 (MOS) 트랜지스터 및 p-타입 MOS 트랜지스터를 포함할 수도 있다. 수정 발진기 및 구동 회로는 발진을 유도하는 포지티브 피드백 회로를 형성하기 위해 접속된다.
도 2 의 신호 다이어그램은 도 1 의 전자 회로 (1) 의 신호들의 거동을 도시한다. 결과들을 더 양호하게 도시하기 위해, 저항기 (RO) 는 생략되었음을 유의해야 한다. 제 1 (최상위) 그래프는 제 2 커패시터 (C2) 의 전압을 시간의 함수로서 도시한다. 다시 말해서, 상기 그래프는 수정 발진기의 발진을 도시한다. 제 2 그래프는 시간에 따른 구동 회로의 출력 전류를 도시하는 반면, 제 3 그래프는 구동 회로 출력 전압을 도시한다. 도 1 의 구동 회로 (5) 는 발진의 전체 하프-사이클 동안 수정 발진기 (3) 를 구동한다. 도 2 의 제 2 그래프에서, 구동 회로로부터의 전류가 발진의 절반의 주기 동안 양쪽 방향들로 흐르는 것이 보여질 수 있으며, 이는 수정 발진기 (3) 의 발진기 인덕터 (LO) 에서의 에너지가 증가되지 않고, 수정 발진기를 통한 전압이 증가하지 않는 것을 의미한다. 이상적인 조건들, 즉 저항이 없고 모든 컴포넌트가 이상적이라고 가정하면, 구동 회로 (5) 에 의해 제공된 전류는 구동 회로 (5) 에서 소실되어야만 한다. 실제 애플리케이션에서, 이는 에너지가 구동 회로 (5) 의 트랜지스터들의 기생 저항에서 소실되는 것을 의미한다.
따라서, 도 1 에 도시된 전자 회로가 전력 소비와 관련하여 최적이 아니라는 것이 명백하다. 더 구체적으로, 드라이버 (5) 로부터의 전류 흐름은 수정 발진기 (3) 의 전류 흐름과 동위상이 아니고, 이는 드라이버 (5) 의 트랜지스터들에서 전력 소실을 야기한다. 인버터 (7) 의 각각의 스위칭 트랜지션 동안 인버터 (7) 에 흐를 수도 있는 짧지만 상당한 전류로 인해, 추가의 문제가 발생할 수도 있다. 그러한 트랜지션 전류 스파이크는, 인버터가 전술된 것과 같은 NMOS-PMOS 트랜지스터 쌍을 포함하는 경우, 발생할 수도 있으며, 여기서 이 쌍은 양자가 일시적으로 온일 경우, 효과적으로 단락 회로를 제시한다.
본 발명의 목적은 발진기 구동 회로들에 관련된 앞서 확인된 문제들을 극복하는 것이다.
본 발명의 제 1 양태에 따르면, 청구항 제 1 항에 기재된 것과 같은 발진기를 구동하기 위한 구동 회로가 제공된다.
제안되는 새로운 해결책은, 구동 회로의 동작이 발진기들에 대한 최신의 구동 회로들보다 더 에너지 효율적이라는 장점을 갖는다. 이는 이하 더 상세히 설명되는 것과 같이, 단락 회로 전류를 회피하고, 발진기의 발진들과 동위상으로 발진기를 구동함으로써 달성된다.
본 발명의 제 2 양태에 따르면, 구동 회로 및 구동 회로에 의해 구동되는 발진기를 포함하는 전자 회로가 제공된다.
본 발명의 제 3 양태에 따르면, 발진기를 구동하는 방법이 제공된다.
본 발명의 다른 양태들은 여기에 첨부된 종속 청구항들에서 언급된다.
본 발명의 다른 특징들 및 장점들은, 첨부되는 도면들을 참조하여, 비-제한적인 예시적인 실시형태의 이하 상세한 설명으로부터 명백해질 것이다:
도 1 은 수정 발진기 및 수정 발진기를 구동하기 위한 구동 회로를 포함하는 최신의 전자 회로를 도시하는 회로도이다.
도 2 는 도 1 의 전자 회로에서 신호들의 거동을 도시하는 신호 다이어그램이다.
도 3 은 수정 발진기 및 본 발명의 일 실시형태에 따라 수정 발진기를 구동하기 위한 구동 회로를 포함하는 전자 회로를 도시하는 회로도이다.
도 4 는 도 3 의 전자 회로에서 신호들의 거동을 도시하는 신호 다이어그램이다.
본 발명의 일 실시형태는 지금부터 첨부된 도면들을 참조하여 상세히 설명될 것이다. 본 발명은 시계의 석영 (quartz) 으로도 알려진 수정 발진기를 구동하기 위한 구동 회로의 문맥에서 설명될 것이다. 그러나, 개시된 구동 회로는 수정 발진기들의 문맥에서 사용되는 것으로 제한되지 않는다. 상이한 도면들에 나타나는 동일한 또는 대응하는 기능적 및 구조적 엘리먼트들에는 동일한 참조부호들이 할당된다.
도 3 은 도 1 에서와 같이, 수정 발진기 (3), 또는 수정 발진기 (3) 를 나타내는 더 정확한 회로를 포함하는 전자 회로 (9) 를 도시한다. 그러나, 도 3 의 수정 발진기에서, 저항기 (RO) 가 생략되었다. 보여질 수 있는 것과 같이, 본 실시형태에 따른 구동 회로 (11) 는 도 1 의 구동 회로 (5) 와 상이하다. 구동 회로 (11) 는 전기 에너지 소스 (13), 즉 상기 예에서 제 1 인덕터로 또한 지칭되는 드라이브 인덕터 (LD) 의 제 1 단자와 접지 간에 접속된 정전압 소스 (13) 를 포함한다. 드라이브 인덕터의 제 2 단자는 도 3 에 도시된 것과 같은 수정 발진기 (3) 에 또한 접속되는 스위칭 회로에 접속된다. 상기 예에서의 스위칭 회로는 제 1 스위치 (17) 및 제 2 스위치 (19) 를 포함한다. 상기 도시된 예에서, 제 1 스위치는 NMOS 트랜지스터 (17) 이지만, 제 2 스위치는 PMOS 트랜지스터 (19) 이다.
도 3 에서 보여질 수 있는 것과 같이, NMOS 트랜지스터 (17) 의 드레인 단자는 드라이브 인덕터 (LD) 의 제 2 단자에 접속되는 반면, NMOS 트랜지스터 (17) 의 소스 단자는 접지에 접속된다. NMOS 트랜지스터의 게이트는 수정 발진기 (3), 및 더 구체적으로, 제 2 인덕터로 또한 지칭되는 발진기 인덕터 (LO) 와 제 2 커패시터 (C2) 간에 위치된 제 1 노드 (21) 에 접속된다. PMOS 트랜지스터의 소스는 드라이브 인덕터 (LD) 의 제 2 단자에 접속되는 반면, PMOS 트랜지스터 (19) 의 드레인은 수정 발진기 (3) 에 및 더 구체적으로, 발진기 인덕터 (LO) 와 제 3 커패시터 (C3) 간에 위치된 제 2 노드 (23) 에 접속된다. PMOS 트랜지스터의 게이트는 제 1 노드 (21) 에 접속된다.
현재 설명에서, NMOS 트랜지스터 (17) 는 그 게이트-소스 전압이 포지티브일 경우, 및 더 구체적으로, 그 게이트 전압이 접지로부터 제 1 임계 전압, 예컨대 0.5 V 이상일 경우, 온이다 (즉, 드레인으로부터 소스로의 채널이 전도성임). 현재 설명에서, 다른 한편으로, PMOS 트랜지스터 (19) 는 그 소스-게이트 전압이 약 0.6 V 의 제 2 임계치에 인접하거나 더 클 경우, 온이다 (즉, 소스로부터 드레인으로의 채널이 전도성임). 상기 특정 케이스에서, 제 2 임계 값은 제 1 임계 값보다 크다. 이는 NMOS 및 PMOS 트랜지스터들의 짧은 시간 주기 동안 양자가 전도성일 수도 있음을 의미한다.
다음으로, 전자 회로 (9) 의 동작이 더 상세히 설명된다. 초기 상태에서, 어떤 전기 에너지도 수정 발진기 (3) 에 공급되지 않을 경우, 수정 발진기 (3) 의 커패시터들은 방전되고, 어떤 전류도 수정 발진기에 흐르지 않는다. 상기 스테이지에서, NMOS 및 PMOS 트랜지스터들 (17, 19) 의 게이트 전압들은 0 V 이고, 오직 PMOS 트랜지스터만이 전도성이다. 다시 말해서, 스위칭 회로는 온 상태에 있다. 전압 소스 (13) 가 턴 온될 경우, 전류는 드라이브 인덕터 (LD) 를 통해 및 PMOS 트랜지스터 (19) 의 전도성 소스-드레인 채널을 통해 수정 발진기 (3) 로 흐르기 시작한다. 이 지점에서, 전류는 수정 발진기 (3) 에서 흐르기 시작하고, 커패시터들 (C1, C2, C3, C4) 은 충전을 시작한다. 동시에, NMOS 및 PMOS 트랜지스터들 (17, 19) 의 게이트 전압들이 상승하기 시작한다. 이는 또한, 전류가 더 이상 수정 발진기 (3) 에 흐르지 않지만, 그 대신 NMOS 트랜지스터 (17) 의 전도성 드레인-소스 채널을 통해 접지로 흐르는 결과로서, NMOS 트랜지스터 (17) 가 턴 온할 때 PMOS 트랜지스터 (19) 가 턴 오프하는 것을 의미한다. 이러한 상태에서, 스위칭 회로는 오프 상태에 있다. NMOS 트랜지스터 (17) 가 온일 경우, 드라이브 인덕터 (LD) 를 통해 흐르는 전류는 에너지를 일시적으로 자기장에, 예컨대 그 코일에 저장한다. 그러므로, 드라이브 인덕터 (LD) 는 충전 또는 전원 공급 상태에 있다.
따라서 지금부터, 수정 발진기는 그 시작부에 제공되는 에너지로 인해, 발진하기 시작한다. 이는 PMOS 트랜지스터 (19) 가 턴 온하는 동안, NMOS 트랜지스터 (17) 가 다시 턴 오프하는 것을 의미하며, 자기장 에너지는 수정 발진기에서의 커패시터들을 충전하기 위해 PMOS 트랜지스터 (19) 를 통해 수정 발진기 (3) 에서의 제 2 노드 (23) 로 흐르는 추가의 전류로서 전달된다. 다시 말해서, 이 지점에서, 자기장에 저장된 에너지는 전압 소스 (13) 로부터 수정 발진기 (3) 로 전류를 "푸시" 한다. 지금부터, 드라이브 인덕터 (LD) 는 방전 또는 전원 공급되지 않는 (de-energising) 상태에 있다. 그 후에, NMOS 트랜지스터 (17) 가 턴 온할 때, PMOS 트랜지스터 (19) 는 다시 턴 오프한다. 그 후에, 앞서 설명된 동작은 수정 발진기 (3) 가 계속해서 발진하는 동안 소정 시퀀스에 따라 반복될 것이다.
도 4 의 신호 다이어그램은 도 3 의 전자 회로에서의 신호들의 거동을 도시한다. 도 4 의 다이어그램에서 2 개의 수직선들은 전체 신호 사이클의 지속시간을 도시한다. 제 1 (최상위) 그래프는 드라이브 인덕터 (LD) 를 통한 전류의 변동을 도시한다. 최상위로부터 제 2 의 그래프는 수정 발진기 전압, 즉 제 1 노드 (21) 에서의 전위 (electrical potential) 의 변동을 도시한다. 상기 노드에서 측정된 전위는 실질적으로 제 1 및 제 2 트랜지스터들 (17, 19) 의 게이트들에서의 전위에 또한 대응한다. 최상위로부터 제 3 그래프는 수정 발진기 (3) 에서의 전류 흐름, 즉 발진기 인덕터 (L0) 를 통해 흐르는 전류의 크기를 도시한다. 마지막으로, 최종 그래프는 수정 발진기의 전압, 즉 제 3 커패시터 (C3) 를 통한 전압을 도시한다. 도 4 에서의 수치 값들은 단지 예시적인 것이고, 수정 발진기 (3) 에서의 저항을 무시하는 것임을 유의해야 한다. 정전압 소스 (13) 에 의해 유지되는 전압은 상기 예에서, 약 3 V 이다.
앞의 설명과 관련하여, NMOS 및 PMOS 트랜지스터들의 동작은, (도 4 에서 최상위로부터 제 2 그래프의) 수정 발진기 전압의 양의 하프-사이클 동안 NMOS 트랜지스터 (17) 가 온이고 PMOS 트랜지스터 (19) 가 오프인 것; 반면에 수정 발진기 전압의 음의 하프 사이클 동안 NMOS 트랜지스터 (17) 가 오프이고 PMOS 트랜지스터 (19) 가 온 인 것을 언급함으로써 근사화될 수 있다. 따라서, 수정 발진기 전압의 양의 하프-사이클 동안, 자기장 에너지가 증가하고, 수정 발진기 전압이 네거티브가 될 경우 (도 4 의 제 2 그래프), 전하는 드라이브 인덕터 (LD) 의 자기장에 의해 제 3 커패시터 (C3) 로 푸시되며 (도 4 의 최종 그래프), 따라서 발진기 인덕터 (LO) 가 그 전압을 다시 증가시키는 것을 돕는다 (도 4 의 제 2 그래프).
앞서 설명되었던 것과 같이, 본 발명에 따르면, 에너지는 드라이브 인덕터 (LD) 에 일시적으로 저장된다. 이러한 방식으로, 종래 기술의 구동 회로들에서 발생하는 단락 회로 전류가 회피될 수 있으며, 이는 에너지가 접지로 단락되는 대신, 드라이브 인덕터 (LD) 에 저장되기 때문이다. 추가로, 전압 소스 (13) 로부터의 전기 에너지는, 드라이브 인덕터 (LD) 에 저장된 에너지의 도움으로, 수정 발진기의 발진들과 동기식으로 (즉, 동위상으로) 수정 발진기 (3) 에 주입된다. 이는 전기 에너지가 오직 소정의 시간 인스턴스들에만, 및 더 구체적으로 제 1 노드 (21) 에서의 전위가 제 2 임계 값 미만일 경우, 수정 발진기 (3) 에 제공되는 것을 의미한다. 따라서, 본 발명에 따르면, 수정 발진기 (3) 는 오직 수정 발진기가 구동 회로 (11) 로부터의 전류를 수신할 준비가 된 경우에만 이 전류가 공급된다. 다시 말해서, 본 발명에 따르면, 구동 회로 (11) 는 수정 발진기 (3) 와 동위상이고, 수정 발진기 (3) 는 수정 발진기 (3) 의 전류 흐름에 대하여 구동되지 않는다. 정전압 소스 (13) 의 전압 및 발진 주파수와 함께, 피드 인덕턴스는 각 사이클에서 발진기 (3) 로 전달된 에너지의 양을 결정하는 것을 유의해야 한다. 따라서, 피드 인덕턴스의 값은 그 주파수로, 또는 특정 발진기로 동조되어야만할 수도 있다.
본 발명은 또한, 드라이브 인덕터 (LD) 를 통해 전기 에너지 소스 (13) 로부터 발진기 (3) 로 전기 에너지를 공급하여, 드라이브 인덕터 (LD) 가 발진기 (3) 가 비-수신 상태에 있는 발진기 사이클의 제 1 페이즈 동안 전기 에너지 소스 (13) 에 의해 전원 공급되도록 하고, 제 1 페이즈 동안 드라이브 인덕터 (LD) 에 저장된 에너지의 적어도 일부가 발진기가 에너지-수신 상태에 있는 발진기 사이클의 제 2 페이즈 동안 전기 에너지 소스 (13) 로부터 발진기 (3) 로 전기 에너지를 전송하는데 사용되도록 함으로써, 수정 발진기 (3) 를 구동하는 방법에 관련된다.
본 발명은 도면들 및 앞서의 설명에서 도시되고 상세히 설명되었지만, 그러한 도면 및 설명은 구체적이거나 예시적이고 제한하지 않은 것으로 고려되기 위한 것이며, 본 발명은 개시된 실시형태에 제한되지 않는다. 다른 실시형태들 및 변형들은, 도면들, 개시물 및 첨부된 청구항들의 연구에 기초하여, 청구된 발명을 수행할 때 당업자에 의해 이해되고, 달성될 수 있다. 예를 들어, 트랜지스터의 단자들의 수는 3 초과일 수 있다. 일부 변형들에서 단자들의 수는 4 이다. 추가로, 구동 회로는, 예컨대 발진기의 커패시터들을 충전하기 위한 커패시터 사전 충전 회로, 전자 회로 (11) 에서 전류들을 제한하기 위한 전류 리미터 및/또는 구동 회로 (11) 의 스위치들 (17, 19) 의 스위칭을 제어하기 위한 제어 회로와 같은 추가의 회로 엘리먼트들을 포함할 수도 있다.
청구항들에서, 단어 "포함하는 (comprising)" 은 다른 엘리먼트들 또는 단계들을 배제하지 않으며, 부정 관사 "a" 또는 "an" 는 복수를 배제하지 않는다. 상이한 피처들이 서로 상이한 종속 청구항들에서 인용된다는 단순한 사실은 이들 피처들의 조합이 이롭게 사용될 수 없는 것을 나타내지 않는다. 청구항들에서의 임의의 참조 부호들은 발명의 범위를 제한하는 것으로 해석되지 않아야 한다.

Claims (12)

  1. 발진기 (3) 를 구동하기 위한 구동 회로 (11) 로서,
    - 제 1 단자 및 제 2 단자를 포함하는 제 1 인덕터 (LD);
    - 상기 제 1 단자에 접속된 전기 에너지 소스 (13); 및
    - 상기 제 2 단자와 상기 발진기 (3) 간에 접속된 스위칭 회로로서, 상기 스위칭 회로는 적어도, 상기 발진기 (3) 에 실질적으로 어떤 전기 에너지도 전달하지 않는 오프 상태에서 및 상기 발진기 (3) 에 전기 에너지를 전달하는 온 상태에서 동작하도록 구성되며, 상기 스위칭 회로는 제 1 스위치 (17) 및 제 2 스위치 (19) 를 포함하는, 상기 스위칭 회로를 포함하며,
    상기 제 1 인덕터 (LD) 는 상기 스위칭 회로가 상기 오프 상태에 있는 동안 에너지를 상기 제 1 인덕터의 자기장에 저장하도록 배열되고, 상기 스위칭 회로가 상기 온 상태에 있을 경우, 상기 스위칭 회로는 상기 자기장에 저장된 상기 에너지의 적어도 일부를 사용하여 상기 전기 에너지 소스 (13) 로부터 상기 발진기 (3) 로 전류의 서지 (surge) 를 전달하도록 배열되고,
    상기 제 1 스위치는 제 1 NMOS 트랜지스터 (17) 이고 상기 제 2 스위치는 제 2 PMOS 트랜지스터 (19) 이며, 그리고
    제 1 및 제 2 MOS 트랜지스터들 (17, 19) 의 게이트 단자들은 공통 노드 (21) 에 접속되고, 상기 제 1 NMOS 트랜지스터 (17) 의 드레인과 상기 제 2 PMOS 트랜지스터 (19) 의 소스는 상기 제 1 인덕터 (LD) 의 상기 제 2 단자에 접속되며, 상기 스위칭 회로는 상기 공통 노드 (21) 에서의 전위가 제 1 임계 값보다 클 경우 상기 오프 상태에 있고, 상기 제 2 단자와 상기 공통 노드 (21) 간의 전위 차이가 제 2 임계 값 이상일 경우 상기 온 상태에 있도록 구성되는 것을 특징을 하는 발진기를 구동하기 위한 구동 회로 (11).
  2. 제 1 항에 있어서,
    상기 제 2 임계 값은 상기 제 1 임계 값보다 높은 것을 특징으로 하는 발진기를 구동하기 위한 구동 회로 (11).
  3. 제 1 항에 있어서,
    상기 제 1 및 제 2 임계 값들은 양의 전압들인 것을 특징으로 하는 발진기를 구동하기 위한 구동 회로 (11).
  4. 제 1 항에 있어서,
    상기 제 1 및 제 2 임계 값들은 0 V 와 1 V 사이인 것을 특징으로 하는 발진기를 구동하기 위한 구동 회로 (11).
  5. 제 1 항에 있어서,
    상기 제 1 트랜지스터 (17) 의 소스 단자는 접지에 접속되는 한편, 상기 제 1 트랜지스터 (17) 의 드레인 단자는 상기 제 2 단자에 접속되는 것을 특징으로 하는 발진기를 구동하기 위한 구동 회로 (11).
  6. 제 1 항에 있어서,
    상기 제 2 트랜지스터 (19) 의 소스 단자는 상기 제 2 단자에 접속되는 것을 특징으로 하는 발진기를 구동하기 위한 구동 회로 (11).
  7. 제 1 항에 있어서,
    상기 전기 에너지 소스 (13) 는 정전압 소스를 포함하는 것을 특징으로 하는 발진기를 구동하기 위한 구동 회로 (11).
  8. 제 1 항에 기재된 구동 회로 (11) 및 발진기 (3) 를 포함하는 전자 회로 (9).
  9. 제 8 항에 있어서,
    상기 발진기 (3) 는 제 3 단자 (23) 와 제 4 단자 (21) 를 포함하는 제 2 인덕터 (LO), 및 상기 제 2 인덕터 (LO) 와 직렬로 접속된 커패시터 (C2) 를 포함하고, 상기 제 2 트랜지스터 (19) 의 드레인 단자는 상기 제 3 단자 (23) 에 접속되는 것을 특징으로 하는 전자 회로 (9).
  10. 제 9 항에 있어서,
    상기 제 1 및 제 2 트랜지스터들 (17, 19) 의 게이트 단자들은 상기 제 4 단자 (21) 에 접속되는 것을 특징으로 하는 전자 회로 (9).
  11. 제 8 항에 있어서,
    상기 스위칭 회로의 동작은 제 4 단자 (21) 에서의 전위에 의해 제어되도록 구성되는 것을 특징으로 하는 전자 회로 (9).
  12. 인덕터 (LD) 를 통해 전기 에너지 소스 (13) 로부터 발진기 (3) 로 전기 에너지를 공급하여, 상기 인덕터 (LD) 가 상기 발진기 (3) 가 비-수신 상태에 있는 발진기 사이클의 제 1 페이즈 동안 상기 전기 에너지 소스 (13) 에 의해 전원 공급되도록 하고, 상기 제 1 페이즈 동안 상기 인덕터 (LD) 에 저장된 에너지의 적어도 일부가 상기 발진기가 에너지-수신 상태에 있는 상기 발진기 사이클의 제 2 페이즈 동안 상기 전기 에너지 소스 (13) 로부터 상기 발진기 (3) 로 전류의 서지 (surge) 를 전송하는데 사용되도록 함으로써, 제 1 항에 기재된 구동 회로 (11) 에 의해 발진기 (3) 를 구동하는 방법.
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