KR20100082576A - 산화물 반도체 및 이를 포함하는 박막 트랜지스터 - Google Patents
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Abstract
산화물 반도체 및 이를 포함하는 박막 트랜지스터에 대해서 개시된다. 상기 산화물 반도체는 In산화물에 Hf이 포함되어 형성된 것으로 이를 박막 트랜지스터의 채널 물질로 적용할 수 있다.
Description
산화물 반도체 및 이를 포함하는 박막 트랜지스터에 관한 것으로, 보다 상세하게는 In 산화물에 새로운 물질을 첨가한 반도체 물질 및 이를 포함하는 산화물 박막 트랜지스터가 개시된다.
박막 트랜지스터(Thin film transistor)는 다양한 응용 분야에 이용되고 있으며, 특히 디스플레이 분야에서 스위칭 및 구동 소자로 이용되고 있고, 크로스 포인트형 메모리 소자의 선택 스위치로 사용되고 있다.
현재 TV용 패널로서 액정디스플레이(LCD)가 주축을 이루고 있는 가운데, 유기발광 디스플레이도 TV로의 응용을 위해 많은 연구가 진행되고 있다. TV용 디스플레이 기술 개발은 시장에서 요구하는 바를 충족시키는 방향으로 발전하고 있다. 시장에서 요구하는 사항으로는 대형화된 TV 또는 DID(Digital Information Display), 저가격, 고화질 (동영상표현력, 고해상도, 밝기, 명암비, 색재현력) 등이 있다. 이와 같은 요구 사항에 대응하기 위해서는 유리 등의 기판의 대형화와 함께, 우수한 성능을 갖는 디스플레이의 스위칭 및 구동소자로 적용될 박막 트랜지스터(TFT)가 요구된다.
디스플레이의 구동 및 스위칭 소자로서 사용되는 것으로, 비정질 실리콘 박막트랜지스터(a-Si TFT)가 있다. 이는 저가의 비용으로 2m가 넘는 대형 기판상에 균일하게 형성될 수 있는 소자로서 현재 가장 널리 쓰이는 소자이다. 그러나, 디스플레이의 대형화 및 고화질화 추세에 따라 소자 성능 역시 고성능이 요구되어, 이동도 0.5 cm2/Vs수준의 기존의 a-Si TFT는 한계에 다다를 것으로 판단된다. 따라서 a-Si TFT보다 높은 이동도를 갖는 고성능 TFT 및 제조 기술이 필요하다.
a-Si TFT 대비 월등히 높은 성능을 갖는 다결정 실리콘 박막트랜지스터(poly-Si TFT)는 수십에서 수백 cm2/Vs의 높은 이동도를 갖기 때문에, 기존 a-Si TFT에서 실현하기 힘들었던 고화질 디스플레이에 적용할 수 있는 성능을 갖는다. 또한, a-Si TFT에 비해 소자 특성 열화 문제가 매우 적다. 그러나, poly-Si TFT를 제작하기 위해서는 a-Si TFT에 비해 복잡한 공정이 필요하고 그에 따른 추가 비용도 증가한다. 따라서, poly-Si TFT는 디스플레이의 고화질화나 OLED와 같은 제품에 응용되기 적합하지만, 비용 면에서는 기존 a-Si TFT에 비해 열세이므로 응용이 제한적인 단점이 있다. 그리고 poly-Si TFT의 경우, 제조 장비의 한계나 균일도 불량과 같은 기술적인 문제로 현재까지는 1 m가 넘는 대형기판을 이용한 제조공정이 실현되고 있지 않기 때문에, TV 제품으로의 응용이 어렵다.
이에 따라 a-Si TFT의 장점과 poly-Si TFT의 장점을 모두 지닌 새로운 TFT기술이 요구되었다. 이에 대한 연구가 활발히 진행되고 있는데, 그 대표적인 것으로 산화물 반도체 소자가 있다.
산화물 반도체 소자로 최근 각광을 받는 것으로 ZnO계 박막 트랜지스터이다. 현재 ZnO 계열 물질로 Zn 산화물, In-Zn 산화물 및 여기에 Ga, Mg, Al, Fe 등이 도핑된 산화물 등이 소개되었다. ZnO계 반도체 소자는 저온 공정으로 제작이 가능하고 비정질 상이기 때문에 대면적화가 용이한 장점을 가진다. 또한, ZnO 계 반도체 필름은 고이동도의 물질로서 다결정 실리콘과 같은 매우 양호한 전기적 특성을 갖는다.
또한 이와 더불에 InO 계열 물질을 TFT의 채널 물질로 적용하기 위한 연구 역시 진행되고 있다. 미국 등록특허 제 7,339,187호에는 증가형(Enhancement Mode) 특성을 나타내는 TFT로서 InO 물질을 채널로 적용한 TFT에 대해서 개시되어 있고, 미국 등록특허 제 7,067,843호에는 도핑되지 않은 금속산화물 반도체를 적용한 TFT로서 금속산화물의 예시로 InO이 개시되어 있다. 또한 WO07/058248호에는 InO 물질에 Zn, Cu, Mg, Co, Ca 등의 물질을 도핑하여 채널물질로 적용한 개념에 대해서 개시되어 있으며, WO07/046181호에는 InO에 CeO를 도핑하여 채널 물질로 적용한 개념에 대해서 개시되어 있어, InO 계열 물질을 박막 트랜지스터의 채널 물질로 적용하기 위한 연구 역시 병행되어 진행되고 있다.
본 발명의 일측면은 In 산화물에 새로운 물질을 첨가한 산화물 반도체에 관련된다.
본 발명의 다른 측면은 상기 산화물 반도체를 채널 영역에 사용한 산화물 박막 트랜지스터에 관련된다.
본 발명의 일 측면에 따라 In 산화물에 Hf이 추가된 산화물 반도체가 제공된다
상기 산화물에서 In 및 Hf 원자의 전체 함량대비 상기 Hf의 조성비가 0 at% < Hf(at %) ≤ 10 at% 범위일 수 있다.
상기 조성비는 0 at% < Hf(at %) ≤ 2 at% 또는 0 at% < Hf(at %) ≤ 1.5 at%일 수 있다.
상기 산화물은 비정질이거나, 혼합결정질이거나 혹은 결정질일 수 있다.
상기 산화물 반도체는 I족 원소, II족 원소, III족 원소, IV족 원소, V족 원소 또는 Ln 계열 원소를 추가로 더 포함할 수 있다.
본 발명의 다른 측면에 따라 게이트; 상기 게이트에 대응되는 위치에 형성된 것으로 In 산화물에 Hf이 추가된 산화물 반도체를 포함하여 형성된 채널; 상기 게이트 및 채널 사이에 형성되는 게이트 절연체; 및 상기 채널의 양측부와 각각 접촉하며 형성된 소스 및 드레인을 포함하는 산화물 박막 트랜지스터가 제공된다.
상기 박막 트랜지스터에서, 상기 산화물은 In 및 Hf 원자의 전체 함량대비 상기 Hf의 조성비가 0 at% < Hf(at %) ≤ 10 at% 범위일 수 있다.
상기 조성비는 0 at% < Hf(at %) ≤ 2 at% 또는 0 at% < Hf(at %) ≤ 1.5 at%일 수 있다.
상기 박막 트랜지스터에서, 상기 산화물은 비정질이거나, 혼합결정질이거나 혹은 결정질일 수 있다.
상기 박막 트랜지스터에서, 상기 산화물 반도체는 I족 원소, II족 원소, III족 원소, IV족 원소, V족 원소 또는 Ln 계열 원소를 추가로 더 포함할 수 있다.
본 발명의 실시예에 따르면 In 산화물에 Hf가 첨가됨으로써 안정되며 신뢰성이 높은 전기적 특성을 지닌 산화물 반도체 및 이를 포함하는 산화물 박막 트랜지스터를 제공할 수 있다.
이하, 도면을 참조하여 본 발명의 실시예에 의한 산화물 반도체, 이를 포함하는 산화물 박막 트랜지스터 및 그 제조 방법에 대해 상세히 설명하고자 한다. 참고로, 도면에 도시된 각 층의 두께 및 폭은 설명을 위하여 다소 과장되게 표현되었음을 명심하여야 한다.
본 발명의 실시예에 의한 산화물 반도체는 In 산화물에 Hf이 첨가된 물질이다. 상기 In 산화물에 Hf이 첨가된 산화물 반도체는 비정질이거나, 혼합결정질이거나 결정질일 수 있다.
In 산화물은 공정 프로세스에 의해 쉽게 캐리어 농도가 변하므로 안정적인 TFT특성을 얻기 어려웠다. 이에 따라 In 산화물에 제3의 원소인 Hf을 도핑함으로써 캐리어 밀도를 낮추고 안정적인 TFT 특성을 확보하고 있으며, 여기서는 Hf 물질을 도핑 물질로 제안한다.
산화물 반도체에서 전체 In 및 Hf 의 원소함량 대비 Hf원소의 조성비는 0 at% < Hf(at %) ≤ 10 at% 범위가 될 수 있다. 또한 상기 Hf 조성비는 0 at% < Hf( at %) ≤ 2at% 범위 또는 0 at% < Hf( at %) ≤ 1.5at% 가 되는 것도 가능하다.
산화물 반도체에는 Li, K과 같은 I족 원소, Mg, Ca, Sr과 같은 II족 원소, Ga, Al, In, Y과 같은 III족 원소, Ti, Zr, Si, Sn, Ge과 같은 IV족 원소, Ta, Vb, Nb, Sb와 같은 V족 원소, Ln 계열 원소(La, Ce, Pr, Nd, Pm, Sm, Eu, Gd, Tb, Dy, Ho, Er, Tm, Yb, Lu) 등이 추가적으로 포함될 수 있다.
본 발명의 실시예에 의한 산화물 반도체는 LCD, OLED에 사용되는 구동 트랜지스터의 채널물질로 적용될 수 있으며, 메모리 소자의 주변회로를 구성하는 트랜지스터, 또는 선택 트랜지스터의 채널 물질로 적용될 수 있다.
도 1a 및 도 1b는 본 발명의 실시예에 의한 산화물 반도체를 포함하는 박막 트랜지스터의 구조를 나타낸 단면도이다. 도 1a에서는 바텀 게이트(bottom gate)형 박막 트랜지스터를 나타내었으며, 도 1b에서는 탑 게이트(top gate)형 박막 트랜지스터를 나타내었다.
도 1a를 참조하면, 본 발명의 실시예에 의한 산화물 박막 트랜지스터는 기판(11)의 일영역 상에 형성된 게이트 전극(13), 기판(11) 및 게이트 전극(13) 상에 형성된 게이트 절연층(14)을 포함하고 있다. 기판(11)이 실리콘으로 형성된 경우 실리콘 기판 표면에 열산화 공정에 의한 산화층(12)을 더 포함할 수 있다. 게이트 전극(13)에 대응되는 게이트 절연층(14) 상에는 채널(15)이 형성되어 있으며, 채널(15)의 양측부 및 게이트 절연층(14) 상에는 소스(16a) 및 드레인(16b)이 형성되어 있다.
도 1b를 참조하면, 기판(101) 상에 각각 형성된 소스(102a) 및 드레인(102b)를 포함하며, 소스(102a), 드레인(102b) 사이 영역에 형성된 채널(103)을 포함한다. 채널(103) 및 기판(101) 상에는 게이트 절연층(104)이 형성되어 있으며, 채널(103)에 대응되는 게이트 절연층(104) 상에는 게이트 전극(105)이 형성되어 있다. 기판(101)이 실리콘으로 형성된 경우, 기판(101) 표면에는 열산화 공정에 의한 산화층을 더 포함할 수 있다.
도 1a 및 도 1b에 나타낸 본 발명의 실시예에 의한 산화물 박막 트랜지스터를 형성하는 각 층의 형성 물질에 대해 설명하면 다음과 같다. 기판(11, 101)은 일반적인 반도체 소자에 사용되는 기판을 사용할 수 있으며, 예를 들어 실리콘, 글래스(glass) 또는 유기물 재료를 사용할 수 있다. 기판(11, 101) 표면에 형성된 산화층은 예를 들어 실리콘 기판을 열산화하여 형성된 실리콘 산화층(SiO2)일 수 있다. 게이트 전극(13, 105)은 전도성 물질을 사용할 수 있으며, 예를 들어 Ti, Pt, Ru, Au, Ag, Mo, Al, W 또는 Cu와 같은 금속 또는 IZO(InZnO) 또는 AZO(AlZnO)와 같은 금속 또는 전도성 산화물일 수 있다. 게이트 절연층(14, 104)은 통상적인 반도체 소자에 사용되는 절연 물질을 사용하여 형성할 수 있다. 예를 들어, SiO2 또는 SiO2보다 유전율이 높은 High-K 물질인 HfO2, Al2O3, Si3N4 또는 이들의 혼합물을 사용할 수 있다. 소스(16a, 102a) 및 드레인(16b, 102b)은 전도성 물질을 사용하여 형성할 수 있으며, 예를 들어 Ti, Pt, Ru, Au, Ag, Mo, Al, W 또는 Cu와 같은 금속 또는 IZO(InZnO) 또는 AZO(AlZnO)와 같은 금속 또는 전도성 산화물을 사용할 수 있다.
이하, 도 2a 내지 도 2e를 참조하여 본 발명의 실시예에 의한 산화물 박막 트랜지스터의 제조 방법에 대해 설명하고자 한다.
도 2a를 참조하면, 먼저 기판(11)을 마련한다. 기판(11)은 실리콘, 글래스 또는 유기물 재료를 사용할 수 있다. 여기서, 실리콘을 기판(11)으로 사용하는 경우, 열산화 공정에 의해 기판(11) 표면에 절연층(12)을 형성할 수 있다. 그리고, 기판(11) 상에 금속 또는 전도성 금속 산화물 등의 전도성 물질(13a)을 도포한다.
도 2b를 참조하면, 전도성 물질(13a)을 패터닝함으로써 게이트 전극(13)을 형성한다. 도 2c를 참조하면, 게이트 전극(13) 상부에 절연 물질을 도포하고 패터닝하여 게이트 절연층(14)을 형성한다. 게이트 절연층은 실리콘 산화물, 실리콘 질화물, 하프늄(Hf) 산화물, 알루미늄 산화물 또는 하프늄산화물 및 알루미늄산화물의 혼합물로 형성할 수 있다.
도 2d를 참조하면, 게이트 절연층(14) 상에 채널 물질을 PVD, CVD 또는 ALD 등의 공정으로 도포한 뒤, 게이트 전극(13)에 대응되는 게이트 절연층(14) 상에 채 널 물질들이 잔류하도록 패터닝함으로써 채널(15)을 형성한다. 여기서, 채널(15)은 In 산화물에 Hf을 첨가하여 형성할 수 있다. 구체적으로 스퍼터링(sputtering) 공정으로 채널(15)을 형성하는 경우, In 산화물로 형성된 타겟(target)과 Hf 금속으로 형성된 타겟을 공정 챔버 내에 장착하여 코스퍼터링(cosputtering) 공정으로 채널(15)을 형성할 수 있다. 또한, In 산화물에 Hf원소가 추가된 형태의 단일 타겟을 사용할 수 있다.
도 2e를 참조하면, 금속 또는 전도성 금속 산화물 등의 물질을 채널(15) 및 게이트 절연층(14) 상에 도포한 뒤, 채널(15)의 양측부에 연결되도록 패터닝함으로써 소스(16a) 및 드레인(16b)를 형성한다. 마지막으로, 섭씨 400도 이하, 예를 들어 섭씨 약 200도 온도에서 일반적인 퍼니스, RTA(rapid thermal annealing), 레이저 또는 핫플레이트에 등을 이용하여 열처리 공정을 실시한다.
제조예
실리콘 표면에 실리콘 산화물이 100nm 두께로 형성된 기판을 마련한다. 기판 표면의 일부 영역에 Mo로 200nm 두께의 게이트를 형성한 뒤, 기판 및 게이트 상부에 200nm 두께의 실리콘 질화물을 도포하여 게이트 절연층을 형성한다. 그리고, 게이트에 대응되는 게이트 절연층 상에 산화물 반도체를 도포하여 채널을 형성한다. 채널 형성의 구체적인 공정을 설명하면 다음과 같다. 타겟으로는 Kojundo 사의 In 산화물 타겟 및 LTS 사의 99.9% Hf 타겟을 사용하였다. 이들 타겟들을 스퍼터(Varian사, 모델명 MS100)의 챔버 내에 장착시켰다. 상온에서 O2 및 Ar 가스를 O2:Ar = 5:95 vol%로 유지시켜 전체 가스 압력을 5mTorr로 유지하였으며, In 산화물 타겟에 150watt 전류를 인가하고, Hf 타겟에 15 내지 30watt의 전류를 인가하면서 코스퍼터링을 실시하였다. 그리하여, 약 70nm 두께의 In 산화물에 Hf이 포함된 산화물 반도체 박막을 도포하여 채널을 형성하였다. 그리고, 채널의 양측에 소스 및 드레인으로 Ti 10nm, Pt 100nm 두께의 이중층을 형성시켰다. 다음으로, 섭씨 200도에서 1시간 동안 열처리 공정을 실시하였다. 제조된 박막 산화물에 대해서 ICP 분석을 실시한 결과 In 및 Hf의 원자비는 98.5at%:1.5at%임을 알 수 있었다.
상술한 바와 같이 제조한 본 발명의 실시예에 의한 산화물 반도체에 대해 게이트 전압(Vg)에 대한 드레인 전류(Id) 값을 측정하였다.
도 3은 상기와 같이 제조된 산화물 박막 트랜지스터에 대해 게이트 전압(Vg)에 대한 드레인 전류(Id) 값을 나타낸 도면이다. ●으로 표시되는 그래프는 게이트 전압이 10V 일때의 그래프이며, ■으로 표시되는 그래프는 게이트 전압이 0.1V 일때의 트랜스퍼 커브이다. 이때 박막 트랜지스터의 width는 40㎛이고 length는 4㎛이었다. 도 3을 참조하면 이동도는 18.6 cm2/V.s를 보이고 있으며, 오프커런트는 Ioff < 1pA 이하의 값을 나타내어 a-Si TFT 대비 우수한 특성을 나타내었다. 또한 온과 오프의 커런트차이도 Ion/Ioff > 108 이상의 차이를 보이고 있다.
도 4는 게이트 전압을 0, 4.28, 7.14 및 10V로 인가하는 경우, 드레인 전압(Vds)에 따른 드레인 전류(Ids) 값을 나타낸 아웃풋 그래프이다. 도 4를 참조하면, 게이트 전압이 증가함에 따라 드레인 전압을 증가시키면 드레인 전류 값도 점차 증가하는 것을 알 수 있다.
도 5는 채널 물질로 In 산화물에 Hf를 추가하여 형성된 산화물 박막 트랜지스의 광안정성을 나타낸 그래프로서, 광조사 여부에 따른 게이트 전압(Vgs)에 대한 드레인 전류(Ids)값을 나타낸 것이다. 여기서, Dark는 시편에 광을 차단한 경우를 나타내며, Open은 시편을 자연광에 노출시킨 경우(door open)을 나타내며, Light1는 박막 트랜지스터에 직접 램프 광을 조사한 것이다. 도 5를 참조하면, 광인가시와 광 차단시의 트랜스퍼 커브의 이동은 크지 않은 것을 알 수 있다. 따라서, 외부 환경, 특히 외부 광량의 변화에 따른 박막 트랜지스터 특성의 변화가 작으며, 결과적으로 신뢰성이 우수한 것을 알 수 있다.
한편 증착된 박막의 조성성분비, 특성 그래프, 이동도 특성 등은 사용되는 타겟의 종류, 증착시 타겟 인가전압, 증착장비, 증착압력, 산소분압 조건, 기판온도 등에 의해 변경가능하다. 예를 들어, In 산화물 타겟과 Hf 타겟의 2종류를 사용하는 경우에 대비하여 Hf-In 산화물의 단일 타겟을 사용하는 경우 증착된 박막 조성이 달라질 수 있다. 또한 증착된 박막 조성이 같은 경우라도 증착 조건에 따라 박막 특성의 변경이 가능하다. 예를 들어 스퍼터링 공정으로 산화물 반도체를 증착하는 경우, 산소 분압에 따라 산화물의 저항 범위는 크게 변할 수 있다. 산소 분압이 적정량 이하로 조절되는 경우 증착된 박막의 저항이 낮은 박막을 증착할 수 있으며, 산소 분압을 높게 조절하는 경우 저항이 높은 박막을 증착할 수 있다.
상술한 바와 같은 실시예를 통해서, 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자라면 본 발명의 기술적 사상에 의해 산화물 반도체를 이용하여 LCD, OLED 등 평판 디스플레이의 구동 트랜지스터, 메모리 소자의 주변회로 구성을 위한 트랜지스터 등의 다양한 전자 소자를 제조할 수 있을 것이다. 본 발명의 실시예에 의한 산화물 박막 트랜지스터는 바텀 게이트형 또는 탑 게이트형으로 사용될 수 있다. 결과적으로 본 발명의 범위는 설명된 실시예에 의하여 정하여 질 것이 아니고 특허 청구범위에 기재된 기술적 사상에 의해 정하여져야 한다.
도 1a 및 도 1b는 본 발명의 실시예에 의한 산화물 반도체를 포함하는 박막 트랜지스터의 구조를 나타낸 단면도이다.
도 2a 내지 도 2e는 본 발명의 실시예에 의한 산화물 박막 트랜지스터의 제조 방법을 나타낸 도면이다.
도 3은 채널 물질로 In 산화물에 Hf를 포함한 산화물 박막 트랜지스터에 대해 게이트 전압에 대한 드레인 전류 값을 나타낸 도면이다.
도 4는 채널 물질로 In 산화물에 Hf을 포함한 산화물 박막 트랜지스터에 대해 드레인 전압 변화에 따른 드레인 전류 값을 나타낸 도면이다.
도 5는 채널 물질로 In 산화물에 Hf를 포함한 산화물 박막 트랜지스터에 대한 광안정성을 나타내는 그래프이다.
< 도면의 주요 부분에 대한 부호의 설명 >
11, 101... 기판 12... 절연층
13, 105... 게이트 전극 14, 104... 게이트 절연층
15, 103... 채널 16a, 102a... 소스
16b, 102b... 드레인
Claims (17)
- In 산화물에 Hf이 추가된 산화물 반도체.
- 제 1항에 있어서,상기 산화물에서 In 및 Hf 원자의 전체 함량대비 상기 Hf의 조성비가 0 at% < Hf(at %) ≤ 10 at% 범위인 산화물 반도체.
- 제 2항에 있어서,상기 산화물에서 In 및 Hf 원자의 전체 함량대비 상기 Hf의 조성비가 0 at% < Hf(at %) ≤ 2 at% 범위인 산화물 반도체.
- 제 3항에 있어서,상기 산화물에서 In 및 Hf 원자의 전체 함량 대비 상기 Hf의 조성비가 0 at% < Hf(at %) ≤ 1.5 at% 범위인 산화물 반도체.
- 제 1항에 있어서,상기 산화물 반도체는 I족 원소, II족 원소, III족 원소, IV족 원소, V족 원소 또는 Ln 계열 원소를 더 포함하는 산화물 반도체.
- 제 1항에 있어서,상기 산화물 반도체는 비정질인 것을 특징으로 하는 산화물 반도체.
- 제 1항에 있어서,상기 산화물 반도체는 혼합결정질인 것을 특징으로 하는 산화물 반도체.
- 제 1항에 있어서,상기 산화물 반도체는 결정질인 것을 특징으로 하는 산화물 반도체.
- 산화물 박막 트랜지스터에 있어서,게이트;상기 게이트에 대응되는 위치에 형성된 것으로 In 산화물에 Hf이 추가된 산화물 반도체를 포함하여 형성된 채널;상기 게이트 및 채널 사이에 형성되는 게이트 절연체; 및상기 채널의 양측부와 각각 접촉하며 형성된 소스 및 드레인을 포함하는 산화물 박막 트랜지스터.
- 제 9항에 있어서,상기 산화물에서 In 및 Hf 원자의 전체 함량대비 상기 Hf의 조성비가 0 at% < Hf(at %) ≤ 10 at% 범위인 산화물 박막 트랜지스터.
- 제 10항에 있어서,상기 산화물에서 In 및 Hf 원자의 전체 함량대비 상기 Hf의 조성비가 0 at% < Hf(at %) ≤ 2 at% 범위인 산화물 박막 트랜지스터.
- 제 11항에 있어서,상기 산화물에서 In 및 Hf 원자의 전체 함량대비 상기 Hf의 조성비가 0 at% < Hf(at %) ≤ 1.5at% 범위인 산화물 박막 트랜지스터.
- 제 9항에 있어서,상기 채널은 I족 원소, II족 원소, III족 원소, IV족 원소, V족 원소 또는 Ln 계열 원소를 더 포함하는 산화물 박막 트랜지스터.
- 제 9항에 있어서,상기 산화물 반도체는 비정질인 것을 특징으로 하는 산화물 박막 트랜지스터.
- 제 9항에 있어서,상기 산화물 반도체는 혼합결정질인 것을 특징으로 하는 산화물 박막 트랜지스터.
- 제 9항에 있어서,상기 산화물 반도체는 결정질인 것을 특징으로 하는 산화물 박막 트랜지스터.
- 제 9항에 따른 산화물 박막 트랜지스터를 스위칭 소자로 포함하는 디스플레이.
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