KR20090064312A - 어드레스 구동 회로 및 플라즈마 디스플레이 장치 - Google Patents

어드레스 구동 회로 및 플라즈마 디스플레이 장치 Download PDF

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Abstract

전력 회수 효율을 손상시키지 않고 회수 스위치를 삭감하기 위해, 어드레스 구동 회로를 하이 임피던스화하는 회로 구성을 제공하는 데에 있다. 플라즈마 디스플레이 패널의 서스테인 기간 중에 어드레스 구동 회로(50)를 하이 임피던스화하는 기구를 설치한다. 하이 임피던스화함으로써, X 전극(41), Y 전극(42)과 어드레스 전극(43)과의 사이의 용량 결합을 해소할 수 있어, 전력 회수율을 손상시키지 않고, 전력 회수 회로를 간소화하는 것이 가능하게 된다.
어드레스 구동 회로, 어드레스 전극, X 전극, Y 전극, 데이터 입력 단자

Description

어드레스 구동 회로 및 플라즈마 디스플레이 장치{ADDRESS DRIVE CIRCUIT AND PLASMA DISPLAY DEVICE}
본 발명은 플라즈마 디스플레이 패널의 구동 회로 및 그것을 이용한 플라즈마 디스플레이 장치에 관한 것이다.
자기 발광형인 플라즈마 디스플레이 패널은 시인성이 좋고, 박형이며 대화면 표시 및 고속 표시가 가능하다. 이 점으로부터 CRT를 대신하는 표시 패널로서 최근 급속하게 보급되고 있다. 한편 급속한 대화면화에 수반하는 소비 전력 증대가 플라즈마 디스플레이의 과제로 되고 있고, 전력 회수 회로라고 불리는 패널을 큰 용량으로 간주한 공진 회로를 이용한다. 이에 의해 투입 전력의 대부분을 회수하여, 저소비 전력화를 도모하고 있다.
일본 특허 공개 제2004-309983호 공보에 기재된 발명에서는 패널 용량을 충전ㆍ방전하기 위한 경로에 공진용의 코일, 다이오드, 스위치로서 기능하는 MOS 트랜지스터, 회수용의 컨덴서 등으로 구성되는 전력 회수 회로가 도시되어 있다. 이 전력 회수 회로는, 예를 들면 일본 특허 공고 평7-109542호 공보에서 그 작용이 상세하게 개시되어 있는 바와 같이, 코일과 플라즈마 디스플레이 패널의 패널 용량 Cp로 형성되는 공진 작용에 의해, 패널 용량 Cp에 축적된 전하를 회수 컨덴서에 회수한다. 그 후, 회수 컨덴서에 의해 회수한 전하를 패널 용량 Cp에 공급하는 것이다. 이하, 이 작용을 편의상 「전력 회수」라고 하기로 한다.
전술한 바와 같이, 전력 회수 회로는 X 전극, Y 전극의 각각의 서스테인 구동 회로에 포함되어 있다. 한편, 이 전력 회수 회로는 서스테인 구동 회로를 복잡하게 하고 있는 요인 중 하나로 되어 있다. 본 회수 회로의 간략화를 도모하기 위해, 패널 전극으로부터 회수용 컨덴서에 이르는 경로에 직렬로 설치된 스위치(이하, 회수 스위치)를 삭감하는 것이 제안되어 있다.
이 방식은 일본 특허 공표 제2003-533722호 공보에서 개시되어 있으므로, 여기서의 상세한 설명은 생략하지만, 회수 스위치를 삭감하여도 전력 회수를 실현하기 위해서는, 한쪽의 전극에 주어진 구동 전압 변화가, 다른 쪽의 전극에 확실하게 전파하는 것이 필수적인 조건이다.
그러나, 실제의 플라즈마 디스플레이 패널 내에서는, X 전극, Y 전극 외에 어드레스 전극이 설치되어 있다. 어드레스 전극은 X 전극, Y 전극 사이의 전압 변화를 저해하기 때문에, 전술한 바와 같은 전력 회수 동작을 실현하는 것은 곤란하다. 구체적으로는 X 전극 또는 Y 전극에 주어진 전압 변화 Vs2-Vs1(서스테인 전압간의 차)이 어드레스 전극과의 용량 결합에 의해 분압되게 되어, Y 전극 또는 X 전극의 전압 변화는 전력 회수에 필요한 전압 변화 Vs2-Vs1에 도달하지 않는다.
여기서 서스테인 전압 Vs2 및 서스테인 전압 Vs1은 서스테인 기간에서의 X 전극, Y 전극의 전위이다.
이와 같이 서스테인 구동 회로 구성의 간소화를 위해, 단순하게 회수 스위치를 삭감하여도 전력 회수 회로가 기능하지 않는다. 전력 회수 효율 저하를 회피하기 위해서는, 어드레스 전극과의 용량 결합을 해소하는 것이 과제로 된다.
이 문제점을 해결하기 위해, 어드레스 구동 회로는 어드레스 기간만 동작하면 되는 것에 주목한다. 어드레스 구동 회로에의 입력 신호 및 어드레스 구동 회로의 전원을 차단하기 위한 스위치를 구비하고, 어드레스 기간 중은 통상 접속으로, 전력 회수를 행하는 서스테인 기간 중은 어드레스 구동 회로를 하이 임피던스로 함으로써, 용량 결합을 해소한다.
이 구성을 실현하기 위한 회로로서는, 통상 포토 커플러ㆍ전자 커플러 등의 스위칭 소자가 적용되어 왔다. 그러나, 이들 소자의 도입은 본래의 목적이었던 회수용 스위치 소자의 삭감에 의한 원가 저감 효과를 부정하게 되므로 목적에 부합한 해결책이라고는 하기 어렵다.
본 발명의 목적은, 전력 회수 효율을 손상시키지 않고 회수 스위치를 삭감하기 위한, 어드레스 구동 회로를 하이 임피던스화하는 회로 구성을 실현하는 방법을 제공하는 데에 있다.
본 발명의 상기 및 그 밖의 목적과 신규의 특징은, 본 명세서의 기술 및 첨부 도면으로부터 명백하게 될 것이다.
본원에서 개시되는 발명 중, 대표적인 것의 개요를 간단히 설명하면, 다음과 같다.
본 발명의 대표적인 실시 형태에 따른 어드레스 구동 회로는, 플라즈마 디스플레이 패널의 주사 전극측과 유지 전극측에 전력 회수 회로를 포함하는 서스테인 구동 회로와, 어드레스 전극측에 어드레스 전압과 비어드레스 전압을 절환하여 출력할 수 있는 복수의 출력측 스위치 소자를 구비하는 어드레스 구동 회로와 복수의 출력측 스위치 소자의 전원측에 어드레스 전압 제어 스위치를 설치하는 것을 특징으로 한다.
이 어드레스 구동 회로의 복수의 입력측 소자의 전원측에 전원 전압 제어 스위치를 설치하는 것을 특징으로 하여도 된다.
이 어드레스 구동 회로에서, 어드레스 구동 회로에는 화상 신호 처리 회로로부터의 신호가 데이터 입력 단자에 입력되어 있고, 화상 신호 처리 회로 및 이 어드레스 구동 회로의 사이에는 입력 신호의 차단을 행하는 입력 신호 스위치가 삽입되는 것을 특징으로 하여도 된다.
이들 어드레스 구동 회로에서, 비어드레스 전압을 접지할지의 여부를 절환하는 접지 제어 스위치를 더 포함하는 것을 특징으로 하여도 된다.
이들 어드레스 구동 회로에서, 비어드레스 전압과 상기 데이터 입력 단자를 접속하는 논리 입력 고정 스위치를 더 갖는 것을 특징으로 하여도 된다.
이 어드레스 구동 회로에서, 어드레스 구동 회로에의 입력을 고정하는 래치 회로를 더 구비하는 것을 특징으로 하여도 된다.
이 어드레스 구동 회로에서, 래치 회로는 RS 플립플롭으로 구성되어 있는 것을 특징으로 하여도 된다.
이 어드레스 구동 회로에서, 서스테인 기간 중에 입력 신호 스위치, 어드레스 전압 제어 스위치, 전원 전압 제어 스위치 및 접지 제어 스위치를 오프로 하고, 어드레스 구동 회로를 플로팅 상태로 하는 것을 특징으로 하여도 된다.
이 어드레스 구동 회로에서, 서스테인 기간 중에 논리 입력 고정 스위치를 온으로 하고, 어드레스 구동 회로의 데이터 입력 단자를 고정하는 것을 특징으로 하여도 된다.
이들 어드레스 구동 회로에서, 어드레스 전압 제어 스위치 및 전원 전압 제어 스위치에 MOS 트랜지스터 혹은 다이오드를 적용하는 것을 특징으로 하여도 된다.
이들 어드레스 구동 회로를 사용하는 것을 특징으로 하는 플라즈마 디스플레이 장치도 본 발명의 사정에 포함한다.
본원에서 개시되는 발명 중, 대표적인 것에 의해 얻어지는 효과를 간단히 설명하면 이하와 같다.
본 발명의 대표적인 실시 형태에 따른 플라즈마 디스플레이 구동 회로에 따르면, 어드레스 구동 회로와 화상 신호 처리 회로 사이에 데이터 신호를 차단할 수 있는 스위치를 설치함으로써, 어드레스 구동 회로를 일시적으로 하이 임피던스화할 수 있다. 이에 의해, 종래 곤란하였던 주사 전극, 유지 전극측의 서스테인 구동 회로 내에 탑재되는 전력 회수 회로에서 회수 효율을 손상시키지 않고 스위치 소자를 삭감하여, 전력 회수 회로를 간소화할 수 있다고 하는 효과가 있다.
본 발명은, 어드레스 구동 회로를 서스테인 기간에 하이 임피던스화함으로써 어드레스 전극을 일시적으로 플로팅 상태로 한다. 이 결과, 플라즈마 디스플레이 패널 내에서 X 전극, Y 전극과 어드레스 전극의 용량 결합을 해소하는 것을 특징으로 한다. 이하, 도면을 참조하면서, 본 발명의 각 실시 형태에 대해서 설명한다.
<제1 실시 형태>
도 1은 플라즈마 디스플레이 장치의 개략 전체 구성도이며, 도 2 및 도 3은 플라즈마 디스플레이 구동 회로의 종래의 구성을 도시하는 구성도이다. 또한, 도 4는 제1 실시 형태의 어드레스 구동 회로(50)를 도시하는 회로도이며, 도 5는 제1 실시 형태의 어드레스 구동 회로(50)의 동작을 나타내는 타이밍차트이다. 우선, 도 1 내지 도 3을 이용하여, 플라즈마 디스플레이 장치의 회로의 개략 전체 구성에 대해서 설명한다.
일반적인 플라즈마 디스플레이 장치는, X 서스테인 구동 회로(10X), Y 서스테인 구동 회로(10Y), 스캔 드라이버(20), 플라즈마 디스플레이 패널(PDP)(40), 어드레스 구동 회로(50), 구동 제어 회로(70), 화상 신호 처리 회로(80)로 구성된다.
각 서스테인 구동 회로는 구동 제어 회로(70)로부터 공급되는 제어 신호에 기초하여, 표시 전극간에서 유지 방전을 일으키기 위한 서스테인 펄스 전압을 공급하는 회로이다. X 서스테인 구동 회로(10X)는 이 중의 X 전극을, Y 서스테인 구동 회로(10Y)는 Y 전극을 구동하는 구동 펄스 전압을 각각 공급한다.
스캔 드라이버(20)는 스캔 전극을 동작시키기 위한 구동 회로이다. 스캔 드라이버(20)에는 스위치(21)가 설치되어 있고, 후술하는 구동 제어 회로(70)로부터의 제어 신호에 의해, 어드레스 기간에는 도시하지 않은 스캔 펄스를 순서대로 인가되도록 절환된다. 그리고, Y 전극은 이 스캔 드라이버(20)에 접속되어 있다.
스캔 드라이버(20)는, 서스테인 방전(유지 방전) 기간에 Y 전극은 Y 서스테인 구동 회로(10Y)에 접속되도록 절환하는 스위치(21)를 동작시킨다.
또한 X 전극은 X 서스테인 구동 회로(1OX)에 접속되어 패널에 소정의 구동 전압을 인가한다.
플라즈마 디스플레이 패널(40)에는, n개의 X 전극(41)과 n개의 Y 전극(42)이 인접하여 교대로 배치된다. X 전극과 Y 전극은 표시 전극이라고 불리지만, 유지 전극 또는 서스테인 전극이라고도 불리는 경우도 있다.
어드레스 전극(43)은 발광하는 화소를 지정하는 전극이며, 어드레스 구동 회로로부터 플라즈마 디스플레이 패널(40)에 대해 출력된다. 어드레스 전극(43)은, 표시 전극과 수직인 방향으로 설치되고, X 전극 및 Y 전극으로 형성되는 각 표시 라인과 각 어드레스 전극(43)의 교점 부분에 각각 표시 셀(도시하지 않음)이 형성된다.
어드레스 구동 회로(50)는 후술하는 어드레스 기간에, 화상 신호 처리 회로(80)에서 변환된 화상 데이터와 스캔 드라이버(20)로부터의 스캔 펄스에 따라서, 표시시키는 화소 데이터를 어드레스 전극(43)에 출력한다. 어드레스 구동 회 로(50)는 이 플라즈마 디스플레이 패널(40)의 어드레스 신호선의 수에 대응한 종래의 어드레스 구동 회로(51)를 내포한다.
어드레스 구동 회로(50)는 본 발명에 의해 제안하는 것이며, 종래의 어드레스 구동 회로(51)를 내포한다.
구동 제어 회로(70)는, 플라즈마 디스플레이 장치의 각 부를 제어하는 신호를 발생하고, X 서스테인 구동 회로(10X), Y 서스테인 구동 회로(10Y), 화상 신호 처리 회로(80)에 공급한다.
화상 신호 처리 회로(80)는, 입력된 디지털 화상 신호를 플라즈마 디스플레이 장치 내부에서의 동작에 적합한 형식으로 변환한 후, 어드레스 구동 회로(50)에 공급하는 회로이다.
플라즈마 디스플레이 장치의 구동 회로는, 상기한 바와 같이 구성되어 있고, 각각의 구성 요소가 이하와 같이 구동됨으로써 플라즈마 방전이 제어된다.
다음으로 플라즈마 디스플레이 패널(40)의 구동 방법에 대해서 도 2를 이용하여 설명한다.
플라즈마 디스플레이 패널의 구동 수순은 리셋 기간, 어드레스 기간, 서스테인 기간으로 대별된다.
리셋 기간에서는, 리셋 기간 전의 서스테인 기간에서의 점등 상태에 상관없이, 방전 공간 내에서의 벽 전하를 중화하고, 각 방전 공간 내의 전하 상태를 균일하게 한다.
어드레스 기간에서는 스캔 드라이버(20)로부터의 스캔 펄스에 따라서, 어드 레스 구동 회로(50)로부터 대응한 화소 데이터가 출력되고, 점등시키는 셀에서만 어드레스 구동 회로(50)로부터 어드레스 전압 Va의 기입 펄스가 공급된다. 이에 의해 X 전극 및 Y 전극에는 자기 방전하지 않은 정도의 벽 전하가 유기된다(어드레스 방전).
서스테인 기간에서는 스위치 SW2x를 도통하고, X 전극에 저전압의 서스테인 전압 Vs1을 인가한다. 또한, 스위치 SW1y를 도통하고, Y 전극에 고전압의 서스테인 전압 Vs2를 인가하고, 플라즈마 디스플레이 패널(40)은 서스테인 방전을 행한다.
다음 주기에서는, 스위치 SW1y, SW2x를 오프하고, 스위치 SW3y, SW3x를 도통하고, 패널 용량과 코일의 공진 동작을 발생시킨다. 그 후, Y 전극을 서스테인 전압 Vs1로 하고, X 전극에 전압 Vs2를 인가하여, X 전극과 Y 전극 사이에서의 방전을 유지한다. 또한, 설명 중의 전압의 관계는 Vs1 < Vs2로 한다.
도 2와 도 3은, 각 서스테인 구동 회로에 스위치 SW3x, SW3y 및 전력 회수용 컨덴서 C1x 및 C1y가 포함되는지에 따라 상위하다. 그러나, 이 스위치 SW3x, SW3y는 서스테인 방전 전류를 온 오프시키므로 전류 용량ㆍ발열이 크다. 이 때문에, 몇 개의 소자를 병렬하여 접속해야만 하고, 또한 히트 싱크의 부설과 같은 방열 대책도 필요하게 된다. 그 결과, 제품 전체가 원가적으로 크게 상위하게 된다. 또한, 도 3은, 특허 문헌 3에 기재된 회로 구성이다. 본 발명의 실시 형태에서는 도 3의 플라즈마 디스플레이 구동 회로의 회로 구성을 이용한다.
다음으로, 본 실시 형태에 따른 어드레스 구동 회로 내에서의 하이 임피던스 화를 실현하는 어드레스 구동 회로(50)의 회로 구성에 대해서, 도 4, 도 5를 이용하여 설명한다. 본 어드레스 구동 회로(50)는 종래의 어드레스 구동 회로(51)에 복수의 스위치를 추가함으로써 하이 임피던스화할 수 있도록 한 것이다.
전술한 바와 같이, 본 실시 형태에 적용하는 전력 회수 회로로부터는 회수 스위치 SW3x, SW3y 등이 삭감되어 있다. 이 회로 구성에 의해 전력 회수 회로를 기능시키기 위해서는, 어드레스 구동 회로를 하이 임피던스화함으로써, 어드레스 전극(43)과 X 전극, Y 전극의 용량 결합에 의해 생기는 X 전극 어드레스 전극간 패널 용량 CXA, Y 전극 어드레스 전극간 패널 용량 CYA를 없앨 필요가 있다.
따라서 종래의 어드레스 구동 회로(51)를 하이 임피던스화하기 위해, 어드레스 회로에 입력되는 신호를 차단하기 위한 스위치, 즉 화상 신호 처리 회로(80)로부터의 데이터 입력 단자(81) 상에 설치된 스위치 SW51(입력 신호 스위치)과, 데이터 입력 단자(81)를 종래의 어드레스 구동 회로(51)의 그라운드 레벨에 접속하는 스위치 SW52(논리 입력 고정 스위치), 종래의 어드레스 구동 회로(51)에 공급하는 전원을 차단하는 스위치 SW53(전원 전압 제어 스위치) 및 SW54(어드레스 전압 제어 스위치)를 설치한다. 또한 비어드레스 전압 Vss를 접지할지 플로팅으로 할지를 결정하는 스위치 SW55(접지 제어 스위치)도 설치한다.
스위치 SW51은 화상 신호 처리 회로(80)로부터 종래의 어드레스 구동 회로(51)에의 입력 신호의 차단을 행하는 스위치이다.
스위치 SW52는 종래의 어드레스 구동 회로(51)의 입력 단자의 전위를 그라운드 레벨에 접속하기 위한 스위치이다. 그라운드 레벨에 접속함으로써, 논리 입력 을 고정하고, 종래의 어드레스 구동 회로(51)의 오동작을 방지한다.
스위치 SW53은 종래의 어드레스 구동 회로(51)의 입력 스위치군에 전원 전압 Vdd를 공급할지의 여부를 결정하는 스위치이다. 또한, 스위치 SW54는 종래의 어드레스 구동 회로(51)의 출력 스위치군에 어드레스 전압 Va를 공급할지의 여부를 결정하는 스위치이다.
스위치 SW55는 비어드레스 전압 Vss를 접지할지 플로팅으로 할지를 결정하는 스위치이다. 여기서 비어드레스 전압 Vss란, 전원 전압 Vdd 및 어드레스 전압 Va와는 서로 다른 전위를 나타낸다. 스위치 SW55가 온 상태일 때에 Vss는 그라운드 레벨로 되고, 오프 상태일 때에 Vss는 플로팅 상태로 된다.
또한, 이들 스위치 SW51, SW52, SW53, SW54, SW55는, MOS 트랜지스터로 구성하는 것을 특징으로 한다. M0S 트랜지스터를 사용함으로써, 채널 단가를 싸게 할 수 있기 때문에 제품 전체의 원가에 미치는 영향을 작게 하는 것이 가능하게 된다.
이 도면의 종래의 어드레스 구동 회로(51)에는 전원 전압 Vdd 및 어드레스 전압 Va의 2개의 전원 전압이 입력된다. 전원 전압 Vdd는 화상 신호 처리 회로(80)로부터의 신호를 처리하고 어드레스 구동 회로를 제어하는 종래의 어드레스 구동 회로(51) 내의 논리 회로의 전원 전압이다. 한편, 어드레스 전압 Va는 어드레스 전극(43)을 구동하는 출력단에 전력을 공급하는 전원을 나타내고 있다.
또한 비어드레스 전압 Vss는 접지 또는 플로팅으로 절환할 때의 기준 전압이다. 스위치 SW55가 온 상태로 되면 Vss는 접지된다(Vss가 그라운드 레벨로 됨). 스위치 SW55가 오프 상태로 되면 비어드레스 전압 Vss는 플로팅 상태로 된다.
전원 전압 Vdd 및 어드레스 전압 Va와 Vss의 사이에 형성된 용량 C50, C51에 의해 어드레스 구동 회로가 플로팅으로 되는 기간 중에 각각의 전원 전압이 유지된다.
또한, 화상 처리 신호로부터의 데이터 입력 단자(81)는 통상 복수이지만, 본 도면에서는 대표적으로 1입력 단자 및 1출력 단자를 도시하였다.
계속해서, 각각의 스위치의 동작 타이밍에 대해 도 5를 이용하여 설명한다.
어드레스 기간에서는, 어드레스 구동 회로(50)가 화상 신호 처리 회로(80)로부터 화소 데이터를 수취하고 어드레스 전극(43)으로부터 화소 데이터를 출력하기 위해, 스위치 SW51, 스위치 SW53, SW54를 도통 상태로 한다.
이 후, 서스테인 기간에서는 스위치 SW51을 오프하고, 화상 신호 처리 회로(80)와의 접속을 차단한다. 또한 스위치 SW52를 도통 상태로 하고, 종래의 어드레스 구동 회로(51)의 그라운드 레벨에 접속한다. 이 때 어드레스 구동 회로의 전원 공급도 차단할 필요가 있기 때문에 스위치 SW53, SW54를 오프 상태로 한다. 이것은 서스테인 구동 전압이 어드레스 구동 전압을 상회하는 경우, 스위치 SW53, SW54가 도통하고 어드레스 전원이 공급되어 있는 상태에서는, 어드레스 전극(43)은 어드레스 구동 회로의 전원 전압의 범위에서만 플로팅 상태를 취할 수 있기 때문이다. 전원 전압 Vdd 및 어드레스 전압 Va의 투입ㆍ차단 시에서는 전원 전압 Vdd, 어드레스 전압 Va의 순으로 투입하고, 어드레스 전압 Va, 전원 전압 Vdd의 순으로 차단해야만 한다.
각각의 스위치의 제어예를 이하에 기재한다. 논리 입력 신호 스위치 SW51, SW52는 도 5의 (a), (b)에 도시한 바와 같이 전원 전압 Vdd, GND 레벨로 제어되어 내압으로서 Vs2-Vs1 이상을 필요로 한다. 또한 스위치 SW55(비어드레스 전압 Vss를 제어하기 위한 제어 스위치)도 마찬가지(도 5의 (e))이다.
어드레스 구동 회로 전원 제어 스위치 SW53, SW54는 마찬가지로 전원 전압 Vdd, GND 레벨로 제어되고, 내압은 각각의 전원 전압을 고려하여 Vs2-Vs1-Vdd 이상, Vs2-Vs1-Va 이상의 내압을 필요로 한다(도 5의 (c), (d)).
이와 같이, 스위치 SW51 내지 SW55를 제어함으로써, 서스테인 기간 중의 어드레스 구동 회로를 신호ㆍ전원을 포함하여 완전하게 하이 임피던스 상태로 하여, X 전극, Y 전극과의 용량 결합을 해소할 수 있다. 이 결과, 도 5의 서스테인 기간에 도시한 바와 같이, 저전압의 서스테인 전압 Vs1이 인가된 X 전극 또는 Y 전극이 고전압의 서스테인 전압 Vs2로 천이할 때에 발생한 전위 변화 Vs2-Vs1은 패널 용량을 통하여 Y 전극 또는 X 전극에 전파된다. 그 후, 도 3에 도시한 바와 같이 회수 코일 Ly 또는 회수 코일 Lx와 패널의 공진 동작에 의해 Y 전극 전위가 하강하고, 서스테인 전압 Vs1에 도달한 후 스위치 SW12y 또는 스위치 SW12x를 도통 상태로 하여 클램프한다. 계속해서 Y 전극의 상승에 의해 전위 변화 Vs2-Vs1이 X 전극 또는 Y 전극에 전파된다. 이후 이 반복에 의해 회수용의 스위치 SW3x, SW3y를 삭감한 후에 전력 회수 효율을 손상시키지 않고, 전력 회수를 실현하는 것이 가능하게 된다.
이상 설명한 바와 같이, 본 실시 형태에 따르면 어드레스 구동 회로의 하이 임피던스화를 신호ㆍ전원을 차단하기 위한 복수의 스위치라고 하는 간단한 회로 구성으로 실시하는 것이 가능하다. 이에 의해 종래, 회수 스위치를 삭감하였을 때의 과제로 되었던 전력 회수 효율의 저하를 억지할 수 있어, 회수 스위치 삭감에 의한 코스트 메리트를 인출하는 것이 가능하다.
또한 회수 스위치를 삭감한 결과로서, 전력 회수를 행하기 위한 공진 회로에서의 배선 길이도 단축시킬 수 있어, 배선 저항에 의한 전력손도 저감하는 것이 가능하게 된다.
<제2 실시 형태>
다음에 본 발명의 제2 실시 형태에 대해서 설명한다.
이 실시 형태에서는, 어드레스 구동 회로를 하이 임피던스화하기 위해 복수의 스위치를 설치하지만, 이 중 스위치 SW52는 하이 임피던스 기간 중의 어드레스 구동 회로 내의 논리 상태를 고정하는 것을 목적으로 하고 있다. 이 스위치 SW52의 제어예에 대해서 도 6을 이용하여 설명한다.
도 6은 본 발명의 제2 실시 형태에 따른 어드레스 구동 회로(50')를 도시하는 회로도이다.
제1 실시 형태와 비교하면, 이 제2 실시 형태에 따른 어드레스 구동 회로(50')에서는, 래치 회로(52) 및 래치 제어 회로(53)가 추가되어 있다. 이하에서는, 이 추가 개소의 동작을 중심으로 설명한다.
하이 임피던스 기간 중의 Vss는 플로팅이다. 따라서, 스위치 SW52의 도통을 계속할 목적으로 스위치 SW52의 게이트 단자를 플로팅의 Vss에 추종하여 제어하는 것이 필요하게 된다. 래치 회로(52)는, 이 목적을 위해 설치된 것이다. 또한 래치 제어 회로(53)는 래치 회로(52)를 제어하기 위해, 종래의 어드레스 구동 회로(51)의 외부에 설치되어 있다.
래치 회로(52)에는 RS 플립플롭을 적용한다. 이 RS 플립플롭은 외부로부터 제어하기 위한 입력 단자로서의 Set 단자와 Reset 단자를 구비한다. 각각의 단자에 의해, 래치 회로(52) 내에 High 레벨 상태(H 레벨) 혹은 Low 레벨 상태(L 레벨)를 기억시키는 것이 가능하다. 그리고 기억한 상태에 따라서, 출력 단자로부터, H 레벨 또는 L 레벨을 출력한다.
구체적으로는, Set 단자에 H 레벨이 입력되면, 래치 회로(52)는 H 레벨을 기억하고, 출력 단자로부터 H 레벨을 출력한다. 그 후 Set 단자의 입력이 L 레벨로 되어도, 래치 회로(52) 내에서 H 레벨이 유지되어 있기 때문에, 출력 단자는 계속해서 H 레벨을 출력할 수 있다. Reset 단자로부터 H 레벨이 입력되면, 래치 회로(52) 내의 유지 상태가 리셋되고, 출력은 L 레벨로 된다.
이 RS 플립플롭의 동작을 전제로 하여, 래치 회로(52)의 동작을 설명한다.
서스테인 기간에 종래의 어드레스 구동 회로(51)가 플로팅으로 되기 전에 화상 신호 처리 회로(80)의 전체 출력을 L 레벨로 하고, 래치 회로(52)에 Set 단자로부터 신호(H 레벨)가 인가되어 래치 상태로 되고 스위치 SW52를 온으로 한다. 래치 회로(52)가 래치 상태로 된 후, Set 단자는 L 레벨로 한다.
계속해서, 스위치 SW51을 오프로 하고, 화상 신호 처리 회로(80)로부터의 신호를 차단한다.
그 후 서스테인 동작이 개시된다. 서스테인 기간 중은 어드레스 구동 회로에는 Vs2-Vs1의 전압 변화가 생긴다. 래치 회로(52)의 외부 제어 회로는 SetㆍReset 단자와 다이오드를 통해서 접속되어 있기 때문에, 서스테인 기간 중에 역바이어스 전압이 인가되어도 차단 상태에 있어 보호된다. 또한, ResetㆍSet 단자는, 저항에 의해 Vss로 풀다운되기 때문에, L 레벨을 계속시킬 수 있다. 이에 의해 스위치 SW52의 도통을 유지하여, 어드레스 구동 회로의 오동작을 방지할 수 있다.
서스테인 기간 종료 후, Reset 신호를 인가함으로써, 래치 상태를 해제하여, 스위치 SW52를 오프시킨다. 게다가, 스위치 SW51을 도통시켜, 화상 신호 처리 회로(80)와 어드레스 구동 회로를 접속한다.
이와 같이, 래치 회로(52)를 설치함으로써, 하이 임피던스 기간 중은 래치 회로(52)가 스위치 SW52의 도통을 확보한다. 이 때문에, 플로팅의 Vss에 따른 제어는 불필요하게 되어, 스위치 SW52의 제어가 간결하게 된다.
이상의 설명에서는, 서스테인 기간 중의 입력 신호를 L 레벨로 고정하기 위해, 스위치 SW52를 데이터 입력 단자(81)와 Vss 사이에 설치하였다. 그러나, 이것을 전원 전압 Vdd와의 사이에 설치하여, H 레벨로 고정하여도 문제는 없다.
<제3 실시 형태>
다음에 본 발명의 제3 실시 형태에 대해서 설명한다.
도 7은 본 실시 형태의 어드레스 구동 회로(50'')를 도시하는 회로도이다.
제1 실시 형태에서는, 서스테인 구동 전압이 어드레스 구동 전압을 초과한 경우에 어드레스 전극(43)이 플로팅 상태이기 위해서는 어드레스 구동 회로의 전원 을 차단할 필요가 있었다. 이 목적 달성을 위해, 스위치 SW53, SW54를 설치하고 있었다.
제3 실시 형태에서도, 서스테인 구동 전압이 어드레스 구동 전압을 초과한 경우에 어드레스 전극(43)이 플로팅 상태이기 위해서는 어드레스 구동 회로의 전원을 차단할 필요가 있다. 제3 실시 형태에서는, 이 전원 제어 스위치 SW53, SW54 대신에, 다이오드 D50, D51을 이용하고 있다.
즉, 제1 실시 형태의 각 스위치는, 어드레스 구동 전압이 서스테인 구동 전압을 초과한 경우에만 전원을 차단하기만 하면 된다. 따라서, 본 실시 형태와 같이 MOS 트랜지스터 스위치를 다이오드로 대용하는 것이 가능하다.
또한, 이 방법을 제2 실시 형태와 조합하여 적용하여도 문제는 생기지 않는 것은 물론이다.
<제4 실시 형태>
다음에 본 발명의 제4 실시 형태에 대해서 설명한다.
도 8은 본 실시 형태의 어드레스 구동 회로(50''')를 도시하는 회로도이다.
제1 실시 형태에서 설명한 바와 같이, 어드레스 구동 회로(50)에 복수의 스위치를 설치함으로써, 서스테인 기간의 어드레스 구동 회로를 하이 임피던스화할 수 있다.
그러나, 통상적으로 서스테인 전압 Vs1 및 Vs2는 어드레스 전압 Va보다 높다. 이 때문에, 플로팅 상태로 한 어드레스 구동 회로(50) 내에, 과도적으로 정격인 어드레스 전압 Va 이상의 전위차가 생겨, 회로에 데미지를 줄 가능성이 있다.
본 발명의 제4 실시 형태에 따른 어드레스 구동 회로(50''')는, 이와 같은 가능성에 대해 대책을 강구한 것이다.
즉, 어드레스 구동 회로(50''') 내의 종래의 어드레스 구동 회로(51)에 대한 전원 전압 Vdd, 어드레스 전압 Va를 Vss로 단락 가능하게 하기 위한 스위치 SW56, SW57을 설치함으로써, 어드레스 구동 회로(50''') 내에 전위차가 생기는 것을 방지한다.
또한, 이 방법도 제2 실시 형태와 조합하여 적용하여도 문제는 생기지 않는 것은 물론이다.
이상, 본 발명자에 의해 이루어진 발명을 실시 형태에 기초하여 구체적으로 설명하였지만, 본 발명은 상기의 실시 형태에 한정되는 것이 아니며, 그 요지를 일탈하지 않는 범위에서 다양하게 변경이 가능한 것은 물론이다.
본 발명은 플라즈마 디스플레이 장치의 전력 회수 회로에의 이용을 생각할 수 있지만, 반드시 이것에 한정되지 않는다. 본 발명에 따른 전력 회수 회로는, 전력 회수의 필요성이 있는 고전압계의 장치이면 제어 타이밍 등의 수정에 의해 적용 가능하다.
도 1은 플라즈마 디스플레이 장치의 회로의 개략 전체 구성도.
도 2는 플라즈마 디스플레이 구동 회로의 종래의 구성을 도시하는 구성도.
도 3은 플라즈마 디스플레이 구동 회로의 종래의 구성을 도시하는 다른 구성도.
도 4는 제1 실시 형태의 어드레스 구동 회로를 도시하는 회로도.
도 5는 제1 실시 형태의 어드레스 구동 회로의 동작을 나타내는 타이밍차트.
도 6은 제2 실시 형태의 어드레스 구동 회로를 도시하는 회로도.
도 7은 제3 실시 형태의 어드레스 구동 회로를 도시하는 회로도.
도 8은 제4 실시 형태의 어드레스 구동 회로를 도시하는 회로도.
<도면의 주요 부분에 대한 부호의 설명>
10X : X 서스테인 구동 회로
10Y : Y 서스테인 구동 회로
20 : 스캔 드라이버
21 : 스위치
40 : 플라즈마 디스플레이 패널(PDP)
43 : 어드레스 전극
50, 51 : 어드레스 구동 회로
52 : 래치 회로
53 : 래치 제어 회로
70 : 구동 제어 회로
80 : 화상 신호 처리 회로

Claims (17)

  1. 플라즈마 디스플레이 패널의 주사 전극측과 유지 전극측에 전력 회수 회로를 포함하는 서스테인 구동 회로와, 어드레스 전극측에 어드레스 전압과 비어드레스 전압을 절환하여 출력 가능한 복수의 출력측 스위치 소자를 포함하는 어드레스 구동 회로로서,
    상기 복수의 출력측 스위치 소자의 전원측에 어드레스 전압 제어 스위치를 설치하는 것을 특징으로 하는 어드레스 구동 회로.
  2. 제1항에 있어서,
    상기 어드레스 구동 회로는 데이터 입력 단자를 갖고,
    상기 데이터 입력 단자의 전원측에 전원 전압 제어 스위치를 설치하는 것을 특징으로 하는 어드레스 구동 회로.
  3. 제2항에 있어서,
    화상 신호 처리 회로로부터의 신호가 상기 데이터 입력 단자에 입력되어 있고,
    상기 화상 신호 처리 회로와 어드레스 구동 회로의 사이에는 입력 신호의 차단을 행하는 입력 신호 스위치가 삽입되는 것을 특징으로 하는 어드레스 구동 회로.
  4. 제3항에 있어서,
    상기 비어드레스 전압을 접지할지의 여부를 절환하는 접지 제어 스위치를 더 포함하는 것을 특징으로 하는 어드레스 구동 회로.
  5. 제4항에 있어서,
    상기 비어드레스 전압과 상기 데이터 입력 단자를 접속하는 논리 입력 고정 스위치를 더 갖는 것을 특징으로 어드레스 구동 회로.
  6. 제3항에 있어서,
    상기 어드레스 구동 회로에의 입력을 고정하는 래치 회로를 더 포함하는 것을 특징으로 어드레스 구동 회로.
  7. 제6항에 있어서,
    상기 래치 회로는 RS 플립플롭으로 구성되어 있는 것을 특징으로 하는 어드레스 구동 회로.
  8. 제3항에 있어서,
    상기 비어드레스 전압을 접지할지의 여부를 절환하는 접지 제어 스위치를 더 포함하고,
    서스테인 기간 중에 상기 입력 신호 스위치, 상기 어드레스 전압 제어 스위치, 상기 전원 전압 제어 스위치 및 상기 접지 제어 스위치를 오프로 하고, 상기 어드레스 구동 회로를 플로팅 상태로 하는 것을 특징으로 하는 어드레스 구동 회로.
  9. 제3항에 있어서,
    상기 비어드레스 전압을 접지할지의 여부를 절환하는 접지 제어 스위치 및 상기 비어드레스 전압과 상기 데이터 입력 단자를 접속하는 논리 입력 고정 스위치를 더 포함하고,
    서스테인 기간 중에 상기 입력 신호 스위치, 상기 어드레스 전압 제어 스위치, 상기 전원 전압 제어 스위치 및 상기 접지 제어 스위치를 오프로 하고, 상기 어드레스 구동 회로를 플로팅 상태로 하고,
    상기 논리 입력 고정 스위치를 온으로 함으로써, 상기 어드레스 구동 회로의 상기 데이터 입력 단자를 고정하는 것을 특징으로 하는 어드레스 구동 회로.
  10. 제9항에 있어서,
    상기 어드레스 전압 제어 스위치에 MOS 트랜지스터 혹은 다이오드를 적용하는 것을 특징으로 하는 어드레스 구동 회로.
  11. 제10항에 있어서,
    상기 전원 전압 제어 스위치에 MOS 트랜지스터 혹은 다이오드를 적용하는 것을 특징으로 하는 어드레스 구동 회로.
  12. 플라즈마 디스플레이 장치로서,
    플라즈마 디스플레이 패널과,
    상기 플라즈마 디스플레이 패널의 주사 전극측과 유지 전극측에 배치된 전력 회수 회로를 포함하는 서스테인 구동 회로와,
    어드레스 전극측에 어드레스 전압과 비어드레스 전압을 절환하여 출력 가능한 복수의 출력측 스위치 소자를 포함하고, 상기 복수의 출력측 스위치 소자의 전원측에 어드레스 전압 제어 스위치를 설치한 어드레스 구동 회로를 갖는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  13. 제12항에 있어서,
    상기 어드레스 구동 회로는 데이터 입력 단자를 갖고,
    상기 데이터 입력 단자의 전원측에 전원 전압 제어 스위치를 설치하는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  14. 제13항에 있어서,
    화상 신호 처리 회로로부터의 신호가 상기 데이터 입력 단자에 입력되어 있고,
    상기 화상 신호 처리 회로와 어드레스 구동 회로 사이에는 입력 신호의 차단을 행하는 입력 신호 스위치가 삽입되는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  15. 제14항에 있어서,
    상기 비어드레스 전압을 접지할지의 여부를 절환하는 접지 제어 스위치를 더 포함하는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  16. 제15항에 있어서,
    상기 비어드레스 전압과 상기 데이터 입력 단자를 접속하는 논리 입력 고정 스위치를 더 갖는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  17. 제14항에 있어서,
    상기 비어드레스 전압을 접지할지의 여부를 절환하는 접지 제어 스위치 및 상기 비어드레스 전압과 상기 데이터 입력 단자를 접속하는 논리 입력 고정 스위치를 더 포함하고,
    서스테인 기간 중에 상기 입력 신호 스위치, 상기 어드레스 전압 제어 스위치, 상기 전원 전압 제어 스위치 및 상기 접지 제어 스위치를 오프로 하고, 상기 어드레스 구동 회로를 플로팅 상태로 하고,
    상기 논리 입력 고정 스위치를 온으로 함으로써, 상기 어드레스 구동 회로의 상기 데이터 입력 단자를 고정하는 것을 특징으로 하는 플라즈마 디스플레이 장치.
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