KR20080038543A - Method for driving discharge display panel wherein frequency of sustaining pulses varies - Google Patents
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Abstract
Description
도 1은 본 발명의 일 실시예에 의하여 구동되는 방전 디스플레이 패널로서 3-전극 면방전 방식의 플라즈마 디스플레이 패널의 구조를 보여주는 내부 사시도이다.1 is an internal perspective view showing a structure of a three-electrode surface discharge plasma display panel as a discharge display panel driven by an embodiment of the present invention.
도 2는 도 1의 플라즈마 디스플레이 패널의 한 디스플레이 셀의 예를 보여주는 단면도이다.FIG. 2 is a cross-sectional view illustrating an example of one display cell of the plasma display panel of FIG. 1.
도 3은 본 발명의 일 실시예를 수행하는 도 2의 플라즈마 디스플레이 패널의 구동 장치를 보여주는 블록도이다.3 is a block diagram illustrating an apparatus for driving the plasma display panel of FIG. 2 according to an exemplary embodiment of the present invention.
도 4는 도 3의 구동 장치에 의하여 도 1의 플라즈마 디스플레이 패널이 구동되는 방법을 보여주는 타이밍도이다.4 is a timing diagram illustrating a method of driving the plasma display panel of FIG. 1 by the driving apparatus of FIG. 3.
도 5는 도 4의 서브필드들 중에서 적어도 어느 하나의 서브필드(SFA)에서 도 1의 플라즈마 디스플레이 패널에 인가되는 구동 신호들을 보여주는 파형도이다. FIG. 5 is a waveform diagram illustrating driving signals applied to the plasma display panel of FIG. 1 in at least one subfield SF A among the subfields of FIG. 4.
도 6은 도 4의 서브필드들 중에서 적어도 어느 하나의 서브필드(SFB)에서 도 1의 플라즈마 디스플레이 패널에 인가되는 또다른 구동 신호들을 보여주는 파형도 이다. FIG. 6 is a waveform diagram illustrating another driving signals applied to the plasma display panel of FIG. 1 in at least one subfield SF B of the subfields of FIG. 4.
도 7은 도 5의 t5 시점에서의 어느 한 디스플레이 셀의 벽전하 분포를 보여주는 단면도이다.FIG. 7 is a cross-sectional view illustrating a wall charge distribution of one display cell at time t 5 of FIG. 5.
도 8은 도 5의 t8 시점에서의 어느 한 디스플레이 셀의 벽전하 분포를 보여주는 단면도이다.8 is a cross-sectional view showing the wall charge distribution of any of the display cells at the time point t 8 in FIG.
도 9는 도 6의 t4 시점에서의 어느 한 디스플레이 셀의 벽전하 분포를 보여주는 단면도이다.FIG. 9 is a cross-sectional view illustrating a wall charge distribution of one display cell at time t 4 of FIG. 6.
도 10은 도 6의 t7 시점에서의 어느 한 디스플레이 셀의 벽전하 분포를 보여주는 단면도이다.FIG. 10 is a cross-sectional view illustrating a wall charge distribution of one display cell at time t 7 of FIG. 6.
도 11은, 도 4의 단위 프레임의 각 서브필드에 도 5의 서브필드 유형(SFA) 또는 도 6의 서브필드 유형(SFB)이 적용되는 예를 보여주는 도면이다.FIG. 11 is a diagram illustrating an example in which the subfield type SF A of FIG. 5 or the subfield type SF B of FIG. 6 is applied to each subfield of the unit frame of FIG. 4.
<도면의 주요 부분에 대한 부호의 설명><Explanation of symbols for the main parts of the drawings>
1...방전 디스플레이 패널, 10...앞쪽 글라스 기판,1 ... discharge display panel, 10 ... front glass substrate,
11, 15...유전체층, 12...보호층,11, 15 dielectric layer, 12 protective layer,
13...뒤쪽 글라스 기판, 14...방전 공간,13 ... back glass substrate, 14 ... discharge space,
16...형광층, 17...격벽,16 fluorescent layers, 17 bulkheads,
X1, ..., Xn...X 전극-라인, Y1, ..., Yn...Y 전극-라인,X 1 , ..., Xn ... X electrode-line, Y 1 , ..., Yn ... Y electrode-line,
AR1, ..., ABm...어드레스 전극-라인, Xna, Yna...투명 전극-라인,A R1 , ..., A Bm ... address electrode-line, X na , Y na ... transparent electrode-line,
Xnb, Ynb...금속 전극-라인, SF1, ...SF8...서브필드,X nb , Y nb ... metal electrode-line, SF 1 , ... SF 8 ... subfield,
SY...Y 구동 제어 신호, VG...접지 전위,S Y ... Y drive control signal, V G ... ground potential,
SX...X 구동 제어 신호, SA...어드레스 구동 제어 신호, S X ... X drive control signal, S A ... address drive control signal,
62...제어부, 63...어드레스 구동부, 62 control unit, 63 address drive unit,
64...X 구동부, 65...Y 구동부, 64 ... X drive, 65 ... Y drive,
66...영상 처리부, R1, ..., R8...리셋 주기. 66 ... image processing unit, R 1 , ..., R 8 ... reset cycle.
본 발명은, 방전 디스플레이 패널의 구동 방법에 관한 것으로서, 보다 상세하게는, 단위 프레임이 복수의 서브필드들로 구분되고, 이 서브필드들 각각이 리셋 주기, 어드레싱 주기, 및 유지 주기로 구분되는 방전 디스플레이 패널의 구동 방법에 관한 것이다.The present invention relates to a method of driving a discharge display panel, and more particularly, to a discharge display in which a unit frame is divided into a plurality of subfields, each of which is divided into a reset period, an addressing period, and a sustain period. It relates to a driving method of the panel.
통상적인 방전 디스플레이 장치 예를 들어, 미국 특허 제5,541,618호의 플라즈마 디스플레이 장치에서는, 단위 프레임이 시분할 계조 디스플레이를 위한 복수의 서브필드들로 구분되고, 서브필드들 각각이 리셋 주기, 어드레싱 주기, 및 유지 주기를 포함한다. 서브필드들 각각은 고유한 계조 가중값을 가지며, 이 계조 가중값에 비례하여 유지 주기가 설정된다. In a typical discharge display device, for example, the plasma display device of US Pat. No. 5,541,618, a unit frame is divided into a plurality of subfields for time division gray scale display, and each of the subfields is a reset period, an addressing period, and a sustain period. It includes. Each of the subfields has a unique gray scale weight value, and a maintenance period is set in proportion to the gray scale weight value.
상기 리셋 주기에서는 모든 디스플레이 셀들의 전하 상태를 균일하게 하기 위하여 지속적이면서도 강한 방전이 사용된다. 따라서, 상기 리셋 주기는 방전 디스플레이 장치의 콘트라스트 성능을 떨어뜨리는 요인이라 할 수 있다.In the reset period, a continuous and strong discharge is used to make the charge state of all display cells uniform. Therefore, the reset period may be a factor that degrades the contrast performance of the discharge display apparatus.
이와 관련하여, 계조 가중값이 낮은 순서에 따라 단위 프레임이 제1 내지 제n 서브필드들로 구분되는 경우, 방전 디스플레이 장치의 콘트라스트 성능을 증진하기 위하여 단위 프레임의 제2 또는 제3 서브필드에만 강한 리셋 방전을 적용하는 방법이 있다.In this regard, when the unit frame is divided into first to nth subfields according to the order of low gray scale weight values, a strong reset is performed only on the second or third subfields of the unit frame in order to enhance contrast performance of the discharge display apparatus. There is a method of applying a discharge.
여기에서, 낮은 계조 가중값을 가진 제2 또는 제3 서브필드에만 강한 방전인 주 리셋 방전을 적용하는 이유는, 그 이전 서브필드인 제1 또는 제2 서브필드에서의 유지 펄스들의 개수가 적어서, 그 다음 서브필드인 제2 또는 제3 서브필드에서 공간 전하들이 부족하여 약한 어드레싱 방전이 일어날 수 있기 때문이다.Here, the reason for applying the main reset discharge which is the strong discharge only to the second or third subfield having the low gray scale weight value is that the number of sustain pulses in the first or second subfield that is the previous subfield is small, This is because a weak addressing discharge may occur due to a lack of space charges in the next or second subfield.
하지만, 나머지 다른 서브필드들 각각의 경우, 약한 리셋 방전이 적용됨에 따라, 선택된 디스플레이 셀들에서 불안정한 어드레스 방전이 일어날 수 있다. 이로 인하여 선택된 디스플레이 셀들에서 불안정한 유지 방전이 일어남에 따라, 디스플레이 영상의 재현성이 떨어질 수 있다. However, in each of the other subfields, as the weak reset discharge is applied, an unstable address discharge may occur in the selected display cells. As a result, unstable sustain discharge occurs in the selected display cells, thereby reducing the reproducibility of the display image.
본 발명의 목적은, 콘트라스트 성능을 향상시키는 한편, 디스플레이 영상의 재현성도 높일 수 있는 방전 디스플레이 패널의 구동 방법을 제공하는 것이다.An object of the present invention is to provide a method of driving a discharge display panel which can improve contrast performance and also improve reproducibility of display images.
상기 목적을 이루기 위한 본 발명은, 단위 프레임이 복수의 서브필드들로 구분되고, 상기 서브필드들 각각이 리셋 주기, 어드레싱 주기, 및 유지 주기로 구분 되는 방전 디스플레이 패널의 구동 방법으로서, 단계들 (a) 내지 (d)를 포함한다.According to an aspect of the present invention, there is provided a method of driving a discharge display panel in which a unit frame is divided into a plurality of subfields, and each of the subfields is divided into a reset period, an addressing period, and a sustain period. ) To (d).
상기 단계 (a)에서는, 상기 복수의 서브필드들 중에서 적어도 어느 하나의 서브필드의 리셋 주기에서 주 리셋 방전이 일어난다. 상기 단계 (b)에서는, 상기 주 리셋 방전이 일어나는 서브필드가 아닌 서브필드들의 리셋 주기들 각각에서 상기 주 리셋 방전보다 약한 보조 리셋 방전이 일어난다. 상기 단계 (c)에서는, 상기 주 리셋 방전을 일으키는 서브필드의 유지 주기에서 제1 주파수의 유지 펄스들이 디스플레이 셀들에 인가된다. 상기 단계 (d)에서는, 상기 보조 리셋 방전을 일으키는 서브필드의 유지 주기에서 상기 제1 주파수보다 낮은 제2 주파수의 유지 펄스들이 상기 디스플레이 셀들에 인가된다.In the step (a), a main reset discharge occurs in a reset period of at least one subfield among the plurality of subfields. In the step (b), the auxiliary reset discharge which is weaker than the main reset discharge occurs in each of the reset periods of the subfields other than the subfield in which the main reset discharge occurs. In the step (c), sustain pulses of the first frequency are applied to the display cells in the sustain period of the subfield causing the main reset discharge. In the step (d), sustain pulses of a second frequency lower than the first frequency are applied to the display cells in the sustain period of the subfield causing the auxiliary reset discharge.
본 발명의 상기 방전 디스플레이 패널의 구동 방법에 의하면, 상기 주 리셋 방전과 함께 상기 보조 리셋 방전이 채용됨에 따라 방전 디스플레이 장치의 콘트라스트 성능이 높아질 수 있다. 또한, 상기 보조 리셋 방전을 일으키는 서브필드의 유지 주기에서 유지 펄스들의 주파수가 낮아지므로, 약한 리셋 방전임에도 불구하고 보다 안정된 유지 방전이 일어날 수 있다. 즉, 디스플레이 영상의 재현성이 높아질 수 있다. According to the driving method of the discharge display panel of the present invention, as the auxiliary reset discharge is employed together with the main reset discharge, the contrast performance of the discharge display apparatus can be increased. In addition, since the frequency of the sustain pulses is lowered in the sustain period of the subfield causing the auxiliary reset discharge, more stable sustain discharge may occur despite the weak reset discharge. That is, the reproducibility of the display image may be increased.
이하, 본 발명에 따른 바람직한 실시예가 상세히 설명된다. Hereinafter, preferred embodiments according to the present invention will be described in detail.
도 1은 본 발명의 일 실시예에 의하여 구동되는 방전 디스플레이 패널로서 3-전극 면방전 방식의 플라즈마 디스플레이 패널(1)의 구조를 보여준다. 도 2는 도 1의 플라즈마 디스플레이 패널(1)의 한 디스플레이 셀의 예를 보여준다.1 shows a structure of a three-electrode surface discharge plasma display panel 1 as a discharge display panel driven by one embodiment of the present invention. FIG. 2 shows an example of one display cell of the plasma display panel 1 of FIG. 1.
도 1 및 2를 참조하면, 본 발명의 일 실시예에 의한 3-전극 면방전 플라즈마 디스플레이 패널(1)의 앞쪽 및 뒤쪽 글라스 기판들(10, 13) 사이에는, 어드레스 전극-라인들(AR1 내지 ABm), 유전체층(11, 15), 유지 전극-라인들로서의 X 전극-라인들(X1 내지 Xn), 주사 전극-라인들로서의 Y 전극-라인들(Y1 내지 Yn), 형광체(16), 격벽(17) 및 보호층으로서의 일산화마그네슘(MgO)층(12)이 마련되어 있다. 1 and 2, between the front and
어드레스 전극-라인들(AR1 내지 ABm)은 뒤쪽 글라스 기판(13)의 앞쪽에 일정한 패턴으로 형성된다. 하부 유전체층(15)은 어드레스 전극-라인들(AR1 내지 ABm)의 앞쪽에서 전면(全面) 도포된다. 하부 유전체층(15)의 앞쪽에는 격벽(17)들이 어드레스 전극-라인들(AR1 내지 ABm)과 평행한 방향으로 형성된다. 이 격벽(17)들은 각 디스플레이 셀의 방전 영역을 구획하고 각 디스플레이 셀 사이의 광학적 간섭(cross talk)을 방지하는 기능을 한다. 형광층(16)은 격벽(17)들 사이에 도포된다. Address electrode-lines A R1 To A Bm ) are formed in a predetermined pattern on the front side of the
유지 전극-라인들로서의 X 전극-라인들(X1 내지 Xn)과 주사 전극-라인들로서의 Y 전극-라인들(Y1 내지 Yn)은 어드레스 전극-라인들(AR1 내지 ABm)과 교차되는 방향으로 앞쪽 글라스 기판(10)의 뒤쪽에서 교호하고 나란하게 형성된다. 각 교차점은 상응하는 디스플레이 셀을 설정한다. 각 X 전극-라인(X1 내지 Xn)과 각 Y 전극-라인(Y1 내지 Yn)은 ITO(Indium Tin Oxide) 등과 같은 투명한 도전성 재질의 투명 전극-라인(도 3의 Xna, Yna)과 전도도를 높이기 위한 금속 전극-라인(도 3의 Xnb, Ynb)이 결합되어 형성된다. 앞쪽 유전체층(11)은 X 전극-라인들(X1 내지 Xn)과 Y 전 극-라인들(Y1 내지 Yn)의 뒤쪽에 전면(全面) 도포되어 형성된다. 강한 전계로부터 패널(1)을 보호하기 위한 보호층(12) 예를 들어, 일산화마그네슘(MgO)층은 앞쪽 유전체층(11)의 뒤쪽에 전면 도포되어 형성된다. 방전 공간(14)에는 플라즈마 형성용 가스가 밀봉된다.X electrode-lines (X 1) as sustain electrode-lines To X n ) and Y electrode-lines Y 1 as scan electrode-lines To Y n are the address electrode-lines A R1 To A Bm ) are formed alternately and side by side at the rear of the
이와 같은 방전 디스플레이 패널에 적용되는 구동 방법에서는, 리셋(reset), 어드레싱(addressing), 및 유지(discharge-sustaining) 주기들이 단위 서브필드에서 순차적으로 수행된다. 리셋 주기에서는 모든 디스플레이 셀들의 전하 상태들이 균일해진다. 어드레싱 주기에서는, 선택된 디스플레이 셀들에 소정의 벽전위가 생성된다. 유지 주기에서는, 모든 XY 전극-라인쌍들에 소정의 교류 전압이 인가됨으로써 어드레싱 주기에서 상기 벽전위가 형성된 디스플레이 셀들이 유지 방전을 일으킨다. 이 유지 주기에 있어서, 유지 방전을 일으키는 선택된 디스플레이 셀들의 방전 공간(14) 즉, 가스층에서 플라즈마가 형성되고, 그 자외선 방사에 의하여 형광층(16)이 여기되어 빛이 발생된다. In the driving method applied to such a discharge display panel, reset, addressing, and discharge-sustaining cycles are sequentially performed in the unit subfield. In the reset period, the charge states of all display cells are uniform. In the addressing period, a predetermined wall potential is generated in the selected display cells. In the sustain period, a predetermined alternating voltage is applied to all the XY electrode-line pairs so that the display cells in which the wall potential is formed in the addressing period cause sustain discharge. In this sustain period, plasma is formed in the
도 3을 참조하면, 본 발명의 일 실시예를 수행하는 도 1의 플라즈마 디스플레이 패널(1)의 구동 장치는 영상 처리부(66), 제어부(62), 어드레스 구동부(63), X 구동부(64), 및 Y 구동부(65)를 포함한다. Referring to FIG. 3, an apparatus for driving the plasma display panel 1 of FIG. 1 according to an exemplary embodiment of the present invention may include an
영상 처리부(66)는 외부 아날로그 영상 신호를 디지털 신호로 변환하여 내부 영상 신호 예를 들어, 각각 8 비트의 적색(R), 녹색(G) 및 청색(B) 영상 데이터, 클럭 신호, 수직 및 수평 동기 신호들을 발생시킨다. The
제어부(62)는 영상 처리부(66)로부터의 내부 영상 신호에 따라 구동 제어 신호들(SA, SY, SX)을 발생시킨다. The
어드레스 구동부(63)는, 제어부(62)로부터의 구동 제어 신호들(SA, SY, SX)중에서 어드레스 신호들(SA)을 처리하여 표시 데이터 신호들을 발생시키고, 발생된 표시 데이터 신호들을 어드레스 전극-라인들(도 2의 AR1 내지 ABm)에 인가한다. X 구동부(64)는 제어부(62)로부터의 구동 제어 신호들(SA, SY, SX)중에서 X 구동 제어 신호들(SX)에 따라 유지 전극-라인들로서의 X 전극-라인들(도 2의 X1 내지 Xn)을 구동한다. Y 구동부(65)는 제어부(62)로부터의 구동 제어 신호들(SA, SY, SX)중에서 Y 구동 제어 신호(SY)에 따라 주사 전극-라인들로서의 Y 전극-라인들(도 2의 Y1 내지 Yn)을 구동한다.The
도 4는 도 3의 구동 장치에 의하여 도 1의 플라즈마 디스플레이 패널(1)이 구동되는 방법을 보여준다. 4 illustrates a method in which the plasma display panel 1 of FIG. 1 is driven by the driving apparatus of FIG. 3.
도 4를 참조하면, 모든 단위 프레임들 각각은 시분할 계조 표시를 실현하기 위하여 계조 가중값이 낮은 순서에 따라 8 개의 서브필드들(SF1 내지 SF8)로 구분된다. 또한, 각 서브필드(SF1 내지 SF8)는 리셋 주기(R1 내지 R8), 어드레싱 주기(A1 내지 A8), 및 유지 주기(S1 내지 S8)로 구분된다. Referring to FIG. 4, each of the unit frames has eight subfields SF 1 according to the order in which the gray scale weights are low in order to realize time division gray scale display. To SF 8 ). In addition, each subfield SF 1 To SF 8 ) is a reset period R 1. To R 8 ), the addressing period A 1 to A 8 , and the sustaining period S 1 To S 8 ).
모든 디스플레이 셀들의 방전 조건들은 각 리셋 주기(R1 내지 R8)에서 균일해지면서 동시에 다음 주기에서 수행될 어드레싱에 적합해지도록 된다. The discharge conditions of all display cells are each reset period R 1. To R 8 ) to be uniform and at the same time suitable for addressing to be performed in the next cycle.
각 어드레싱 주기(A1 내지 A8)에서는, 어드레스 전극-라인들(도 1의 AR1 내지 ABm)에 표시 데이터 신호가 인가됨과 동시에 각 Y 전극-라인(Y1 내지 Yn)에 상응하는 주사 펄스가 순차적으로 인가된다. 이에 따라 주사 펄스가 인가되는 동안에 높은 레벨의 표시 데이터 신호가 인가되면 상응하는 방전셀에서 어드레싱 방전에 의하여 벽전하들이 형성되며, 그렇지 않은 방전셀에서는 벽전하들이 형성되지 않는다. In each addressing period A 1 to A 8 , the address electrode-lines (A R1 in FIG. 1) To A Bm ) and a display data signal is applied to each Y electrode line Y 1. To Y n ) are sequentially applied. Accordingly, when a high level display data signal is applied while the scan pulse is applied, wall charges are formed by addressing discharge in the corresponding discharge cell, and wall charges are not formed in the discharge cell that is not.
각 유지 주기(S1 내지 S8)에서는, 모든 Y 전극-라인들(Y1 내지 Yn)과 모든 X 전극-라인들(X1 내지 Xn)에 유지 펄스가 교호하게 인가되어, 상응하는 어드레싱 주기(A1 내지 A8)에서 벽전하들이 형성되었던 방전셀들에서 유지 방전을 일으킨다. 따라서 어느 한 디스플레이 셀의 출력 휘도는 단위 프레임에서 차지하는 유지 주기(S1 내지 S8)의 길이에 비례한다. 본 실시예의 경우, 단위 프레임에서 차지하는 유지 주기(S1 내지 S8)의 길이는 255T(T는 단위 주기)이다. 따라서 단위 프레임에서 한 번도 표시되지 않은 경우를 포함하여 256 계조로써 표시할 수 있다.Each maintenance cycle (S 1 To S 8 , all Y electrode-lines Y 1 To Y n ) and all X electrode-lines (X 1) To X n ), a sustain pulse is alternately applied, causing sustain discharge in the discharge cells in which wall charges were formed in the corresponding addressing periods A 1 to A 8 . Therefore, the sustain period (S 1) of the output luminance of one display cell occupies a unit frame. To S 8 ). In the present embodiment, the maintenance period occupies in the unit frame (S 1 To S 8 ) has a length of 255T (T is a unit period). Therefore, it can be displayed in 256 gray scales, even if it is not displayed once in a unit frame.
여기에서, 제1 서브필드(SF1)의 유지 주기(S1)에는 20에 상응하는 주기(1T)이, 제2 서브필드(SF2)의 유지 주기(S2)에는 21에 상응하는 주기(2T)이, 제3 서브필 드(SF3)의 유지 주기(S3)에는 22에 상응하는 주기(4T)이, 제4 서브필드(SF4)의 유지 주기(S4)에는 23에 상응하는 주기(8T)이, 제5 서브필드(SF5)의 유지 주기(S5)에는 24에 상응하는 주기(16T)이, 제6 서브필드(SF6)의 유지 주기(S6)에는 25에 상응하는 주기(32T)이, 제7 서브필드(SF7)의 유지 주기(S7)에는 26에 상응하는 주기(64T)이, 그리고 제8 서브필드(SF8)의 유지 주기(S8)에는 27에 상응하는 주기(128T)이 각각 설정된다.Here, the first sustain period of a subfield (SF 1) (S 1) is equivalent to include two first sustain period (S 2) of a period (1T) which corresponds to 20, the second sub-field (SF 2) period (2T) is the third sub-field sustain period (S 3), the period (4T) corresponding to 22, a fourth sustain period of a subfield (SF 4) of (SF 3) to (S 4) In the
이에 따라, 8 개의 서브필드들(SF1 내지 SF8) 중에서 표시될 서브필드를 적절히 선택하면, 어느 서브필드에서도 표시되지 않는 0(영) 계조를 포함하여 모두 256 계조의 디스플레이가 수행될 수 있다. Accordingly, eight subfields SF 1 From SF 8 ), if a subfield to be displayed is appropriately selected, display of 256 gray levels may be performed including all zero (zero) gray levels that are not displayed in any subfields.
한편, 적어도 어느 하나의 서브필드의 리셋 주기에서 주 리셋 방전이 일어난다(도 5 참조). 또한, 주 리셋 방전이 일어나지 않는 서브필드들의 리셋 주기들 각각에서 주 리셋 방전보다 약한 보조 리셋 방전이 일어난다(도 6 참조). 그리고, 이 보조 리셋 방전을 일으키는 서브필드의 유지 주기에서 유지 펄스들의 주파수가 낮아진다(도 5 및 6 참조).On the other hand, the main reset discharge occurs in the reset period of at least one subfield (see Fig. 5). Further, in each of the reset periods of the subfields in which the main reset discharge does not occur, the auxiliary reset discharge weaker than the main reset discharge occurs (see FIG. 6). Then, in the sustain period of the subfield causing this auxiliary reset discharge, the frequency of the sustain pulses is lowered (see FIGS. 5 and 6).
따라서, 주 리셋 방전과 함께 상기 보조 리셋 방전이 채용되므로, 플라즈마 디스플레이 장치의 콘트라스트 성능이 높아질 수 있다. 또한, 보조 리셋 방전을 일으키는 서브필드의 유지 주기에서 유지 펄스들의 주파수가 낮아지므로, 약한 리셋 방전임에도 불구하고 보다 안정된 유지 방전이 일어날 수 있다. 즉, 디스플레이 영상의 재현성이 높아질 수 있다. 이와 관련된 내용이 아래에 상세히 설명된다.Therefore, since the auxiliary reset discharge is employed together with the main reset discharge, the contrast performance of the plasma display device can be increased. In addition, since the frequency of the sustain pulses is lowered in the sustain period of the subfield causing the auxiliary reset discharge, more stable sustain discharge may occur despite the weak reset discharge. That is, the reproducibility of the display image may be increased. This is described in detail below.
도 5는 도 4의 서브필드들(SF1 내지 SF8) 중에서 적어도 어느 하나의 서브필드(SFA)에서 사용되는 구동 신호들을 보여준다. 도 5에서 참조부호 SAR1 .. ABm은 각 어드레스 전극-라인(도 1의 AR1 내지 ABm)에 인가되는 구동 신호를 가리킨다. SX1 .. Xn은 X 전극-라인들(도 1의 X1 내지 Xn)에 인가되는 구동 신호를 가리킨다. SY1 내지 SYn은 각 Y 전극-라인(도 1의 Y1 내지 Yn)에 인가되는 구동 신호를 가리킨다. 도 7은 도 5의 t5 시점에서의 어느 한 디스플레이 셀의 벽전하 분포를 보여준다. 도 8은 도 5의 t8 시점에서의 어느 한 디스플레이 셀의 벽전하 분포를 보여준다. 도 7 및 8에서 도 2와 동일한 참조 부호는 동일한 기능의 대상을 가리킨다. FIG. 5 shows the subfields SF 1 of FIG. To SF 8 ) show driving signals used in at least one subfield SF A. In FIG. 5, reference numeral S AR1 .. ABm denotes each address electrode-line (A R1 of FIG. 1). To A Bm ). S X1 .. Xn is X electrode-lines (X 1 of FIG. 1) To X n ). S Y1 To S Yn is each Y electrode-line (Y 1 of FIG. 1). To Y n ). FIG. 7 illustrates a wall charge distribution of one display cell at time t 5 of FIG. 5. Figure 8 shows the wall charge distribution of any of the display cells at the time point t 8 in FIG. 7 and 8, the same reference numerals as used in FIG. 2 indicate the objects of the same function.
도 5를 참조하면, 도 4의 서브필드들(SF1 내지 SF8) 중에서 적어도 어느 하나의 서브필드(SFA)의 리셋 주기(RA)에 있어서, 벽전하 축적 주기(t1 ~ t5)에서는, Y 전극-라인들(Y1 내지 Yn)에 인가되는 전위가 접지 전위(VG)로부터 제3 전위(|VSCL - VSCH|)보다 제6 전위(VSET)만큼 더 높은 최고 전위로서의 정극성의 제1 전위(VSET +| VSCL - VSCH|) 예를 들어, 355 볼트(V)까지 상승된다. 정극성의 제3 전위(|VSCL - VSCH|)는 부극성의 제2 전위(VSCL)와 부극성의 제4 전위(VSCH)의 차이에 의하여 발생된다. Referring to FIG. 5, the subfields SF 1 of FIG. 4. To SF 8) in at least one of sub-fields (in the reset period (R A) of the SF A), the wall charge accumulating period (t1 ~ t5) among, Y electrode lines (Y 1 To Y n ), the potential applied from the ground potential V G to the third potential | V SCL The first positive potential V SET as the highest potential higher by the sixth potential V SET than V SCH | + | V SCL -V SCH |) For example, it is raised to 355 volts (V). Positive third potential (| V SCL V SCH | is generated by the difference between the negative second potential V SCL and the negative fourth potential V SCH .
X 전극-라인들(X1 내지 Xn)과 어드레스 전극-라인들(AR1 내지 ABm)에는 접지 전위(VG)가 인가된다. X electrode-lines (X 1 To X n ) and address electrode-lines A R1 To A Bm ), the ground potential V G is applied.
이에 따라, Y 전극-라인들(Y1 내지 Yn)과 X 전극-라인들(X1 내지 Xn) 사이에 방전이 일어나는 한편, Y 전극-라인들(Y1 내지 Yn)과 어드레스 전극-라인들(AR1 내지 ABm) 사이에 방전이 일어난다. 이에 따라, 모든 Y 전극-라인들(Y1 내지 Yn) 주위에는 부극성 벽전하들이 형성되고, 모든 X 전극-라인들(X1 내지 Xn) 주위에는 정극성의 벽전하들이 형성되며, 모든 어드레스 전극-라인들(AR1 내지 ABm) 주위에는 정극성의 벽전하들이 형성된다(도 7 참조). Accordingly, Y electrode-lines Y 1 To Y n ) and the X electrode-lines (X 1) To X n ), while discharge occurs between Y electrode-lines Y 1. To Y n ) and address electrode-lines A R1 To A Bm ). Accordingly, all Y electrode-lines Y 1 To Y n ), negative wall charges are formed and all X electrode-lines (X 1 ) are formed. To X n ), positive wall charges are formed, and all address electrode-lines A R1. To A Bm ), positive wall charges are formed (see FIG. 7).
다음에, 도 4의 서브필드들(SF1 내지 SF8) 중에서 적어도 어느 하나의 서브필드(SFA)의 리셋 주기(RA)에 있어서, 벽전하 배분 주기(t5 ~ t8)에서는, X 전극-라인들(X1 내지 Xn)에 인가되는 전위가 제5 전위(VE1)로 유지된 상태에서, Y 전극-라인들(Y1 내지 Yn)에 인가되는 전위가 제1 전위(VSET +|VSCL - VSCH|)로부터 부극성의 제2 전위(VSCL)까지 하강된다. 여기에서, 어드레스 전극-라인들(AR1 내지 ABm)에는 접지 전위(VG)가 인가된다. 이에 따라, X 전극-라인들(X1 내지 Xn)과 Y 전극-라인들(Y1 내지 Yn) 사이의 방전으로 인하여, Y 전극-라인들(Y1 내지 Yn) 주위의 부극성의 벽전하들의 일부가 X 전극-라인들(X1 내지 Xn) 주위로 적절히 이동한다(도 8 참조). 또한, 어드레스 전극-라인들(AR1 내지 ABm)에는 접지 전위(VG)가 인가되므로, 어드레스 전극-라인들(AR1 내지 ABm) 주위의 정극성의 벽전하들이 적절히 감소한다(도 8 참조). Next, the subfields SF 1 of FIG. X SF electrode-lines X 1 in the wall charge distribution period t5 to t8 in the reset period R A of at least one subfield SF A from SF 8 ). To Y n , the Y electrode-lines Y 1 in the state where the potential applied to the fifth potential V E1 is maintained at the fifth potential V E1 . To potential applied to Y n is the first potential V SET. + | V SCL From V SCH | to the second negative potential V SCL . Here, address electrode-lines A R1 To A Bm ), the ground potential V G is applied. Accordingly, X electrode-lines X 1 To X n ) and the Y electrode-lines Y 1 To due to the discharge between the Y n), Y electrode lines (Y 1 To Y n , some of the negative wall charges around the X electrode-lines (X 1). To X n ), as appropriate (see FIG. 8). In addition, address electrode-lines A R1 To A Bm , the ground potential V G is applied, and therefore, the address electrode lines A R1 To A Bm ), the positive wall charges around them are appropriately reduced (see FIG. 8).
이에 따라, 이어지는 어드레싱 주기(A)에서, 어드레스 전극-라인들(AR1 내지 ABm)에 표시 데이터 신호가 인가되고, 상기 부극성의 제4 전위(VSCH)로 바이어싱된 Y 전극-라인들(Y1 내지 Yn)에 상기 부극성의 제2 전위(VSCL)의 주사 펄스가 순차적으로 인가됨에 따라, 원활한 어드레싱이 수행될 수 있다. 각 어드레스 전극-라인(AR1 내지 ABm)에 인가되는 표시 데이터 신호는 디스플레이 셀을 선택할 경우에 정극성 어드레스 전위(VA)가, 그렇지 않을 경우에 접지 전위(VG)가 인가된다. 이에 따라 상기 부극성의 제2 전위(VSCL)의 주사 펄스가 인가되는 동안에 정극성 어드레스 전위(VA)의 표시 데이터 신호가 인가되면 상응하는 디스플레이 셀에서 어드레스 방전에 의하여 벽전하들이 형성되며, 그렇지 않은 디스플레이 셀에서는 벽전하들이 형성되지 않는다. 여기에서, 보다 정확하고 효율적인 어드레스 방전을 위하여, X 전 극-라인들(X1 내지 Xn)에 상기 정극성의 제5 전위(VE1)가 인가된다.Thus, in the following addressing period A, the address electrode-lines A R1 To A Bm ), the display data signal is applied to the Y electrode-lines Y 1 biased to the negative fourth potential V SCH . To Y n ), as the scan pulses of the negative second potential V SCL are sequentially applied, smooth addressing may be performed. In the display data signal applied to each of the address electrode lines A R1 to A Bm , the positive address potential V A is applied when the display cell is selected, and the ground potential V G is applied when the display cell is not selected. Accordingly, when the display data signal of the positive address potential V A is applied while the scan pulse of the second negative potential V SCL is applied, wall charges are formed by the address discharge in the corresponding display cell. In other display cells, wall charges are not formed. Here, X electrode-lines (X 1) for more accurate and efficient address discharge. To X n ), the positive fifth potential V E1 is applied.
유지 주기(SA)에서는, 모든 Y 전극-라인들(Y1 내지 Yn)과 X 전극-라인들(X1 내지 Xn)에 정극성의 제7 전위(VS)의 유지 펄스들이 교호하게 인가되어, 상응하는 어드레스 주기(A)에서 벽전하들이 형성된 디스플레이 셀들에서 유지를 위한 방전을 일으킨다. 주 리셋 방전이 일어나는 서브필드(SFA)의 유지 주기(SA)에 있어서, 유지 펄스들은 제1 주파수를 가짐에 따라 제1 폭(TA)을 가진다.In the sustain period S A , all Y electrode-lines Y 1 To Y n ) and the X electrode-lines (X 1) To X n ), sustain pulses of the seventh potential V S of the positive polarity are alternately applied, causing discharge for sustaining in the display cells in which wall charges are formed in the corresponding address period A. FIG. In the sustain period S A of the subfield SF A in which the main reset discharge occurs, the sustain pulses have a first width T A as having a first frequency.
도 6은 도 4의 서브필드들 중에서 도 5의 서브필드(SFA)가 아닌 다른 서브필드(SFB) 즉, 보조 리셋 주기(RB)를 적용한 서브필드(SFB)에서 사용되는 구동 신호들을 보여준다. 도 6에서 도 5와 동일한 참조 부호는 동일한 기능의 대상을 가리킨다. 도 9는 도 6의 t4 시점에서의 어느 한 디스플레이 셀의 벽전하 분포를 보여준다. 도 10은 도 6의 t7 시점에서의 어느 한 디스플레이 셀의 벽전하 분포를 보여준다. 도 9 및 10에서 도 2와 동일한 참조 부호는 동일한 기능의 대상을 가리킨다. 6 is a view of the figures, the four sub-fields 5 sub-fields different sub-field other than the (SF A) (SF B) That is, the drive signal used in the sub-reset period (R B) sub-field (SF B) applying the Show them. In FIG. 6, the same reference numerals as used in FIG. 5 indicate objects of the same function. 9 illustrates a wall charge distribution of one display cell at time t 4 of FIG. 6. FIG. 10 illustrates a wall charge distribution of one display cell at time t 7 of FIG. 6. 9 and 10, the same reference numerals as used in FIG. 2 indicate objects of the same function.
도 6을 참조하면, 도 5의 서브필드(SFA)가 아닌 다른 서브필드(SFB)의 보조 리셋 주기(RB)에 있어서, 벽전하 축적 주기(t1 ~ t4)에서는, Y 전극-라인들(Y1 내지 Yn)에 인가되는 전위가 접지 전위(VG)로부터 정극성의 제7 전위(VS)까지 상승된다. 또한, X 전극-라인들(X1 내지 Xn)과 어드레스 전극-라인들(AR1 내지 ABm)에는 접지 전 위(VG)가 인가된다. Referring to FIG. 6, the subfield SF of FIG. 5ASubfields other thanBAuxiliary reset cycle (R)BIn the wall charge accumulation period t1 to t4, the Y electrode-lines YOne To YnIs applied to ground potential (V)GFrom the positive seventh potential (V)STo rise). Also, X electrode-lines (XOne To Xn) And address electrode-lines AR1 To ABm) Has a ground potential (V)G) Is applied.
이에 따라, 이전 서브필드에서 선택되어 유지 방전을 수행했던 디스플레이 셀들에 있어서, Y 전극들과 X 전극들 사이에 방전이 일어나는 한편, Y 전극들과 어드레스 전극들 사이에 방전이 일어난다. 이에 따라, Y 전극들 주위에는 부극성 벽전하들이 형성되고, X 전극들 주위에는 정극성의 벽전하들이 형성되며, 어드레스 전극들 주위에는 정극성의 벽전하들이 형성된다(도 9 참조). Accordingly, in the display cells selected in the previous subfield to perform sustain discharge, a discharge occurs between the Y electrodes and the X electrodes, while a discharge occurs between the Y electrodes and the address electrodes. Accordingly, negative wall charges are formed around the Y electrodes, positive wall charges are formed around the X electrodes, and positive wall charges are formed around the address electrodes (see FIG. 9).
다음에, 도 5의 서브필드(SFA)가 아닌 다른 서브필드(SFB)의 보조 리셋 주기(RB)에 있어서, 벽전하 배분 주기(t4 ~ t7)에서는, X 전극-라인들(X1 내지 Xn)에 정극성의 제5 전위(VE)가 인가되고, 어드레스 전극-라인들(AR1 내지 ABm)에 접지 전위(VG)가 인가된 상태에서, Y 전극-라인들(Y1 내지 Yn)에 인가되는 전위가 제7 전위(VS)로부터 부극성의 제2 전위(VSCL)까지 하강된다. Next, in the auxiliary reset period R B of the subfield SF B other than the subfield SF A of FIG. 5, in the wall charge distribution period t4 to t7, the X electrode-lines X One To X n ), the positive fifth potential V E is applied, and the address electrode lines A R1. To from a ground potential (V G) applied to the state A Bm), Y electrode lines (Y 1 To Y n ) is lowered from the seventh potential V S to the second negative potential V SCL of the negative polarity.
이에 따라, 이전 서브필드에서 선택되어 유지 방전을 수행했던 디스플레이 셀들에 있어서, X 전극들과 Y 전극들 사이의 방전으로 인하여, Y 전극-라인들(Y1 내지 Yn) 주위의 부극성의 벽전하들의 일부가 X 전극-라인들(X1 내지 Xn) 주위로 적절히 이동한다(도 11 참조). 또한, 어드레스 전극-라인들(AR1 내지 ABm)에는 접지 전위(VG)가 인가되므로, 어드레스 전극-라인들(AR1 내지 ABm) 주위의 정극성의 벽전하들이 적절히 감소한다(도 10 참조).Accordingly, in the display cells selected in the previous subfield to perform sustain discharge, the Y electrode-lines Y 1 due to the discharge between the X electrodes and the Y electrodes. To Y n ) some of the negative wall charges around move properly around the X electrode-lines X 1 to X n (see FIG. 11). In addition, address electrode-lines A R1 To A Bm , the ground potential V G is applied, and therefore, the address electrode lines A R1 To A Bm ), the positive wall charges around them are appropriately reduced (see FIG. 10).
이어지는 어드레싱 주기(A)는 도 5를 참조하여 설명된 바와 같다.The following addressing period A is as described with reference to FIG. 5.
유지 주기(SB)에서는, 모든 Y 전극-라인들(Y1 내지 Yn)과 X 전극-라인들(X1 내지 Xn)에 정극성의 제7 전위(VS)의 유지 펄스들이 교호하게 인가되어, 상응하는 어드레스 주기(A)에서 벽전하들이 형성된 디스플레이 셀들에서 유지를 위한 방전을 일으킨다. In the sustain period S B , all Y electrode-lines Y 1 To Y n ) and the X electrode-lines (X 1) To X n ), sustain pulses of the seventh potential V S of the positive polarity are alternately applied, causing discharge for sustaining in the display cells in which wall charges are formed in the corresponding address period A. FIG.
여기에서, 보조 리셋 방전이 일어나는 서브필드(SFB)의 유지 주기(SB)에 있어서, 유지 펄스들은 상기 제1 주파수보다 낮은 제2 주파수를 가짐에 따라 상기 제1 폭(도 5의 TA)보다 긴 제2 폭(TB)을 가진다.Here, in the sustain period S B of the subfield SF B in which the auxiliary reset discharge occurs, the sustain pulses have a second frequency lower than the first frequency, so that the first width (T A in FIG. 5). Has a second width T B that is longer than).
이상 설명된 바와 같이, 주 리셋 방전과 함께 상기 보조 리셋 방전이 채용되므로, 플라즈마 디스플레이 장치의 콘트라스트 성능이 높아질 수 있다. 또한, 보조 리셋 방전을 일으키는 서브필드(SFB)의 유지 주기(SB)에서 유지 펄스들의 주파수가 낮아지므로, 약한 리셋 방전임에도 불구하고 보다 안정된 유지 방전이 일어날 수 있다. 즉, 디스플레이 영상의 재현성이 높아질 수 있다.As described above, since the auxiliary reset discharge is employed together with the main reset discharge, the contrast performance of the plasma display apparatus can be increased. In addition, since the frequency of the sustain pulses is lowered in the sustain period S B of the subfield SF B causing the auxiliary reset discharge, more stable sustain discharge may occur despite the weak reset discharge. That is, the reproducibility of the display image may be increased.
도 11은, 도 4의 단위 프레임의 각 서브필드에 도 5의 서브필드 유형(SFA) 또는 도 6의 서브필드 유형(SFB)이 적용되는 예를 보여준다. 도 11을 참조하면, 도 4의 단위 프레임의 제3 서브필드(SF3)에서 도 5의 서브필드 유형(SFA)이 적용되고, 나머지 서브필드들에서 도 6의 서브필드 유형(SFB)이 적용된다. FIG. 11 shows an example in which the subfield type SF A of FIG. 5 or the subfield type SF B of FIG. 6 is applied to each subfield of the unit frame of FIG. 4. Referring to FIG. 11, the subfield type SF A of FIG. 5 is applied to the third subfield SF 3 of the unit frame of FIG. 4, and the subfield type SF B of FIG. 6 in the remaining subfields. This applies.
이상 설명된 바와 같이, 본 발명에 따른 방전 디스플레이 패널의 구동 방법에 의하면, 주 리셋 방전과 함께 보조 리셋 방전이 채용됨에 따라 방전 디스플레이 장치의 콘트라스트 성능이 높아질 수 있다. 또한, 보조 리셋 방전을 일으키는 서브필드의 유지 주기에서 유지 펄스들의 주파수가 낮아지므로, 약한 리셋 방전임에도 불구하고 보다 안정된 유지 방전이 일어날 수 있다. 즉, 디스플레이 영상의 재현성이 높아질 수 있다. As described above, according to the driving method of the discharge display panel according to the present invention, as the secondary reset discharge is employed together with the main reset discharge, the contrast performance of the discharge display apparatus can be increased. In addition, since the frequency of the sustain pulses is lowered in the sustain period of the subfield causing the auxiliary reset discharge, more stable sustain discharge may occur despite the weak reset discharge. That is, the reproducibility of the display image may be increased.
본 발명은, 상기 실시예에 한정되지 않고, 청구범위에서 정의된 발명의 사상 및 범위 내에서 당업자에 의하여 변형 및 개량될 수 있다.The present invention is not limited to the above embodiments, but may be modified and improved by those skilled in the art within the spirit and scope of the invention as defined in the claims.
Claims (8)
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Applications Claiming Priority (1)
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Publications (1)
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2006
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
WITN | Withdrawal due to no request for examination |