KR100741119B1 - Method for driving discharge display panel according to cumulative drive time - Google Patents
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Abstract
Description
도 1은 본 발명의 일 실시예에 의하여 구동되는 방전 표시 패널로서 3-전극 면방전 방식의 플라즈마 표시 패널의 구조를 보여주는 내부 사시도이다.1 is a perspective view illustrating an internal structure of a three-electrode surface discharge plasma display panel as a discharge display panel driven by an embodiment of the present invention.
도 2는 도 1의 플라즈마 표시 패널의 한 방전 셀의 예를 보여주는 단면도이다.FIG. 2 is a cross-sectional view illustrating an example of one discharge cell of the plasma display panel of FIG. 1.
도 3은 도 1의 플라즈마 표시 패널이 구동되는 방식을 보여주는 타이밍도이다.3 is a timing diagram illustrating a method of driving the plasma display panel of FIG. 1.
도 4는 본 발명의 일 실시예를 수행하는 도 1의 플라즈마 표시 패널의 구동 장치를 보여주는 블록도이다.4 is a block diagram illustrating a driving apparatus of the plasma display panel of FIG. 1 according to an exemplary embodiment of the present invention.
도 5는 도 4의 논리 제어부의 제어 알고리듬을 보여주는 흐름도이다.5 is a flowchart illustrating a control algorithm of the logic controller of FIG. 4.
도 6은, 도 1의 플라즈마 표시 패널의 누적 구동 시간이 설정 시간을 경과하지 않은 경우, 도 3의 단위 프레임의 어느 한 서브필드에서 사용되는 구동 신호들을 보여주는 파형도이다. FIG. 6 is a waveform diagram illustrating driving signals used in any subfield of the unit frame of FIG. 3 when the accumulated driving time of the plasma display panel of FIG. 1 does not pass the set time.
도 7은 도 6의 t5 시점에서의 어느 한 방전 셀의 벽전하 분포를 보여주는 단면도이다.FIG. 7 is a cross-sectional view illustrating a wall charge distribution of one discharge cell at time t 5 of FIG. 6.
도 8은 도 6의 t8 시점에서의 어느 한 방전 셀의 벽전하 분포를 보여주는 단면도이다.Figure 8 is a cross-sectional view of the one wall charge distribution of a discharge cell at the time t 8 in FIG.
도 9는, 도 1의 플라즈마 표시 패널의 누적 구동 시간이 설정 시간을 경과한 경우, 도 3의 단위 프레임의 어느 한 서브필드에서 사용되는 구동 신호들을 보여주는 파형도이다. FIG. 9 is a waveform diagram illustrating driving signals used in any subfield of the unit frame of FIG. 3 when the cumulative driving time of the plasma display panel of FIG.
<도면의 주요 부분에 대한 부호의 설명><Explanation of symbols for main parts of the drawings>
1...방전 표시 패널, 10...앞쪽 글라스 기판,1 ... discharge display panel, 10 ... front glass substrate,
11, 15...유전체층, 12...보호층,11, 15 dielectric layer, 12 protective layer,
13...뒤쪽 글라스 기판, 14...방전 공간,13 ... back glass substrate, 14 ... discharge space,
16...형광층, 17...격벽,16 fluorescent layers, 17 bulkheads,
X1, ..., Xn...X 전극 라인, Y1, ..., Yn...Y 전극 라인,X 1 , ..., Xn ... X electrode line, Y 1 , ..., Yn ... Y electrode line,
AR1, ..., ABm...어드레스 전극 라인, Xna, Yna...투명 전극 라인,A R1 , ..., A Bm ... address electrode line, X na , Y na ... transparent electrode line,
Xnb, Ynb...금속 전극 라인, SF1, ...SF8...서브필드,X nb , Y nb ... metal electrode lines, SF1, ... SF8 ... subfield,
SY...Y 구동 제어 신호, VG...접지 전위,S Y ... Y drive control signal, V G ... ground potential,
SX...X 구동 제어 신호, SA...어드레스 구동 제어 신호, S X ... X drive control signal, S A ... address drive control signal,
52...논리 제어부, 53...어드레스 구동부, 52 logic controller, 53 address drive,
54...X 구동부, 55...Y 구동부, 54 ... X drive, 55 ... Y drive,
56...영상 처리부, S...리셋 주기. 56 ... image processing unit, S ... reset cycle.
본 발명은, 방전 표시 패널의 구동 방법에 관한 것으로서, 보다 상세하게는, 서로 대향 이격된 앞쪽 기판과 뒤쪽 기판을 갖고, 이 기판들 사이에 유지 전극 라인들 및 주사 전극 라인들이 서로 교호하고 나란하게 형성되며, 어드레스 전극 라인들이 유지 전극 라인들 및 주사 전극 라인들에 대하여 교차되게 형성되는 방전 표시 패널의 구동 방법에 관한 것이다.BACKGROUND OF THE
통상적인 방전 표시 장치 예를 들어, 미국 특허 제5,541,618호의 플라즈마 표시 장치에서는, 단위 프레임이 시분할 계조 표시를 위한 복수의 서브필드들로 구분되고, 서브필드들 각각이 리셋 주기, 어드레싱 주기, 및 유지 주기를 포함한다. 서브필드들 각각은 고유한 계조 가중값을 가지며, 이 계조 가중값에 비례하여 유지 주기가 설정된다. In a typical discharge display device, for example, the plasma display device of US Pat. No. 5,541,618, a unit frame is divided into a plurality of subfields for time division gray scale display, and each of the subfields is a reset period, an addressing period, and a sustain period. It includes. Each of the subfields has a unique gray scale weight value, and a maintenance period is set in proportion to the gray scale weight value.
한편, 어드레스 전극 라인들은 적색용 어드레스 전극 라인들, 녹색용 어드레스 전극 라인들, 및 청색용 어드레스 전극 라인들로 구분된다. 적색용 어드레스 전극 라인들은 유전체를 사이에 두고 적색 형광층과 대면된다. 녹색용 어드레스 전극 라인들은 유전체를 사이에 두고 녹색 형광층과 대면된다. 청색용 어드레스 전극 라인들은 유전체를 사이에 두고 청색 형광층과 대면된다. Meanwhile, the address electrode lines are divided into red address electrode lines, green address electrode lines, and blue address electrode lines. The red address electrode lines face the red fluorescent layer with a dielectric interposed therebetween. The green address electrode lines face the green fluorescent layer with a dielectric interposed therebetween. The blue address electrode lines face the blue fluorescent layer with a dielectric interposed therebetween.
여기에서, 녹색 형광층의 경우, 그 특성상 방전 시에 이온들의 충격에 대한 내구성이 상대적으로 약하여 누적 구동 시간에서의 어느 한 시점에서부터는 녹색 형광층의 특성이 열화되기 시작한다. 이에 따라, 녹색 형광층의 수명이 짧아지고, 표시 색상들 사이의 균형이 점점 틀어짐으로 인하여 표시 영상의 재현성이 떨어진다. Here, in the case of the green fluorescent layer, the durability of the impact of ions during discharge is relatively weak due to its characteristics, and the characteristic of the green fluorescent layer starts to deteriorate from one point in the cumulative driving time. Accordingly, the lifespan of the green fluorescent layer is shortened, and the balance between the display colors is gradually changed, thereby reducing the reproducibility of the display image.
본 발명의 목적은, 녹색 형광층의 수명을 연장시키고, 표시 색상들 사이의 균형을 유지시킴으로 인하여 표시 영상의 재현성을 높일 수 있는 방전 표시 패널의 구동 방법을 제공하는 것이다.SUMMARY OF THE INVENTION An object of the present invention is to provide a method of driving a discharge display panel which can increase the reproducibility of a display image by extending the life of the green fluorescent layer and maintaining a balance between display colors.
상기 목적을 이루기 위한 본 발명은, 서로 대향 이격된 앞쪽 기판과 뒤쪽 기판을 갖고, 상기 기판들 사이에 유지 전극 라인들 및 주사 전극 라인들이 서로 교호하고 나란하게 형성되며, 어드레스 전극 라인들이 상기 유지 전극 라인들 및 주사 전극 라인들에 대하여 교차되게 형성되는 방전 표시 패널의 구동 방법에 있어서, 패널 구동 단계 및 바이어스 인가 단계를 포함한다.In order to achieve the above object, the present invention has a front substrate and a rear substrate spaced apart from each other, wherein sustain electrode lines and scan electrode lines are alternately and parallel to each other, and address electrode lines are formed on the sustain electrode. A driving method of a discharge display panel which is formed to cross the lines and the scan electrode lines, the method comprising a panel driving step and a bias applying step.
상기 패널 구동 단계에서는, 영상 데이터의 단위 프레임이 복수의 서브필드들로 구분되고, 상기 서브필드들 각각이 리셋 주기, 어드레싱 주기, 및 유지 주기로 구분되어 상기 방전 표시 패널이 구동된다.In the panel driving step, the unit frame of the image data is divided into a plurality of subfields, and each of the subfields is divided into a reset period, an addressing period, and a sustain period to drive the discharge display panel.
상기 바이어스 인가 단계에서는, 상기 유지 주기에서 상기 유지 전극 라인들 및 주사 전극 라인들에 교호하게 유지 펄스들이 인가되되, 상기 방전 표시 패널의 누적 구동 시간이 설정 시간을 경과하면, 상기 유지 주기에서 상기 유지 펄스들과 동일한 극성의 바이어스 전위가 상기 어드레스 전극 라인들 중에서 녹색용 어드레 스 전극 라인들에 인가된다.In the bias applying step, sustain pulses are alternately applied to the sustain electrode lines and the scan electrode lines in the sustain period. When the accumulated driving time of the discharge display panel has passed a set time, the sustain period is maintained in the sustain period. A bias potential of the same polarity as the pulses is applied to the green address electrode lines among the address electrode lines.
본 발명의 상기 방전 표시 패널의 구동 방법에 의하면, 상기 방전 표시 패널의 누적 구동 시간이 설정 시간을 경과하면, 상기 유지 주기에서 상기 유지 전극 라인들과 주사 전극 라인들 사이의 방전으로 인한 이온들 중에서 상기 녹색용 어드레스 전극 라인들에 대면하는 녹색 형광층에 충돌하는 이온들이 줄어든다.According to the driving method of the discharge display panel of the present invention, when the cumulative driving time of the discharge display panel passes a set time, among the ions due to the discharge between the sustain electrode lines and the scan electrode lines in the sustain period. Ions that collide with the green fluorescent layer facing the green address electrode lines are reduced.
이에 따라, 녹색 형광층의 수명이 연장되고, 표시 색상들 사이의 균형이 유지됨으로 인하여 표시 영상의 재현성이 높아질 수 있다.As a result, the lifespan of the green fluorescent layer is extended and the balance between the display colors is maintained, thereby increasing the reproducibility of the display image.
이하, 본 발명에 따른 바람직한 실시예가 상세히 설명된다. Hereinafter, preferred embodiments according to the present invention will be described in detail.
도 1은 본 발명의 일 실시예에 의하여 구동되는 방전 표시 패널로서 3-전극 면방전 방식의 플라즈마 표시 패널(1)의 구조를 보여준다. 도 2는 도 1의 플라즈마 표시 패널(1)의 한 방전 셀의 예를 보여준다.FIG. 1 shows the structure of a three-electrode surface discharge
도 1 및 2를 참조하면, 본 발명의 일 실시예에 의한 3-전극 면방전 플라즈마 표시 패널(1)의 앞쪽 및 뒤쪽 글라스 기판들(10, 13) 사이에는, 어드레스 전극 라인들(AR1 내지 ABm), 유전체층(11, 15), 유지 전극 라인들로서의 X 전극 라인들(X1 내지 Xn), 주사 전극 라인들로서의 Y 전극 라인들(Y1 내지 Yn), 형광체(16), 격벽(17) 및 보호층으로서의 일산화마그네슘(MgO)층(12)이 마련되어 있다. 1 and 2, between the front and
어드레스 전극 라인들(AR1 내지 ABm)은 뒤쪽 글라스 기판(13)의 앞쪽에 일정한 패턴으로 형성된다. 하부 유전체층(15)은 어드레스 전극 라인들(AR1 내지 ABm)의 앞쪽에서 전면(全面) 도포된다. 하부 유전체층(15)의 앞쪽에는 격벽(17)들이 어드레 스 전극 라인들(AR1 내지 ABm)과 평행한 방향으로 형성된다. 이 격벽(17)들은 각 방전 셀의 방전 영역을 구획하고 각 방전 셀 사이의 광학적 간섭(cross talk)을 방지하는 기능을 한다. 형광층(16)은 격벽(17)들 사이에 도포된다. Address electrode lines A R1 To A Bm ) are formed in a predetermined pattern on the front side of the
유지 전극 라인들로서의 X 전극 라인들(X1 내지 Xn)과 주사 전극 라인들로서의 Y 전극 라인들(Y1 내지 Yn)은 어드레스 전극 라인들(AR1 내지 ABm)과 교차되는 방향으로 앞쪽 글라스 기판(10)의 뒤쪽에서 교호하고 나란하게 형성된다. 각 교차점은 상응하는 방전 셀을 설정한다. 각 X 전극 라인(X1 내지 Xn)과 각 Y 전극 라인(Y1 내지 Yn)은 ITO(Indium Tin Oxide) 등과 같은 투명한 도전성 재질의 투명 전극 라인(도 3의 Xna, Yna)과 전도도를 높이기 위한 금속 전극 라인(도 2의 Xnb, Ynb)이 결합되어 형성된다. 앞쪽 유전체층(11)은 X 전극 라인들(X1 내지 Xn)과 Y 전극 라인들(Y1 내지 Yn)의 뒤쪽에 전면(全面) 도포되어 형성된다. 강한 전계로부터 패널(1)을 보호하기 위한 보호층(12) 예를 들어, 일산화마그네슘(MgO)층은 앞쪽 유전체층(11)의 뒤쪽에 전면 도포되어 형성된다. 방전 공간(14)에는 플라즈마 형성용 가스가 밀봉된다.X electrode lines X 1 as sustain electrode lines To X n and Y electrode lines Y 1 as scan electrode lines To Y n are the address electrode lines A R1. To A Bm ) are formed alternately and side by side at the rear of the
이와 같은 방전 표시 패널에 적용되는 구동 방법에서는, 리셋(reset), 어드레싱(addressing), 및 유지(sustaining) 주기들이 단위 서브필드에서 순차적으로 수행된다. 리셋 주기에서는 모든 방전 셀들의 전하 상태들이 어드레싱 주기에 적합하도록 균일해진다. 어드레싱 주기에서는, 선택된 방전 셀들에 소정의 벽전위가 생성된다. 유지 주기에서는, 모든 XY 전극 라인쌍들에 소정의 교류 전압이 인가됨으로써 어드레싱 주기에서 상기 벽전위가 형성된 방전 셀들이 유지 방전을 일으킨다. 이 유지 주기에 있어서, 유지 방전을 일으키는 선택된 방전 셀들의 방전 공간(14) 즉, 가스층에서 플라즈마가 형성되고, 그 자외선 방사에 의하여 형광층(16)이 여기되어 빛이 발생된다. In the driving method applied to such a discharge display panel, reset, addressing, and sustaining cycles are sequentially performed in the unit subfield. In the reset period, the charge states of all the discharge cells become uniform to suit the addressing period. In the addressing period, a predetermined wall potential is generated in the selected discharge cells. In the sustain period, a predetermined alternating voltage is applied to all the XY electrode line pairs, so that the discharge cells in which the wall potential is formed in the addressing period cause sustain discharge. In this sustain period, a plasma is formed in the
도 3은 도 1의 플라즈마 표시 패널(1)이 구동되는 방식을 보여준다. 도 3을 참조하면, 모든 단위 프레임들 각각은 시분할 계조 표시를 실현하기 위하여 계조 가중값이 낮은 순서에 따라 8 개의 서브필드들(SF1 내지 SF8)로 구분된다. 또한, 각 서브필드(SF1 내지 SF8)는 리셋 주기(R1 내지 R8), 어드레싱 주기(A1 내지 A8), 및 유지 주기(S1 내지 S8)로 구분된다. 3 illustrates a method in which the
모든 방전 셀들의 방전 조건들은 각 리셋 주기(R1 내지 R8)에서 균일해지면서 동시에 다음 주기에서 수행될 어드레싱에 적합해지도록 된다. The discharge conditions of all the discharge cells are each reset period R1. To R8) to be uniform and at the same time suitable for addressing to be performed in the next cycle.
각 어드레싱 주기(A1 내지 A8)에서는, 어드레스 전극 라인들(도 1의 AR1 내지 ABm)에 표시 데이터 신호가 인가됨과 동시에 각 Y 전극 라인(Y1 내지 Yn)에 상응하는 주사 펄스가 순차적으로 인가된다. 이에 따라 주사 펄스가 인가되는 동안에 높은 레벨의 표시 데이터 신호가 인가되면 상응하는 방전 셀에서 어드레싱 방전에 의하여 설정 값 이상의 벽전위들이 형성되며, 그렇지 않은 방전 셀에서는 설정 값 이상의 벽전위들이 형성되지 않는다. Each addressing cycle (A1 From A8 to A8, the address electrode lines (A R1 in FIG. 1). To A Bm and a display data signal is applied to each Y electrode line Y 1. To Y n ) are sequentially applied. Accordingly, when a high level display data signal is applied while the scan pulse is applied, wall potentials greater than or equal to the set value are formed by addressing discharge in the corresponding discharge cells, and wall potentials greater than or equal to the set value are not formed in the discharge cells that are not.
각 유지 주기(S1 내지 S8)에서는, 모든 Y 전극 라인들(Y1 내지 Yn)과 모든 X 전극 라인들(X1 내지 Xn)에 유지 펄스가 교호하게 인가되어, 상응하는 어드레싱 주기(A1 내지 A8)에서 설정 값 이상의 벽전위들이 형성되었던 방전셀들에서 표시 방전을 일으킨다. 따라서 어느 한 방전 셀의 출력 휘도는 단위 프레임에서 차지하는 유지 주기(S1 내지 S8)의 길이에 비례한다. 본 실시예의 경우, 단위 프레임에서 차지하는 유지 주기(S1 내지 S8)의 길이는 255T(T는 단위 주기)이다. 따라서 단위 프레임에서 한 번도 표시되지 않은 경우를 포함하여 256 계조로써 표시할 수 있다.Each maintenance cycle (S1 To S8, all Y electrode lines Y 1. To Y n ) and all X electrode lines (X 1) To X n ), the sustain pulse is alternately applied, so that the corresponding addressing period A1 To A8), display discharge is caused in the discharge cells in which wall potentials above the set value were formed. Therefore, the sustaining period S1 occupies the output luminance of one discharge cell in the unit frame. To the length of S8). In the present embodiment, the sustain period (S1) occupies in the unit frame To S8) is 255T (T is a unit period). Therefore, it can be displayed in 256 gray scales, even if it is not displayed once in a unit frame.
여기에서, 제1 서브필드(SF1)의 유지 주기(S1)에는 20에 상응하는 시간(1T)이, 제2 서브필드(SF2)의 유지 주기(S2)에는 21에 상응하는 시간(2T)이, 제3 서브필드(SF3)의 유지 주기(S3)에는 22에 상응하는 시간(4T)이, 제4 서브필드(SF4)의 유지 주기(S4)에는 23에 상응하는 시간(8T)이, 제5 서브필드(SF5)의 유지 주기(S5)에는 24에 상응하는 시간(16T)이, 제6 서브필드(SF6)의 유지 주기(S6)에는 25에 상응하는 시간(32T)이, 제7 서브필드(SF7)의 유지 주기(S7)에는 26에 상응하는 시간(64T)이, 그리고 제8 서브필드(SF8)의 유지 주기(S8)에는 27에 상응하는 시간(128T)이 각각 설정된다.Here, the
이에 따라, 8 개의 서브필드들(SF1 내지 SF8) 중에서 표시될 서브필드를 적절히 선택하면, 어느 서브필드에서도 표시되지 않는 0(영) 계조를 포함하여 모두 256 계조의 표시가 수행될 수 있다. Accordingly, eight subfields SF 1 From SF 8 ), if a subfield to be displayed is appropriately selected, display of 256 gray levels can be performed including all zero (zero) gray levels that are not displayed in any subfields.
도 4를 참조하면, 본 발명의 일 실시예를 수행하는 도 1의 플라즈마 표시 패널(1)의 구동 장치는 영상 처리부(56), 논리 제어부(52), 어드레스 구동부(53), X 구동부(54), 및 Y 구동부(55)를 포함한다. Referring to FIG. 4, an apparatus for driving the
영상 처리부(56)는 외부 아날로그 영상 신호를 디지털 신호로 변환하여 내부 영상 신호 예를 들어, 각각 8 비트의 적색(R), 녹색(G) 및 청색(B) 영상 데이터, 클럭 신호, 수직 및 수평 동기 신호들을 발생시킨다. The
논리 제어부(52)는 영상 처리부(56)로부터의 내부 영상 신호에 따라 구동 제어 신호들(SA, SY, SX)을 발생시킨다. The
어드레스 구동부(53)는, 논리 제어부(52)로부터의 구동 제어 신호들(SA, SY, SX) 중에서 어드레스 신호들(SA)을 처리하여 표시 데이터 신호를 발생시키고, 발생된 표시 데이터 신호를 어드레스 전극 라인들(도 1의 AR1 내지 ABm)에 인가한다. The
X 구동부(54)는 논리 제어부(52)로부터의 구동 제어 신호들(SA, SY, SX) 중에서 X 구동 제어 신호들(SX)에 따라 유지 전극 라인들로서의 X 전극 라인들(도 1의 X1 내지 Xn)을 구동한다. The
Y 구동부(55)는 논리 제어부(52)로부터의 구동 제어 신호들(SA, SY, SX) 중에서 Y 구동 제어 신호(SY)에 따라 주사 전극 라인들로서의 Y 전극 라인들(도 1의 Y1 내지 Yn)을 구동한다.The
도 5는 도 4의 논리 제어부(52)의 제어 알고리듬을 보여준다. 도 4 및 5를 참조하여, 논리 제어부(52)의 제어 알고리듬을 설명하면 다음과 같다.5 shows a control algorithm of the
논리 제어부(52)에 전원이 인가되면, 논리 제어부(52)는 플라즈마 표시 패널(1)의 누적 구동 시간을 측정하기 위하여 내부적인 누적 타이머를 온(On)시킨다(단계 S1).When power is applied to the
다음에, 논리 제어부(52)는 영상 처리부(56)로부터의 내부 영상 신호에 따라 플라즈마 표시 패널(1)의 구동을 수행한다(단계 S2). 즉, 논리 제어부(52)는 영상 처리부(56)로부터의 내부 영상 신호에 따라 구동 제어 신호들(SA, SY, SX)을 발생시킴으로써 어드레스 구동부(53), X 구동부(54), 및 Y 구동부(55)를 동작시킨다.Next, the
한편, 논리 제어부(52)는, 내부적인 누적 타이머로부터의 구동 시간이 설정 시간(신뢰성 시험에 의함)으로서의 1200 시간을 경과하면(단계 S3), 어드레스 구동부(53)를 제어함에 의하여, 유지 주기들(도 3의 S1 내지 S8)에서 유지 펄스들과 동일한 극성의 바이어스 전위를 녹색용 어드레스 전극 라인들(도 1의 AG1 내지 AGm)에 인가한다(단계 S4).On the other hand, when the driving time from the internal cumulative timer passes 1200 hours as the set time (by the reliability test) (step S3), the
상기 단계들 S2 내지 S4는 외부적인 종료 신호가 발생될 때까지 계속 수행된 다(단계 S5).Steps S2 to S4 are continued until an external end signal is generated (step S5).
상기 종료 신호가 발생되면, 논리 제어부(52)는 플라즈마 표시 패널(1)의 구동을 종료한다(단계 S6). 즉, 논리 제어부(52)는 어드레스 구동부(53), X 구동부(54), 및 Y 구동부(55)의 구동 동작을 종료시킨다. 또한, 논리 제어부(52)는 내부적인 누적 타이머를 오프시킨다(단계 S7). When the end signal is generated, the
상기와 같은 논리 제어부(52)의 제어 알고리듬에 의하면, 플라즈마 표시 패널(1)의 누적 구동 시간이 설정 시간으로서의 1200 시간을 경과하면, 유지 주기들(도 3의 S1 내지 S8)에서 X 전극 라인들(도 1의 X1 내지 Xn)과 Y 전극 라인들(도 1의 Y1 내지 Yn) 사이의 방전으로 인한 이온들 중에서 녹색용 어드레스 전극 라인들(도 1의 AG1 내지 AGm)에 대면하는 녹색 형광층에 충돌하는 이온들이 줄어든다.According to the control algorithm of the
이에 따라, 녹색 형광층의 수명이 연장되고, 표시 색상들 사이의 균형이 유지됨으로 인하여 표시 영상의 재현성이 높아질 수 있다. 이와 관련된 기술이 이하에서 보다 상세히 설명된다.As a result, the lifespan of the green fluorescent layer is extended and the balance between the display colors is maintained, thereby increasing the reproducibility of the display image. Techniques related to this are described in more detail below.
도 6은, 도 1의 플라즈마 표시 패널(1)의 누적 구동 시간이 설정 시간을 경과하지 않은 경우, 도 3의 단위 프레임의 어느 한 서브필드(SF)에서 사용되는 구동 신호들을 보여준다. 도 6에서 참조부호 SAR1..ARm은 적색용 어드레스 전극 라인들(도 1의 AR1 내지 ARm)에 인가되는 구동 신호들을 가리킨다. SAG1 .. AGm은 녹색용 어드레스 전극 라인들(도 1의 AG1 내지 AGm)에 인가되는 구동 신호들을 가리킨다. SAB1 .. ABm은 청색용 어드레스 전극 라인들(도 1의 AB1 내지 ABm)에 인가되는 구동 신호들을 가리킨다. SX1 .. Xn은 X 전극 라인들(도 1의 X1 내지 Xn)에 인가되는 구동 신호를 가리킨다. SY1 내지 SYn은 각 Y 전극 라인(도 1의 Y1 내지 Yn)에 인가되는 구동 신호들을 가리킨다. 도 7은 도 6의 t5 시점에서의 어느 한 방전 셀의 벽전하 분포를 보여준다. 도 8은 도 6의 t8 시점에서의 어느 한 방전 셀의 벽전하 분포를 보여준다. 도 7 및 8에서 도 2와 동일한 참조 부호는 동일한 기능의 대상을 가리킨다. FIG. 6 illustrates driving signals used in one subfield SF of the unit frame of FIG. 3 when the cumulative driving time of the
도 6을 참조하면, 도 3의 서브필드들(SF1 내지 SF8) 중에서 적어도 어느 하나의 서브필드(SF)의 리셋 주기(R)에 있어서, 벽전하 축적 주기(t1 ~ t5)에서는, Y 전극-라인들(Y1 내지 Yn)에 인가되는 전위가 접지 전위(VG)로부터 제3 전위(VS)보다 제6 전위(VSET)만큼 더 높은 최고 전위로서의 정극성의 제1 전위(VSET + VS) 예를 들어, 355 볼트(V)까지 상승된다. X 전극-라인들(X1 내지 Xn)과 어드레스 전극-라인들(AR1 내지 ABm)에는 접지 전위(VG)가 인가된다. Referring to FIG. 6, the subfields SF1 of FIG. 3. In the reset period R of at least one of the subfields SF from SF8), in the wall charge accumulation periods t1 to t5, the potential applied to the Y electrode-lines Y 1 to Y n is increased. Positive first potential V SET as the highest potential higher than ground potential V G by the sixth potential V SET higher than third potential V S. + V S ), for example, rises to 355 volts (V). X electrode-lines (X 1 To X n ) and address electrode-lines A R1 To A Bm ), the ground potential V G is applied.
이에 따라, Y 전극-라인들(Y1 내지 Yn)과 X 전극-라인들(X1 내지 Xn) 사이에 방전이 일어나는 한편, Y 전극-라인들(Y1 내지 Yn)과 어드레스 전극-라인들(AR1 내지 ABm) 사이에 방전이 일어난다. 이에 따라, 모든 Y 전극-라인들(Y1 내지 Yn) 주위에는 부극성 벽전하들이 축적되고, 모든 X 전극-라인들(X1 내지 Xn) 주위에는 정극성 의 벽전하들이 축적되며, 모든 어드레스 전극-라인들(AR1 내지 ABm) 주위에는 정극성의 벽전하들이 축적된다(도 7 참조). Accordingly, Y electrode-lines Y 1 To Y n ) and the X electrode-lines (X 1) To X n ), while discharge occurs between Y electrode-lines Y 1. To Y n ) and address electrode-lines A R1 To A Bm ). Accordingly, all Y electrode-lines Y 1 To Y n ), negative wall charges accumulate and all X electrode-lines (X 1). To X n ), positive wall charges are accumulated and all address electrode-lines A R1. To A Bm ), positive wall charges are accumulated (see FIG. 7).
다음에, 리셋 주기(R)의 벽전하 배분 주기(t5 ~ t8)에서는, X 전극-라인들(X1 내지 Xn)에 인가되는 전위가 제5 전위(VE)로 유지된 상태에서, Y 전극-라인들(Y1 내지 Yn)에 인가되는 전위가 제1 전위(VSET + VS)로부터 부극성의 제2 전위(VSCL)까지 하강된다. 여기에서, 어드레스 전극-라인들(AR1 내지 ABm)에는 접지 전위(VG)가 인가된다. 이에 따라, X 전극-라인들(X1 내지 Xn)과 Y 전극-라인들(Y1 내지 Yn) 사이의 방전으로 인하여, Y 전극-라인들(Y1 내지 Yn) 주위의 부극성의 벽전하들의 일부가 X 전극-라인들(X1 내지 Xn) 주위로 적절히 이동한다(도 8 참조). 또한, 어드레스 전극-라인들(AR1 내지 ABm)에는 접지 전위(VG)가 인가되므로, 어드레스 전극-라인들(AR1 내지 ABm) 주위의 정극성의 벽전하들이 적절히 감소한다(도 8 참조). Next, in the wall charge distribution period t5 to t8 of the reset period R, while the potential applied to the X electrode lines X 1 to X n is maintained at the fifth potential V E , Y electrode-lines (Y 1) To potential applied to Y n is the first potential V SET. From + V S ) to the second negative potential V SCL . Here, address electrode-lines A R1 To A Bm ), the ground potential V G is applied. Accordingly, X electrode-lines X 1 To X n ) and the Y electrode-lines Y 1 To due to the discharge between the Y n), Y electrode lines (Y 1 To Y n ) some of the negative wall charges around move properly around the X electrode-lines X 1 to X n (see FIG. 8). In addition, address electrode-lines A R1 To A Bm , the ground potential V G is applied, and therefore, the address electrode lines A R1 To A Bm ), the positive wall charges around them are appropriately reduced (see FIG. 8).
이에 따라, 이어지는 어드레싱 주기(A)에서, 어드레스 전극-라인들(AR1 내지 ABm)에 표시 데이터 신호가 인가되고, 부극성의 제4 전위(VSCH)로 바이어싱된 Y 전극-라인들(Y1 내지 Yn)에 상기 부극성의 제2 전위(VSCL)의 주사 펄스가 순차적으로 인가됨에 따라, 원활한 어드레싱이 수행될 수 있다. 각 어드레스 전극-라인(AR1 내지 ABm)에 인가되는 표시 데이터 신호는 방전 셀을 선택할 경우에 정극성 어드레스 전 위(VA)가, 그렇지 않을 경우에 접지 전위(VG)가 인가된다. 이에 따라 상기 부극성의 제2 전위(VSCL)의 주사 펄스가 인가되는 동안에 정극성 어드레스 전위(VA)의 표시 데이터 신호가 인가되면 상응하는 방전 셀에서 어드레스 방전에 의하여 적절한 벽전위들이 형성되며, 그렇지 않은 방전 셀에서는 어드레스 방전이 일어나지 않는다. 여기에서, 보다 정확하고 효율적인 어드레스 방전을 위하여, X 전극-라인들(X1 내지 Xn)에 상기 정극성의 제5 전위(VE)가 인가된다.Thus, in the following addressing period A, the address electrode-lines A R1 To A Bm ), the display data signal is applied and the Y electrode-lines Y 1 biased to the negative fourth potential V SCH . To Y n ), as the scan pulses of the negative second potential V SCL are sequentially applied, smooth addressing may be performed. The display data signal applied to each of the address electrode lines A R1 to A Bm is supplied with the positive address potential V A when the discharge cell is selected, and the ground potential V G when the discharge cell is selected. Accordingly, when the display data signal of the positive address potential V A is applied while the scan pulse of the second negative potential V SCL is applied, appropriate wall potentials are formed by the address discharge in the corresponding discharge cell. In other discharge cells, no address discharge occurs. Here, for more accurate and efficient address discharge, X electrode-lines X 1 To X n ), the positive fifth potential V E is applied.
유지 주기(S)에서는, 모든 Y 전극-라인들(Y1 내지 Yn)과 X 전극-라인들(X1 내지 Xn)에 정극성의 제3 전위(VS)의 유지 펄스가 교호하게 인가되어, 상응하는 어드레스 주기(A)에서 적절한 벽전위들이 형성된 방전 셀들에서 유지 방전을 일으킨다. 여기에서, 모든 어드레스 전극-라인들(AR1 내지 ABm)에 접지 전위(VG)가 인가되므로, 유지 방전의 활성화가 증진될 수 있다.In the sustain period S, all Y electrode-lines Y 1 To Y n ) and the X electrode-lines (X 1) To X n ), a sustain pulse of the positive third potential V S is alternately applied, causing sustain discharge in discharge cells in which appropriate wall potentials are formed in the corresponding address period A. FIG. Here, all address electrode-lines A R1 To A Bm ), since the ground potential V G is applied, activation of the sustain discharge can be enhanced.
도 9는, 도 1의 플라즈마 표시 패널(1)의 누적 구동 시간이 설정 시간 예를 들어, 1200 시간을 경과한 경우, 도 3의 단위 프레임의 어느 한 서브필드(SF)에서 사용되는 구동 신호들을 보여준다. 도 9에서 도 6과 동일한 참조 부호는 동일한 기능의 대상을 가리킨다. FIG. 9 illustrates driving signals used in one subfield SF of the unit frame of FIG. 3 when the cumulative driving time of the
도 9의 도 6에 대한 차이점은, 유지 주기(S)에서 유지 펄스들과 동일한 정극성의 바이어스 전위가 어드레스 전극 라인들(AR1 내지 ABm) 중에서 녹색용 어드레스 전극 라인들(AG1 내지 AGm)에 인가되는 것이다. 녹색용 어드레스 전극 라인들(AG1 내지 AGm)에 인가되는 정극성 바이어스 전위는 상기 정극성의 어드레싱 펄스의 전위(VA)와 동일한 레벨을 갖는다.The difference with respect to FIG. 6 of FIG. 9 is that in the sustain period S, the bias potential of the same polarity as the sustain pulses is equal to the address electrode lines A R1. To A Bm , the green address electrode lines A G1 To A Gm ). Green address electrode lines A G1 To A Gm ) has the same level as the potential V A of the positive addressing pulse.
따라서, 플라즈마 표시 패널(1)의 누적 구동 시간이 설정 시간을 경과하면, 유지 주기들(S)에서 X 전극 라인들(X1 내지 Xn)과 Y 전극 라인들(Y1 내지 Yn) 사이의 유지 방전으로 인한 이온들 중에서 녹색용 어드레스 전극 라인들(AG1 내지 AGm)에 대면하는 녹색 형광층에 충돌하는 이온들이 줄어든다.Therefore, when the cumulative driving time of the
이에 따라, 녹색 형광층의 수명이 연장되고, 표시 색상들 사이의 균형이 유지됨으로 인하여 표시 영상의 재현성이 높아질 수 있다. As a result, the lifespan of the green fluorescent layer is extended and the balance between the display colors is maintained, thereby increasing the reproducibility of the display image.
적색용 어드레스 전극 라인들(AR1 내지 ARm)과 청색용 어드레스 전극 라인들(AB1 내지 ABm)은 유지 방전의 활성화를 증진하기 위하여 누적 구동 시간과 무관하게 접지 전위(VG)가 인가된다.Red address electrode lines A R1 To A Rm ) and the blue address electrode lines A B1 to A Bm are applied with a ground potential V G regardless of the cumulative driving time to promote activation of sustain discharge.
이상 설명된 바와 같이, 본 발명에 따른 방전 표시 패널의 구동 방법에 의하면, 방전 표시 패널의 누적 구동 시간이 설정 시간을 경과하면, 유지 주기에서 유지 전극 라인들과 주사 전극 라인들 사이의 방전으로 인한 이온들 중에서 상기 녹색용 어드레스 전극 라인들에 대면하는 녹색 형광층에 충돌하는 이온들이 줄어든다. 이에 따라, 녹색 형광층의 수명이 연장되고, 표시 색상들 사이의 균형이 유지 됨으로 인하여 표시 영상의 재현성이 높아질 수 있다. As described above, according to the driving method of the discharge display panel according to the present invention, when the cumulative driving time of the discharge display panel passes the set time, due to the discharge between the sustain electrode lines and the scan electrode lines in the sustain period Among the ions, ions colliding with the green fluorescent layer facing the green address electrode lines are reduced. Accordingly, the lifespan of the green fluorescent layer is extended, and the balance between the display colors is maintained, thereby increasing the reproducibility of the display image.
본 발명은, 상기 실시예에 한정되지 않고, 청구범위에서 정의된 발명의 사상 및 범위 내에서 당업자에 의하여 변형 및 개량될 수 있다.The present invention is not limited to the above embodiments, but may be modified and improved by those skilled in the art within the spirit and scope of the invention as defined in the claims.
Claims (7)
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Citations (3)
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KR20030045960A (en) * | 2001-12-03 | 2003-06-12 | 삼성에스디아이 주식회사 | Method for driving plasma display panel to acquire accurate color temperature and color coordinate |
KR20060016254A (en) * | 2004-08-17 | 2006-02-22 | 삼성에스디아이 주식회사 | Plasma display device and driving method thereof |
KR20060026650A (en) * | 2004-09-21 | 2006-03-24 | 삼성에스디아이 주식회사 | Method for driving plasma display panel on which pulses having mutually different rising time are applied |
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