KR20050069761A - 플라즈마 디스플레이 패널의 구동 방법 - Google Patents

플라즈마 디스플레이 패널의 구동 방법 Download PDF

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Abstract

본 발명은 표시 품질을 향상시킬 수 있도록 한 플라즈마 디스플레이 패널의 구동 방법에 관한 것이다.
본 발명의 실시 예에 따른 프라즈마 디스플레이 패널의 구동 방법은 방전셀 각각에서 화상을 표현하기 위하여 구동파형을 공급하는 데이터 구동기간과 상기 구동파형을 공급하기 위한 전압값들이 원하는 전압까지 상승되기 위한 예비 기간으로 나뉘어 구동되는 플라즈마 디스플레이 패널의 구동방법에 있어서, 상기 데이터 구동기간에 전극들로 공급되는 파형과 상기 예비 기간에 상기 전극들로 공급되는 파형이 상이한 것을 특징으로 한다.
본 발명에 의하면, 서스테인 기간 동안 서스테인 오방전을 방지하여 플라즈마 디스플레이 패널의 온 동작 시 이전 구동 상태에 의한 잔상을 해결함으로써 표시 품질을 향상시킬 수 있다. 또한, 데이터 구동 파형이 입력되기 이전에 대략 1 내지 3초 간 바람직하게는 2초 정도 기저전압을 공급하여 방전셀 내에 잔존하는 전하들을 제거하여 전화면의 잔상을 방지함으로써 표시 품질을 향상시킬 수 있다.

Description

플라즈마 디스플레이 패널의 구동 방법{DRIVING METHOD OF PLASMA DISPLAY PANEL}
본 발명은 플라즈마 디스플레이 패널에 관한 것으로, 특히 표시 품질을 향상시킬 수 있도록 한 플라즈마 디스플레이 패널의 구동 방법에 관한 것이다.
최근의 정보화 사회에서 표시소자는 시각정보 전달매체로서 그 중요성이 어느 때보다 강조되고 있다. 현재 주류를 이루고 있는 음극선관(Cathode Ray Tube) 또는 브라운관은 무게와 부피가 큰 문제점이 있다. 이러한 음극선관의 한계를 극복할 수 있는 많은 종류의 평판 표시 장치(Flat Panel Display)가 개발되고 있다.
이러한 평판표시장치는 액정 표시장치(Liquid Crystal Display), 플라즈마 디스플레이 패널(Plasma Display Panel: 이하 "PDP"라 함), 전계방출 표시장치(Field Emission Display), 일렉트로 루미네센스(Electro-luminescence) 등이 있다.
이러한 평면 표시 장치 중, PDP는 He+Xe, Ne+Xe 또는 He+Xe+Ne 가스의 방전시 발생하는 147nm의 자외선에 의해 형광체를 발광시킴으로서 문자 또는 그래픽을 포함한 화상 및 동영상을 표시하게 된다. 이러한 플라즈마 디스플레이 패널은 박막화와 대형화가 용이할 뿐만 아니라 최근, 기술 개발에 힘입어 크게 향상된 화질을 제공한다.
특히, 3전극 교류 면방전형 PDP는 방전시 유전체층을 이용하여 벽전하를 축적하여 방전에 필요한 전압을 낮추게 되며, 플라즈마의 스퍼터링(Sputtering)으로 부터 전극들을 보호하기 때문에 저전압 구동과 장수명의 장점을 가진다.
도 1은 종래의 3전극 교류 면방전형 PDP의 방전셀을 나타내는 사시도이다.
도 1을 참조하면, 3전극 교류 면방전형 PDP의 방전셀은 상부기판(10) 상에 형성되어진 주사전극(Y) 및 유지전극(Z)과, 하부기판(18) 상에 형성되어진 어드레스전극(X)을 구비한다. 주사전극(Y)과 유지전극(Z) 각각은 투명전극(12Y,12Z)과, 투명전극(12Y,12Z)의 선폭보다 작은 선폭을 가지며 투명전극의 일측 가장자리에 형성되는 금속버스전극(13Y,13Z)을 포함한다.
투명전극(12Y,12Z)은 통상 인듐틴옥사이드(Indium-Tin-Oxide : ITO)로 상부기판(10) 상에 형성된다. 금속버스전극(13Y,13Z)은 통상 크롬(Cr) 등의 금속으로 투명전극(12Y,12Z) 상에 형성되어 저항이 높은 투명전극(12Y,12Z)에 의한 전압강하를 줄이는 역할을 한다. 주사전극(Y)과 유지전극(Z)이 나란하게 형성된 상부기판(10)에는 상부 유전체층(14)과 보호막(16)이 적층된다. 상부 유전체층(14)에는 플라즈마 방전시 발생된 벽전하가 축적된다. 보호막(16)은 플라즈마 방전시 발생된 스퍼터링에 의한 상부 유전체층(14)의 손상을 방지함과 아울러 2차 전자의 방출 효율을 높이게 된다. 보호막(16)으로는 통상 산화마그네슘(MgO)이 이용된다.
어드레스전극(X)이 형성된 하부기판(18) 상에는 하부 유전체층(22), 격벽(24)이 형성되며, 하부 유전체층(22)과 격벽(24) 표면에는 형광체층(26)이 도포된다. 어드레스전극(X)은 주사전극(Y) 및 유지전극(Z)과 교차되는 방향으로 형성된다. 격벽(24)은 어드레스전극(X)과 나란하게 형성되어 방전에 의해 생성된 자외선 및 가시광이 인접한 방전셀에 누설되는 것을 방지한다. 형광체층(26)은 플라즈마 방전시 발생된 자외선에 의해 여기되어 적색, 녹색 또는 청색 중 어느 하나의 가시광선을 발생하게 된다. 상/하부기판(10,18)과 격벽(24) 사이에 마련된 방전공간에는 불활성 혼합가스가 주입된다.
PDP는 화상의 계조를 구현하기 위하여, 한 프레임을 발광횟수가 다른 여러 서브필드로 나누어 시분할 구동하게 된다. 각 서브필드는 전화면을 리셋시키기 위한 리셋기간과, 주사라인을 선택하고 선택된 주사라인에서 셀을 선택하기 위한 어드레스기간과, 방전횟수에 따라 계조를 구현하는 서스테인기간으로 나뉘어진다.
여기서, 리셋 기간은 상승 램프 파형이 공급되는 셋업 기간과 하강 램프 파형이 공급되는 셋다운 기간으로 나뉘어진다. 예를 들어, 256 계조로 화상을 표시하고자 하는 경우에 도 2와 같이 1/60 초에 해당하는 프레임 기간(16.67ms)은 8개의 서브필드들(SF1내지SF8)로 나누어지게 된다. 8개의 서브필드들(SF1내지SF8) 각각은 전술한 바와 같이, 리셋 기간, 어드레스 기간과 서스테인 기간으로 나누어지게 된다. 각 서브필드의 리셋 기간과 어드레스 기간은 각 서브필드 마다 동일한 반면에 서스테인 기간은 각 서브필드에서 2n(n=0,1,2,3,4,5,6,7)의 비율로 증가된다.
도 3은 종래의 PDP의 구동방법을 나타내는 파형도이다.
도 3을 참조하면, PDP는 전화면을 리셋시키기 위한 리셋 기간, 셀을 선택하기 위한 어드레스 기간 및 선택된 셀의 방전을 유지시키기 위한 서스테인 기간으로 나뉘어 구동된다.
리셋 기간에 있어서, 셋업 기간에는 모든 주사전극들(Y)에 상승 램프 파형(Ramp-up)이 동시에 인가된다. 이때, 주사전극(Y)은 셀들은 방전시키기 위한 전압(Vp)까지 상승된다. 이 상승 램프 파형(Ramp-up)에 의해 전화면의 셀들 내에는 미약한 방전이 일어나게 되어 셀들 내에 벽전하가 생성된다. 셋다운 기간에는 상승 램프 파형(Ramp-up)이 공급된 후, 상승 램프 파형(Ramp-up)의 피크전압보다 낮은 정극성 전압에서 떨어지는 하강 램프 파형(Ramp-down)이 주사전극들(Y)에 동시에 인가된다. 하강 램프 파형(Ramp-down)은 셀들 내에 미약한 소거 방전을 일으킴으로써 셋업 방전에 의해 생성된 벽전하 및 공간전하 중 불요전하를 소거시키게 되고 전화면의 셀들 내에 어드레스 방전에 필요한 벽전하를 균일하게 잔류시키게 된다.
어드레스 기간에는 부극성 스캔 펄스(scan)가 주사전극들(Y)에 순차적으로 인가됨과 동시에 어드레스전극들(X)에 정극성의 데이터 펄스(data)가 인가된다. 이 스캔 펄스(scan)의 전압(Vy)과 데이터 펄스(data)의 전압(Va) 차와 리셋 기간에 생성된 벽전압이 더해지면서 데이터 펄스(data)가 인가되는 셀 내에는 어드레스 방전이 발생된다. 어드레스 방전에 의해 선택된 셀들 내에는 벽전하가 생성된다.
한편, 셋다운 기간과 어드레스 기간 동안에 유지전극들(Z)에는 서스테인 전압레벨(Vs)의 정극성 직류전압이 공급된다.
서스테인 기간에는 주사전극들(Y)과 유지전극들(Z)에 서스테인 전압(Vs) 크기의 서스테인 펄스(sus)가 교번적으로 인가된다. 그러면 어드레스 방전에 의해 선택된 셀은 셀 내의 벽전압과 서스테인 펄스(sus)가 더해지면서 매 서스테인 펄스(sus)가 인가될 때 마다 주사전극(Y)과 유지전극(Z) 사이에 면방전 형태로 서스테인방전이 일어나게 된다. 마지막으로, 서스테인방전이 완료된 후에는 펄스폭이 작은 소거 램프 파형(erase)이 유지전극(Z)에 공급되어 셀 내의 벽전하를 소거시키게 된다.
이와 같은 PDP는 전원이 온(On) 될 때 다수의 전압원들(예를 들면 Vp,Vs,Vy,Va)이 원하는 전압까지 상승될 수 있는 시간을 확보하기 위하여 도 4와 같이 예비 기간 동안 예비방전 파형을 인가시키게 된다.
여기서, 예비 기간 동안에는 방전이 발생되지 않도록 어드레스 기간에는 데이터 펄스가 공급되지 않는다. 그리고, 리셋 기간 및 서스테인 기간은 도 3에 설명된 내용과 동일하므로 자세한 설명은 생략하기로 한다.
그러나, 이와 같은 예비 기간에서는 원치 않는 서스테인 방전이 발생되어 패널에 잔상이 표시되는 문제점이 있다. 이를 상세히 설명하면, PDP 전원이 오프(Off) 되는 시점은 사용자에 의해 결정되기 때문에 방전셀들 내에는 벽전하가 잔류된다. 특히, 이와 같은 벽전하는 PDP의 전원이 오프되기 전에 밝은 휘도를 표시한 방전셀 내에 많이 잔류하게 되고, 이 잔류된 전하들에 의해 예비 기간의 서스테인 기간 동안 원치 않는 서스테인 방전이 발생된다. 따라서, 예비 기간 동안 이전 상태 다시 말해 PDP의 전원이 오프되는 시점에 밝은 화면이 표시되었던 방전셀들의 일부분에서 잔상이 표시된다.
따라서, 본 발명의 목적은 표시 품질을 향상시킬 수 있도록 한 플라즈마 디스플레이 패널의 구동 방법을 제공하는데 있다.
상기 목적을 달성하기 위하여, 본 발명의 실시 예에 따른 프라즈마 디스플레이 패널의 구동 방법은 방전셀 각각에서 화상을 표현하기 위하여 구동파형을 공급하는 데이터 구동기간과 상기 구동파형을 공급하기 위한 전압값들이 원하는 전압까지 상승되기 위한 예비 기간으로 나뉘어 구동되는 플라즈마 디스플레이 패널의 구동방법에 있어서, 상기 데이터 구동기간에 전극들로 공급되는 파형과 상기 예비 기간에 상기 전극들로 공급되는 파형이 상이한 것을 특징으로 한다.
본 발명의 실시 예에 따른 프라즈마 디스플레이 패널의 구동 방법은 상기 예비구간에 포함되는 서브필드의 서스테인 기간 동안 상기 방전셀에 포함된 주사전극 및 유지전극으로 기저전압이 공급되는 것을 특징으로 한다.
본 발명의 실시 예에 따른 프라즈마 디스플레이 패널의 구동 방법은 상기 예비구간에 포함되는 서브필드의 서스테인 기간 동안 상기 방전셀에 포함된 주사전극에 제 1 서스테인 펄스가 공급되는 단계와, 상기 방전셀에 포함된 유지전극에 상기 제 1 서스테인 펄스와 동기되는 제 2 서스테인 펄스가 공급되는 단계를 포함하는 것을 특징으로 한다.
본 발명의 실시 예에 따른 프라즈마 디스플레이 패널의 구동 방법은 상기 예비구간에 포함되는 서브필드의 서스테인 기간 동안 상기 방전셀에 포함된 주사전극 및 유지전극 중 어느 하나의 전극이 플로팅되는 것을 특징으로 한다.
본 발명의 실시 예에 따른 프라즈마 디스플레이 패널의 구동 방법은 상기 플로팅되지 않은 나머지 전극에는 서스테인 펄스가 공급되는 것을 특징으로 한다.
본 발명의 실시 예에 따른 프라즈마 디스플레이 패널의 구동 방법은 상기 예비구간에 포함되는 서브필드의 서스테인 기간 동안 상기 방전셀에 포함된 주사전극 및 유지전극이 플로팅되는 것을 특징으로 한다.
본 발명의 실시 예에 따른 프라즈마 디스플레이 패널의 구동 방법은 상기 예비구간에 포함되는 서브필드의 서스테인 기간 동안 상기 방전셀에 포함된 전극들에 기저전압이 인가되는 것을 특징으로 한다.
본 발명의 실시 예에 따른 프라즈마 디스플레이 패널의 구동 방법은 상기 예비구간에 포함되는 서브필드의 서스테인 기간 동안 상기 방전셀에 포함된 전극들에 상기 기저전압이 대략 1 내지 3 초 동안 바람직하게는 2초 동안 인가되는 것을 특징으로 한다.
상기 목적들 외에 본 발명의 다른 목적 및 특징들은 첨부한 도면들을 참조한 실시 예에 대한 설명을 통하여 명백하게 드러나게 될 것이다.
이하, 도 5 내지 도 9를 참조하여 본 발명의 바람직한 실시 예에 대하여 설명하기로 한다.
도 5는 본 발명의 제 1 실시 예에 따른 PDP의 예비방전 파형을 나타내는 도면이다.
도 5를 참조하면, 본 발명의 제 1 실시 예에 따른 PDP의 예비방전 파형은 방전셀들을 리셋시키기 위한 리셋 기간, 방전셀들을 선택하기 위한 어드레스 기간 및 셀의 방전을 유지시키기 위한 서스테인 기간으로 나뉘어 구동된다. 이때, 예비방전 파형은 도 3에 도시된 데이터 구동파형 이전에 공급된다.
리셋 기간에 있어서, 셋업 기간에는 모든 주사전극들(Y)에 상승 램프 파형(Ramp-up)이 동시에 인가된다. 이 상승 램프 파형(Ramp-up)에 의해 전화면의 셀들 내에는 미약한 방전이 일어나게 되어 셀들 내에 벽전하가 생성된다. 여기서, 상승 램프 파형(Ramp-up)의 전압이 원하는 전압(Vp)으로 상승되지 못했기 때문에 방전셀들 내에서 원하는 리셋 방전이 발생되지 못한다. 셋다운 기간에는 상승 램프 파형(Ramp-up)이 공급된 후, 상승 램프 파형(Ramp-up)의 피크전압보다 낮은 정극성 전압에서 떨어지는 하강 램프 파형(Ramp-down)이 주사전극들(Y)에 동시에 인가된다.
어드레스 기간에는 부극성 스캔 펄스(scan)가 주사전극들(Y)에 순차적으로 인가되고 어드레스전극들(X)에는 기저전압이 인가된다. 이때, 주사전극(Y)과 어드레스전극(X) 사이에는 어드레스 방전을 일으킬 만한 전위차가 발생하지 않으므로 즉, 데이터 펄스가 공급되지 않기 때문에 어드레스 방전은 일어나지 않게 된다.
한편, 셋다운 기간과 어드레스 기간 동안에 유지전극들(Z)에는 서스테인 전압레벨(Vs)의 정극성 직류전압이 공급된다.
서스테인 기간에는 주사전극(Y) 및 유지전극(Z)에 기저전압이 공급된다. 이와같이 기전전압이 주사전극(Y) 및 유지전극(Z)에 공급되면 예비 기간에 포함되는 서브필드의 서스테인 기간 동안 서스테인 방전이 일어나지 않는다. 즉, 주사전극(Y)과 유지전극(Z) 사이에는 서스테인 오방전이 일어나지 않게 되어 예비 기간 동안 잔상이 표시되지 것을 방지 할 수 있다.
실제로, 예비 기간에는 전극들(Y,Z,X)의 전압이 원하는 전압(예를 들면, Vp,Vy,Vs,Va)까지 상승될 수 있도록 도 5와 같은 서브필드가 다수 공급된다. 이후, 도 3에 도시된 데이터 구동파형이 전극들(주사전극, 유지전극 및 어드레스전극)에 인가되어 PDP의 화상을 구현하게 된다. 이때, 도 3 및 도 5에 도시된 바와 같이 예비방전 파형과 데이터 구동파형은 상이함을 알 수 있다.
도 6은 본 발명의 제 2 실시 예에 따른 PDP의 예비방전 파형을 나타내는 도면이다.
도 6을 참조하면, 본 발명의 제 2 실시 예에 따른 PDP의 예비방전 파형은 방전셀들을 리셋시키기 위한 리셋 기간, 방전셀들을 선택하기 위한 어드레스 기간 및 셀의 방전을 유지시키기 위한 서스테인 기간으로 나뉘어 구동된다.
여기서, 리셋 기간 및 어드레스 기간은 본 발명의 제 1 실시 예와 동일한 파형을 가지고 구동되므로 자세한 설명은 생략하기로 한다.
서스테인 기간 동안 동기화된 다시 말해 동일한 시간에 동일한 크기의 서스테인 펄스(sus)가 주사전극들(Y)과 유지전극들(Z)에 공급된다. 이와 같이 주사전극들(Y)과 유지전극들(Z)에 동기화된 서스테인 펄스(sus)가 공급되면 주사전극들(Y)과 유지전극들(Z) 사이에는 전위차가 발생하지 않으므로 서스테인 방전이 일어나지 않게 된다. 즉, 주사전극(Y)과 유지전극(Z) 사이에는 서스테인 오방전이 일어나지 않게 되어 예비 기간 동안 잔상이 표시되지 것을 방지 할 수 있다.
실제로, 예비 기간에는 전극들(Y,Z,X)의 전압이 원하는 전압(예를 들면, Vp,Vy,Vs,Va)까지 상승될 수 있도록 도 6과 같은 서브필드가 다수 공급된다. 이후, 도 3에 도시된 데이터 구동파형이 전극들(주사전극, 유지전극 및 어드레스전극)에 인가되어 PDP의 화상을 구현하게 된다. 이때, 도 3 및 도 6에 도시된 바와 같이 예비방전 파형과 데이터 구동파형은 상이함을 알 수 있다.
도 7은 본 발명의 제 3 실시 예에 따른 PDP의 예비방전 파형을 나타내는 도면이다.
도 7을 참조하면, 본 발명의 제 3 실시 예에 따른 PDP의 예비방전 파형은 방전셀들을 리셋시키기 위한 리셋 기간, 방전셀들을 선택하기 위한 어드레스 기간 및 셀의 방전을 유지시키기 위한 서스테인 기간으로 나뉘어 구동된다.
여기서, 리셋 기간 및 어드레스 기간은 본 발명의 제 1 실시 예와 동일한 파형을 가지고 구동되므로 자세한 설명은 생략하기로 한다.
서스테인 기간 동안 주사전극들(Y) 및 유지전극들(Z) 중 적어도 어느 하나 예를 들면 주사전극들(Y)에 서스테인 펄스(sus)가 인가된다. 이때, 나머지 전극(Y 또는 Z)은 서스테인 펄스(sus)가 인가된 전극(Y 또는 Z)에 의해 1/2 서스테인 펄스(sus)가 유도된다. 이때, 1/2 서스테인 펄스(sus)는 플로팅(Floating) 상태로 유도된다. 이로 인해, 주사전극(Y)과 유지전극(Z) 사이에는 서스테인 방전이 일어나지 않게 된다. 즉, 주사전극(Y)과 유지전극(Z) 사이에는 서스테인 오방전이 일어나지 않게 되어 예비 기간 동안 잔상이 표시되지 것을 방지 할 수 있다.
실제로, 예비 기간에는 전극들(Y,Z,X)의 전압이 원하는 전압(예를 들면, Vp,Vy,Vs,Va)까지 상승될 수 있도록 도 7과 같은 서브필드가 다수 공급된다. 이후, 도 3에 도시된 데이터 구동파형이 전극들(주사전극, 유지전극 및 어드레스전극)에 인가되어 PDP의 화상을 구현하게 된다. 이때, 도 3 및 도 7에 도시된 바와 같이 예비방전 파형과 데이터 구동파형은 상이함을 알 수 있다.
도 8은 본 발명의 제 4 실시 예에 따른 PDP의 예비방전 파형을 나타내는 도면이다.
도 8을 참조하면, 본 발명의 제 4 실시 예에 따른 PDP의 예비방전 파형은 방전셀들을 리셋시키기 위한 리셋 기간, 방전셀들을 선택하기 위한 어드레스 기간 및 셀의 방전을 유지시키기 위한 서스테인 기간으로 나뉘어 구동된다.
여기서, 리셋 기간 및 어드레스 기간은 본 발명의 제 1 실시 예와 동일한 파형을 가지고 구동되므로 자세한 설명은 생략하기로 한다.
서스테인 기간 동안 주사전극들(Y)과 유지전극들(Z)에 플로팅된 상태의 서스테인 펄스(sus)가 인가된다. 이로 인해, 주사전극들(Y)과 유지전극들(Z) 사이에는 서스테인 방전이 일어나지 않게 된다. 즉, 주사전극(Y)과 유지전극(Z) 사이에는 서스테인 오방전이 일어나지 않게 되어 예비 기간 동안 잔상이 표시되지 것을 방지 할 수 있다.
실제로, 예비 기간에는 전극들(Y,Z,X)의 전압이 원하는 전압(예를 들면, Vp,Vy,Vs,Va)까지 상승될 수 있도록 도 8과 같은 서브필드가 다수 공급된다. 이후, 도 3에 도시된 데이터 구동파형이 전극들(주사전극, 유지전극 및 어드레스전극)에 인가되어 PDP의 화상을 구현하게 된다. 이때, 도 3 및 도 8에 도시된 바와 같이 예비방전 파형과 데이터 구동파형은 상이함을 알 수 있다.
도 9는 본 발명의 제 5 실시 예에 따른 PDP의 예비방전 파형을 나타내는 도면이다.
도 9를 참조하면, 본 발명의 제 5 실시 예에 따른 PDP는 방전셀 각각에서 화상을 표현하기 위하여 구동파형을 공급하는 데이터 구동 기간 이전의 예비 기간 동안 전극들(Y,Z,X)에 기저전압이 공급된다. 여기서, 예비 기간은 구동파형의 전압 값들이 원하는 전압(Vp,Va,-Vy,Vs)까지 상승되도록 1 내지 3초 동안 바람직하게는 2초로 설정된다. 다시 말해, 본 발명의 제 5 실시 예에 따른 PDP의 예비방전 파형은 1 내지 3초 동안 바람직하게는 2초 동안 주사전극(Y), 유지전극(Z) 및 어드레스전극(X)에 기저전압이 인가된다. 이때, 예비방전 기간 동안 PDP의 이전 구동 상태 다시 말해 PDP의 오프 동작 시 방전셀 내에 잔존하는 전하들은 제거된다. 이로 인해, PDP의 이전 구동 상태에 따른 잔상이 발생되지 않아 PDP의 표시 품질을 향상시킬 수 있다. 이후, 데이터 구동 기간 동안 주사전극(Y), 유지전극(Z) 및 어드레스전극(X)에는 원하는 전압들이 공급되어 PDP는 안정적으로 화상을 표시하게 된다.
상술한 바와 같이, 본 발명에 따른 플라즈마 디스플레이 패널의 구동 방법은 서스테인 기간 동안 서스테인 오방전을 방지하여 플라즈마 디스플레이 패널의 온 동작 시 이전 구동 상태에 의한 잔상을 해결함으로써 표시 품질을 향상시킬 수 있다. 또한, 데이터 구동 파형이 입력되기 이전에 대략 1 내지 3초 간 바람직하게는 2초 정도 기저전압을 공급하여 방전셀 내에 잔존하는 전하들을 제거하여 전화면의 잔상을 방지함으로써 표시 품질을 향상시킬 수 있다.
이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을것이다. 따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의해 정하여 져야만 할 것이다.
도 1은 종래의 3전극 교류 면방전형 플라즈마 디스플레이 패널의 방전셀 구조를 나타내는 사시도.
도 2는 종래의 플라즈마 디스플레이 패널의 한 프레임을 나타내는 도면.
도 3은 종래의 플라즈마 디스플레이 패널의 구동방법을 나타내는 파형도.
도 4는 종래의 플라즈마 디스플레이 패널의 예비방전 파형도.
도 5는 본 발명의 제 1 실시 예에 따른 플라즈마 디스플레이 패널의 예비방전 파형도.
도 6은 본 발명의 제 2 실시 예에 따른 플라즈마 디스플레이 패널의 예비방전 파형도.
도 7은 본 발명의 제 3 실시 예에 따른 플라즈마 디스플레이 패널의 예비방전 파형도.
도 8은 본 발명의 제 4 실시 예에 따른 플라즈마 디스플레이 패널의 예비방전 파형도.
도 9는 본 발명의 제 5 실시 예에 따른 플라즈마 디스플레이 패널의 예비방전 파형도.
<도면의 주요 부분에 대한 부호의 설명>
10 : 상부기판 12Y,12Z : 투명전극
13Y,13Z : 버스전극 14,22 : 유전체층
16 : 보호막 18 : 하부기판
24 : 격벽 26 : 형광체층

Claims (8)

  1. 방전셀 각각에서 화상을 표현하기 위하여 구동파형을 공급하는 데이터 구동기간과 상기 구동파형을 공급하기 위한 전압값들이 원하는 전압까지 상승되기 위한 예비 기간으로 나뉘어 구동되는 플라즈마 디스플레이 패널의 구동방법에 있어서,
    상기 데이터 구동기간에 전극들로 공급되는 파형과 상기 예비 기간에 상기 전극들로 공급되는 파형이 상이한 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 방법.
  2. 제 1 항에 있어서,
    상기 예비구간에 포함되는 서브필드의 서스테인 기간 동안 상기 방전셀에 포함된 주사전극 및 유지전극으로 기저전압이 공급되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 방법.
  3. 제 1 항에 있어서,
    상기 예비구간에 포함되는 서브필드의 서스테인 기간 동안 상기 방전셀에 포함된 주사전극에 제 1 서스테인 펄스가 공급되는 단계와,
    상기 방전셀에 포함된 유지전극에 상기 제 1 서스테인 펄스와 동기되는 제 2 서스테인 펄스가 공급되는 단계를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 방법.
  4. 제 3 항에 있어서,
    상기 예비구간에 포함되는 서브필드의 서스테인 기간 동안 상기 방전셀에 포함된 주사전극 및 유지전극 중 어느 하나의 전극이 플로팅되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 방법.
  5. 제 4 항에 있어서,
    상기 플로팅되지 않은 나머지 전극에는 서스테인 펄스가 공급되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 방법.
  6. 제 1 항에 있어서,
    상기 예비구간에 포함되는 서브필드의 서스테인 기간 동안 상기 방전셀에 포함된 주사전극 및 유지전극이 플로팅되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 방법.
  7. 제 1 항에 있어서,
    상기 예비구간에 포함되는 서브필드의 서스테인 기간 동안 상기 방전셀에 포함된 전극들에 기저전압이 인가되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 방법.
  8. 제 7 항에 있어서,
    상기 예비구간에 포함되는 서브필드의 서스테인 기간 동안 상기 방전셀에 포함된 전극들에 상기 기저전압이 대략 1 내지 3 초 동안 바람직하게는 2초 동안 인가되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 방법.
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