KR20040107567A - 플라즈마 디스플레이 패널의 구동방법 - Google Patents

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Abstract

본 발명은 구동효율을 향상시킴과 아울러 오방전을 방지할 수 있도록 한 플라즈마 디스플레이 패널의 구동방법에 관한 것이다.
본 발명에 의한 플라즈마 디스플레이 패널의 구동방법은 서스테인 기간동안 주사전극 및 유지전극에 교번적으로 서스테인 펄스가 공급되는 단계와; 서스테인 일부 기간동안 어드레스 전극에 정극성의 직류전압이 공급되는 단계를 포함한다.

Description

플라즈마 디스플레이 패널의 구동방법{DRIVING METHOD OF PLASMA DISPLAY PANEL}
본 발명은 플라즈마 디스플레이 패널의 구동방법에 관한 것으로 특히, 구동효율을 향상시킴과 아울러 오방전을 방지할 수 있도록 한 플라즈마 디스플레이 패널의 구동방법에 관한 것이다.
플라즈마 디스플레이 패널(Plasma Display Panel : 이하 "PDP"라 한다)은He+Xe, Ne+Xe, He+Xe+Ne 등의 불활성 혼합가스가 방전할 때 발생하는 자외선이 형광체를 발광시킴으로써 화상을 표시하게 된다. 이러한 PDP는 박막화와 대형화가 용이할 뿐만 아니라 최근의 기술 개발에 힘입어 화질이 향상되고 있다.
도 1을 참조하면, 3전극 교류 면방전형 PDP의 방전셀은 상부기판(10) 상에 형성되어진 주사전극(30Y) 및 유지전극(30Z)과, 하부기판(18) 상에 형성되어진 어드레스전극(20X)을 구비한다.
주사전극(30Y)과 유지전극(30Z) 각각은 투명전극(12Y,12Z)과, 투명전극(12Y,12Z)의 선폭보다 작은 선폭을 가지며 투명전극의 일측 가장자리에 형성되는 금속버스전극(13Y,13Z)을 포함한다. 투명전극(12Y,12Z)은 통상 인듐틴옥사이드(Indium-Tin-Oxide : ITO)로 상부기판(10) 상에 형성된다. 금속버스전극(13Y,13Z)은 통상 크롬(Cr) 등의 금속으로 투명전극(12Y,12Z) 상에 형성되어 저항이 높은 투명전극(12Y,12Z)에 의한 전압강하를 줄이는 역할을 한다.
주사전극(30Y)과 유지전극(30Z)이 나란하게 형성된 상부기판(10)에는 상부 유전체층(14)과 보호막(16)이 적층된다. 상부 유전체층(14)에는 플라즈마 방전시 발생된 벽전하가 축적된다. 보호막(16)은 플라즈마 방전시 발생된 스퍼터링에 의한 상부 유전체층(14)의 손상을 방지함과 아울러 2차 전자의 방출 효율을 높이게 된다. 보호막(16)으로는 통상 산화마그네슘(MgO)이 이용된다.
어드레스전극(20X)이 형성된 하부기판(18) 상에는 하부 유전체층(22), 격벽(24)이 형성되며, 하부 유전체층(22)과 격벽(24) 표면에는 형광체층(26)이 도포된다. 어드레스전극(20X)은 주사전극(30Y) 및 유지전극(30Z)과 교차되는 방향으로 형성된다. 격벽(24)은 어드레스전극(20X)과 나란하게 형성되어 방전에 의해 생성된 자외선 및 가시광이 인접한 방전셀에 누설되는 것을 방지한다. 형광체층(26)은 플라즈마 방전시 발생된 자외선에 의해 여기되어 적색, 녹색 또는 청색 중 어느 하나의 가시광선을 발생하게 된다. 상/하부기판(10,18)과 격벽(24) 사이에 마련된 방전공간에는 불활성 혼합가스가 주입된다.
PDP는 화상의 계조를 구현하기 위하여, 한 프레임을 발광횟수가 다른 여러 서브필드로 나누어 시분할 구동하게 된다. 각 서브필드는 전화면을 초기화시키기 위한 초기화기간과, 주사라인을 선택하고 선택된 주사라인에서 셀을 선택하기 위한 어드레스기간과, 방전횟수에 따라 계조를 구현하는 서스테인기간으로 나뉘어진다. 여기서, 초기화기간은 상승램프파형이 공급되는 셋업기간과 하강램프파형이 공급되는 셋다운 기간으로 나뉘어진다.
예를 들어, 256 계조로 화상을 표시하고자 하는 경우에 도 2와 같이 1/60 초에 해당하는 프레임 기간(16.67ms)은 8개의 서브필드들(SF1내지SF8)로 나누어지게 된다. 8개의 서브 필드들(SF1내지SF8) 각각은 전술한 바와 같이, 초기화기간, 어드레스기간과 서스테인기간으로 나누어지게 된다. 각 서브필드의 초기화기간과 어드레스 기간은 각 서브필드마다 동일한 반면에 서스테인 기간은 각 서브필드에서 2n(n=0,1,2,3,4,5,6,7)의 비율로 증가된다.
도 3은 두 개의 서브필드에 공급되는 PDP의 구동파형을 나타낸다.
도 3에 있어서, Y는 주사전극을 나타내며, Z는 유지전극을 나타낸다. 그리고 X는 어드레스전극을 나타낸다.
도 3을 참조하면, PDP는 전화면을 초기화시키기 위한 리셋기간, 셀을 선택하기 위한 어드레스 기간 및 선택된 셀의 방전을 유지시키기 위한 서스테인기간으로 나누어 구동된다.
리셋기간에 있어서, 셋업기간에는 모든 주사전극들(Y)에 상승 램프파형(Ramp-up)이 동시에 인가된다. 이 상승 램프파형(Ramp-up)에 의해 전화면의 셀들 내에는 미약한 방전이 일어나게 되어 셀들 내에 벽전하가 생성된다. 셋다운기간에는 상승 램프파형(Ramp-up)이 공급된 후, 상승 램프파형(Ramp-up)의 피크전압보다 낮은 정극성 전압에서 떨어지는 하강 램프파형(Ramp-down)이 주사전극들(Y)에 동시에 인가된다. 하강 램프파형(Ramp-down)은 셀들 내에 미약한 소거방전을 일으킴으로써 셋업방전에 의해 생성된 벽전하 및 공간전하 중 불요전하를 소거시키게 되고 전화면의 셀들 내에 어드레스 방전에 필요한 벽전하를 균일하게 잔류시키게 된다.
어드레스기간에는 부극성 스캔펄스(scan)가 주사전극들(Y)에 순차적으로 인가됨과 동시에 어드레스전극들(X)에 정극성의 데이터펄스(data)가 인가된다. 이 스캔펄스(scan)와 데이터펄스(data)의 전압차와 초기화기간에 생성된 벽전압이 더해지면서 데이터펄스(data)가 인가되는 셀 내에는 어드레스 방전이 발생된다. 어드레스방전에 의해 선택된 셀들 내에는 벽전하가 생성된다.
한편, 셋다운기간과 어드레스기간 동안에 유지전극들(Z)에는 서스테인전압레벨(Vs)의 정극성 직류전압이 공급된다.
서스테인기간에는 주사전극들(Y)과 유지전극들(Z)에 교번적으로 서스테인펄스(sus)가 인가된다. 그러면 어드레스방전에 의해 선택된 셀은 셀 내의 벽전압과 서스테인펄스(sus)가 더해지면서 매 서스테인펄스(sus)가 인가될 때 마다 주사전극(Y)과 유지전극(Z) 사이에 면방전 형태로 서스테인방전이 일어나게 된다. 마지막으로, 서스테인방전이 완료된 후에는 펄스폭이 작은 소거 램프파형(erase)이 유지전극(Z)에 공급되어 셀 내의 벽전하를 소거시키게 된다.
하지만, 이와 같은 종래의 PDP에서는 어드레스전극들(X)에 형성되는 벽전하에 의하여 방전효율이 저하되는 문제점이 있다. 이를 상세히 설명하면, 서스테인 펄스가 교번적으로 주사전극들(Y) 및 유지전극들(Z)로 공급되는 서스테인 기간동안 어드레스전극들(X)은 기저전위를 유지한다. 여기서, 기저전위를 유지하는 어드레스전극들(X)에는 서스테인 방전에 의하여 생성된 소정의 벽전하들이 쌓이고, 이 벽전하들에 의하여 발광효율이 낮은 서스테인 방전이 발생된다. 실제로, 어드레스전극들(X)에 형성되는 벽전하들은 대략 서스테인 펄스의 전압레벨의 절반정도의 벽전압을 갖게된다.
이러한 문제점을 해결하기 위하여, 도 4와 같이 서스테인 기간동안 어드레스전극들(X)에 어드레스전압레벨(Va)의 정극성 직류전압을 공급하는 방법에 제안되었다. 서스테인 기간동안 어드레스전극들(X)에 어드레스전압레벨(Va)의 정극성 직류전압이 공급되면 어드레스전극들(X)에 형성되는 벽전하들이 최소화되고, 이에 따라 구동효율이 향상되게 된다. 다시 말하여, 어드레스전극들(X)에 형성되는 벽전하들의 벽전압을 낮춤으로써 안정된 서스테인 방전이 일어나도록 한다. 실제, 실험적으로 서스테인 기간동안 어드레스전극들(X)에 어드레스전압레벨(Va)의 정극성 직류전압이 공급되면 PDP의 구동효율이 향상된다.
그러나, 도 4에 도시된 구동방법은 한 프레임에 선택적 쓰기 서브필드와 선택적 소거 서브필드가 동시에 존재하는 경우 오방전이 발생되는 문제점이 있다. 이를 도 5를 참조하여 설명하면, 선택적 소거 서브필드들의 경우 어드레스 기간과 서스테인 기간만으로 구성되므로 서스테인 기간후에 바로 어드레스 방전으로 이어진다. 그런데, 구동효율을 높이기 위해 선택적 소거 서브필드가 시작되기 이전 서브필드에서 서스테인 기간동안 어드레스 전극들(X)에 어드레스전압레벨(Va)의 정극성 직류전압을 공급하게 되면 방전조건이 달라지게 되어 상대적으로 어드레스전극들(X)에 쌓이는 정극성의 벽전하의 양이 줄어들게 되므로 이후 이어지는 어드레스 방전에서는 어드레스전극들(X)의 벽전압 양이 부족해지므로 오방전 현상이 발생하게 된다.
따라서, 본 발명의 목적은 구동효율을 향상시킴과 아울러 오방전을 방지할 수 있도록 한 플라즈마 디스플레이 패널의 구동방법을 제공하는데 있다.
도 1은 종래의 3전극 교류 면방전형 플라즈마 디스플레이 패널의 방전셀 구조를 나타내는 사시도.
도 2는 도 1에 도시된 플라즈마 디스플레이 패널의 한 프레임을 나타내는 도면.
도 3은 도 1에 도시된 플라즈마 디스플레이 패널에 인가되는 구동파형을 나타내는 파형도.
도 4는 도 1에 도시된 플라즈마 디스플레이 패널에 인가되는 다른 구동파형을 나타내는 파형도.
도 5는 도 4에 도시된 구동파형을 이용하여 선택적 쓰기 및 소거 방식으로 구동되는 플라즈마 디스플레이 패널 구동방법을 나타내는 도면.
도 6은 본 발명의 제 1 실시 예에 의한 플라즈마 디스플레이 패널의 구동방법을 나타내는 도면.
도 7은 도 6의 구동파형이 이용되는 선택적 쓰기 및 소거 방식으로 구동되는 플라즈마 디스플레이 패널의 구동방법을 나타내는 도면.
도 8은 본 발명의 제 2 실시 예에 의한 플라즈마 디스플레이 패널의 구동방법을 나타내는 도면.
도 9는 도 8의 구동파형이 이용되는 선택적 쓰기 및 소거 방식으로 구동되는 플라즈마 디스플레이 패널의 구동방법을 나타내는 도면.
< 도면의 주요 부분에 대한 부호의 설명 >
10 : 상부기판 12Y,12Z : 투명전극
13Y,13Z : 버스전극 14,22 : 유전체층
16 : 보호막 18 : 하부기판
20X : 어드레스전극 24 : 격벽
26 : 형광체층 30Y : 주사전극
30Z : 유지전극
상기 목적을 달성하기 위하여, 본 발명의 실시 예에 의한 플라즈마 디스플레이 패널의 구동방법은 서스테인 기간동안 주사전극 및 유지전극에 교번적으로 서스테인 펄스가 공급되는 단계와; 서스테인 일부 기간동안 어드레스전극에 정극성의 직류전압이 공급되는 단계를 포함한다.
상기 플라즈마 디스플레이 패널의 구동방법에서 정극성의 직류전압은 상기 서스테인 기간의 후반부를 제외한 기간동안 공급되는 것을 특징으로 한다.
상기 플라즈마 디스플레이 패널의 구동방법에서 서스테인 기간의 후반부는 적어도 하나 이상의 서스테인 펄스를 포함하는 기간인 것을 특징으로 한다.
상기 플라즈마 디스플레이 패널의 구동방법에서 서스테인 기간의 후반부에는 상기 어드레스전극에 기저전위가 공급되는 것을 특징으로 한다.
상기 플라즈마 디스플레이 패널의 구동방법에서 정극성의 직류전압에서 상기 기저전위로 상기 어드레스전극에 인가되는 전압이 변화되는 순간에 상기 주사전극 및 유지전극에는 기저전위가 공급되는 것을 특징으로 한다.
상기 목적 외에 본 발명의 다른 목적 및 특징들은 첨부도면을 참조한 실시예에 대한 설명을 통하여 명백하게 드러나게 될 것이다.
이하, 도 6 내지 도 9를 참조하여 본 발명의 바람직한 실시 예들에 대하여 설명하기로 한다.
도 6은 본 발명의 제 1 실시 예에 의한 플라즈마 디스플레이 패널의 구동방법을 나타내는 도면이다.
도 6에 있어서, Y는 주사전극을 나타내며, Z는 유지전극을 나타낸다. 그리고 X는 어드레스전극을 나타낸다.
도 6을 참조하면, 본 발명의 제 1 실시 예에 의한 PDP는 전화면을 초기화시키기 위한 리셋기간, 셀을 선택하기 위한 어드레스 기간 및 선택된 셀의 방전을 유지시키기 위한 서스테인기간으로 나누어 구동된다.
리셋기간에 있어서, 셋업기간에는 모든 주사전극들(Y)에 상승 램프파형(Ramp-up)이 동시에 인가된다. 이 상승 램프파형(Ramp-up)에 의해 전화면의 셀들 내에는 미약한 방전이 일어나게 되어 셀들 내에 벽전하가 생성된다. 셋다운기간에는 상승 램프파형(Ramp-up)이 공급된 후, 상승 램프파형(Ramp-up)의 피크전압보다 낮은 정극성 전압에서 떨어지는 하강 램프파형(Ramp-down)이 주사전극들(Y)에 동시에 인가된다. 하강 램프파형(Ramp-down)은 셀들 내에 미약한 소거방전을 일으킴으로써 셋업방전에 의해 생성된 벽전하 및 공간전하 중 불요전하를 소거시키게 되고 전화면의 셀들 내에 어드레스 방전에 필요한 벽전하를 균일하게 잔류시키게 된다.
어드레스기간에는 부극성 스캔펄스(scan)가 주사전극들(Y)에 순차적으로 인가됨과 동시에 어드레스전극들(X)에 정극성의 데이터펄스(data)가 인가된다. 이 스캔펄스(scan)와 데이터펄스(data)의 전압차와 초기화기간에 생성된 벽전압이 더해지면서 데이터펄스(data)가 인가되는 셀 내에는 어드레스 방전이 발생된다. 어드레스방전에 의해 선택된 셀들 내에는 벽전하가 생성된다.
한편, 셋다운기간과 어드레스기간 동안에 유지전극들(Z)에는 서스테인전압레벨(Vs)의 정극성 직류전압이 공급된다.
서스테인기간에는 주사전극들(Y)과 유지전극들(Z)에 교번적으로 서스테인펄스(sus)가 인가된다. 그리고, 어드레스전극들(X)에 서스테인 방전이 끝나기 전 적어도 하나 이상의 서스테인 펄스 이전에, 예를 들면 마지막 서스테인 펄스쌍이 공급되기 전까지 어드레스전압레벨(Va)의 정극성 직류전압이 인가된다. 그러면 어드레스방전에 의해 선택된 셀은 셀 내의 벽전압과 서스테인펄스(sus)가 더해지면서 매 서스테인펄스(sus)가 인가될 때 마다 주사전극들(Y)과 유지전극들(Z) 사이에 면방전 형태로 서스테인방전이 일어나게 된다. 그리고, 어드레스전극들(X)에 어드레스전압레벨(Va)의 정극성 직류전압이 인가되므로 어드레스전극들(X)에 벽전하가 쌓이지 않게 되어 서스테인 방전이 보다 효율적으로 발생하게 된다. 또한, 도 6의 (A)에서처럼 서스테인 방전이 끝나기 전 적어도 하나 이상의 서스테인 펄스에, 예를 들면 마지막 서스테인 펄스쌍에서 어드레스전극들(X)에 기저전위를 인가함으로써 이후 어드레스기간이 바로 시작되는 선택적 소거 서브필드로 넘어가도라도 어드레스전극들(X)의 벽전압 양이 충분하므로 안정된 어드레스 방전을 할 수 있게 된다.
이를 상세히 설명하면, 도 7에 도시된 바와 같이 선택적 쓰기 서브필드 이후에 선택적 소거 서브필드가 이어질 경우 마지막 선택적 쓰기 서브필드의 서스테인 기간은 이후 이어지는 첫 번째 선택적 소거 서브필드을 위한 리셋기간이라고 볼 수 있다. 이 서스테인 기간동안 어드레스전극들(X)에 어드레스전압레벨(Va)의 정극성 직류전압을 인가하여 어드레스전극들(X)에 벽전하가 쌓이지 않게 함으로써 구동효율을 향상시키게 된다. 그런데, 어드레스전극들(X)에 어드레스전압레벨(Va)의 정극성 직류전압을 인가하게 되면 상대적으로 어드레스전극들(X)에 형성되는 벽전하의 양이 줄어들게 되므로 이후 이어지는 선택적 소거 서브필드의 어드레스방전에서는 어드레스전극들(X)의 벽전압 양이 부족해지므로 오방전이 발생할 수 있다. 따라서, 도 7에 도시된 바와 같이 선택적 소거 서브필드로 넘어가기 전의 마지막 선택적 쓰기 서브필드의 서스테인 방전이 끝나기 전 적어도 하나 이상의 서스테인 펄스에서, 예를 들면 마지막 서스테인펄스쌍에서 (B)처럼 어드레스전극들(X)에 기저전위를 인가한다. 이에 따라, 어드레스전극들(X)에 벽전하가 충분히 쌓이게 되어 이후 어드레스기간이 바로 시작되는 선택적 소거 서브필드로 넘어가도라도 어드레스전극들(X)의 벽전압 양이 충분하므로 안정된 어드레스 방전을 할 수 있게 된다.
한편, 통상적으로 서스테인 펄스는 주사전극들(Y) 및 유지전극들(Z)에서 교번적으로 공급되며, 교번적으로 공급되는 두 서스테인 펄스 사이는 쉬는 시간 없이 서스테인 동작이 연속적으로 동작하고 있다. 교번적으로 공급되는 두 서스테인 펄스 사이에 쉬는 시간이 확보되더라도 매우 짧은 시간 간격(최대 수백ns 정도)을 가지고 있을 뿐이며 실제 구동에서는 방전 전류 및 라이징(rising) 현상 등에 의해 안정된 전압을 유지하기 어렵다. 따라서, 서스테인 펄스가 쉬지 않고 동작하는 기간 안에서 본 발명의 제 1 실시 예에서와 같이 어드레스전극들(X)에 인가되는 어드레스전압레벨(Va)의 정극성 직류전압을 제거시키면 자칫 과도한 전압 변화에 의해 회로 부품의 파손 및 오방전 현상을 발생시킬 수 있다. 이에 따라, 도 8과 같은 구동방법이 제안된다.
도 8은 본 발명의 제 2 실시 예에 의한 플라즈마 디스플레이 패널의 구동방법을 나타내는 도면이다.
도 8을 참조하면, 본 발명의 제 2 실시 예에 의한 PDP는 전화면을 초기화시키기 위한 리셋기간, 셀을 선택하기 위한 어드레스 기간 및 선택된 셀의 방전을 유지시키기 위한 서스테인기간으로 나누어 구동된다.
리셋기간에 있어서, 셋업기간에는 모든 주사전극들(Y)에 상승 램프파형(Ramp-up)이 동시에 인가된다. 이 상승 램프파형(Ramp-up)에 의해 전화면의 셀들 내에는 미약한 방전이 일어나게 되어 셀들 내에 벽전하가 생성된다. 셋다운기간에는 상승 램프파형(Ramp-up)이 공급된 후, 상승 램프파형(Ramp-up)의 피크전압보다 낮은 정극성 전압에서 떨어지는 하강 램프파형(Ramp-down)이 주사전극들(Y)에 동시에 인가된다. 하강 램프파형(Ramp-down)은 셀들 내에 미약한 소거방전을 일으킴으로써 셋업방전에 의해 생성된 벽전하 및 공간전하 중 불요전하를 소거시키게 되고 전화면의 셀들 내에 어드레스 방전에 필요한 벽전하를 균일하게 잔류시키게 된다.
어드레스기간에는 부극성 스캔펄스(scan)가 주사전극들(Y)에 순차적으로 인가됨과 동시에 어드레스전극들(X)에 정극성의 데이터펄스(data)가 인가된다. 이 스캔펄스(scan)와 데이터펄스(data)의 전압차와 초기화기간에 생성된 벽전압이 더해지면서 데이터펄스(data)가 인가되는 셀 내에는 어드레스 방전이 발생된다. 어드레스방전에 의해 선택된 셀들 내에는 벽전하가 생성된다.
한편, 셋다운기간과 어드레스기간 동안에 유지전극들(Z)에는 서스테인전압레벨(Vs)의 정극성 직류전압이 공급된다.
서스테인기간에는 주사전극들(Y)과 유지전극들(Z)에 교번적으로 서스테인펄스(sus)가 인가된다. 그리고, 어드레스전극들(X)에 서스테인 방전이 끝나기 전 적어도 하나 이상의 서스테인 펄스 이전에, 예를 들면 마지막 서스테인 펄스쌍이 공급되기 전까지 어드레스전압레벨(Va)의 정극성 직류전압이 인가된다. 이 때, 어드레스전극들(X)에 인가되는 어드레스전압레벨(Va)의 정극성 직류전압에서 기저전위로 떨어지는 시점을 전후로 소정기간(△t)동안 주사전극들(Y) 및 유지전극들(Z)에 기저전위를 인가한다. 그러면 어드레스방전에 의해 선택된 셀은 셀 내의 벽전압과 서스테인펄스(sus)가 더해지면서 매 서스테인펄스(sus)가 인가될 때 마다 주사전극들(Y)과 유지전극들(Z) 사이에 면방전 형태로 서스테인방전이 일어나게 된다. 그리고, 어드레스전극들(X)에 어드레스전압레벨(Va)의 정극성 직류전압이 인가되므로 어드레스전극들(X)에 벽전하가 쌓이지 않게 되어 서스테인 방전이 보다 효율적으로 발생하게 된다. 또한, 도 8의 (C)에서처럼 서스테인 방전이 끝나기 전 적어도 하나 이상의 서스테인 펄스에, 예를 들면 마지막 서스테인 펄스쌍에서 어드레스전극들(X)에 기저전위를 인가함과 아울러 어드레스전극들(X)에 인가되는 어드레스전압레벨(Va)의 정극성 직류전압에서 기저전위로 떨어지는 시점을 전후로 소정기간(△t)동안 주사전극들(Y) 및 유지전극들(Z)에 기저전위를 인가함으로써 이후 어드레스기간이 바로 시작되는 선택적 소거 서브필드로 넘어가도라도 어드레스전극들(X)의 벽전압 양이 충분하므로 안정된 어드레스 방전을 할 수 있을 뿐만 아니라 어드레스전극들(X)에 인가되는 어드레스전압레벨(Va)의 정극성 직류전압에서 기저전위로 떨어지는 시점에서 과도한 전압 변화에 의해 회로 부품의 파손 및 오방전 현상을 방지할 수 있게 된다.
이를 상세히 설명하면, 도 9에 도시된 바와 같이 선택적 쓰기 서브필드 이후에 선택적 소거 서브필드가 이어질 경우 마지막 선택적 쓰기 서브필드의 서스테인 기간은 이후 이어지는 첫 번째 선택적 소거 서브필드을 위한 리셋기간이라고 볼 수 있다. 이 서스테인 기간동안 어드레스전극들(X)에 어드레스전압레벨(Va)의 정극성 직류전압을 인가하여 어드레스전극들(X)에 벽전하가 쌓이지 않게 함으로써 구동효율을 향상시키게 된다. 그런데, 어드레스전극들(X)에 어드레스전압레벨(Va)의 정극성 직류전압을 인가하게 되면 상대적으로 어드레스전극들(X)에 형성되는 벽전하의 양이 줄어들게 되므로 이후 이어지는 선택적 소거 서브필드의 어드레스방전에서는 어드레스전극들(X)의 벽전압 양이 부족해지므로 오방전이 발생할 수 있다. 또한, 서스테인 펄스가 쉬지 않고 동작하는 기간 안에서 어드레스전극들(X)에 인가되는 어드레스전압레벨(Va)의 정극성 직류전압을 제거시키면 자칫 과도한 전압 변화에 의해 회로 부품의 파손 및 오방전 현상을 발생시킬 수 있다. 따라서, 도 9에 도시된 바와 같이 선택적 소거 서브필드로 넘어가기 전의 마지막 선택적 쓰기 서브필드의 서스테인 방전이 끝나기 전 적어도 하나 이상의 서스테인 펄스에서, 예를 들면 마지막 서스테인 펄스쌍에서 (D)처럼 어드레스전극들(X)에 기저전위를 인가함과 아울러 어드레스전극들(X)에 인가되는 어드레스전압레벨(Va)의 정극성 직류전압에서 기저전위로 떨어지는 시점을 전후로 소정기간(△t)동안 주사전극들(Y) 및 유지전극들(Z)에 기저전위를 인가함으로써 이후 어드레스기간이 바로 시작되는 선택적 소거 서브필드로 넘어가도라도 어드레스전극들(X)의 벽전압 양이 충분하므로 안정된 어드레스 방전을 할 수 있을 뿐만 아니라 어드레스전극들(X)에 인가되는 어드레스전압레벨(Va)의 정극성 직류전압이 기저전위로 떨어지는 시점에서 과도한 전압변화에 의해 회로 부품의 파손 및 오방전 현상을 방지할 수 있게 된다.
상술한 바와 같이, 본 발명에 따른 플라즈마 디스플레이 패널의 구동방법은 구동효율을 향상시키기 위해 서스테인 기간동안 어드레스전극들에 어드레스전압레벨의 정극성 직류전압을 공급할 때 서스테인 방전이 끝나기 전 적어도 하나 이상의 서스테인 펄스에 해당하는 기간에는 기저전위를 인가함으로써 이후 이어지는 어드레스 방전을 안정화 시킬 수 있다.
아울러, 어드레스전압레벨의 정극성의 직류전압에서 기저전위로 떨어지는 시점을 전후로 소정의 시간동안 주사전극 및 유지전극에 기저전위를 공급하여 과도한 전압 변화에 의해 발생되는 회로 부품의 파손 및 오방전 현상을 방지할 수 있다.
이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의해 정하여져야만 할 것이다.

Claims (5)

  1. 서스테인 기간동안 주사전극 및 유지전극에 교번적으로 서스테인 펄스가 공급되는 단계와;
    상기 서스테인 일부 기간동안 어드레스전극에 정극성의 직류전압이 공급되는 단계를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  2. 제 1 항에 있어서,
    상기 정극성의 직류전압은 상기 서스테인 기간의 후반부를 제외한 기간동안 공급되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  3. 제 2 항에 있어서,
    상기 서스테인 기간의 후반부는 적어도 하나 이상의 서스테인 펄스를 포함하는 기간인 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  4. 제 3 항에 있어서,
    상기 서스테인 기간의 후반부에는 상기 어드레스전극에 기저전위가 공급되는 것을 특징으로 하는 플라즈마 디스프레이 패널의 구동방법.
  5. 제 4 항에 있어서,
    상기 정극성의 직류전압에서 상기 기저전위로 상기 어드레스전극에 인가되는 전압이 변화되는 순간에 상기 주사전극 및 유지전극에는 기저전위가 공급되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
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