KR20050108630A - 플라즈마 디스플레이 패널의 구동방법 - Google Patents

플라즈마 디스플레이 패널의 구동방법 Download PDF

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Abstract

본 발명은 오방전을 방지함과 아울러 콘트라스트를 향상시킬 수 있도록 한 플라즈마 디스플레이 패널의 구동방법에 관한 것이다.
본 발명의 플라즈마 디스플레이 패널의 구동방법은 한 프레임에 포함된 다수의 서브필드 중 적어도 하나 이상의 서브필드의 어드레스기간동안 주사전극에 스캔펄스를 공급함과 아울러 어드레스전극에 데이터펄스를 공급하여 켜질 방전셀을 선택하는 단계와, 적어도 하나 이상의 서브필드의 서스테인기간동안 주사전극 및 유지전극에 서스테인전압을 가지는 서스테인펄스를 교번적으로 공급하는 단계와, 적어도 하나 이상의 서브필드의 서스테인기간동안 유지전극에 마지막 서스테인펄스를 공급하는 단계와, 마지막 서스테인펄스가 공급된 후 주사전극에 기울기를 가지고 상승하는 소거 램프펄스를 인가하는 단계를 포함한다.

Description

플라즈마 디스플레이 패널의 구동방법{Method of Driving Plasma Display Panel}
본 발명은 플라즈마 디스플레이 패널의 구동방법에 관한 것으로 특히, 오방전을 방지함과 아울러 콘트라스트를 향상시킬 수 있도록 한 플라즈마 디스플레이 패널의 구동방법에 관한 것이다.
플라즈마 디스플레이 패널(Plasma Display Panel : 이하 "PDP"라 함)은 He+Xe, Ne+Xe 또는 He+Xe+Ne 등의 불활성 혼합가스의 방전시 발생하는 147nm의 자외선에 의해 형광체를 발광시킴으로써 문자 또는 그래픽을 포함한 화상을 표시하게 된다.
이러한 PDP는 박막화와 대형화가 용이할 뿐만 아니라 최근의 기술 개발에 힘입어 크게 향상된 화질을 제공한다. 특히, 3전극 교류 면방전형 PDP는 방전시 표면에 벽전하가 축적되며 방전에 의해 발생되는 스퍼터링으로부터 전극들을 보호하기 때문에 저전압 구동과 장수명의 장점을 가진다.
도 1을 참조하면, 3전극 교류 면방전형 PDP의 방전셀은 상부기판(10) 상에 형성되어진 주사전극(Y) 및 유지전극(Z)과, 하부기판(18) 상에 형성되어진 어드레스전극(X)을 구비한다. 주사전극(Y)과 유지전극(Z) 각각은 투명전극(12Y,12Z)과, 투명전극(12Y,12Z)의 선폭보다 작은 선폭을 가지며 투명전극의 일측 가장자리에 형성되는 금속버스전극(13Y,13Z)을 포함한다.
투명전극(12Y,12Z)은 통상 인듐틴옥사이드(Indium-Tin-Oxide : ITO)로 상부기판(10) 상에 형성된다. 금속버스전극(13Y,13Z)은 통상 크롬(Cr) 등의 금속으로 투명전극(12Y,12Z) 상에 형성되어 저항이 높은 투명전극(12Y,12Z)에 의한 전압강하를 줄이는 역할을 한다. 주사전극(Y)과 유지전극(Z)이 나란하게 형성된 상부기판(10)에는 상부 유전체층(14)과 보호막(16)이 적층된다. 상부 유전체층(14)에는 플라즈마 방전시 발생된 벽전하가 축적된다. 보호막(16)은 플라즈마 방전시 발생된 스퍼터링에 의한 상부 유전체층(14)의 손상을 방지함과 아울러 2차 전자의 방출 효율을 높이게 된다. 보호막(16)으로는 통상 산화마그네슘(MgO)이 이용된다.
어드레스전극(X)이 형성된 하부기판(18) 상에는 하부 유전체층(22), 격벽(24)이 형성되며, 하부 유전체층(22)과 격벽(24) 표면에는 형광체층(26)이 도포된다. 어드레스전극(X)은 주사전극(Y) 및 유지전극(Z)과 교차되는 방향으로 형성된다. 격벽(24)은 어드레스전극(X)과 나란하게 형성되어 방전에 의해 생성된 자외선 및 가시광이 인접한 방전셀에 누설되는 것을 방지한다. 형광체층(26)은 플라즈마 방전시 발생된 자외선에 의해 여기되어 적색, 녹색 또는 청색 중 어느 하나의 가시광선을 발생하게 된다. 상/하부기판(10,18)과 격벽(24) 사이에 마련된 방전공간에는 불활성 혼합가스가 주입된다.
PDP는 화상의 계조를 구현하기 위하여, 한 프레임을 발광횟수가 다른 여러 서브필드로 나누어 시분할 구동하게 된다. 각 서브필드는 전화면을 초기화시키기 위한 초기화기간과, 주사라인을 선택하고 선택된 주사라인에서 셀을 선택하기 위한 어드레스기간과, 방전횟수에 따라 계조를 구현하는 서스테인기간으로 나뉘어진다.
여기서, 초기화기간은 상승램프파형이 공급되는 셋업기간과 하강램프파형이 공급되는 셋다운 기간으로 나뉘어진다. 예를 들어, 256 계조로 화상을 표시하고자 하는 경우에 도 2와 같이 1/60 초에 해당하는 프레임 기간(16.67ms)은 8개의 서브필드들(SF1내지SF8)로 나누어지게 된다. 8개의 서브 필드들(SF1내지SF8) 각각은 전술한 바와 같이, 초기화기간, 어드레스기간과 서스테인기간으로 나누어지게 된다. 각 서브필드의 초기화기간과 어드레스 기간은 각 서브필드마다 동일한 반면에 서스테인 기간은 각 서브필드에서 2n(n=0,1,2,3,4,5,6,7)의 비율로 증가된다.
전극들(Y,Z,X)로 공급되는 구동파형을 도 3를 참조하여 상세히 설명하면, 먼저 초기화기간 중 셋업기간에는 모든 주사전극들(Y)에 상승 램프파형(Ramp-up)이 동시에 인가된다. 이 상승 램프파형(Ramp-up)에 의해 전화면의 셀들 내에는 미약한 셋업방전이 일어나게 되어 셀들 내에 벽전하가 생성된다. 이때, 정극성의 상승 램프파형(Ramp-up)이 공급된 주사전극들(Y)에는 도 4a와 같이 부극성(-)의 벽전하들이 형성되고, 주사전극들(Y)에 비하여 상대적으로 낮은 전위를 가지는 유지전극들(Z) 및 어드레스전극들(X)에는 정극성(+)의 벽전하들이 형성된다.
셋다운기간에는 상승 램프파형(Ramp-up)이 공급된 후, 상승 램프파형(Ramp-up)의 피크전압보다 낮은 정극성 전압에서 떨어지는 하강 램프파형(Ramp-down)이 주사전극들(Y)에 동시에 인가된다. 하강 램프파형(Ramp-down)은 셀들 내에서 미약한 소거방전을 일으킴으로써 도 4b와 같이 셋업방전에 의해 생성된 벽전하 및 공간전하 중 일부전하를 소거시키게 되고 전화면의 셀들 내에 어드레스 방전에 필요한 벽전하를 균일하게 잔류시키게 된다.
어드레스기간에는 부극성 스캔펄스(scan)가 주사전극들(Y)에 순차적으로 인가됨과 동시에 어드레스전극들(X)에 정극성의 데이터펄스(data)가 인가된다. 주사전극들(Y)에 인가된 스캔펄스(scan)의 전압값은 초기화기간에 주사전극들(Y)에 생성된 부극성의 벽전하와 그 전압값이 합쳐지고 어드레스전극들(X)에 인가된 데이터펄스(data)의 전압값은 초기화기간에 유지전극들(Z)에 생성된 정극성의 벽전하와 그 전압값이 합쳐져 셀 내에는 어드레스 방전이 발생된다. 이때, 부극성의 스캔펄스(scan)가 공급된 주사전극들(Y)에는 도 4c와 같이 정극성(+)의 벽전하들이 형성되고, 정극성의 데이터펄스(data)가 공급된 어드레스전극들(X)에는 부극성(-)의 벽전하들이 형성된다. 여기서, 어드레스전극들(X)에 형성되는 대부분의 부극성(-) 벽전하들은 도 4c와 같이 주사전극들(Y)과의 중첩영역에 형성된다.
한편, 셋다운기간과 어드레스기간 동안에 유지전극들(Z)에는 서스테인전압(Vs)의 정극성 전압이 공급된다.
서스테인 기간에는 주사전극들(Y)과 유지전극들(Z)에 교번적으로 서스테인펄스(sus)가 인가된다. 여기서, 첫번째 서스테인펄스(sus)가 주사전극들(Y)에 인가되기 때문에 첫번째 서스테인펄스(sus)와 어드레스방전에 의하여 주사전극들(Y)에 생성된 정극성(+)의 벽전하 전압값이 합쳐져 셀 내에서 주사전극들(Y)과 유지전극들(Z)간에 서스테인 방전이 발생된다. 그리고, 어드레스방전이 발생되지 않은 셀 내에는 도 4b와 같이 주사전극들(Y)에 부극성(-)의 벽전하가 형성되어 있기 때문에 첫번째 서스테인펄스(sus)에 의하여 서스테인방전이 발생되지 않는다.
이후, 서스테인 기간동안 유지전극들(Z)과 주사전극들(Y)간에 교번적으로 서스테인펄스(sus)를 인가함으로써 어드레스방전에 의해 선택된 셀내에서 서스테인방전을 일으킨다. 한편, 종래의 PDP에서 마지막 서스테인펄스(sus)는 주사전극들(Y)에 인가된다. 따라서, 마지막 서스테인펄스(sus)에 의하여 방전된 서스테인방전에 의하여 도 4d와 같이 주사전극들(Y)에는 부극성(-)의 벽전하가 형성되고, 유지전극들(Z)에는 정극성(+)의 벽전하가 형성된다.
서스테인 기간동안 기저전위를 유지하고 있는 어드레스전극들(X)에는 소정의 전하가 형성된다. 이를 상세히 설명하면, 어드레스방전이 발생된 셀 내에 포함된 어드레스전극들(X)에는 도 4c와 같이 부극성(-)의 벽전하가 형성된다. 이후, 서스테인 기간동안 소정 횟수의 서스테인방전이 발생되고, 이 방전에 발생된 하전입자들이 어드레스전극들(X)로 공급되어 어드레스전극들(X)에는 소정의 차지(Charge)가 형성된다. 실제로, 어드레스전극들(X)에는 서스테인방전 횟수에 대응하여 정극성(+) 또는 부극성(-)의 벽전하가 형성된다.(도 4d의 "X"는 정극성 또는 부극성 전하를 의미한다) 그리고, 서스테인기간동안 어드레스전극들(X)에 형성된 대부분의 차지는 주사전극들(Y)과의 중첩면에 형성된다.
다시 말하여, 서스테인기간 이전에 어드레스전극(X)은 주사전극(Y)과 방전을 일으키게 된다.(셋업방전, 셋다운방전, 어드레스방전) 따라서, 서스테인방전에 의하여 형성된 하전입자들은 부극성(-) 벽전하가 형성된 어드레스전극들(X)로 공급되기 때문에 서스테인기간동안 어드레스전극들(X)에 형성된 대부분의 차지는 주사전극들(Y)과의 중첩면에 위치되게 된다.
서스테인방전이 완료된 후에 유지전극들(Z)에는 소거 램프파형(erase)이 공급된다. 유지전극들(Z)에 정극성(+)의 소거 램프파형(erase)이 인가되면 주사전극(Y)과 유지전극(Z)간에 소거방전이 발생되고, 이 소거방전에 의하여 도 4e와 같이 유지전극들(Z) 및 주사전극들(Y)에 형성된 벽전하들이 일부 소거된다. 이후, 상술한 과정을 반복하면서 PDP에서 소정의 화상을 표시한다.
하지만, 이와 같은 종래의 구동방법에서는 소거방전에 의하여 어드레스전극들(X)에 형성된 차지들을 제거하지 못하기 때문에 오방전이 발생될 염려가 있다. 이를 상세히 설명하면, 어드레스전극들(X)에는 서스테인방전 횟수에 대응되는 차지들이 형성된다. 여기서, 어드레스전극들(X)에 형성되는 대부분의 차지들은 주사전극들(Y)과의 중첩되는 부분에 형성되기 때문에 유지전극들(Z)에 공급되는 소거 램프파형(erase)에 의하여 소거되지 못한다.(즉, 어드레스전극들(X)과 유지전극들(Z)간에 소거방전이 일어나지 않는다) 따라서, 어드레스전극들(X)에 형성되어 있는 차지들은 다음 서브필드의 방전조건의 변화를 초래하고, 이에 따라 PDP에서 오방전이 발생될 염려가 있다. 특히, 어드레스전극들(X)에 의하여 방전조건이 변하는 현상은 서스테인방전 횟수가 많을수록 더욱 크게 나타난다.
따라서, 본 발명의 목적은 오방전을 방지함과 아울러 콘트라스트를 향상시킬 수 있도록 한 플라즈마 디스플레이 패널의 구동방법을 제공하는 것이다.
상기 목적을 달성하기 위하여 본 발명의 플라즈마 디스플레이 패널의 구동방법은 한 프레임에 포함된 다수의 서브필드 중 적어도 하나 이상의 서브필드의 어드레스기간동안 주사전극에 스캔펄스를 공급함과 아울러 어드레스전극에 데이터펄스를 공급하여 켜질 방전셀을 선택하는 단계와, 적어도 하나 이상의 서브필드의 서스테인기간동안 주사전극 및 유지전극에 서스테인전압을 가지는 서스테인펄스를 교번적으로 공급하는 단계와, 적어도 하나 이상의 서브필드의 서스테인기간동안 유지전극에 마지막 서스테인펄스를 공급하는 단계와, 마지막 서스테인펄스가 공급된 후 주사전극에 기울기를 가지고 상승하는 소거 램프펄스를 인가하는 단계를 포함한다.
상기 적어도 하나 이상의 서브필드의 리셋기간동안 셋업전압까지 상승하는 상승 램프파형이 공급되는 단계를 포함한다.
상기 소거 램프펄스의 전압값은 서스테인전압을 초과한다.
상기 소거 램프펄스의 전압값은 셋업전압 이하로 설정된다.
상기 소거 램프펄스의 기울기는 상승 램프파형의 기울기와 동일하게 설정된다.
상기 적어도 하나 이상의 서브필드는 서스테인기간에 공급되는 서스테인펄스의 갯수가 10개 이상인 서브필드이다.
상기 적어도 하나 이상의 서브필드는 서스테인기간에 공급되는 서스테인펄스의 갯수가 50개 이상인 서브필드이다.
상기 적어도 하나 이상의 서브필드는 한 프레임에서 미리 설정된 휘도가중치의 누적계조가 20계조를 초가하는 서브필드들이다.
상기 주사전극에 소거 램프펄스가 인가될 때 유지전극은 플로팅된다.
상기 주사전극에 소거 램프펄스가 인가될 때 유지전극에는 동기 램프펄스가 인가된다.
상기 동기 램프펄스의 전압값은 소거 램프펄스의 전압값 이하로 설정된다.
상기 목적 외에 본 발명의 다른 목적 및 특징들은 첨부도면을 참조한 실시예에 대한 설명을 통하여 명백하게 드러나게 될 것이다.
이하 도 5 내지 도 9를 참조하여 본 발명의 바람직한 실시예에 대하여 설명하기로 한다.
도 5는 본 발명의 실시예에 의한 플라즈마 디스플레이 패널의 구동방법을 나타내는 도면이다.
도 5를 참조하면, 먼저 초기화기간 중 셋업기간에는 모든 주사전극들(Y)에 상승 램프파형(Ramp-up)이 동시에 인가된다. 이 상승 램프파형(Ramp-up)에 의해 전화면의 셀들 내에는 미약한 셋업방전이 일어나게 되어 셀들 내에 벽전하가 생성된다. 이때, 정극성의 상승 램프파형(Ramp-up)이 공급된 주사전극들(Y)에는 도 4a와 같이 부극성(-)의 벽전하들이 형성되고, 주사전극들(Y)에 비하여 상대적으로 낮은 전위를 가지는 유지전극들(Z) 및 어드레스전극들(X)에는 정극성(+)의 벽전하들이 형성된다.
셋다운기간에는 상승 램프파형(Ramp-up)이 공급된 후, 상승 램프파형(Ramp-up)의 피크전압보다 낮은 정극성 전압에서 떨어지는 하강 램프파형(Ramp-up)이 주사전극들(Y)에 동시에 인가된다. 하강 램프파형(Ramp-down)은 셀들 내에서 미약한 소거방전을 일으킴으로써 도 4b와 같이 셋업방전에 의해 생성된 벽전하 및 공간전하 중 일부전하를 소거시키게 되고 전화면의 셀들 내에 어드레스 방전에 필요한 벽전하를 균일하게 잔류시키게 된다.
어드레스기간에는 부극성 스캔펄스(scan)가 주사전극들(Y)에 순차적으로 인가됨과 동시에 어드레스전극들(X)에 정극성의 데이터펄스(data)가 인가된다. 주사전극들(Y)에 인가된 스캔펄스(scan)의 전압값은 초기화기간에 주사전극들(Y)에 생성된 부극성의 벽전하와 그 전압값이 합쳐지고 어드레스전극들(X)에 인가된 데이터펄스(data)의 전압값은 초기화기간에 유지전극들(Z)에 생성된 정극성의 벽전하와 그 전압값이 합쳐져 셀 내에는 어드레스 방전이 발생된다. 이때, 부극성의 스캔펄스(scan)가 공급된 주사전극들(Y)에는 도 4c와 같이 정극성(+)의 벽전하들이 형성되고, 정극성의 데이터펄스(data)가 공급된 어드레스전극들(X)에는 부극성(-)의 벽전하들이 형성된다. 여기서, 어드레스전극들(X)에 형성되는 대부분의 부극성(-) 벽전하들은 도 4c와 같이 주사전극들(Y)과의 중첩영역에 형성된다.
한편, 셋다운기간과 어드레스기간 동안에 유지전극들(Z)에는 서스테인전압(Vs)의 정극성 전압이 공급된다.
서스테인 기간에는 주사전극들(Y)과 유지전극들(Z)에 교번적으로 서스테인펄스(sus)가 인가된다. 여기서, 첫번째 서스테인펄스(sus)가 주사전극들(Y)에 인가되기 때문에 첫번째 서스테인펄스(sus)와 어드레스방전에 의하여 주사전극들(Y)에 생성된 정극성(+)의 벽전하 전압값이 합쳐져 셀 내에서 주사전극들(Y)과 유지전극들(Z)간에 서스테인 방전이 발생된다. 그리고, 어드레스방전이 발생되지 않은 셀 내에는 도 4b와 같이 주사전극들(Y)에 부극성(-)의 벽전하가 형성되어 있기 때문에 첫번째 서스테인펄스(sus)에 의하여 서스테인방전이 발생되지 않는다.
이후, 서스테인 기간동안 유지전극들(Z)과 주사전극들(Y)간에 교번적으로 서스테인펄스(sus)를 인가함으로써 어드레스방전에 의해 선택된 셀내에서 서스테인방전을 일으킨다. 한편, 본 발명의 PDP의 구동방법에서 마지막 서스테인펄스(sus)는 유지전극들(Z)에 인가된다. 따라서, 마지막 서스테인펄스(sus)에 의한 서스테인방전에 의하여 도 6a와 같이 주사전극들(Y)에는 정극성(+)의 벽전하가 형성되고, 유지전극들(Z)에는 부극성(-)의 벽전하가 형성된다. 그리고, 서스테인방전 횟수에 대응하여 어드레스전극들(X)에는 소정의 전하가 형성된다.
서스테인방전이 완료된 후에 주사전극들(Y)에는 소거 램프파형(erase)이 공급된다. 여기서, 유지전극들(Z)은 기저전위를 유지한다. 주사전극들(Y)에 인가된 정극성 소거 램프파형(erase)은 마지막 서스테인방전에 의하여 주사전극들(Y)에 형성된 정극성 벽전하와 그 전압값이 합쳐지고, 이에 따라 셀 내에서 소거방전이 일어난다. 여기서, 주사전극들(Y)에 소거 램프파형(erase)이 인가되기 때문에 소거방전은 어드레스전극(X)과 주사전극(Y) 및 유지전극(Z)과 주사전극(Y)간에 일어나게 된다.
이를 상세히 설명하면, 어드레스전극(X)에 형성된 차지들은 대부분 주사전극들(Y)과 중첩영역에 위치된다. 따라서, 주사전극들(Y)에 소거 램프파형(erase)이 인가되면 주사전극(Y)와 어드레스전극(X)간에 소거방전이 발생된다. 그리고, 주사전극들(Y)에 인가되는 정극성 소거 램프파형(erase)의 전압값은 어드레스전극(X)에 형성된 차지들과 무관하게 방전이 일어날 수 있도록 서스테인전압(Vs)(서스테인펄스의 전압)을 초과하는 전압값으로 설정된다. 다시 말하여, 서스테인전압(Vs)을 초과하는 전압으로 설정된 소거 램프파형(erase)이 주사전극들(Y)에 인가되면 어드레스전극(X)과 주사전극(Y) 및 유지전극(Z)과 주사전극(Y)간에 소거방전이 발생되어 도 6b와 같은 벽전하가 형성된다. 즉, 본 발명에서는 도 6b와 같이 소거방전에 의하여 주사전극들(Y), 유지전극들(Z) 및 어드레스전극(X)에 형성된 벽전하의 양을 감소시키기 때문에 이후 서브필드 기간에서 오방전이 발생되는 것을 방지할 수 있다.
한편, 서스테인 방전이 발생되지 않은 셀들 내에는 도 4b와 같은 벽전하가 형성되어 있기 때문에, 즉 주사전극들(Y)에 부극성의 벽전하가 형성되기 때문에 주사전극들(Y)에 정극성의 소거 램프파형(erase)이 인가되더라도 셀들 내에서 소거 방전이 일어나지 않는다. 즉, 본 발명에서는 콘트라스트의 손실없이 어드레스전극(X)에 형성된 차지를 리셋시킬 수 있다.(서스테인방전이 발생된 셀에서만 소거방전이 발생된다)
본 발명의 소거 램프파형(erase)의 기울기는 초기화기간에 공급되는 상승 램프파형(Ramp-up)의 기울기와 동일하게 설정된다. 그러면, 추가적으로 회로가 구성되지 않더라도 상승 램프파형(Ramp-up)을 공급하는 회로를 이용하여 소거 램프파형(erase)을 인가할 수 있고, 이에 따라 제조비용이 추가되는 것을 방지할 수 있다. 그리고, 소거 램프파형(erase)의 전압값은 어드레스전극(X)과 안정적 방전이 일어남과 동시에 강방전이 발생되지 않도록 상승 램프파형(ramp-up)의 피크 전압보다 낮게 설정된다. 아울러, 도 5에 도시된 본 발명의 실시예에 의한 구동파형은 한 프레임에 포함된 다수의 서브필드 중 적어도 하나 이상의 서브필드에 적용된다.
이를 상세히 설명하면, 한 프레임에는 도 2와 같이 다수의 서브필드가 포함된다. 도 5에 도시된 본 발명의 구동파형은 한 프레임 포함된 다수의 서브필드 중 적어도 하나 이상의 서브필드에 적용되어 PDP에서 오방전이 발생되는 것을 방지할 수 있다. 여기서, 한 프레임에 포함된 나머지 서브필드에는 도 3에 도시된 종래의 구동파형이 인가된다.
실제로, 도 5에 도시된 본 발명의 구동파형은 서스테인기간에 공급되는 서스테인펄스의 갯수가 10개 이상, 바람직하는 50개 이상일 때 적용된다. 이와 같이 서스테인기간에 다수의 서스테인펄스가 공급될 때 어드레스전극(X)에 형성되는 차지양이 증가되기 때문에 도 5에 도시된 본 발명의 구동파형을 적용하여 어드레스전극(X)을 리셋시킴으로써 오방전이 발생되는 것을 방지할 수 있다.
그리고, 도 5에 도시된 본 발명의 구동파형은 한 프레임에서 누적계조가 20계조 이상일 때 적용할 수 있다. 예를 들어, 한 프레임의 계조값이 "1, 2, 4, 8, 16, 32, 64, 128"로 설정될 때 누적계조가 20계조를 초과하는 "16"계조의 서브필드부터 본 발명의 구동파형을 적용하게 된다. 실제로, 한 프레임의 누적 계조가 증가됨에 따라 어드레스전극(X)에 형성되는 차지양도 증가되기 때문에 도 5에 도시된 본 발명의 구동파형을 적용하여 오방전이 발생되는 것을 방지할 수 있다.
도 7은 본 발명의 다른 실시예에 의한 플라즈마 디스플레이 패널의 구동방법을 나타내는 도면이다. 도 7에 도시된 본 발명의 다른 실시예에 의한 PDP의 구동방법의 초기화기간 및 어드레스기간은 도 5에 도시된 본 발명의 실시예와 동일하므로 상세한 설명은 생략하기로 한다.
도 7을 참조하면, 본 발명의 다른 실시예에 의한 PDP의 구동방법에서 서스테인기간동안 주사전극들(Y)과 유지전극들(Z)에는 교번적으로 서스테인펄스(sus)가 인가된다. 여기서, 첫번째 서스테인펄스(sus)가 주사전극들(Y)에 인가되기 때문에 첫번째 서스테인펄스(sus)와 어드레스방전에 의하여 주사전극들(Y)에 생성된 정극성(+)의 벽전하 전압값이 합쳐져 셀 내에서 주사전극들(Y)과 유지전극들(Z)간에 서스테인 방전이 발생된다. 그리고, 어드레스방전이 발생되지 않은 셀 내에는 도 4b와 같이 주사전극들(Y)에 부극성(-)의 벽전하가 형성되어 있기 때문에 첫번째 서스테인펄스(sus)에 의하여 서스테인방전이 발생되지 않는다.
이후, 서스테인 기간동안 유지전극들(Z)과 주사전극들(Y)간에 교번적으로 서스테인펄스(sus)를 인가함으로써 어드레스방전에 의해 선택된 셀내에서 서스테인방전을 일으킨다. 한편, 본 발명의 PDP의 구동방법에서 마지막 서스테인펄스(sus)는 유지전극들(Z)에 인가된다. 따라서, 마지막 서스테인펄스(sus)에 의한 서스테인방전에 의하여 도 6a와 같이 주사전극들(Y)에는 정극성(+)의 벽전하가 형성되고, 유지전극들(Z)에는 부극성(-)의 벽전하가 형성된다. 그리고, 서스테인방전 횟수에 대응하여 어드레스전극들(X)에는 소정의 전하가 형성된다.
서스테인방전이 완료된 후에 주사전극들(Y)에는 소거 램프파형(erase)이 공급된다. 주사전극들(Y)에 소거 램프파형(erase)이 인가될 때 유지전극들(Z)은 플로팅(floating)된다. 주사전극들(Y)에 인가된 정극성 소거 램프파형(erase)은 마지막 서스테인방전에 의하여 주사전극들(Y)에 형성된 정극성 벽전하와 그 전압값이 합쳐지고, 이에 따라 셀 내에서 소거방전이 일어난다. 여기서, 소거방전은 주사전극들(Y)과 어드레스전극들(X)간에 일어난다. 다시 말하여, 플로팅상태를 유지하고 있는 유지전극들(Z)에는 주사전극들(Y)에 공급되는 소거 램프파형(erase)에 대응하는 소정의 전압이 유도되고, 이 전압에 의하여 주사전극들(Y)과 유지전극들(Z)간에는 방전이 일어나지 않는다.
소거 램프파형(erase)에 의하여 소거 방전이 발생되면 도 8과 같이 주사전극들(Y) 및 어드레스전극들(X)에 형성된 벽전하들이 소거된다.(여기서, 유지전극들(Z)에 형성된 벽전하들이 소거방전에 발생된 하전입자와의 재결합에 의하여 일부 소거된다) 즉, 본 발명에서는 소거방전에 의하여 어드레스전극들(X)에 형성된 벽전하 양을 감소시키기 때문에 이후 서브필드 기간에서 오방전이 발생되는 것을 방지할 수 있다. 한편, 소거 램프파형(erase)의 전압값 및 적용되는 서브필드들은 도 5에 기재된 본 발명의 실시예와 동일하므로 상세한 설명은 생략하기로 한다.
도 9는 본 발명의 또 다른 실시예에 의한 플라즈마 디스플레이 패널의 구동방법을 나타내는 도면이다. 도 9에 도시된 본 발명의 다른 실시예에 의한 PDP의 구동방법의 초기화기간 및 어드레스기간은 도 5에 도시된 본 발명의 실시예와 동일하므로 상세한 설명은 생략하기로 한다.
도 9을 참조하면, 본 발명의 다른 실시예에 의한 PDP의 구동방법에서 서스테인기간동안 주사전극들(Y)과 유지전극들(Z)에는 교번적으로 서스테인펄스(sus)가 인가된다. 여기서, 첫번째 서스테인펄스(sus)가 주사전극들(Y)에 인가되기 때문에 첫번째 서스테인펄스(sus)와 어드레스방전에 의하여 주사전극들(Y)에 생성된 정극성(+)의 벽전하 전압값이 합쳐져 셀 내에서 주사전극들(Y)과 유지전극들(Z)간에 서스테인 방전이 발생된다. 그리고, 어드레스방전이 발생되지 않은 셀 내에는 도 4b와 같이 주사전극들(Y)에 부극성(-)의 벽전하가 형성되어 있기 때문에 첫번째 서스테인펄스(sus)에 의하여 서스테인방전이 발생되지 않는다.
이후, 서스테인 기간동안 유지전극들(Z)과 주사전극들(Y)간에 교번적으로 서스테인펄스(sus)를 인가함으로써 어드레스방전에 의해 선택된 셀내에서 서스테인방전을 일으킨다. 한편, 본 발명의 PDP의 구동방법에서 마지막 서스테인펄스(sus)는 유지전극들(Z)에 인가된다. 따라서, 마지막 서스테인펄스(sus)에 의한 서스테인방전에 의하여 도 6a와 같이 주사전극들(Y)에는 정극성(+)의 벽전하가 형성되고, 유지전극들(Z)에는 부극성(-)의 벽전하가 형성된다. 그리고, 서스테인방전 횟수에 대응하여 어드레스전극들(X)에는 소정의 전하가 형성된다.
서스테인방전이 완료된 후에 주사전극들(Y)에는 제 1소거 램프파형(erase1)이 공급된다. 주사전극들(Y)에 제 1소거 램프파형(erase1)이 인가될 때 유지전극들(Z)에는 제 2소거 램프파형(erase2)이 공급된다. 주사전극들(Y)에 인가된 제 1소거 램프파형(erase1)은 마지막 서스테인방전에 의하여 주사전극들(Y)에 형성된 벽전하와 그 전압값이 합쳐지고, 이에 따라 셀 내에서 소거방전이 일어난다. 여기서, 소거방전은 주사전극들(Y)과 어드레스전극들(X)간에 발생된다. 다시 말하여, 유지전극들(Z)에는 제 2소거 램프파형(erase2)이 공급되기 때문에 주사전극들(Y)과 유지전극들(Z)간에는 방전이 일어나지 않는다.
소거 램프파형(erase)에 의하여 소거 방전이 발생되면 도 8과 같이 주사전극들(Y) 및 어드레스전극들(X)에 형성된 벽전하들이 소거된다.(여기서, 유지전극들(Z)에 형성된 벽전하들이 소거방전에 발생된 하전입자와의 재결합에 의하여 일부 소거된다) 즉, 본 발명에서는 소거방전에 의하여 어드레스전극들(X)에 형성된 벽전하 양을 감소시키기 때문에 이후 서브필드 기간에서 오방전이 발생되는 것을 방지할 수 있다.
한편, 제 2소거 램프파형(erase2)의 전압값은 제 1소거 램프파형(erase1)의 전압값에 비하여 작거나 같게 설정된다. 그리고, 제 1소거 램프파형(erase1)의 전압값 및 적용되는 서브필드들은 도 5에 기재된 본 발명의 실시예와 동일하므로 상세한 설명은 생략하기로 한다.
상술한 바와 같이, 본 발명에 따른 플라즈마 디스플레이 패널의 구동방법에 의하면 주사전극에 서스테인전압을 초과하는 소거 램프파형을 인가하여 어드레스전극에 형성된 차지를 제거할 수 있고, 이에 따라 오방전이 발생되는 것을 방지할 수 있다. 또한, 본 발명에서는 서스테인방전이 발생된 셀에서만 소거 방전을 일으키기 때문에 콘트라스트의 저하없이 오방전을 방지할 수 있다.
이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의해 정하여져야만 할 것이다.
도 1은 종래의 3전극 교류 면방전형 플라즈마 디스플레이 패널의 방전셀 구조를 나타내는 사시도.
도 2는 종래의 플라즈마 디스플레이 패널의 한 프레임을 나타내는 도면.
도 3은 종래의 플라즈마 디스플레이 패널의 구동방법을 나타내는 파형도.
도 4a 내지 도 4e는 도 3에 도시된 구동파형에 의하여 방전셀에 형성되는 벽전하를 나타내는 도면.
도 5는 본 발명의 실시예에 의한 플라즈마 디스플레이 패널의 구동방법을 나타내는 파형도.
도 6a 및 도 6b는 도 5에 도시된 구동파형에 의하여 방전셀에 형성되는 벽전하를 나타내는 도면.
도 7은 본 발명의 다른 실시예에 의한 플라즈마 디스플레이 패널의 구동방법을 나타내는 파형도.
도 8은 도 7에 도시된 구동파형에 의하여 방전셀에 형성되는 벽전하를 나타내는 도면.
도 9는 본 발명의 또 다른 실시예에 의한 플라즈마 디스플레이 패널의 구동방법을 나타내는 파형도.
< 도면의 주요 부분에 대한 부호의 설명 >
10 : 상부기판 12Y,12Z : 투명전극
13Y,13Z : 버스전극 14,22 : 유전체층
16 : 보호막 18 : 하부기판
24 : 격벽 26 : 형광체층

Claims (11)

  1. 한 프레임에 포함된 다수의 서브필드 중 적어도 하나 이상의 서브필드의 어드레스기간동안 주사전극에 스캔펄스를 공급함과 아울러 어드레스전극에 데이터펄스를 공급하여 켜질 방전셀을 선택하는 단계와,
    상기 적어도 하나 이상의 서브필드의 서스테인기간동안 상기 주사전극 및 유지전극에 서스테인전압을 가지는 서스테인펄스를 교번적으로 공급하는 단계와,
    상기 적어도 하나 이상의 서브필드의 상기 서스테인기간동안 상기 유지전극에 마지막 서스테인펄스를 공급하는 단계와,
    상기 마지막 서스테인펄스가 공급된 후 상기 주사전극에 기울기를 가지고 상승하는 소거 램프펄스를 인가하는 단계를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  2. 제 1항에 있어서,
    상기 적어도 하나 이상의 서브필드의 리셋기간동안 셋업전압까지 상승하는 상승 램프파형이 공급되는 단계를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  3. 제 2항에 있어서,
    상기 소거 램프펄스의 전압값은 상기 서스테인전압을 초과하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  4. 제 3항에 있어서,
    상기 소거 램프펄스의 전압값은 상기 셋업전압 이하로 설정되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  5. 제 2항에 있어서,
    상기 소거 램프펄스의 기울기는 상기 상승 램프파형의 기울기와 동일하게 설정되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  6. 제 1항에 있어서,
    상기 적어도 하나 이상의 서브필드는 상기 서스테인기간에 공급되는 상기 서스테인펄스의 갯수가 10개 이상인 서브필드인 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  7. 제 6항에 있어서,
    상기 적어도 하나 이상의 서브필드는 상기 서스테인기간에 공급되는 상기 서스테인펄스의 갯수가 50개 이상인 서브필드인 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  8. 제 1항에 있어서,
    상기 적어도 하나 이상의 서브필드는 한 프레임에서 미리 설정된 휘도가중치의 누적계조가 20계조를 초가하는 서브필드들인 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  9. 제 1항에 있어서,
    상기 주사전극에 상기 소거 램프펄스가 인가될 때 상기 유지전극은 플로팅되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  10. 제 1항에 있어서,
    상기 주사전극에 상기 소거 램프펄스가 인가될 때 상기 유지전극에는 동기 램프펄스가 인가되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  11. 제 10항에 있어서,
    상기 동기 램프펄스의 전압값은 상기 소거 램프펄스의 전압값 이하로 설정되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
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