KR100640053B1 - 플라즈마 디스플레이 패널의 구동방법 - Google Patents

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Abstract

본 발명은 크로스토크로 인한 셀소거 및 오방전을 방지할 수 있도록 한 플라즈마 디스플레이 패널의 구동방법에 관한 것이다.
본 발명에 따른 플라즈마 디스플레이 패널의 구동방법은 스캔전극, 서스테인전극 및 어드레스전극을 구비하고 수직으로 인접한 방전셀들에 형성된 전극들이 서스테인전극-스캔전극-스캔전극-서스테인전극 순으로 배치되며 한 프레임이 다수의 서브필들로 나누어지고, 서브필드 각각이 리셋기간, 어드레스기간 및 서스테인기간으로 나누어져 구동되는 플라즈마 디스플레이 패널의 구동방법에 있어서, 상기 서스테인기간 동안 서스테인펄스를 상기 스캔전극들 및 서스테인전극들에 교번적으로 인가하는 제1 단계와; 상기 서스테인전극들에 상기 서스테인펄스가 마지막으로 인가된 후 상기 스캔전극들을 기수그룹과 우수그룹으로 나누어, 상기 기수그룹과 우수그룹의 스캔전극들에 상기 서스테인 펄스의 크기와는 다른 크기를 갖는 펄스를 교번적으로 인가하는 제2 단계를 포함한다.

Description

플라즈마 디스플레이 패널의 구동방법{METHOD OF DRIVING PLASMA DISPLAY PANEL}
도 1은 종래의 3전극 교류 면방전형 플라즈마 디스플레이 패널의 방전셀 구조를 나타내는 사시도이다.
도 2 및 도 3은 도 1에 도시된 방전셀의 단면도를 나타내는 도면이다.
도 4는 한 프레임에 포함된 서브필드의 휘도가중치의 일례를 나타내는 도면이다.
도 5는 종래의 플라즈마 디스플레이 패널의 구동방법을 나타내는 파형도이다.
도 6은 종래의 다른 플라즈마 디스플레이 패널의 구동방법을 나타내는 파형도이다.
도 7은 도 6에 도시된 구동파형에 의해 온셀과 오프셀에서 발생되는 크로스토크현상을 나타내는 도면이다.
도 8은 본 발명의 제 1 실시 예에 따른 플라즈마 디스플레이 패널의 구동방법을 나타내는 파형도이다.
도 9는 본 발명의 제 2 실시 예에 따른 플라즈마 디스플레이 패널의 구동방 법을 나타내는 파형도이다.
도 10은 본 발명의 제 3 실시 예에 따른 플라즈마 디스플레이 패널의 구동방법을 나타내는 파형도이다.
< 도면의 주요 부분에 대한 부호의 설명 >
10 : 상부기판 12Y,12Z : 투명전극
13Y,13Z : 버스전극 14,22 : 유전체층
16 : 보호막 18 : 하부기판
24 : 격벽 26 : 형광체층
본 발명은 플라즈마 디스플레이 패널의 구동방법에 관한 것으로, 특히 크로스토크로 인한 셀소거 및 오방전을 방지할 수 있도록 한 플라즈마 디스플레이 패널의 구동방법에 관한 것이다.
플라즈마 디스플레이 패널(Plasma Display Panel : 이하 "PDP"라 함)은 He+Xe, Ne+Xe 또는 He+Xe+Ne 등의 불활성 혼합가스의 방전시 발생하는 147nm의 자외선에 의해 형광체를 발광시킴으로써 문자 또는 그래픽을 포함한 화상을 표시하게 된다. 이러한 PDP는 박막화와 대형화가 용이할 뿐만 아니라 최근의 기술 개발에 힘입어 크게 향상된 화질을 제공한다. 특히, 3전극 교류 면방전형 PDP는 방전시 표면에 벽전하가 축적되며 방전에 의해 발생되는 스퍼터링으로부터 전극들을 보호하기 때문에 저전압 구동과 장수명의 장점을 가진다.
도 1은 종래의 3전극 교류 면방전형 PDP의 방전셀 구조를 나타내는 사시도이다.
도 1을 참조하면, 종래의 3전극 교류 면방전형 PDP의 방전셀은 상부기판(10) 상에 형성되어진 스캔전극(Y) 및 서스테인전극(Z)과, 하부기판(18) 상에 형성되어진 어드레스전극(X)을 구비한다. 스캔전극(Y)과 서스테인전극(Z) 각각은 투명전극(12Y,12Z)과, 투명전극(12Y,12Z)의 선폭 보다 작은 선폭을 가지며 투명전극의 일측 가장자리에 형성되는 금속버스전극(13Y,13Z)을 포함한다.
투명전극(12Y,12Z)은 통상 인듐틴옥사이드(Indium-Tin-Oxide : ITO)로 상부기판(10) 상에 형성된다. 금속버스전극(13Y,13Z)은 통상 크롬(Cr) 등의 금속으로 투명전극(12Y,12Z) 상에 형성되어 저항이 높은 투명전극(12Y,12Z)에 의한 전압강하를 줄이는 역할을 한다. 스캔전극(Y)과 서스테인전극(Z)이 나란하게 형성된 상부기판(10)에는 상부 유전체층(14)과 보호막(16)이 적층된다. 상부 유전체층(14)에는 플라즈마 방전시 발생된 벽전하가 축적된다. 보호막(16)은 플라즈마 방전시 발생된 스퍼터링에 의한 상부 유전체층(14)의 손상을 방지함과 아울러 2차 전자의 방출 효율을 높이게 된다. 보호막(16)으로는 통상 산화마그네슘(MgO)이 이용된다.
어드레스전극(X)이 형성된 하부기판(18) 상에는 하부 유전체층(22), 격벽(24)이 형성되며, 하부 유전체층(22)과 격벽(24) 표면에는 형광체층(26)이 도포된 다. 어드레스전극(X)은 스캔전극(Y) 및 서스테인전극(Z)과 교차되는 방향으로 형성된다. 격벽(24)은 어드레스전극(X)과 나란하게 형성되어 방전에 의해 생성된 자외선 및 가시광이 인접한 방전셀에 누설되는 것을 방지한다. 형광체층(26)은 플라즈마 방전시 발생된 자외선에 의해 여기되어 적색, 녹색 또는 청색 중 어느 하나의 가시광선을 발생하게 된다. 상/하부기판(10,18)과 격벽(24) 사이에 마련된 방전공간에는 불활성 혼합가스가 주입된다.
이와 같은 종래의 3전극 면방전형 PDP는 도 2에 도시된 바와 같이 스캔전극(Y) 및 서스테인전극(Z)이 상부기판(10) 상에 교번적으로 형성되거나, 도 3에 도시된 바와 같이 인접한 방전셀 간 스캔전극들(Y) 및 서스테인전극들(Z)이 인접하게 형성된다. 여기서, 도 2 및 도 3에 도시된 상부기판(10)은 하부기판(18)과의 비교를 위해 90도 회전시켰다.
이러한, PDP는 화상의 계조를 구현하기 위하여, 한 프레임을 발광횟수가 다른 여러 서브필드로 나누어 시분할 구동하게 된다. 각 서브필드는 전화면을 초기화시키기 위한 리셋기간과, 주사라인을 선택하고 선택된 주사라인에서 셀을 선택하기 위한 어드레스기간과, 방전횟수에 따라 계조를 구현하는 서스테인기간으로 나뉘어진다.
여기서, 리셋기간은 상승 램프파형이 인가되는 셋업기간과 하강 램프파형이 인가되는 셋다운기간으로 나뉘어진다. 예를 들어, 256 계조로 화상을 표시하고자 하는 경우에 도 4와 같이 1/40 초에 해당하는 프레임 기간(16.67ms)은 8개의 서브필드들(SF1내지SF8)로 나누어지게 된다. 8개의 서브 필드들(SF1내지SF8) 각각은 전술한 바와 같이, 리셋기간, 어드레스기간과 서스테인기간으로 나누어지게 된다. 각 서브필드의 리셋기간과 어드레스기간은 각 서브필드마다 동일한 반면에 서스테인기간은 각 서브필드에서 2n(n=0,1,2,3,4,5,6,7)의 비율로 증가된다.
도 5는 종래의 PDP의 구동방법을 나타내는 파형도이다.
도 5를 참조하면, 종래의 PDP의 구동방법은 전화면을 초기화시키기 위한 리셋기간, 셀을 선택하기 위한 어드레스기간 및 선택된 셀의 방전을 유지시키기 위한 서스테인기간으로 나뉘어 구동된다.
리셋기간에 있어서, 셋업기간에는 모든 스캔전극들(Y)에 상승 램프파형(Ramp-up)이 동시에 인가된다. 이 상승 램프파형(Ramp-up)에 의해 전화면의 셀들 내에는 미약한 방전이 일어나게 되어 셀들 내에 벽전하가 생성된다. 셋다운기간에는 상승 램프파형(Ramp-up)이 인가된 후, 상승 램프파형(Ramp-up)의 피크전압 보다 작은 정극성(+)의 서스테인전압(Vs)에서 부극성(-)으로 하강하는 하강 램프파형(Ramp-down)이 스캔전극들(Y)에 동시에 인가된다. 하강 램프파형(Ramp-down)은 셀들 내에 미약한 소거방전을 일으킴으로써 셋업방전에 의해 생성된 벽전하 및 공간전하 중 불요전하를 소거시키게 되고 전화면의 셀들 내에 어드레스방전에 필요한 벽전하를 균일하게 잔류시키게 된다.
어드레스기간에는 부극성(-)의 스캔펄스(Vscan)가 스캔전극들(Y)에 순차적으로 인가됨과 동시에 어드레스전극들(X)에 정극성(+)의 데이터펄스(data)가 인가된다. 이 스캔펄스(Vscan)와 데이터펄스(data)의 전압차와 리셋기간에 생성된 벽전 압이 더해지면서 데이터펄스(data)가 인가되는 셀 내에는 어드레스방전이 발생된다. 어드레스방전에 의해 선택된 셀들 내에는 벽전하가 생성된다.
한편, 셋다운기간과 어드레스기간 동안에 서스테인전극들(Z)에는 정극성(+)의 서스테인전압(Vs)이 인가된다.
서스테인기간에는 스캔전극들(Y)과 서스테인전극들(Z)에 교번적으로 정극성(+)의 서스테인펄스(sus)가 인가된다. 그러면 어드레스방전에 의해 선택된 셀은 셀 내의 벽전압과 서스테인펄스(sus)가 더해지면서 매 서스테인펄스(sus)가 인가될 때 마다 스캔전극(Y)과 서스테인전극(Z) 간에 면방전 형태로 서스테인방전이 일어나게 된다.
그러나, 이와 같은 종래의 PDP 구동파형은 각각의 서브필드 마다 높은 전압값을 가지는 상승 램프파형(Ramp-up)이 스캔전극들(Y)에 인가되어야 하기 때문에 많은 전력을 소모하게 된다. 또한, 리셋기간 동안 스캔전극(Y)에 인가되는 상승 램프파형(Ramp-up)에 의해 많은 빛이 발생되어 콘트라스트가 저하되는 문제가 있다.
도 6은 종래의 다른 PDP의 구동방법을 나타내는 파형도이다.
도 6을 참조하면, 종래의 다른 PDP의 구동방법은 한 프레임이 다수의 서브필드들로 나뉘어 구동되고, 각각의 서브필드들은 전화면의 셀들을 초기화시키기 위한 리셋기간, 셀을 선택하기 위한 어드레스기간 및 선택된 셀의 방전을 유지시키기 위한 서스테인기간으로 나뉘어 구동된다.
한 프레임에서 첫 번째 서브필드의 리셋기간 중 셋업기간 동안 모든 스캔전 극들(Y)에 셋업전압(Vsetup)까지 상승되는 상승 램프파형(Ramp-up)이 동시에 인가된다. 이 상승 램프파형(Ramp-up)에 의해 전화면의 셀들 내에는 미약한 방전(셋업방전)이 일어나게 되어 셀들 내에 벽전하가 생성된다. 이러한, 상승 램프파형(Ramp-up)은 한 프레임의 첫 번째 서브필드(SF1)에만 인가된다. 상승 램프파형(Ramp-up)이 인가된 후 상승 램프파형(Ramp-up)의 피크전압 보다 작은 정극성(+)의 서스테인전압(Vs)에서 부극성(-)으로 하강하는 하강 램프파형(Ramp-down)이 리셋기간 중 셋다운기간 동안 스캔전극들(Y)에 동시에 인가된다. 하강 램프파형(Ramp-down)은 셀들 내에 미약한 소거방전을 일으킴으로써 셋업방전에 의해 생성된 벽전하 및 공간전하 중 불요전하를 소거시키게 되고 전화면의 셀들 내에 어드레스방전에 필요한 벽전하를 균일하게 잔류시키게 된다.
어드레스기간에는 부극성(-)의 스캔펄스(scan)가 스캔전극들(Y)에 순차적으로 인가됨과 동시에 어드레스전극들(X)에 정극성(+)의 데이터펄스(data)가 인가된다. 이 스캔펄스(scan)와 데이터펄스(data)의 전압차와 리셋기간에 생성된 벽전압이 더해지면서 데이터펄스(data)가 인가되는 셀 내에는 어드레스방전이 발생된다. 어드레스방전에 의해 선택된 셀들 내에는 소정의 벽전하가 생성된다.
한편, 스캔전극들(Y)에 하강 램프파형(Ramp-down)이 인가되는 시점부터 어드레스기간이 끝나는 시점까지 서스테인전극들(Z)에는 정극성(+)의 서스테인전압(Vs)이 인가된다.
서스테인기간에는 스캔전극들(Y)과 서스테인전극들(Z)에 교번적으로 서스테인펄스(sus)가 인가된다. 그러면, 어드레스방전에 의해 선택된 셀은 셀 내의 벽전 압과 서스테인펄스(sus)가 더해지면서 매 서스테인펄스(sus)가 인가될 때 마다 스캔전극(Y)과 서스테인전극(Z) 사이에 면방전 형태로 서스테인방전이 일어나게 된다. 여기서, 서스테인기간 동안 인가되는 서스테인펄스(sus)의 수는 각 프레임의 휘도 가중치에 대응하여 설정된다.
서스테인기간 동안 스캔전극들(Y) 및 서스테인전극들(Z)에 서스테인펄스(sus)가 교번적으로 인가된 후 서스테인펄스(sus)의 전압값 보다 작은 전압값을 갖는 온셀제어펄스(Vr)가 스캔전극들(Y)에 인가된다. 이에 따라, 스캔전극들(Y)에 인가된 온셀제어펄스(Vr)로 인해 방전셀들에서는 마지막 서스테인방전이 발생하게 된다.
이후, 두 번째 서브필드의 리셋기간 동안 기저전압에서 부극성(-)으로 하강하는 하강 램프파형(Ramp-down)이 스캔전극들(Y)에 동시에 인가된다. 하강 램프파형(Ramp-down)은 셀들 내에 미약한 소거방전을 일으킴으로써 셋업방전에 의해 생성된 벽전하 및 공간전하 중 불요전하를 소거시키게 되고 전화면의 셀들 내에 어드레스방전에 필요한 벽전하를 균일하게 잔류시키게 된다.
한편, 첫 번째 서브필드에서 서스테인방전이 발생되지 않은 오프셀(off-cell)들은 첫 번째 서브필드의 리셋기간에 형성된 벽전하를 유지한다. 따라서, 오프셀들은 두 번째 서브필드에서 스캔전극들(Y)에 하강 램프파형(Ramp-down)이 공급될 때 소거방전이 발생되지 않는다.
두 번째 서브필드의 어드레스기간에는 부극성(-)의 스캔펄스(scan)가 스캔전극들(Y)에 순차적으로 인가됨과 동시에 어드레스전극들(X)에 정극성(+)의 데이터펄 스(data)가 인가된다. 이 스캔펄스(scan)와 데이터펄스(data)의 전압차와 리셋기간에 생성된 벽전압이 더해지면서 데이터펄스(data)가 인가되는 셀 내에는 어드레스방전이 발생된다. 어드레스방전에 의해 선택된 셀들 내에는 소정의 벽전하가 생성된다.
두 번째 서브필드의 서스테인기간에는 스캔전극들(Y)과 서스테인전극들(Z)에 교번적으로 서스테인펄스(sus)가 인가된다. 그러면, 어드레스방전에 의해 선택된 셀은 셀 내의 벽전압과 서스테인펄스(sus)가 더해지면서 매 서스테인펄스(sus)가 인가될 때 마다 스캔전극(Y)과 서스테인전극(Z) 사이에 면방전 형태로 서스테인방전이 일어나게 된다. 여기서, 서스테인기간 동안 인가되는 서스테인펄스(sus)의 수는 각 프레임의 휘도 가중치에 대응하여 설정된다.
서스테인기간 동안 스캔전극들(Y) 및 서스테인전극들(Z)에 서스테인펄스(sus)가 교번적으로 인가된 후 서스테인펄스(sus)의 전압값 보다 작은 전압값을 갖는 온셀제어펄스(Vr)가 스캔전극들(Y)에 인가된다. 이에 따라, 스캔전극들(Y)에 인가된 온셀제어펄스(Vr)로 인해 방전셀들에서는 마지막 서스테인방전이 발생하게 된다.
이와 같은 종래의 다른 PDP의 구동방법에서 한 프레임의 첫 번째 서브필드를 제외한 나머지 서브필드들에서는 상술한 두 번째 서브필드의 구동방법과 동일한 방법에 의해 구동된다.
그러나, 이와 같은 종래의 다른 PDP의 구동방법은 스캔전극들(Y)에 인가된 온셀제어펄스(Vr)에 의해 특정 서브필드에서 방전이 발생된 셀들 즉, 온셀들(on- cell)에서 강한 방전이 발생되면 도 7에 도시된 바와 같이 크로스토크(Crosstalk)로 인해 스캔전극(Y)이 수직으로 인접한 오프셀들의 스캔전극(Y)에 전자가 충전되어 다음 서브필드에서 오프셀이 온셀로 전환되지 못하는 현상이 발생하게 된다. 다시 말해, 온셀에서 강방전이 발생될 경우 크로스토크로 인해 인접셀로 전하들이 이동하게 되는데 이동 속도가 빠른 전자가 정공 보다 훨씬 많은 양이 이동하게 된다. 이때, 인접한 오프셀의 스캔전극들(Y)에도 온셀제어펄스(Vr)가 인가되어 있기 때문에 크로스토크로 인해 이동된 전자들이 스캔전극들(Y)에 붙게 된다. 이로 인해, 오프셀의 상태가 변환되지만 첫 번째 서브필드를 제외한 나머지 서브필드들에서 오프셀의 상태를 변환시킬수 있는 전압이 스캔전극들(Y)에 인가되지 않기 때문에 오프셀이 온셀로 전환되는 과정에서 셀소거가 발생되어 오방전이 발생되는 문제가 있다.
따라서, 본 발명의 목적은 크로스토크로 인한 셀소거 및 오방전을 방지할 수 있도록 한 플라즈마 디스플레이 패널의 구동방법을 제공하는데 있다.
상기 목적을 달성하기 위하여, 본 발명에 따른 플라즈마 디스플레이 패널의 구동방법은 스캔전극, 서스테인전극 및 어드레스전극을 구비하고 수직으로 인접한 방전셀들에 형성된 전극들이 서스테인전극-스캔전극-스캔전극-서스테인전극 순으로 배치되며 한 프레임이 다수의 서브필들로 나누어지고, 서브필드 각각이 리셋기간, 어드레스기간 및 서스테인기간으로 나누어져 구동되는 플라즈마 디스플레이 패널의 구동방법에 있어서, 상기 서스테인기간 동안 서스테인펄스를 상기 스캔전극들 및 서스테인전극들에 교번적으로 인가하는 제1 단계와; 상기 서스테인전극들에 상기 서스테인펄스가 마지막으로 인가된 후 상기 스캔전극들을 기수그룹과 우수그룹으로 나누어, 상기 기수그룹과 우수그룹의 스캔전극들에 상기 서스테인 펄스의 크기와는 다른 크기를 갖는 펄스를 교번적으로 인가하는 제2 단계를 포함한다.
상기 제2 단계는, 상기 기수그룹 및 우수그룹 중 어느 한 그룹의 스캔전극들에 상기 서스테인 펄스의 크기와는 다른 크기를 갖는 정극성의 제 1 펄스를 인가하는 단계와, 제 1 펄스가 인가되지 않은 그룹의 스캔전극들에 제 1 펄스와 교번되도록 상기 서스테인 펄스의 크기와는 다른 크기를 갖는 정극성의 제 2 펄스를 인가하는 단계를 포함하는 것을 특징으로 한다.
상기 제 1 및 제 2 펄스는 상기 서스테인펄스의 최소값과 최대값 사이의 전압값을 갖는 것을 특징으로 한다.
상기 제 1 및 제 2 펄스는 온셀에서 방전이 발생되지 않을 수 있는 전압 보다 크고 오프셀에서 방전이 발생되는 전압 보다 작은 전압인 것을 특징으로 한다.
상기 제 1 및 제 2 펄스는 동일한 전압값을 갖거나 서로 다른 전압값을 갖는 것을 특징으로 한다.
본 발명에 따른 플라즈마 디스플레이 패널의 구동방법은 상기 기수그룹 및 우수그룹 중 어느 한 그룹의 스캔전극들에 상기 제 1 펄스가 인가될 때 상기 제 1 펄스가 인가되지 않은 그룹의 스캔전극들에 상기 제 2 펄스 보다 작은 전압값을 갖 는 정극성의 제 3 펄스를 인가하는 단계와, 상기 제 1 펄스가 인가되지 않은 그룹의 스캔전극들에 상기 제 2 펄스가 인가될 때 상기 제 1 펄스가 인가되는 그룹의 스캔전극들에 상기 제 1 펄스 보다 작은 전압값을 갖는 정극성의 제 4 펄스를 인가하는 단계를 더 포함한다.
상기 제 3 및 제 4 펄스는 기저전압 보다 크고 온셀에서 방전이 발생되지 않을 수 있는 경계전압 보다 작은 전압인 것을 특징으로 한다.
상기 제 3 및 제 4 펄스는 동일한 전압값을 갖거나 서로 다른 전압값을 갖는 것을 특징으로 한다.
상기 제 2 및 제 4 펄스는 상기 제 1 및 제 3 펄스 보다 소정시간 늦게 인가되는 것을 특징으로 한다.
상기 제 1 및 제 4 펄스와 상기 제 3 및 제 2 펄스 각각은 계단형태인 것을 특징으로 한다.
본 발명에 따른 플라즈마 디스플레이 패널의 구동방법은 상기 프레임의 첫 번째 서브필드의 리셋기간 동안 상기 스캔전극들에 셋업전압까지 상승되는 상승 램프파형과 상기 상승 램프파형의 피크전압 보다 작은 정극성의 서스테인전압에서 부극성으로 하강하는 제 1 하강 램프파형을 순차적으로 인가하는 단계와, 상기 프레임의 두 번째 서브필드의 리셋기간 동안 상기 스캔전극들에 기저전압에서 부극성으로 하강하는 제 2 하강 램프파형을 인가하는 단계를 더 포함한다.
상기 목적 외에 본 발명의 다른 목적 및 특징들은 첨부도면을 참조한 실시 예에 대한 설명을 통하여 명백하게 드러나게 될 것이다.
이하 도 8 내지 도 10을 참조하여 본 발명의 바람직한 실시 예에 대하여 설명하기로 한다.
도 8은 본 발명의 제 1 실시 예에 따른 PDP의 구동방법을 나타내는 파형도이다.
도 8을 참조하면, 본 발명의 제 1 실시 예에 따른 PDP의 구동방법은 한 프레임이 다수의 서브필드들로 나뉘어지고, 서브필드들 각각이 전화면을 초기화시키기 위한 리셋기간, 셀을 선택하기 위한 어드레스기간 및 선택된 셀의 방전을 유지시키기 위한 서스테인기간으로 나뉘어 구동된다.
한 프레임에서 첫 번째 서브필드의 리셋기간 중 셋업기간 동안 모든 스캔전극들(Y)에 셋업전압(Vsetup)까지 상승되는 상승 램프파형(Ramp-up)이 동시에 인가된다. 이 상승 램프파형(Ramp-up)에 의해 전화면의 셀들 내에는 미약한 방전(셋업방전)이 일어나게 되어 셀들 내에 벽전하가 생성된다. 이러한, 상승 램프파형(Ramp-up)은 한 프레임의 첫 번째 서브필드(SF1)에만 인가된다. 상승 램프파형(Ramp-up)이 인가된 후 상승 램프파형(Ramp-up)의 피크전압 보다 작은 정극성(+)의 서스테인전압(Vs)에서 부극성(-)으로 하강하는 하강 램프파형(Ramp-down)이 리셋기간 중 셋다운기간 동안 스캔전극들(Y)에 동시에 인가된다. 하강 램프파형(Ramp-down)은 셀들 내에 미약한 소거방전을 일으킴으로써 셋업방전에 의해 생성된 벽전하 및 공간전하 중 불요전하를 소거시키게 되고 전화면의 셀들 내에 어드레스방전에 필요한 벽전하를 균일하게 잔류시키게 된다.
어드레스기간에는 부극성(-)의 스캔펄스(scan)가 스캔전극들(Y)에 순차적으 로 인가됨과 동시에 어드레스전극들(X)에 정극성(+)의 데이터펄스(data)가 인가된다. 이 스캔펄스(scan)와 데이터펄스(data)의 전압차와 리셋기간에 생성된 벽전압이 더해지면서 데이터펄스(data)가 인가되는 셀 내에는 어드레스방전이 발생된다. 어드레스방전에 의해 선택된 셀들 내에는 소정의 벽전하가 생성된다.
한편, 스캔전극들(Y)에 하강 램프파형(Ramp-down)이 인가되는 시점부터 어드레스기간이 끝나는 시점까지 서스테인전극들(Z)에는 정극성(+)의 서스테인전압(Vs)이 인가된다.
서스테인기간에는 스캔전극들(Y)과 서스테인전극들(Z)에 서스테인펄스(sus)가 교번적으로 인가된다. 그러면, 어드레스방전에 의해 선택된 셀은 셀 내의 벽전압과 서스테인펄스(sus)가 더해지면서 매 서스테인펄스(sus)가 인가될 때 마다 스캔전극들(Y)과 서스테인전극들(Z) 사이에 면방전 형태로 서스테인방전이 일어나게 된다. 여기서, 서스테인기간 동안 인가되는 서스테인펄스(sus)의 수는 각 프레임의 휘도 가중치에 대응하여 설정된다.
서스테인기간 동안 서스테인전극들(Z)에 서스테인펄스(sus)가 마지막으로 인가된 후 서스테인펄스(sus)의 최소값과 최대값 사이의 전압값 즉, 온셀에서 방전이 발생되지 않을 수 있는 전압 보다 크고 오프셀에서 방전이 발생되는 전압 보다 작은 전압을 갖는 정극성(+)의 제 1 및 제 2 펄스전압(V1, V2)이 우수번째(even) 스캔전극들(Y)과 기수번째(odd) 스캔전극들(Y)에 교번적으로 인가된다. 여기서, 제 1 펄스전압(V1)은 제 2 펄스전압(V2)과 동일한 전압값을 갖거나 서로 다른 전압값을 갖을 수 있다. 이에 따라, 우수번째(even) 위치한 방전셀들에서 마지막 서스테 인방전이 발생된 후 기수번째(odd) 위치한 방전셀들에서 마지막 서스테인방전이 차례로 발생하게 된다.
이후, 두 번째 서브필드의 리셋기간 동안 기저전압에서 부극성(-)으로 하강하는 하강 램프파형(Ramp-down)이 스캔전극들(Y)에 동시에 인가된다. 하강 램프파형(Ramp-down)은 셀들 내에 미약한 소거방전을 일으킴으로써 셋업방전에 의해 생성된 벽전하 및 공간전하 중 불요전하를 소거시키게 되고 전화면의 셀들 내에 어드레스방전에 필요한 벽전하를 균일하게 잔류시키게 된다.
한편, 첫 번째 서브필드에서 서스테인방전이 발생되지 않은 오프셀들은 첫 번째 서브필드의 리셋기간에 형성된 벽전하를 유지한다. 따라서, 오프셀들은 두 번째 서브필드에서 스캔전극들(Y)에 하강 램프파형(Ramp-down)이 공급될 때 소거방전이 발생되지 않는다.
두 번째 서브필드의 어드레스기간 및 서스테인기간은 첫 번째 서브필드의 어드레스기간 및 서스테인기간과 동일한 방법으로 동작하므로 자세한 동작 설명은 상술한 설명으로 대치하기로 한다.
실제로, 본 발명의 제 1 실시 예에 따른 PDP의 구동방법에서는 위와 같은 과정을 반복하면서 소정의 화상을 표시하게 된다. 이때, 본 발명의 제 1 실시 예에 따른 PDP의 구동방법에서 한 프레임의 첫 번째 서브필드를 제외한 나머지 서브필드들에서는 상술한 두 번째 서브필드의 구동방법과 동일한 방법에 의해 구동된다.
이와 같이 본 발명의 제 1 실시 예에 따른 PDP의 구동방법에서는 한 프레임의 첫 번째 서브필드의 리셋기간에만 셋업전압(Vsetup)을 가지는 상승 램프파형 (Ramp-down)을 공급함으로써 첫 번째 서브필드에서만 셋업방전에 의해 광이 발생되고 나머지 서브필드에서는 셋업방전에 의한 광이 발생되지 않으므로 콘트라스트를 향상시킬 수 있을 뿐만 아니라 전력소모를 줄일 수 있다. 또한, 본 발명의 제 1 실시 예에 따른 PDP의 구동방법에서는 서스테인기간에 우수번째(even) 스캔전극들(Y)과 기수번째(odd) 스캔전극들(Y)에 서스테인펄스(sus)의 최소값과 최대값 사이의 전압값 즉, 온셀에서 방전이 발생되지 않을 수 있는 전압 보다 크고 오프셀에서 방전이 발생되는 전압 보다 작은 전압을 갖는 정극성(+)의 제 1 및 제 2 펄스전압(V1, V2)을 교번적으로 인가함으로써 수직으로 인접한 셀들간의 크로스토크를 방지할 수 있다. 이에 따라, 수직으로 인접한 셀 내에서의 셀소거를 방지하게 되므로 오방전을 방지할 수 있게 된다. 다시 말해, 온셀들의 스캔전극들(Y)에 제 1 및 제 2 펄스전압(V1, V2) 중 어느 하나가 인가되어 온셀들에서 강방전이 발생되면 온셀들의 스캔전극들(Y)에는 전자가 쌓이게 된다. 이때, 수직으로 인접한 오프셀들의 스캔전극들(Y)에는 기저전압(GND)이 인가되므로 온셀들의 스캔전극들(Y)에 쌓인 전자는 수직으로 인접한 오프셀들로 이동하지 않는다. 또한, 온셀들의 스캔전극들(Y)에 쌓인 전자가 수직으로 인접한 오프셀들로 이동하더라도 오프셀의 스캔전극들(Y)에는 기저전압(GND)이 인가되므로 오프셀들로 이동된 전자들은 소멸하게 된다. 이에 따라, 온셀들의 스캔전극들(Y)에 제 1 및 제 2 펄스전압(V1, V2)이 인가되더라도 오프셀들의 벽전하 상태는 변화되지 않는다. 이로 인해, 셀소거나 오방전이 발생되지 않게 되므로 PDP를 안정적으로 구동할 수 있다.
이상 본 발명의 제 1 실시 예에 따른 PDP의 구동방법에서는 우수번째(even) 스캔전극들(Y)에 제 1 펄스전압(V1)을 인가한 후 기수번째(odd) 스캔전극들(Y)에 제 2 펄스전압(V2)을 인가하는 방법만을 설명하였으나, 기수번째(odd) 스캔전극들(Y)에 제 1 펄스전압(V1)을 인가한 후 우수번째(even) 스캔전극들(Y)에 제 2 펄스전압(V2)을 인가하더라도 동일한 효과를 얻을 수 있다. 다시 말해, 본 발명의 제 1 실시 예에 따른 PDP의 구동방법에서는 우수번째(even) 스캔전극들(Y)에 먼저 펄스전압을 인가하였으나 기수번째(odd) 스캔전극들(Y)에 펄스전압을 먼저 인가하여도 본 발명의 제 1 실시 예에 따른 PDP의 구동방법과 동일한 효과를 얻을 수 있다.
도 9는 본 발명의 제 2 실시 예에 따른 PDP의 구동방법을 나타내는 파형도이다.
도 9를 참조하면, 본 발명의 제 2 실시 예에 따른 PDP의 구동방법은 한 프레임이 다수의 서브필드들로 나뉘어지고, 서브필드들 각각이 전화면을 초기화시키기 위한 리셋기간, 셀을 선택하기 위한 어드레스기간 및 선택된 셀의 방전을 유지시키기 위한 서스테인기간으로 나뉘어 구동된다.
본 발명의 제 2 실시 예에 따른 PDP의 구동방법은 본 발명의 제 1 실시 예와 대비하여 서스테인기간을 제외한 나머지 기간의 구동방법은 동일하므로 나머지 기간의 상세한 설명은 상술한 설명으로 대치하기로 한다.
서스테인기간에는 스캔전극들(Y)과 서스테인전극들(Z)에 서스테인펄스(sus)가 교번적으로 인가된다. 그러면, 어드레스방전에 의해 선택된 셀은 셀 내의 벽전압과 서스테인펄스(sus)가 더해지면서 매 서스테인펄스(sus)가 인가될 때 마다 스캔전극들(Y)과 서스테인전극들(Z) 사이에 면방전 형태로 서스테인방전이 일어나게 된다. 여기서, 서스테인기간 동안 인가되는 서스테인펄스(sus)의 수는 각 프레임의 휘도 가중치에 대응하여 설정된다.
서스테인기간 동안 서스테인전극들(Z)에 서스테인펄스(sus)가 마지막으로 인가된 후 서스테인펄스(sus)의 최소값과 최대값 사이의 전압값 즉, 온셀에서 방전이 발생되지 않을 수 있는 전압 보다 크고 오프셀에서 방전이 발생되는 전압 보다 작은 전압을 갖는 정극성(+)의 제 1 및 제 2 펄스전압(V1, V2)이 우수번째(even) 스캔전극들(Y)과 기수번째(odd) 스캔전극들(Y)에 교번적으로 인가된다. 여기서, 제 1 펄스전압(V1)은 제 2 펄스전압(V2)과 동일한 전압값을 갖거나 서로 다른 전압값을 갖을 수 있다. 또한, 우수번째(even) 스캔전극들(Y)에 제 1 펄스전압(V1)이 인가될 때 기수번째(odd) 스캔전극들(Y)에는 기저전압 보다 크고 온셀들에서 방전이 발생되지 않을 수 있는 경계전압(즉, 서스테인펄스의 최소값) 보다 작은 전압을 갖는 정극성(+)의 제 3 펄스전압(V3)이 인가된다. 그리고, 기수번째(odd) 스캔전극들(Y)에 제 2 펄스전압(V2)이 인가될 때 우수번째(even) 스캔전극들(Y)에는 기저전압 보다 크고 온셀들에서 방전이 발생되지 않을 수 있는 경계전압(즉, 제 1 펄스전압) 보다 작은 전압을 갖는 정극성(+)의 제 4 펄스전압(V4)이 인가된다. 여기서, 제 3 펄스전압(V3)은 제 4 펄스전압(V4)과 동일한 전압값을 갖거나 서로 다른 전압값을 갖을 수 있다. 이때, 기수번째(odd) 스캔전극들(Y) 및 우수번째(even) 스캔전극들(Y)에는 우수번째(even) 스캔전극들(Y) 및 기수번째(odd) 스캔전극들(Y)에 각각 인가되는 제 1 및 제 3 펄스전압(V1, V3) 보다 소정시간(T1) 늦게 제 2 및 제 4 펄스전압(V2, V4)이 각각 인가된다. 이에 따라, 우수번째(even) 위치한 방전셀 들에서 마지막 서스테인방전이 발생된 후 기수번째(odd) 위치한 방전셀들에서 마지막 서스테인방전이 차례로 발생하게 된다.
이와 같이 본 발명의 제 2 실시 예에 따른 PDP의 구동방법에서는 한 프레임의 첫 번째 서브필드의 리셋기간에만 셋업전압(Vsetup)을 가지는 상승 램프파형(Ramp-down)을 공급함으로써 첫 번째 서브필드에서만 셋업방전에 의해 광이 발생되고 나머지 서브필드에서는 셋업방전에 의한 광이 발생되지 않으므로 콘트라스트를 향상시킬 수 있을 뿐만 아니라 전력소모를 줄일 수 있다. 또한, 본 발명의 제 2 실시 예에 따른 PDP의 구동방법에서는 서스테인기간에 우수번째(even) 스캔전극들(Y)과 기수번째(odd) 스캔전극들(Y)에 정극성(+)의 제 1 및 제 2 펄스전압(V1, V2)을 교번적으로 인가하고, 우수번째(even) 스캔전극들(Y)과 기수번째(odd) 스캔전극들(Y)에 제 1 및 제 2 펄스전압(V1, V2)이 각각 인가될 때 제 3 및 제 4 펄스전압(V3, V4)을 기수번째(odd) 스캔전극들(Y) 및 우수번째(even) 스캔전극들(Y)에 각각 인가함으로써 수직으로 인접한 셀들간의 크로스토크를 방지할 수 있다. 다시 말해, 제 1 및 제 2 펄스전압(V1, V2) 중 어느 하나에 의해 온셀들에서 강방전이 발생될 때 수직으로 인접한 오프셀들의 스캔전극들(Y)에는 제 1 및 제 2 펄스전압(V1, V2) 중 어느 하나의 전압값 보다 작은 전압값을 갖는 제 3 및 제 4 펄스전압(V3, V4) 중 어느 하나가 인가되므로 온셀들에서 강방전 발생 시 스캔전극들(Y)에 쌓인 전자들은 수직으로 인접한 오프셀들의 스캔전극들(Y)로 이동하지 않게 된다. 이에 따라, 수직으로 인접한 셀 내에서의 셀소거가 방지되므로 오방전을 방지할 수 있게 된다.
이상 본 발명의 제 2 실시 예에 따른 PDP의 구동방법에서는 우수번째(even) 스캔전극들(Y)에 제 1 및 제 4 펄스전압(V1, V4)을 인가하고, 기수번째(odd) 스캔전극들(Y)에 제 3 및 제 2 펄스전압(V3, V2)을 인가하는 방법만을 설명하였으나, 기수번째(odd) 스캔전극들(Y)에 제 1 및 제 4 펄스전압(V1, V4)을 인가하고, 우수번째(even) 스캔전극들(Y)에 제 3 및 제 2 펄스전압(V3, V2)을 인가하더라도 동일한 효과를 얻을 수 있다. 다시 말해, 본 발명의 제 2 실시 예에 따른 PDP의 구동방법에서는 우수번째(even) 스캔전극들(Y)에 먼저 펄스전압을 인가하였으나 기수번째(odd) 스캔전극들(Y)에 펄스전압을 먼저 인가하더라도 본 발명의 제 2 실시 예에 따른 PDP의 구동방법과 동일한 효과를 얻을 수 있다.
도 10은 본 발명의 제 3 실시 예에 따른 PDP의 구동방법을 나타내는 파형도이다.
도 10을 참조하면, 본 발명의 제 3 실시 예에 따른 PDP의 구동방법은 한 프레임이 다수의 서브필드들로 나뉘어지고, 서브필드들 각각이 전화면을 초기화시키기 위한 리셋기간, 셀을 선택하기 위한 어드레스기간 및 선택된 셀의 방전을 유지시키기 위한 서스테인기간으로 나뉘어 구동된다.
본 발명의 제 3 실시 예에 따른 PDP의 구동방법은 본 발명의 제 1 실시 예와 대비하여 서스테인기간을 제외한 나머지 기간의 구동방법은 동일하므로 나머지 기간의 상세한 설명은 상술한 설명으로 대치하기로 한다.
서스테인기간에는 스캔전극들(Y)과 서스테인전극들(Z)에 서스테인펄스(sus)가 교번적으로 인가된다. 그러면, 어드레스방전에 의해 선택된 셀은 셀 내의 벽전 압과 서스테인펄스(sus)가 더해지면서 매 서스테인펄스(sus)가 인가될 때 마다 스캔전극들(Y)과 서스테인전극들(Z) 사이에 면방전 형태로 서스테인방전이 일어나게 된다. 여기서, 서스테인기간 동안 인가되는 서스테인펄스(sus)의 수는 각 프레임의 휘도 가중치에 대응하여 설정된다.
서스테인기간 동안 서스테인전극들(Z)에 서스테인펄스(sus)가 마지막으로 인가된 후 서스테인펄스(sus)의 최소값과 최대값 사이의 전압값 즉, 온셀에서 방전이 발생되지 않을 수 있는 전압 보다 크고 오프셀에서 방전이 발생되는 전압 보다 작은 전압을 갖는 정극성(+)의 제 1 및 제 2 펄스전압(V1, V2)이 우수번째(even) 스캔전극들(Y)과 기수번째(odd) 스캔전극들(Y)에 교번적으로 인가된다. 여기서, 제 1 펄스전압(V1)은 제 2 펄스전압(V2)과 동일한 전압값을 갖거나 서로 다른 전압값을 갖을 수 있다. 또한, 우수번째(even) 스캔전극들(Y)에 제 1 펄스전압(V1)이 인가될 때 기수번째(odd) 스캔전극들(Y)에는 기저전압 보다 크고 온셀들에서 방전이 발생되지 않을 수 있는 경계전압(즉, 서스테인펄스의 최소값) 보다 작은 정극성(+)의 제 3 펄스전압(V3)이 인가된다. 그리고, 기수번째(odd) 스캔전극들(Y)에 제 2 펄스전압(V2)이 인가될 때 우수번째(even) 스캔전극들(Y)에는 기저전압 보다 크고 온셀들에서 방전이 발생되지 않을 수 있는 경계전압(즉, 제 1 전압) 보다 작은 정극성(+)의 제 4 펄스전압(V4)이 인가된다. 여기서, 제 3 펄스전압(V3)은 제 4 펄스전압(V4)과 동일한 전압값을 갖거나 서로 다른 전압값을 갖을 수 있다. 이때, 기수번째(odd) 스캔전극들(Y)에 순차적으로 인가되는 제 3 및 제 2 펄스전압(V3, V2)과, 우수번째(even) 스캔전극들(Y)에 순차적으로 인가되는 제 1 및 제 4 펄스전 압(V1, V4)은 계단형태의 펄스파형이다. 이에 따라, 우수번째(even) 위치한 방전셀들에서 마지막 서스테인방전이 발생된 후 기수번째(odd) 위치한 방전셀들에서 마지막 서스테인방전이 차례로 발생하게 된다.
이와 같이 본 발명의 제 3 실시 예에 따른 PDP의 구동방법에서는 한 프레임의 첫 번째 서브필드의 리셋기간에만 셋업전압(Vsetup)을 가지는 상승 램프파형(Ramp-down)을 공급함으로써 첫 번째 서브필드에서만 셋업방전에 의해 광이 발생되고 나머지 서브필드에서는 셋업방전에 의한 광이 발생되지 않으므로 콘트라스트를 향상시킬 수 있을 뿐만 아니라 전력소모를 줄일 수 있다. 또한, 본 발명의 제 3 실시 예에 따른 PDP의 구동방법에서는 서스테인기간에 우수번째(even) 스캔전극들(Y)과 기수번째(odd) 스캔전극들(Y)에 정극성(+)의 제 1 및 제 2 펄스전압(V1, V2)을 교번적으로 인가하고, 우수번째(even) 스캔전극들(Y)과 기수번째(odd) 스캔전극들(Y)에 제 1 및 제 2 펄스전압(V1, V2)이 각각 인가될 때 제 3 및 제 4 펄스전압(V3, V4)을 기수번째(odd) 스캔전극들(Y) 및 우수번째(even) 스캔전극들(Y)에 각각 인가함으로써 수직으로 인접한 셀들간의 크로스토크를 방지할 수 있다. 다시 말해, 제 1 및 제 2 펄스전압(V1, V2) 중 어느 하나에 의해 온셀들에서 강방전이 발생될 때 수직으로 인접한 오프셀들의 스캔전극들(Y)에는 제 1 및 제 2 펄스전압(V1, V2) 중 어느 하나의 전압값 보다 작은 전압값을 갖는 제 3 및 제 4 펄스전압(V3, V4) 중 어느 하나가 인가되므로 온셀들에서 강방전 발생 시 스캔전극들(Y)에 쌓인 전자들은 수직으로 인접한 오프셀들의 스캔전극들(Y)로 이동하지 않게 된다. 이에 따라, 수직으로 인접한 셀 내에서의 셀소거가 방지되므로 오방전을 방지할 수 있게 된다.
이상 본 발명의 제 3 실시 예에 따른 PDP의 구동방법에서는 우수번째(even) 스캔전극들(Y)에 제 1 및 제 4 펄스전압(V1, V4)을 인가하고, 기수번째(odd) 스캔전극들(Y)에 제 3 및 제 2 펄스전압(V3, V2)을 인가하는 방법만을 설명하였으나, 기수번째(odd) 스캔전극들(Y)에 제 1 및 제 4 펄스전압(V1, V4)을 인가하고, 우수번째(even) 스캔전극들(Y)에 제 3 및 제 2 펄스전압(V3, V2)을 인가하더라도 동일한 효과를 얻을 수 있다. 다시 말해, 본 발명의 제 3 실시 예에 따른 PDP의 구동방법에서는 우수번째(even) 스캔전극들(Y)에 먼저 펄스전압을 인가하였으나 기수번째(odd) 스캔전극들(Y)에 펄스전압을 먼저 인가하더라도 본 발명의 제 3 실시 예에 따른 PDP의 구동방법과 동일한 효과를 얻을 수 있다.
상술한 바와 같이, 본 발명에 따른 플라즈마 디스플레이 패널의 구동방법은 스캔전극들을 기수와 우수로 분리하여 기수번째 위치한 스캔전극들과 우수번째 위치한 스캔전극들에 서로 다른 레벨의 전압을 인가하여 마지막 서스테인방전을 발생시킴으로써 수직으로 인접한 셀들간의 크로스토크를 방지할 수 있다. 이에 따라, 수직으로 인접한 셀 내에서의 셀소거가 방지되므로 오방전을 방지할 수 있다.
이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니 라 특허 청구의 범위에 의해 정하여져야만 할 것이다.

Claims (11)

  1. 스캔전극, 서스테인전극 및 어드레스전극을 구비하고 수직으로 인접한 방전셀들에 형성된 전극들이 서스테인전극-스캔전극-스캔전극-서스테인전극 순으로 배치되며 한 프레임이 다수의 서브필들로 나누어지고, 서브필드 각각이 리셋기간, 어드레스기간 및 서스테인기간으로 나누어져 구동되는 플라즈마 디스플레이 패널의 구동방법에 있어서,
    상기 서스테인기간 동안 서스테인펄스를 상기 스캔전극들 및 서스테인전극들에 교번적으로 인가하는 제1 단계와;
    상기 서스테인전극들에 상기 서스테인펄스가 마지막으로 인가된 후 상기 스캔전극들을 기수그룹과 우수그룹으로 나누어, 상기 기수그룹과 우수그룹의 스캔전극들에 상기 서스테인펄스의 최소값과 최대값 사이의 전압값을 갖는 펄스를 교번적으로 인가하는 제2 단계를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  2. 제 1 항에 있어서, 상기 제2 단계는,
    상기 기수그룹 및 우수그룹 중 어느 한 그룹의 스캔전극들에 상기 서스테인펄스의 최소값과 최대값 사이의 전압값을 갖는 정극성의 제 1 펄스를 인가하는 단계와,
    상기 제 1 펄스가 인가되지 않은 그룹의 스캔전극들에 제 1 펄스와 교번되도록 상기 서스테인펄스의 최소값과 최대값 사이의 전압값을 갖는 정극성의 제 2 펄스를 인가하는 단계를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  3. 삭제
  4. 제 2 항에 있어서,
    상기 제 1 및 제 2 펄스는 온셀에서 방전이 발생되지 않을 수 있는 전압 보다 크고 오프셀에서 방전이 발생되는 전압 보다 작은 전압인 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  5. 제 4 항에 있어서,
    상기 제 1 및 제 2 펄스는 동일한 전압값을 갖거나 서로 다른 전압값을 갖는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  6. 제 2 항에 있어서,
    상기 기수그룹 및 우수그룹 중 어느 한 그룹의 스캔전극들에 상기 제 1 펄스가 인가될 때 상기 제 1 펄스가 인가되지 않은 그룹의 스캔전극들에 상기 제 2 펄스 보다 작은 전압값을 갖는 정극성의 제 3 펄스를 인가하는 단계와,
    상기 제 1 펄스가 인가되지 않은 그룹의 스캔전극들에 상기 제 2 펄스가 인가될 때 상기 제 1 펄스가 인가되는 그룹의 스캔전극들에 상기 제 1 펄스 보다 작은 전압값을 갖는 정극성의 제 4 펄스를 인가하는 단계를 더 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  7. 제 6 항에 있어서,
    상기 제 3 및 제 4 펄스는 기저전압 보다 크고 온셀에서 방전이 발생되지 않을 수 있는 경계전압 보다 작은 전압인 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  8. 제 7 항에 있어서,
    상기 제 3 및 제 4 펄스는 동일한 전압값을 갖거나 서로 다른 전압값을 갖는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  9. 제 6 항에 있어서,
    상기 제 2 및 제 4 펄스는 상기 제 1 및 제 3 펄스 보다 소정시간 늦게 인가되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  10. 제 6 항에 있어서,
    상기 제 1 및 제 4 펄스와 상기 제 3 및 제 2 펄스 각각은 계단형태인 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  11. 제 1 항에 있어서,
    상기 프레임의 첫 번째 서브필드의 리셋기간 동안 상기 스캔전극들에 셋업전압까지 상승되는 상승 램프파형과 상기 상승 램프파형의 피크전압 보다 작은 정극성의 서스테인전압에서 부극성으로 하강하는 제 1 하강 램프파형을 순차적으로 인가하는 단계와,
    상기 프레임의 두 번째 서브필드의 리셋기간 동안 상기 스캔전극들에 기저전압에서 부극성으로 하강하는 제 2 하강 램프파형을 인가하는 단계를 더 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
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