KR100697006B1 - 플라즈마 디스플레이 패널 - Google Patents

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Abstract

본 발명은 발광 효율을 향상시킬 수 있도록 한 플라즈마 디스플레이 패널에 관한 것이다.
본 발명의 플라즈마 디스플레이 패널은 방전셀마다 형성되는 스캔전극 및 서스테인전극과, 상기 스캔전극과 교차되는 방향으로 형성되며, 상기 스캔전극과 중첩되는 부분에서 제 1폭으로 형성되고 그 외의 부분에서 제 2폭으로 형성되는 어드레스전극을 구비한다.

Description

플라즈마 디스플레이 패널{Plasma Display Panel}
도 1은 종래의 플라즈마 디스플레이 패널을 나타내는 사시도이다.
도 2는 도 1에 도시된 플라즈마 디스플레이 패널의 한 프레임을 나타내는 도면이다.
도 3은 본 발명의 실시 예에 의한 플라즈마 디스플레이 패널을 나타내는 평면도이다.
< 도면의 주요 부분에 대한 부호의 설명 >
10 : 상부기판 12Y,12Z : 투명전극
13Y,13Z : 금속버스전극 14,22 : 유전체층
16 : 보호막 18 : 하부기판
24 : 격벽 26 : 형광체층
100 : 방전셀
본 발명은 플라즈마 디스플레이 패널에 관한 것으로, 특히 발광 효율을 향상시킬 수 있도록 한 플라즈마 디스플레이 패널에 관한 것이다.
플라즈마 디스플레이 패널(Plasma Display Panel : 이하 "PDP"라 함)은 He+Xe, Ne+Xe 또는 He+Xe+Ne 등의 불활성 혼합가스의 방전시 발생하는 147nm의 자외선에 의해 형광체를 발광시킴으로써 문자 또는 그래픽을 포함한 화상을 표시하게 된다. 이러한 PDP는 박막화와 대형화가 용이할 뿐만 아니라 최근의 기술 개발에 힘입어 크게 향상된 화질을 제공한다. 특히, 3전극 교류 면방전형 PDP는 방전시 표면에 벽전하가 축적되며 방전에 의해 발생되는 스퍼터링으로부터 전극들을 보호하기 때문에 저전압 구동과 장수명의 장점을 가진다.
도 1은 종래의 플라즈마 디스플레이 패널을 나타내는 도면이다.
도 1을 참조하면, 3전극 교류 면방전형 PDP의 방전셀은 상부기판(10) 상에 형성되어진 스캔전극(Y) 및 서스테인전극(Z)과, 하부기판(18) 상에 형성되어진 어드레스전극(X)을 구비한다. 스캔전극(Y)과 서스테인전극(Z) 각각은 투명전극(12Y,12Z)과, 투명전극(12Y,12Z)의 선폭보다 작은 선폭을 가지며 투명전극의 일측 가장자리에 형성되는 금속버스전극(13Y,13Z)을 포함한다.
투명전극(12Y,12Z)은 통상 인듐틴옥사이드(Indium-Tin-Oxide : ITO)로 상부기판(10) 상에 형성된다. 금속버스전극(13Y,13Z)은 통상 크롬(Cr) 등의 금속으로 투명전극(12Y,12Z) 상에 형성되어 저항이 높은 투명전극(12Y,12Z)에 의한 전압강하를 줄이는 역할을 한다. 스캔전극(Y)과 서스테인전극(Z)이 나란하게 형성된 상부 기판(10)에는 상부 유전체층(14)과 보호막(16)이 적층된다. 상부 유전체층(14)에는 플라즈마 방전시 발생된 벽전하가 축적된다. 보호막(16)은 플라즈마 방전시 발생된 스퍼터링에 의한 상부 유전체층(14)의 손상을 방지함과 아울러 2차 전자의 방출 효율을 높이게 된다. 보호막(16)으로는 통상 산화마그네슘(MgO)이 이용된다.
어드레스전극(X)이 형성된 하부기판(18) 상에는 하부 유전체층(22), 격벽(24)이 형성되며, 하부 유전체층(22)과 격벽(24) 표면에는 형광체층(26)이 도포된다. 어드레스전극(X)은 스캔전극(Y) 및 서스테인전극(Z)과 교차되는 방향으로 형성된다. 격벽(24)은 어드레스전극(X)과 나란하게 형성되어 방전에 의해 생성된 자외선 및 가시광이 인접한 방전셀에 누설되는 것을 방지한다. 형광체층(26)은 플라즈마 방전시 발생된 자외선에 의해 여기되어 적색, 녹색 또는 청색 중 어느 하나의 가시광선을 발생하게 된다. 상/하부기판(10,18)과 격벽(24) 사이에 마련된 방전공간에는 불활성 혼합가스가 주입된다.
PDP는 화상의 계조를 구현하기 위하여, 한 프레임을 발광횟수가 다른 여러 서브필드로 나누어 시분할 구동하게 된다. 각 서브필드는 전화면을 초기화시키기 위한 리셋기간과, 주사라인을 선택하고 선택된 주사라인에서 셀을 선택하기 위한 어드레스기간과, 방전횟수에 따라 계조를 구현하는 서스테인기간으로 나뉘어진다.
여기서, 리셋기간은 상승램프파형이 공급되는 셋업기간과 하강램프파형이 공급되는 셋다운 기간으로 나뉘어진다. 예를 들어, 256 계조로 화상을 표시하고자 하는 경우에 도 2와 같이 1/60 초에 해당하는 프레임 기간(16.67ms)은 8개의 서브필드들(SF1내지SF8)로 나누어지게 된다. 8개의 서브 필드들(SF1내지SF8) 각각은 전술한 바와 같이, 리셋기간, 어드레스기간과 서스테인기간으로 나누어지게 된다. 각 서브필드의 리셋기간과 어드레스 기간은 각 서브필드마다 동일한 반면에 서스테인 기간은 각 서브필드에서 2n(n=0,1,2,3,4,5,6,7)의 비율로 증가된다.
이와 같은 종래의 PDP는 스캔전극(Y)과 어드레스전극(X)이 중첩되는 면적이 넓은수록 안정적으로 어드레스 방전을 일으킨다. 한편, 종래의 PDP의 방전셀은 등가적으로 커패시터로 표현될 수 있다. 여기서, 방전셀의 커패시턴스가 높게 설정되면 많은 방전전류가 흐르기 때문에 스캔전극(Y)을 구동하기 위한 스캔 집적회로(Integrated Circuit) 및 어드레스전극(X)을 구동하기 위한 데이터 집적회로에서 높은 열이 발생된다. 따라서, 스캔전극(Y)과 어드레스전극(X)과 안정적인 어드레스 방전을 유지하면서 방전셀의 커패시턴스를 줄일 수 있는 방법이 요구되고 있다.
또한, 서스테인전극(Z)과 스캔전극(Y)의 간격은 PDP의 효율에 직접으로 영향을 미치게 된다. 다시 말하여, 스캔전극(Y)과 서스테인전극(Z)이 간격이 좁으면 발광효율이 저하되지만 소비전력은 줄어들게 된다. 그리고, 서스테인전극(Z)과 스캔전극(Y)의 간격이 넓어지면 소비전력은 상승하나 발광효율은 상승된다. 따라서, 발광효율을 높이면서 소비전력을 어느정도 이하로 유지할 수 있는 서스테인전극(Z)과 스캔전극(Y)의 간격이 요구되고 있다.
따라서, 본 발명의 목적은 발광 효율을 향상시킬 수 있도록 한 플라즈마 디 스플레이 패널을 제공하는 것이다.
상기 목적을 달성하기 위하여 본 발명의 플라즈마 디스플레이 패널은 방전셀마다 형성되는 스캔전극 및 서스테인전극과; 상기 스캔전극과 교차되는 방향으로 형성되며, 상기 스캔전극과 중첩되는 부분에서 제 1폭으로 형성되고 그 외의 부분에서 제 2폭으로 형성되는 어드레스전극을 구비하며; 상기 제 2폭은 80㎛이하로 설정된다.
상기 제 2폭은 80㎛ 내지 20㎛ 사이에서 설정된다.
상기 제 1폭은 상기 제 2폭보다 넓은 폭으로 설정된다.
상기 방전셀에 포함되는 상기 스캔전극 및 서스테인전극의 간격은 120㎛ 이상으로 설정된다.
본 발명의 플라즈마 디스플레이 패널은 방전셀마다 서로 나란하게 형성되는 스캔전극 및 서스테인전극과, 상기 방전셀마다 상기 스캔전극 및 서스테인전극과 교차되는 방향으로 형성되는 어드레스전극을 구비하며, 상기 스캔전극과 상기 서스테인전극의 간격은 120㎛ 이상으로 설정된다.
상기 목적 외에 본 발명의 다른 목적 및 특징들은 첨부도면을 참조한 실시예에 대한 설명을 통하여 명백하게 드러나게 될 것이다.
이하, 도 3을 참조하여 본 발명의 바람직한 실시예에 대하여 설명하기로 한다.
도 3을 참조하면, 본 발명의 PDP는 복수의 스캔전극(Y) 및 서스테인전극(Z)과, 복수의 스캔전극(Y) 및 서스테인전극(Z)과 교차되는 방향으로 형성되는 어드레스전극(X)과, 스캔전극(Y), 서스테인전극(Z) 및 어드레스전극(X)의 교차부마다 위치되는 방전셀(100)을 구비한다.
어드레스전극(X)은 도시되지 않는 하부기판에 형성된다. 이와 같은 어드레스전극(X)은 어드레스기간 동안 공급되는 데이터펄스를 공급받아 켜질 방전셀을 선택한다. 실제로, 어드레스전극(X)에 데이터펄스가 공급되면 스캔전극(Y)으로 공급되는 스캔펄스와 데이터펄스의 전압값이 합쳐져 방전셀(100)에서 어드레스 방전이 일어난다.
스캔전극(Y) 및 서스테인전극(Z)은 도시되지 않는 상부기판에 형성된다. 이 경우, 스캔전극(Y) 및 서스테인전극(Z)은 방전셀(100)에서 생성된 빛이 외부로 공급될 수 있도록 투명물질로 형성된다. 리셋기간 동안 스캔전극(Y)은 외부로부터 초기화펄스를 공급받아 방전셀(100)을 초기화한다. 어드레스기간 동안 스캔전극(Y)은 순차적으로 스캔펄스를 공급받고, 이에 따라 데이터펄스가 공급된 방전셀(100)에서 어드레스 방전이 일어난다. 서스테인기간 동안 스캔전극(Y) 및 서스테인전극(Z)에 교번적으로 서스테인펄스가 공급되어 어드레스 방전이 일어난 방전셀(100)에서 서스테인 방전을 일으키고, 이 서스테인 방전횟수에 대응하여 소정휘도의 영상이 표시된다.
이와 같은 본 발명에서 어드레스전극(X)의 폭은 스캔전극(Y)과 중첩되는 부분과 그 외의 부분에서 상이하게 설정된다. 다시 말하여, 스캔전극(Y)과 어드레스 전극(X)이 중첩되는 부분에서 어드레스전극(X)의 폭은 제 1폭(T1)으로 설정된다. 그리고, 스캔전극(Y)과 어드레스전극(X)이 중첩되지 않는 부분에서 어드레스전극(X)의 폭은 제 1폭(T1)보다 좁은 제 2폭(T2)으로 설정된다.
스캔전극(Y)과 어드레스전극(X)이 중첩되는 부분에서 어드레스전극(X)이 제 1폭(T1)으로 설정되면 스캔전극(Y)과 어드레스전극(X)이 중첩면적이 넓게 설정되고, 이에 따라 안정적으로 어드레스방전을 일으킬 수 있다. 또한, 스캔전극(Y)과 어드레스전극(X)이 중첩되는 부분을 제외한 나머지 부분에서 어드레스전극(X)이 제 2폭(T2)으로 설정되면 방전셀(100)의 커패시터 용량을 최소화할 수 있다. 이를 위하여, 본 발명에서는 제 2폭(T2)을 80㎛이하, 예를 들면 80㎛ 내지 20㎛ 사이로 설정한다. 이와 같이 제 2폭(T2)이 80㎛이하로 설정되면 실험적으로 스캔 집적회로 및 데이터 집적회로의 발열량을 최소화하면서 안정적으로 PDP를 구동시킬 수 있다.
그리고, 본 발명에서는 서스테인전극(Z)과 스캔전극(Y)의 간격을 제 1폭(T1)보다 넓은 제 3폭(T3)으로 설정한다. 예를 들어, 본 발명에서 스캔전극(Y) 및 서스테인전극(Z)의 간격은 120㎛ 이상으로 설정된다. 이와 같이 스캔전극(Y) 및 서스테인전극(Z)의 간격이 120㎛ 이상으로 설정되면 서스테인펄스의 전압이 종래에 비하여 상승하지만, 이와 더불어 PDP의 발광효율도 상승되게 된다. 실험적으로 스캔전극(Y) 및 서스테인전극(Z)의 간격이 120㎛ 이상으로 설정되면 서스테인펄스의 전압을 적정한 수준으로 유지하면서 발광효율을 상승시킬 수 있는 장점이 있다.
상술한 바와 같이, 본 발명에 따른 플라즈마 디스플레이 패널에 의하면 스캔전극과 중첩되지 않는 부분에서 어드레스전극의 폭을 80㎛ 이하로 설정하여 방전셀의 커패시터 용량값을 줄일 수 있고, 이에 따라 안정적으로 구동될 수 있다. 그리고, 본 발명에서는 스캔전극과 서스테인전극의 간격을 120㎛ 이상으로 설정하여 방광효율을 향상시킬 수 있다.
이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의해 정하여져야만 할 것이다.

Claims (4)

  1. 방전셀마다 형성되는 스캔전극 및 서스테인전극과;
    상기 스캔전극과 교차되는 방향으로 형성되며, 상기 스캔전극과 중첩되는 부분에서 제 1폭으로 형성되고 그 외의 부분에서 제 2폭으로 형성되는 어드레스전극을 구비하며;
    상기 제 2폭은 20㎛ 내지 80㎛로 형성되고,
    상기 서스테인전극과 스캔전극의 간격은 상기 제 1폭 보다 넓은 제 3폭으로 형성되는 플라즈마 디스플레이 패널.
  2. 제 1항에 있어서,
    상기 제 1폭은 상기 제 2폭보다 넓은 폭으로 설정되는 플라즈마 디스플레이 패널.
  3. 제 1항 또는 제 2항에 있어서,
    상기 방전셀에 포함되는 상기 스캔전극 및 서스테인전극의 간격은 120㎛ 이상으로 설정되는 플라즈마 디스플레이 패널.
  4. 삭제
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