KR200179140Y1 - 액정표시장치 - Google Patents
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Abstract
본 고안은 액정표시장치에 관한 것으로, 액정표시장치의 박막 트랜지스터의 특성을 용이하게 검사하기 위해 게이트 버스라인과 데이타 버스라인이 매트릭스 형태로 각각의 박막트랜지스터의 게이트 전극에 각각 연결되어 있고, 박막트랜지스터의 화소전극은 액정을 가운데 두고 상대전극인 공통전극과 마주보도록 형성되어 있으며, 상기 화소전극이 전기적으로 측정 가능하도록 유효표시영역 외부에 별도의 접촉전극인 화소전극용 접속전극과 연결되어 있다.
Description
제1도는 종래의 기술에 의한 액정표시장치 박막트랜지스터 어레이의 구성도.
제2도는 본 고안에 의한 액정표시장치 박막트랜지스터 어레이의 제1실시예 의 구성도.
제3도는 본 고안에 의한 액정표시장치 박막트랜지스터 어레이의 제2실시예의 구성도.
* 도면의 주요부분에 대한 부호의 설명
1 : 게이트 전극 2 : 드레인 전극
3 : 게이트 버스라인 4 : 데이타 버스라인
5 : 게이트 접속전극 6 : 데이타 접속전극
7 : 화소전극 8 : 화소전극용 접속전극
본 고안은 액정표시장치에 관한 것으로, 특히 검사가 어려운 박막트랜지스터(transistor) 어레이(array) 내의 트랜지스터 특성을 용이하게 검사할 수 있는 액정표시장치에 관한 것이다.
종래의 액정표시장치는 액정을 구동하기 위한 능동소자인 박막트랜지스터 어레이의 경우, 제1도에 도시한 바와 같이 게이트(gate) 전극(1), 드레인(drain) 전극(2) 및 소스(source) 전극의 3전극으로 구성되어 있고, 상기 박막 트랜지스터의 게이트 전극(1)과 드레인 전극(2)은 각각 게이트 버스라인(bus line)(3)과 데이타 버스라인(4)에 연결되어 있으며, 박막 트랜지스터의 어레이 외각에는 게이트 및 데이타 접속전극(5,6)이 연결되어 있으며, 또한 소스전극은 화소전극(7)으로서 공통전극과 대응되는 위치의 어레이 내에 만들어진다.
상기 화소전극(7)은 트랜지스터의 소스전극으로서 뿐만아니라 공통전극과 함께 캐패시터를 형성하며 각 화소전극과 공통전극간의 액정을 구동시키기 때문에 어레이 내에 분리되어 있으며, 어레이 전면 위에는 예를들면 실리콘 나이트 라이드(SiNx)와 같은 절연물질로 보호막이 형성되어 있는데, 이러한 구조에서 어레이 내의 트랜지스터의 특성을 검사하기 위해서 종래에는 상기 화소전극 위의 보호막을 화소전극보다 작은 크기로 제거하여 화소전극을 오픈(open)시켜 상기 화소전극이 전기적 접촉을 가능하게 하는 방법을 사용하였다.
그러나 상기와 같은 구조의 박막 트랜지스터 어레이의 경우 상기 화소전극의 크기가 수백 마이크로 미터(㎛)로 너무 작아 특성 검사를 위한 프루빙(probing) 작업이 어려우며, 화소전극을 오픈시킬때 공통전극에 액정이 접촉함으로써 액정이 열화되기 쉬우며, 어레이 공정 이후의 액정공정 또는 그 이후에 트랜지스터의 분석에 있어서 파괴검사 외에의 검사가 불가능한 문제점이 있다.
따라서 본 고안의 목적은 상기와 같은 문제점을 해결하여 쉽게 트랜지스터의 특성검사를 할 수 있는 액정표시장치를 제공하는 것이다.
상기의 목적을 달성하기 위한 본 고안의 액정표시장치는 게이트 버스라인과 데이타 버스라인이 매트릭스 형태로 각각의 박막트랜지스터의 게이트 전극에 각각 연결되어 있고, 박막트랜지스터의 화소전극은 액정을 가운데 두고 상대전극인 공통전극과 마주보도록 형성되어 있으며, 상기 화소전극이 전기적으로 측정 가능하도록 유효표시영역 외부에 별도의 접촉전극인 화소전극용 접속전극과 연결되어 있는 것을 특징으로 한다.
이하 첨부도면을 참조하여 본 고안을 좀 더 상세하게 설명하고자 한다.
본 고안의 액정표시장치는 제2도에 도시한 바와 같이 종래와 동일하게 박막 트랜지스터의 게이트 전극(1)과 드레인 전극(2)은 각각 게이트 버스라인(3)과 데이타 버스라인(4)에 연결되며, 박막 트랜지스터의 어레이 외각에는 게이트 및 데이타 접속전극(5,6)이 연결되며, 화소전극(7)은 실제 화상을 표현하는 유효표시영역(A) 외부에 별도의 접촉전극인 화소전극용 접속전극(8)을 형성하여 이 화소전극용 접속전극(8)과 연결시키므로써 트랜지스터 어레이 외부영역예서 상기 각 접속전극(5,6,8)을 통해 트랜지스터의 특성을 검사할 수 있도록 하거나 또는 제3도에 도시한 바와 같이 독립적으로 화소전극용 접속전극을 형성하지 않고 상기 화소전극(7)을 인접한 데이타 접속전극(6)이나 게이트 접속전극(5)에 연결시킨 다음 순차적으로 행(columu) 또는 열(row)을 바꾸면서 트랜지스터 어레이 외부영역에서 트랜지스터의 특성을 검사할 수 있으며, 검사가 완료되면 액정패널의 정상적인 구동을 위해 화소전극(7)과 인접한 데이타 접속전극(6) 또는 게이트 접속전극(5)을 연결시키는 배선을 커팅시켜 완제품의 구동에 영향을 미치지 않도록 한다.
이상에서와 같이 본 고안에 의하면 트랜지스터 어레이 형성공정 이후 액정공정상이나 완료후에 실제 트랜지스터의 특성을 용이하게 검사할수 있으며, 액정공정 후 화소전극과 공통전극간에 액정의 캐패시턴스 및 누설전류특성 또한 용이하게 검사할 수 있는 효과가 있다.
Claims (1)
- 게이트 버스라인(3)과 데이타 버스라인(4)이 매트릭스 형태로 각각의 박막트랜지스터의 게이트 전극(1)과 드레인 전극(2)에 각각 연결되어 있고, 박막트랜지스터의 화소전극(7)이 액정을 중심으로 상대전극인 공통전극과 마주보도록 형성되어 있으며, 상기 화소전극(7)이 전기적으로 측정 가능하도록 유효표시영역 외부에 별도의 접촉전극인 화소전극용 접속전극(8)과 연결되어 있는 것을 특징으로 하는 액정표시장치.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR2019940002995U KR200179140Y1 (ko) | 1994-02-18 | 1994-02-18 | 액정표시장치 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR2019940002995U KR200179140Y1 (ko) | 1994-02-18 | 1994-02-18 | 액정표시장치 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| KR950025628U KR950025628U (ko) | 1995-09-18 |
| KR200179140Y1 true KR200179140Y1 (ko) | 2000-05-01 |
Family
ID=19377457
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| KR2019940002995U KR200179140Y1 (ko) | 1994-02-18 | 1994-02-18 | 액정표시장치 |
Country Status (1)
| Country | Link |
|---|---|
| KR (1) | KR200179140Y1 (ko) |
-
1994
- 1994-02-18 KR KR2019940002995U patent/KR200179140Y1/ko not_active IP Right Cessation
Also Published As
| Publication number | Publication date |
|---|---|
| KR950025628U (ko) | 1995-09-18 |
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