KR101088288B1 - 플라즈마 디스플레이 장치 - Google Patents

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Abstract

플라즈마 디스플레이 장치는, 복수의 주사 전극을 갖는 패널과, 복수의 주사 전극에 주사 펄스를 인가하는 주사 IC를 탑재한 회로 기판을 갖는 구동 회로를 구비한 플라즈마 디스플레이 장치로서, 구동 회로는, 복수의 주사 전극을 홀수번째의 주사 전극 그룹과 짝수번째의 주사 전극 그룹으로 나눠 구동하고, 주사 IC를 탑재한 회로 기판은, 홀수번째의 주사 전극 그룹에 주사 펄스를 인가하는 주사 IC를 실장하는 면 또는 층과, 짝수번째의 주사 전극 그룹에 주사 펄스를 인가하는 주사 IC를 실장하는 면 또는 층은 서로 다르다.

Description

플라즈마 디스플레이 장치{PLASMA DISPLAY DEVICE}
본 발명은 플라즈마 디스플레이 패널을 이용한 플라즈마 디스플레이 장치에 관한 것이다.
플라즈마 디스플레이 패널(이하, 「패널」이라고 약기함)로서 대표적인 교류 면방전형 패널은, 대향 배치된 전면판과 배면판 사이에 다수의 방전 셀이 형성되어 있다.
전면판에는 주사 전극과 유지 전극으로 이루어지는 표시 전극쌍이 전면유리기판 상에 서로 평행하게 복수쌍 형성되고, 배면판에는 데이터 전극이 배면 유리 기판 상에 평행하게 복수 형성되어 있다. 그리고, 표시 전극쌍과 데이터 전극이 입체교차하도록 전면판과 배면판이 대향 배치되어 밀봉되고, 내부의 방전 공간에는 방전 가스가 봉입되어 있다. 여기서 표시 전극쌍과 데이터 전극의 대향하는 부분에 방전 셀이 형성된다.
플라즈마 디스플레이 장치는, 이러한 패널과 패널의 각 전극을 구동하는 구동 회로를 구비한다. 구동 회로는, 서브필드법, 즉, 1 필드 기간을 복수의 서브필 드로 분할한 뒤에, 발광시키는 서브필드의 조합에 의해 계조 표시를 행하는 방법을 이용하여, 패널의 주사 전극, 유지 전극 및 데이터 전극의 각각을 구동한다. 각 서브필드는, 초기화 기간, 기입 기간 및 유지 기간을 갖는다. 초기화 기간에서는 초기화 방전을 발생하여, 계속되는 기입 동작에 필요한 벽전하가 각 전극 상에 형성된다. 기입 기간에서는, 주사 전극의 각각에 주사 펄스를 순차적으로 인가함과 동시에 표시를 해야 할 방전 셀의 데이터 전극에 기입 펄스를 인가하여, 기입 방전이 발생한다. 그리고 유지 기간에서는, 표시 전극쌍에 교대로 유지 펄스를 인가하여 유지 방전을 발생시켜 발광시키는 것에 의해 화상 표시가 행하여진다.
그러나 서브필드법을 이용하여 패널을 구동하는 경우에, 주사 전극에 주사 펄스를 인가하지 않더라도 데이터 전극에 기입 펄스를 인가하는 것만으로 기입 동작에 필요한 벽전하가 감소한다. 그 결과, 기입 방전이 불안정하게 되는 경우가 있다. 이 과제를 해결하는 방법으로서, 예컨대, 특허문헌 1에는, 주사 전극을 4개의 주사 전극 그룹으로 나눔과 동시에, 각 주사 전극 그룹에 속하는 주사 전극에 주사 펄스를 순차적으로 인가하는 4개의 기간으로 기입 기간을 분할하고, 주사 펄스를 인가하지 않는 주사 전극 그룹에는, 주사 펄스를 인가하는 주사 전극 그룹보다도 높은 전압을 인가하는 구동 방법이 개시되어 있다.
그러나 상기의 구동 방법에 의하면, 인접하는 주사 전극의 전압차가 과대하게 되는 타이밍이 생겨, 패널의 전극 단자 사이나 프린트 기판의 배선 패턴 사이에서 스파크가 발생할 가능성이 있다. 또는, 마이그레이션에 의해 패널의 주사 전극인출 부분에서 단락하는 등의 가능성이 있다. 또한, 주사 전극 그룹의 각각에 대응 한 주사 전극 구동 회로로부터 구동 전압이 공급되기 때문에, 주사 전극 그룹마다 구동 전압 파형에 약간의 차이가 생겨, 주사 전극 그룹의 경계에 대응하는 화상 표시영역에 윤곽이 발생하여 화상 표시 품질이 저하되는 등의 과제가 있다.
[특허문헌 1] 일본 특허 공개 제2003-43989호 공보
본 발명은 상술한 과제에 비추어 이루어진 것이며, 패널의 전극 단자 사이나 프린트 기판의 배선 패턴 사이에서 스파크나 단락을 발생시킬 우려가 없고, 또한 화상 표시 품질을 저하시키지 않고, 벽전하의 감소를 막아 안정한 기입 방전을 발생시킬 수 있는 플라즈마 디스플레이 장치를 제공한다.
플라즈마 디스플레이 장치는, 복수의 주사 전극을 갖는 플라즈마 디스플레이 패널과, 복수의 주사 전극에 주사 펄스를 인가하는 주사 IC를 탑재한 회로 기판을 갖는 구동 회로를 구비하고, 구동 회로는 복수의 주사 전극을 홀수번째의 주사 전극 그룹과 짝수번째의 주사 전극 그룹으로 나눠 구동하고, 주사 IC를 탑재한 회로 기판은, 한쪽의 면에 홀수번째의 주사 전극 그룹에 주사 펄스를 인가하는 주사 IC를 실장하며, 다른 쪽의 면에 짝수번째의 주사 전극 그룹에 주사 펄스를 인가하는 주사 IC를 실장한다.
플라즈마 디스플레이 장치는, 복수의 주사 전극을 갖는 플라즈마 디스플레이 패널과, 복수의 주사 전극에 주사 펄스를 인가하는 주사 IC를 탑재한 회로 기판을 갖는 구동 회로를 구비하고, 구동 회로는 복수의 주사 전극을 홀수번째의 주사 전극 그룹과 짝수번째의 주사 전극 그룹으로 나눠 구동하고, 주사 IC를 탑재한 회로 기판은 2층 이상의 배선층을 구비한 다층의 회로 기판이며, 홀수번째의 주사 전극 그룹에 주사 펄스를 인가하는 주사 IC의 출력을 배선하는 배선층과 짝수번째의 주사 전극 그룹에 주사 펄스를 인가하는 주사 IC의 출력을 배선하는 배선층이 서로 다르다.
도 1은 본 발명의 실시예에 이용하는 패널의 구조를 나타내는 분해 사시도,
도 2은 본 발명의 실시예에 이용하는 패널의 전극 배열도,
도 3은 본 발명의 실시예에 있어서의 플라즈마 디스플레이 장치의 회로 블록도,
도 4은 본 발명의 실시예에 있어서의 패널의 각 전극에 인가하는 구동 전압 파형을 나타내는 도면,
도 5은 본 발명의 실시예에 있어서의 패널의 각 전극에 인가하는 구동 전압 파형을 나타내는 도면,
도 6은 본 발명의 실시예에 있어서의 플라즈마 디스플레이 장치의 주사 펄스 발생부의 구성을 나타내는 회로도,
도 7은 본 발명의 실시예에 있어서의 플라즈마 디스플레이 장치의 구조의 일례를 나타내는 분해 사시도,
도 8(a)는 본 발명의 실시예에 있어서의 주사 IC를 실장한 회로 기판을 나타 내는 도면,
도 8(b)는 본 발명의 실시예에 있어서의 주사 IC를 실장한 회로 기판을 나타내는 도면,
도 9은 본 발명의 실시예에 있어서의 회로 기판의 배선의 모양을 나타내는 도면이다.
부호의 설명
10 : 패널 22 : 주사 전극
23 : 유지 전극 24 : 표시 전극쌍
32 : 데이터 전극 41 : 화상 신호 처리 회로
42a, 42b : 데이터 전극 구동 회로 43 : 주사 전극 구동 회로
44 : 유지 전극 구동 회로 45 : 타이밍 발생 회로
50 : 주사 펄스 발생부 51, 52 : 스위치
53 : 홀수 전극 출력부 54 : 짝수 전극 출력부
55(1), 55(3), …, 56(2), 56(4), … : 출력부
100 : 플라즈마 디스플레이 장치 531~550 : 주사 IC
561~568 : 커넥터
이하, 본 발명의 실시예에 있어서의 플라즈마 디스플레이 장치에 대하여, 도 면을 이용하여 설명한다.
(실시예)
도 1은 본 발명의 실시예에 이용하는 패널(10)의 구조를 나타내는 분해 사시도이다. 유리제의 전면 기판(21) 상에는, 주사 전극(22)과 유지 전극(23)으로 이루어지는 표시 전극쌍(24)이 복수 형성되어 있다. 그리고 주사 전극(22)과 유지 전극(23)을 덮도록 유전체층(25)이 형성되고, 그 유전체층(25) 상에 보호층(26)이 형성되어 있다. 배면 기판(31) 상에는 데이터 전극(32)이 복수 형성되고, 데이터 전극(32)을 덮도록 유전체층(33)이 형성되고, '井'자 형상의 격벽(34)이 더 형성되어 있다. 그리고, 격벽(34)의 측면 및 유전체층(33) 상에는 적색, 녹색 및 청색의 각 색으로 발광하는 형광체층(35)이 마련되어 있다.
이들 전면 기판(21)과 배면 기판(31)은, 미소한 방전 공간을 사이에 두고 표시 전극쌍(24)과 데이터 전극(32)이 교차하도록 대향 배치되고, 그 외주부는 유리 프리트 등의 밀봉재에 의해 밀봉되어 있다. 그리고 방전 공간에는, 예컨대, 네온과 제논의 혼합 가스가 방전 가스로서 봉입되어 있다. 방전 공간은 격벽(34)에 의해 복수의 구획으로 나누어져 있고, 표시 전극쌍(24)과 데이터 전극(32)이 교차하는 부분에 방전 셀이 형성되어 있다. 그리고 이들의 방전 셀이 방전, 발광하는 것에 의해 화상이 표시된다.
또, 패널(10)의 구조는 상술한 것에 한정되는 것이 아니고, 예컨대, 스트라이프 형상의 격벽을 구비한 것이더라도 좋다.
도 2는 본 발명의 실시예에 이용하는 패널(10)의 전극 배열도이다. 패널(10)에는, 행 방향으로 긴 n개(n은 짝수)의 주사 전극 SC1~주사 전극 SCn(도 1의 주사 전극(22)) 및 n개의 유지 전극 SU1~유지 전극 SUn(도 1의 유지 전극(23))이 배열되어 있다. 또한 패널(10)의 상반분에는 열 방향으로 긴 m개의 데이터 전극 D1a~데이터 전극 Dma(도 1의 데이터 전극(32))이 배열되고, 패널(10)의 하반분에는 열 방향으로 긴 m개의 데이터 전극 D1b~데이터 전극 Dmb(도 1의 데이터 전극(32))가 배열되어 있다. 그리고, 1쌍의 주사 전극 SCi(i=1~n) 및 유지 전극 SUi와 하나의 데이터 전극 Dja(j=1~m) 또는 데이터 전극 Djb(j=1~m)가 교차한 부분에 방전 셀이 형성되고, 방전 셀은 방전 공간내에 2×m×n개 형성되어 있다. 본 실시예에 있어서는, 상술한 바와 같이 데이터 전극 Dja와 데이터 전극 Djb로 분할된 데이터 전극을 구비한 패널(10)을 예로 설명하지만, 본 발명은 이것에 한정되는 것이 아니라, 데이터 전극 Dj는 분할되어 있지 않더라도 좋다.
도 3은 본 발명의 실시예에 있어서의 플라즈마 디스플레이 장치(100)의 회로 블록도이다. 플라즈마 디스플레이 장치(100)는, 패널(10), 화상 신호 처리 회로(41), 데이터 전극 구동 회로(42a), 데이터 전극 구동 회로(42b), 주사 전극 구동 회로(43), 유지 전극 구동 회로(44), 타이밍 발생 회로(45) 및 각 회로 블록에 필요한 전원을 공급하는 전원부(도시하지 않음)를 구비하고 있다.
화상 신호 처리 회로(41)는 입력된 화상 신호를 서브필드마다의 발광·비발광을 나타내는 화상 데이터로 변환한다. 데이터 전극 구동 회로(42a)는 서브필드마다의 화상 데이터를 각 데이터 전극 D1a~데이터 전극 Dma에 대응하는 신호로 변환 하여 각 데이터 전극 D1a~데이터 전극 Dma를 구동한다. 데이터 전극 구동 회로(42b)는 서브필드마다의 화상 데이터를 각 데이터 전극 D1b~데이터 전극 Dmb에 대응하는 신호로 변환하여 각 데이터 전극 D1b~데이터 전극 Dmb를 구동한다.
타이밍 발생 회로(45)는 수평 동기 신호 및 수직 동기 신호를 바탕으로 하여 각 회로 블록의 동작을 제어하는 각종 타이밍 신호를 발생시키고, 각각의 회로 블록으로 공급한다. 주사 전극 구동 회로(43)는, 기입 기간에 있어서 주사 전극 SC1~주사 전극 SCn에 인가하는 각종 전압 및 주사 펄스를 발생시키기 위한 주사 펄스 발생부(50)를 갖고, 타이밍 신호에 의거하여 각 주사 전극 SC1~주사 전극 SCn을 각각 구동한다. 유지 전극 구동 회로(44)는 타이밍 신호에 의거하여 유지 전극 SU1~유지 전극 SUn을 구동한다.
다음으로, 패널(10)을 구동하기 위한 구동 전압 파형과 그 동작에 대하여 설명한다. 플라즈마 디스플레이 장치(100)는, 서브필드법, 즉 1 필드 기간을 복수의 서브필드로 분할하여, 서브필드마다 각 방전 셀의 발광·비발광을 제어함으로써 계조 표시를 행한다. 각각의 서브필드는 초기화 기간, 기입 기간 및 유지 기간을 갖는다. 초기화 기간에서는 초기화 방전을 발생하여, 계속되는 기입 방전에 필요한 벽전하가 각 전극 상에 형성된다. 기입 기간에서는, 발광시켜야 할 방전 셀에서 선택적으로 기입 방전을 발생하여 벽전하가 형성된다. 그리고 유지 기간에서는, 기입 방전을 발생한 방전 셀에서 유지 방전을 발생시켜 발광시킨다.
또, 본 실시예는, 주사 전극을 홀수번째의 주사 전극 그룹과 짝수번째의 주사 전극 그룹으로 나눠 구동한다. 기입 기간은, 홀수번째의 주사 전극 SC1, 주사 전극 SC3, …, 주사 전극 SCn-1의 각각에 주사 펄스를 순차적으로 인가하는 홀수 기입 기간(이하, 「홀수 기간」이라고 약기함)과, 짝수번째의 주사 전극 SC2, 주사 전극 SC4, …, 주사 전극 SCn의 각각 주사 펄스를 순차적으로 인가하는 짝수 기입 기간(이하, 「짝수 기간」이라고 약기함)으로 분할된다. 그리고 이하에서는, 우선 짝수 기간, 다음으로 홀수 기간을 배치하여 기입 기간을 구성한 것으로 하여 설명하지만, 물론 본 발명은 이 순서에 한정되는 것이 아니다.
도 4 및 도 5는, 본 발명의 실시예에 있어서의 패널(10)의 각 전극에 인가하는 구동 전압 파형을 나타내는 도면이다. 도 4는 패널(10)의 상반분의 데이터 전극 D1a~데이터 전극 Dma 및 주사 전극 SC1~주사 전극 SCn/2의 각각에 인가하는 구동 전압 파형을 나타내고 있다. 도 5는 패널(10)의 하반분의 데이터 전극 D1b~데이터 전극 Dmb 및 주사 전극 SCn/2+1~주사 전극 SCn의 각각에 인가하는 구동 전압 파형을 나타내고 있다. 1 필드 기간은, 예컨대, 10개의 서브필드로 구성되어 있지만, 도 4 및 도 5에는 2개의 서브필드의 구동 전압 파형을 나타내고 있다.
제 1 서브필드의 초기화 기간의 전반부에서는, 데이터 전극 D1a~데이터 전극 Dma, 데이터 전극 D1b~데이터 전극 Dmb에 기입 펄스 전압 Vw가 인가된다. 유지 전극 SU1~유지 전극 SUn에 전압 0(V)이 인가된다. 주사 전극 SC1~주사 전극 SCn에는, 유지 전극 SU1~유지 전극 SUn에 대하여 방전 개시 전압 이하의 전압 Vi1로부터, 방전 개시 전압을 초과하는 전압 Vi2를 향하여 완만히 상승하는 경사 파형 전압이 인가된다. 이 경사 파형 전압이 상승하는 사이에, 주사 전극 SC1~주사 전극 SCn과 유지 전극 SU1~유지 전극 SUn, 데이터 전극 D1a~데이터 전극 Dma, 데이터 전극 D1b~ 데이터 전극 Dmb와의 사이에서 각각 미약한 초기화 방전이 일어난다. 그리고, 주사 전극 SC1~주사 전극 SCn 상에 부(負)의 벽전압이 축적되고, 또한, 데이터 전극 D1a~데이터 전극 Dma 상, 데이터 전극 D1b~데이터 전극 Dmb 상 및 유지 전극 SU1~유지 전극 SUn 상에는 정의 벽전압이 축적된다. 여기서, 전극 상의 벽전압이란 전극을 덮는 유전체층 상, 보호층 상, 형광체층 상 등에 축적된 벽전하에 의해 생기는 전압을 나타낸다.
초기화 기간의 후반부에서는, 데이터 전극 D1a~데이터 전극 Dma, 데이터 전극 D1b~데이터 전극 Dmb에 전압 0(V)이 인가되어, 유지 전극 SU1~유지 전극 SUn에 정의 전압 Ve1이 인가된다. 주사 전극 SC1~주사 전극 SCn에는, 유지 전극 SU1~유지 전극 SUn에 대하여 방전 개시 전압 이하로 되는 전압 Vi3으로부터 방전 개시 전압을 초과하는 전압 Vi4를 향하여 완만히 하강하는 경사 파형 전압이 인가된다. 그 사이에, 주사 전극 SC1~주사 전극 SCn과 유지 전극 SU1~유지 전극 SUn, 데이터 전극 D1a~데이터 전극 Dma, 데이터 전극 D1b~데이터 전극 Dmb와의 사이에서 각각 미약한 초기화 방전이 일어난다. 그리고, 주사 전극 SC1~주사 전극 SCn 상의 부의 벽전압 및 유지 전극 SU1~유지 전극 SUn 상의 정의 벽전압이 약하게 되고, 데이터 전극 D1a~데이터 전극 Dma 상, 데이터 전극 D1b~데이터 전극 Dmb 상의 정의 벽전압은 기입 동작에 적합한 값으로 조정된다.
또, 1 필드를 구성하는 서브필드 중, 몇 개의 서브필드에서는 초기화 기간의 전반부를 생략할 수도 있고, 그 경우에는, 직전의 서브필드에서 유지 방전을 한 방전 셀에 대하여 선택적으로 초기화 동작이 행하여진다. 도 4는, 제 1 서브필드의 초기화 기간에서는 전반부 및 후반부를 갖는 초기화 동작, 제 2 서브필드 및 그 이후의 초기화 기간에서는 후반부만을 갖는 초기화 동작을 행하는 구동 전압 파형을 나타내고 있다.
계속되는 기입 기간에서는, 본 실시예에 있어서는 패널(10)의 상반분의 방전 셀과 패널(10)의 하반분의 방전 셀에서 동시에 기입 동작이 행하여진다. 우선 짝수 기간에 있어서의 패널(10)의 상반분의 방전 셀의 기입 동작에 대하여 설명한다.
짝수 기간의 처음에, 유지 전극 SU1~유지 전극 SUn에 전압 Ve2이 인가된다. 홀수번째의 주사 전극 SC1, 주사 전극 SC3, …, 주사 전극 SCn/2-1의 각각에는 제 4 전압 Vs4이 인가되고, 짝수번째의 주사 전극 SC2, 주사 전극 SC4, …, 주사 전극 SCn/2의 각각에는 제 2 전압 Vs2이 각각 인가된다. 여기서, 제 4 전압 Vs4은 제 2 전압 Vs2보다 높은 전압이다.
다음으로, 2번째의 주사 전극 SC2에 부의 주사 펄스를 인가하기 위해 제 1 전압인 주사 펄스 전압 Vad가 인가된다. 그리고, 데이터 전극 D1a~데이터 전극 Dma 중 위에서 첫번째로 발광시켜야 할 방전 셀의 데이터 전극 Dka(k=1~m)에 정(正)의 기입 펄스 전압 Vw가 인가된다. 이 때 본 실시예에 있어서는, 주사 전극 SC2에 인접하는 주사 전극, 즉 첫번째의 주사 전극 SC1 및 세번째의 주사 전극 SC3에 제 4 전압 Vs4보다 낮은 제 3 전압 Vs3이 인가된다. 이것은, 서로 인접하는 주사 전극 SC1과 주사 전극 SC2의 사이, 및 주사 전극 SC2와 주사 전극 SC3의 사이에 과대한 전압차가 인가되는 것을 막기 위해서이다.
그러면 기입 펄스 전압 Vw를 인가한 방전 셀의 데이터 전극 Dka 상과 주사 전극 SC2 상의 교차부의 전압차는, 외부 인가 전압의 차(Vw-Vad)에 데이터 전극 Dka 상의 벽전압과 주사 전극 SC2상의 벽전압의 차가 가산된 것으로 되어, 방전 개시 전압을 초과한다. 그리고, 데이터 전극 Dka와 주사 전극 SC2의 사이 및 유지 전극 SU2와 주사 전극 SC2의 사이에 기입 방전이 일어난다. 그렇게 하여, 주사 전극 SC2 상에 정의 벽전압이 축적되고, 유지 전극 SU2 상에 부의 벽전압이 축적되며, 데이터 전극 Dka 상에도 부의 벽전압이 축적된다. 이렇게 하여, 위에서 2번째로 발광시켜야 할 방전 셀에서 기입 방전을 일으켜 각 전극 상에 벽전압을 축적하는 기입 동작이 행하여진다. 한편, 기입 펄스 전압 Vw를 인가하지 않은 데이터 전극 D1a~데이터 전극 Dma와 주사 전극 SC2의 교차부의 전압은 방전 개시 전압을 초과하지 않기 때문에, 기입 방전은 발생하지 않는다.
다음으로, 네번째의 주사 전극 SC4에 제 1 전압인 주사 펄스 전압 Vad가 인가되고, 또한, 데이터 전극 D1a~데이터 전극 Dma 중 위에서 네번째로 발광시켜야 할 방전 셀의 데이터 전극 Dka에 정의 기입 펄스 전압 Vw가 인가된다. 이 때 주사 전극 SC4에 인접하는 세번째의 주사 전극 SC3 및 다섯번째의 주사 전극 SC5에도 제 3 전압 Vs3이 인가된다. 그러면 그 방전 셀의 데이터 전극 Dka와 주사 전극 SC4와의 사이 및 유지 전극 SU4와 주사 전극 SC4와의 사이에 기입 방전이 일어나, 각 전극 상에 벽전압을 축적하는 기입 동작이 행하여진다.
이하, 짝수번째의 주사 전극 SC6, 주사 전극 SC8, …, 주사 전극 SCn/2에 관해서도 마찬가지로 기입 동작이 행하여진다. 그리고 이 때 기입 동작을 행하는 짝수번째의 주사 전극 SCp(p=짝수, 1<p<n)에 인접하는 홀수번째의 주사 전극 SCp-1 및 주사 전극 SCp+1에도 제 3 전압 Vs3이 인가된다.
패널(10)의 하반분의 방전 셀의 기입 동작에 관해서도 마찬가지로, 유지 전극 SU1~유지 전극 SUn에 전압 Ve2이 인가된다. 홀수번째의 주사 전극 SCn/2+1, 주사 전극 SCn/2+3, …, 주사 전극 SCn-1의 각각에는 제 4 전압 Vs4이 인가된다. 짝수번째의 주사 전극 SCn/2+2, 주사 전극 SCn/2+4, …, 주사 전극 SCn의 각각에는 제 2 전압 Vs2이 각각 인가된다. 그 후, 도 5에 나타내는 바와 같이, 짝수번째의 주사 전극 SCn, 주사 전극 SCn-2, …, 주사 전극 SCn/2+2에 주사 펄스가 순차적으로 인가된다. 그리고 이 때 기입 동작을 행하는 짝수번째의 주사 전극 SCp에 인접하는 홀수번째의 주사 전극 SCp-1 및 주사 전극 SCp+1에도 제 3 전압 Vs3이 인가된다.
또 본 실시예의 짝수 기간에 있어서는, 도 4, 도 5에 나타내는 바와 같이, 패널(10)의 상반분의 주사 전극 SC2, 주사 전극 SC4, …, 주사 전극 SCn/2에는 위에서 아래를 향해 주사 펄스가 순차적으로 인가되고, 패널(10)의 하반분의 주사 전극 SCn/2+2, 주사 전극 SCn/2+4, …, 주사 전극 SCn에는 아래에서 위를 향해 주사 펄스가 순차적으로 인가된다. 그리고 주사 전극 SC2와 주사 전극 SCn에 동시에 주사 펄스가 인가되고, 주사 전극 SC4와 주사 전극 SCn-2에 동시에 주사 펄스가 인가되고, …, 주사 전극 SCn/2와 주사 전극 SCn/2+2에 동시에 주사 펄스가 인가된다. 그러나 본 발명은 이것에 한정되는 것이 아니다. 즉, 패널(10)의 상반분의 주사 전극 SC2, 주사 전극 SC4, …, 주사 전극 SCn/2 및 하반분의 주사 전극 SCn/2+2, 주사 전극 SCn/2+4, …, 주사 전극 SCn 모두에 위에서 아래를 향해 순차적으로 주사 펄스를 인가할 수도 있다. 또한 패널(10)의 상반분의 주사 전극 SC2, 주사 전극 SC4, …, 주사 전극 SCn/2에 아래에서 위를 향해 주사 펄스를 순차적으로 인가하고, 하반분의 주사 전극 SCn/2+2, 주사 전극 SCn/2+4, …, 주사 전극 SCn에 위에서 아래를 향해 주사 펄스를 순차적으로 인가할 수도 있다.
계속되는 홀수 기간에서는, 패널(10)의 상반분에 있어서, 홀수번째의 주사 전극 SC1, 주사 전극 SC3, …, 주사 전극 SCn/2-1에 제 2 전압 Vs2이 인가된다. 짝수번째의 주사 전극 SC2, 주사 전극 SC4, …, 주사 전극 SCn/2에 관해서는 제 4 전압 Vs4을 인가할 수도 있지만, 본 실시예는 제 2 전압 Vs2을 인가한다.
다음으로, 첫번째의 주사 전극 SC1에 부의 주사 펄스를 인가하기 위한 제 1 전압인 주사 펄스 전압 Vad가 인가된다. 그와 동시에, 데이터 전극 D1a~데이터 전극 Dma 중 위에서 첫번째로 발광시켜야 할 방전 셀의 데이터 전극 Dka에 정의 기입 펄스 전압 Vw가 인가된다. 그러면 그 방전 셀의 데이터 전극 Dka와 주사 전극 SC1의 교차부의 전압차는 방전 개시 전압을 초과하고, 위에서 첫번째로 발광시켜야 할 방전 셀에서 기입 방전을 일으켜 각 전극 상에 벽전압을 축적하는 기입 동작이 행하여진다. 다음으로, 세번째의 주사 전극 SC3에 주사 펄스 전압 Vad가 인가되고, 또한, 위에서 세번째로 발광시켜야 할 방전 셀의 데이터 전극 Dka에 정의 기입 펄스 전압 Vw가 인가된다. 그러면 그 방전 셀에서 기입 방전이 일어난다. 이하 마찬가지로, 홀수번째의 주사 전극 SC5, 주사 전극 SC7, …, 주사 전극 SCn/2-1에 관해서도 마찬가지로 기입 동작이 행하여진다.
패널(10)의 하반분의 방전 셀의 기입 동작에 관해서도 마찬가지로, 홀수번째 의 주사 전극 SCn/2+1, 주사 전극 SCn/2+3, …, 주사 전극 SCn-1에 제 2 전압 Vs2이 인가된다. 짝수번째의 주사 전극 SCn/2+2, 주사 전극 SCn/2+4, …, 주사 전극 SCn에도 제 2 전압 Vs2이 인가된다. 그 후, 도 5에 나타낸 바와 같이, 홀수번째의 주사 전극 SCn-1, 주사 전극 SCn-3, …, 주사 전극 SCn/2+1에 주사 펄스를 순차적으로 인가하여 기입 동작이 행하여진다.
또 홀수 기간에 있어서도, 패널(10)의 상반분의 주사 전극 SC1, 주사 전극 SC3, …, 주사 전극 SCn/2-1에는 위에서 아래를 향해 주사 펄스가 순차적으로 인가된다. 패널(10)의 하반분의 주사 전극 SCn/2+1, 주사 전극 SCn/2+3, …, 주사 전극 SCn-1에는 아래에서 위를 향해 주사 펄스가 순차적으로 인가된다. 그리고 주사 전극 SC1과 주사 전극 SCn-1에 동시에 주사 펄스가 인가되고, 주사 전극 SC3과 주사 전극 SCn-3에 동시에 주사 펄스가 인가되고, …, 주사 전극 SCn/2-1과 주사 전극 SCn/2+1에 동시에 주사 펄스가 인가된다. 그러나 본 발명은 이것에 한정되는 것이 아니라, 주사 펄스를 인가하는 순서는 임의로 설정할 수 있다.
또한 상술한 설명에서는, 짝수 기간의 후에 홀수 기간을 마련했지만, 홀수 기간의 후에 짝수 기간을 마련하더라도 좋고, 또한 이 순서를 적절히 바꾸더라도 좋다.
계속되는 유지 기간에서는, 우선 주사 전극 SC1~주사 전극 SCn에 정의 유지 펄스 전압 Vm이 인가되고, 또한 유지 전극 SU1~유지 전극 SUn에 전압 0(V)이 인가된다. 그러면 기입 방전을 일으킨 방전 셀에서는, 주사 전극 SCi 상과 유지 전극 SUi 상의 전압차는 유지 펄스 전압 Vm에 주사 전극 SCi 상의 벽전압과 유지 전극 SUi 상의 벽전압의 차가 가산된 것으로 되어 방전 개시 전압을 초과한다. 그리고, 주사 전극 SCi와 유지 전극 SUi의 사이에 유지 방전이 일어나고, 이 때 발생한 자외선에 의해 형광체층(35)이 발광한다. 그리고 주사 전극 SCi 상에 부의 벽전압이 축적되고, 유지 전극 SUi 상에 정의 벽전압이 축적된다. 데이터 전극 Dka 상, 데이터 전극 Dkb 상에도 정의 벽전압이 더 축적된다. 기입 기간에 있어서 기입 방전이 일어나지 않은 방전 셀에서는 유지 방전은 발생하지 않고, 초기화 기간의 종료시에서의 벽전압이 유지된다.
계속해서, 주사 전극 SC1~주사 전극 SCn에는 전압 0(V)이, 유지 전극 SU1~유지 전극 SUn에는 유지 펄스 전압 Vm이 각각 인가된다. 그러면, 유지 방전을 일으킨 방전 셀에서는, 유지 전극 SUi 상과 주사 전극 SCi 상의 전압차가 방전 개시 전압을 초과하기 때문에 다시 유지 전극 SUi와 주사 전극 SCi의 사이에 유지 방전이 일어난다. 그렇게 하여, 유지 전극 SUi 상에 부의 벽전압이 축적되고 주사 전극 SCi 상에 정의 벽전압이 축적된다. 이후 마찬가지로, 주사 전극 SC1~주사 전극 SCn과 유지 전극 SU1~유지 전극 SUn에 교대로 휘도 가중치에 따른 수의 유지 펄스를 인가하여, 표시 전극쌍의 전극간에 전위차를 인가하는 것에 의해, 기입 기간에 있어서 기입 방전을 일으킨 방전 셀에서 유지 방전이 계속하여 실시된다.
그리고, 유지 기간의 최후에는 전압 Vr을 향하여 완만히 상승하는 경사 파형 전압을 주사 전극 SC1~주사 전극 SCn에 인가하여, 데이터 전극 Dka 상과 데이터 전극 Dkb 상의 정의 벽전압을 남긴 채로, 주사 전극 SCi 상 및 유지 전극 SUi 상의 벽전압이 소거되어 있다. 이렇게 해서 유지 기간에 있어서의 유지 동작이 종료한 다.
다음으로, 주사 펄스 발생부(50)의 상세한 구성에 대하여 설명한다. 또 본 실시예에 있어서는, 제 2 전압 Vs2와 제 1 전압인 주사 펄스 전압 Vad의 차가, 제 4 전압 Vs4와 제 3 전압 Vs의 차와 같은 것으로 하여 설명한다. 이 전압의 차이를 이하, 전압 Vscn라고 기재한다. 즉, (Vs2-Vad)=(Vs4-Vs3)=Vscn이다. 또한, 제 1 전압 Vs1은 Vad이기 때문에, 제 2 전압 Vs2은 (Vad+Vscn)이며, 제 4 전압 Vs4은 (Vs3+Vscn)이다. 또한 본 실시예에 있어서의 각 전압의 값은, 예컨대, 주사 펄스 전압 Vad는 -140(V), 전압 Vscn은 150(V), 제 3 전압 Vs3은 0(V)이다. 그러나 이들의 전압은 일례이며, 패널(10)의 특성 등에 맞춰 알맞은 값으로 설정하는 것이 바람직하다.
또한, 본 실시예에 이용하는 패널(10)은 고정밀도 패널이며, n=1080, 즉 1080개의 주사 전극 SC1~주사 전극 SC1080 및 유지 전극 SU1~유지 전극 SU1080을 구비한 패널인 것으로 하여 설명한다.
도 6은 본 발명의 실시예에 있어서의 플라즈마 디스플레이 장치(100)의 주사 펄스 발생부(50)의 구성을 나타내는 회로도이다. 도 6은 패널(10) 및 유지 전극 구동 회로(44)도 나타내고 있다. 주사 펄스 발생부(50)는, 홀수 전극 출력부(53)와 짝수 전극 출력부(54)와 플로팅 전원 VSCN1과 플로팅 전원 VSCN2와 스위치(51)와 스위치(52)를 구비하고 있다. 홀수 전극 출력부(53)는, 홀수번째의 주사 전극 SC1, 주사 전극 SC3, …, 주사 전극 SC1079에 인가하는 구동 전압을 출력한다. 또, 도 6에서는, 주사 전극 SC1079을 「SCn-1」이라고 기재하고 있다. 짝수 전극 출력 부(54)는, 짝수번째의 주사 전극 SC2, 주사 전극 SC4, …, 주사 전극 SC1080에 인가하는 구동 전압을 출력한다. 또, 도 6에서는, 주사 전극 SC1080을 「SCn」이라고 기재하고 있다. 플로팅 전원 VSCN1은 홀수 전극 출력부(53)에 전력을 공급한다. 스위치(51)는, 플로팅 전원 VSCN1의 저전압측을 제 1 전압인 주사 펄스 전압 Vad 또는 제 3 전압 Vs3에 접속한다. 플로팅 전원 VSCN2은 짝수 전극 출력부(54)에 전력을 공급한다. 스위치(52)는, 플로팅 전원 VSCN2의 저전압측을 제 1 전압인 주사 펄스 전압 Vad 또는 제 3 전압 Vs3에 접속한다. 본 실시예에 있어서는, 플로팅 전원 VSCN1 및 플로팅 전원 VSCN2의 전압은 모두 전압 Vscn이다.
또, 도 6에서는, 초기화 기간 및 유지 기간에 있어서의 구동 전압 파형을 발생하는 회로는 생략했다.
홀수 전극 출력부(53)는, 플로팅 전원 VSCN1의 저전압측의 전압 또는 고압측의 전압을 홀수번째의 주사 전극 SC1, 주사 전극 SC3, …, 주사 전극 SC1079의 각각에 인가하는 출력부(55(1)), 출력부(55(3)), …, 출력부(55(1079))를 구비하고 있다. 출력부(55(1)), 출력부(55(3)), …, 출력부(55(1079))의 각각은, 플로팅 전원 VSCN1의 고압측의 전압을 출력하는 스위칭 소자와 플로팅 전원 VSCN1의 저압측의 전압을 출력하는 스위칭 소자를 갖는다.
짝수 전극 출력부(54)도 마찬가지로, 플로팅 전원 VSCN2의 저전압측의 전압 또는 고압측의 전압을 짝수번째의 주사 전극 SC2, 주사 전극 SC4, …, 주사 전극 SC1080의 각각에 인가하는 출력부(56(2)), 출력부(56(4)), …, 출력부(56(1080))를 구비하고 있다. 그리고 출력부(56(2)), 출력부(56(4)), …, 출력부(56(1080))의 각 각은, 플로팅 전원 VSCN2의 고압측의 전압을 출력하는 스위칭 소자와 플로팅 전원 VSCN2의 저압측의 전압을 출력하는 스위칭 소자를 갖는다.
또, 플로팅 전원 VSCN1, 플로팅 전원 VSCN2는, 예컨대, DC-DC 컨버터 등을 이용하여 구성할 수도 있지만, 다이오드와 콘덴서를 갖는 부트스트랩(bootstrap) 회로를 이용하여 간단히 구성할 수도 있다.
여기서, 홀수 전극 출력부(53)의 출력부(55(1)), 출력부(55(3)), …, 출력부(55(539))는 복수 블록마다 정리되어 IC화되어 있다. 마찬가지로 짝수 전극 출력부(54)의 출력부(56(2)), 출력부(56(4)), …, 출력부(56(540))도 복수 블록마다 정리되어 IC화되어 있다. 이하, 이 IC를 「주사 IC」라고 부른다. 본 실시예에 있어서는, 64개분의 출력부가 하나의 모놀리식 IC(monolithic IC)로서 집적되어 있는 것으로 하여 설명한다. 그리고 10개의 주사 IC를 이용하여 홀수 전극 출력부(53)가 구성되고, 마찬가지로 10개의 주사 IC를 이용하여 짝수 전극 출력부(54)가 구성되어 있다. 이와 같이 다수의 출력부를 IC화하는 것에 의해 회로를 조밀하게 정리할 수 있어 실장 면적도 작게 된다. 그리고 IC가 모놀리식 IC이면 실장 면적도 더 작아지기 때문에, 보다 바람직하다.
도 7은 본 발명의 실시예에 있어서의 플라즈마 디스플레이 장치(100)의 구조의 일례를 나타내는 분해 사시도이다. 플라즈마 디스플레이 장치(100)는, 패널(10)과, 패널(10)을 수용하는 전면 프레임(71) 및 백 커버(72)와, 패널(10)을 보지(保持)하는 섀시(73)와, 패널(10)에서 발생한 열을 섀시(73)에 방출시키는 열전도 시트(74)를 구비한다. 또한, 플라즈마 디스플레이 장치(100)는, 주사 전극 구동 회 로(43), 유지 전극 구동 회로(44), 타이밍 발생 회로(45), 전원 회로 등의 패널(10)을 구동하기 위한 구동 회로를 탑재한 회로 기판 그룹(75)을 구비하고 있고, 이들의 회로 기판 그룹(75)은 섀시(73) 상에 배치되어 있다.
도 3에 나타낸 주사 전극 구동 회로(43)는, 회로 기판(81a), 회로 기판(81b) 및 회로 기판(82)으로 분할되어 탑재되어 있다. 그리고, 회로 기판(81a)에는, 주사 전극 SC1~주사 전극 SC540을 구동하는 주사 IC, 즉 홀수 전극 출력부(53)의 5개의 주사 IC(531)~주사 IC(535), 및 짝수 전극 출력부(54)의 5개의 주사 IC(541)~주사 IC(545)가 실장되어 있다. 회로 기판(81b)에는, 주사 전극 SC541~주사 전극 SC1080을 구동하는 주사 IC, 즉 홀수 전극 출력부(53)의 나머지의 5개의 주사 IC(536)~주사 IC(540), 및 짝수 전극 출력부(54)의 나머지의 5개의 주사 IC(546)~주사 IC(550)가 실장되어 있다.
회로 기판(82)에는 홀수 전극 출력부(53) 및 짝수 전극 출력부(54)를 제외하는 주사 전극 구동 회로(43)가 탑재되어 있다. 그리고 회로 기판(82)은 커넥터(83a), 커넥터(83b)를 구비하고, 이들의 커넥터를 통해서 회로 기판(81a), 회로 기판(81b)에 필요한 전력 및 신호가 공급된다.
도 8(a)와 도 8(b)는, 본 발명의 실시예에 있어서의 주사 IC(531)~주사 IC(550)를 실장한 회로 기판을 나타내는 도면이다. 도 8(a)는 회로 기판(81a)을 나타내고, 도 8(b)는 회로 기판(81b)을 나타내고 있다. 또, 도 8(a)와 도 8(b)에서는, 주사 IC(531)~주사 IC(550)를 각각 「IC(531)」~「IC(550)」라고 기재하고 있다.
본 실시예에 있어서는, 회로 기판(81a)의 한쪽의 면에 홀수번째의 주사 전극 SC1, 주사 전극 SC3, …, 주사 전극 SC539을 구동하기 위한 5개의 주사 IC(531)~주사 IC(535)가 실장되고, 다른 쪽의 면에 짝수번째의 주사 전극 SC2, 주사 전극 SC4, …, 주사 전극 SC540을 구동하기 위한 5개의 주사 IC(541)~주사 IC(545)가 실장되어 있다. 그리고, 주사 IC(531)~주사 IC(535), 주사 IC(541)~주사 IC(545)의 출력을 FPC을 통해서 패널에 공급하기 위한 커넥터(561)~커넥터(564)가 다른 쪽의 면에 실장되어 있다. 또한 회로 기판(81b)의 한쪽의 면에 홀수번째의 주사 전극 SC541, 주사 전극 SC543, …, 주사 전극 SC1079을 구동하기 위한 5개의 주사 IC(536)~주사 IC(540)가 실장되고, 다른 쪽의 면에 짝수번째의 주사 전극 SC542, 주사 전극 SC544, …, 주사 전극 SC1080을 구동하기 위한 5개의 주사 IC(546)~주사 IC(550)가 실장되어 있다. 그리고, 주사 IC(536)~주사 IC(540), 주사 IC(546)~주사 IC(550)의 출력을 FPC을 통해서 패널에 공급하기 위한 커넥터(565)~커넥터(568)가 같은 면에 실장되어 있다. 또 주사 IC(531)~주사 IC(550) 및 커넥터(561)~커넥터(568)에 기재한 수치는 대응하는 주사 전극의 번호를 나타내고 있다.
상술한 바와 같이, 기입 기간에 있어서 주사 전극 SC1~주사 전극 SC1080에 인가하는 가장 높은 전압은 제 4 전압 Vs4이며 가장 낮은 전압은 제 1 전압인 주사 펄스 전압 Vad이다. 따라서, 그 차이는 (Vs4-Vad)이며, 본 실시예에 있어서는 (150-(-140))=290(V)이 된다. 그러나 본 실시예에 있어서는, 홀수번째의 주사 전극 SC1, 주사 전극 SC3, …, 주사 전극 SC1079의 출력을 회로 기판(81a), 회로 기판(81b)의 한쪽의 면이 되고, 짝수번째의 주사 전극 SC2, 주사 전극 SC4, …, 주사 전극 SC1080의 출력을 회로 기판(81a), 회로 기판(81b)의 다른 쪽의 면이 되도록 분리하여 실장하고 있다. 그 때문에, 한쪽의 면 및 다른 쪽의 면의 동일면 내의 최대의 전압차는 모두 전압 Vscn=150(V)로 되고, 회로 기판(81a), 회로 기판(81b)의 배선 패턴 사이에서 스파크나 단락을 발생시킬 우려가 없다. 또한, 커넥터(561)~커넥터(568)의 단자 사이나 FPC를 접속하는 패널의 주사 전극 단자 사이에서는 최대의 전압차는 커지지만, 인접하는 주사 전극 사이의 최대의 전위차는 상술한 바와 같이 낮게 억제할 수 있다. 그 때문에, 패널의 전극 단자 사이나 프린트 기판의 배선 패턴 사이에서 스파크나 단락을 발생시킬 우려가 없다. 부가하여, 홀수번째의 주사 전극에 대응하는 주사 IC와 짝수번째의 주사 전극에 대응하는 주사 IC를 분리하여 실장하는 것으로, 주사 IC(531)~주사 IC(550)의 출력을 커넥터(561)~커넥터(568)의 단자에 교차시키지 않고 배선할 수 있다. 그 결과, 배선을 위한 면적을 억제할 수 있어, 회로 기판을 조밀하게 설계할 수 있다.
도 9는 본 발명의 실시예에 있어서의 회로 기판(81a)의 배선의 모양을 나타내는 도면이다. 도 9는 한쪽의 면에 실장된 주사 IC(531)와 다른 쪽의 면에 실장된 주사 IC(541), 및 그들의 출력으로부터 커넥터(561)의 단자까지의 배선을 나타내고 있다. 또, 도 9는 상기 다른 쪽의 면에서 본 도면이며, 상기 한쪽의 면에 실장되어 있는 주사 IC(541), 커넥터(561) 및 배선을 실선으로 나타내고, 상기 다른 쪽의 면에 실장되어 있는 주사 IC(531) 및 배선을 파선으로 나타내고 있다. 커넥터의 단자는 스루홀에 삽입되어 있다.
본 실시예에 있어서의 주사 IC(531)~주사 IC(550)는, 64개의 출력 단자로부 터 출력되는 64개의 주사 펄스의 순서를 역전시키는 기능을 구비하고 있다. 그 때문에, 한쪽의 면에 실장된 주사 IC와 다른 쪽의 면에 실장된 주사 IC와의 주사 펄스의 순서를 서로 역전시키는 것에 의해, 교차시키지 않고 배선하는 것이 가능해진다. 또한 본 실시예에 있어서는, 홀수번째의 주사 전극 SC1, 주사 전극 SC3, …, 주사 전극 SC539과 짝수번째의 주사 전극 SC2, 주사 전극 SC4, …, 주사 전극 SC540은 오름차순으로 주사된다. 한편, 홀수번째의 주사 전극 SC541, 주사 전극 SC543, …, 주사 전극 SC1079과 짝수번째의 주사 전극 SC542, 주사 전극 SC544, …, 주사 전극 SC1080은 내림차순으로 주사된다. 이것에 대응하기 위해서, 회로 기판(81a)의 상기 한쪽의 면에 실장한 주사 IC와 회로 기판(81b)의 상기 한쪽의 면에 실장한 주사 IC의 주사 펄스의 순서를 서로 역전시키고, 회로 기판(81a)의 상기 다른 쪽의 면에 실장한 주사 IC와 회로 기판(81b)의 상기 다른 쪽의 면에 실장한 주사 IC의 주사 펄스의 순서도 서로 역전시키고 있다.
이와 같이, 본 발명의 실시예는, 한쪽의 면에 홀수번째의 주사 전극 그룹에 주사 펄스를 인가하는 주사 IC를 실장하고, 다른 쪽의 면에 짝수번째의 주사 전극 그룹에 주사 펄스를 인가하는 주사 IC를 실장하고 있다. 이렇게 하는 것으로, 패널의 전극 단자 사이나 프린트 기판의 배선 패턴 사이에서 스파크나 단락을 발생시킬 우려가 없고, 또한 화상 표시 품질을 저하시키지 않고, 벽전하의 감소를 막아 안정한 기입 방전을 발생시킬 수 있다. 또한 주사 IC(531)~주사 IC(550)의 각각의 출력을 커넥터(561)~커넥터(568)의 단자에 교차시키지 않고 배선할 수 있기 때문에, 배선을 위한 면적을 억제할 수 있어, 회로 기판을 조밀하게 설계할 수 있다.
또, 본 실시예에 있어서는, 도 9에 나타낸 바와 같이, 회로 기판(81a) 및 회로 기판(81b)은, 한쪽의 면에 실장한 주사 IC의 출력을 그 면에서 배선하고, 다른 쪽의 면에 실장한 주사 IC의 출력을 그 면에서 배선하는 것으로 하여 설명했다. 그러나, 회로 기판(81a) 및 회로 기판(81b)을 2층 이상의 배선층을 구비한 다층의 회로 기판을 이용하는 경우에는, 홀수번째의 주사 전극 그룹에 주사 펄스를 인가하는 주사 IC의 출력을 배선하는 배선층과 짝수번째의 주사 전극 그룹에 주사 펄스를 인가하는 주사 IC의 출력을 배선하는 배선층을 서로 다른 층으로 할 수 있다. 이 경우는, 도 8(a) 및 도 8(b)에서, 회로 기판(81a) 및 회로 기판(81b)을 2층 이상의 배선층을 구비하고, 실선으로 나타낸 주사 IC(541)~주사 IC(550)가 실장되는 층과 파선으로 나타낸 주사 IC(531)~주사 IC(540)가 실장되는 층은 서로 다른 층이 된다. 이렇게 하는 것으로, 프린트 기판의 배선 패턴 사이에서의 스파크나 단락을 막을 수 있다.
또한, 본 실시예에 있어서는, 데이터 전극이 패널의 상반의 방전 셀에 대응하는 데이터 전극과 패널의 하반분의 방전 셀에 대응하는 데이터 전극으로 분할된 패널을 이용하여, 기입 기간에 있어서 패널의 상반과 패널의 하반분으로 분할하여 독립적으로 구동하는 플라즈마 디스플레이 장치에 대하여 설명했다. 그러나 본 발명은 이것에 한정되는 것이 아니라, 데이터 전극 Dj가 분할되어 있지 않은 패널을 이용하여, 패널을 분할하지 않고 구동할 수도 있는 것은 물론이다.
또한, 본 실시예에 있어서 이용한 구체적인 수치 등은, 단지 일례를 든 것에 지나지 않고, 패널의 특성이나 플라즈마 디스플레이 장치의 사양 등에 맞춰, 적절 히 알맞은 값으로 설정하는 것이 바람직하다.
이상의 설명으로부터 분명한 바와 같이, 발명은, 패널의 전극 단자 사이나 프린트 기판의 배선 패턴 사이에서 스파크나 단락을 발생시킬 우려가 없고, 또한 화상 표시 품질을 저하시키지 않고, 벽전하의 감소를 막아 안정한 기입 방전을 발생시킬 수 있는 플라즈마 디스플레이 장치를 제공하는 것이 가능하다.
본 발명에 의하면, 패널의 전극 단자 사이나 프린트 기판의 배선 패턴 사이에서 스파크나 단락을 발생시킬 우려가 없고, 또한 화상 표시 품질을 저하시키지 않고, 벽전하의 감소를 막아 안정한 기입 방전을 발생시킬 수 있기 때문에, 플라즈마 디스플레이 장치로서 유용하다.

Claims (3)

  1. 복수의 주사 전극을 갖는 플라즈마 디스플레이 패널과, 상기 복수의 주사 전극에 주사 펄스를 인가하는 주사 IC를 탑재한 회로 기판을 갖는 구동 회로를 구비한 플라즈마 디스플레이 장치로서,
    상기 구동 회로는, 상기 복수의 주사 전극을 홀수번째의 주사 전극 그룹과 짝수번째의 주사 전극 그룹으로 나눠 구동하고,
    상기 주사 IC를 탑재한 회로 기판은, 한쪽 면에 상기 홀수번째의 주사 전극 그룹에 주사 펄스를 인가하는 주사 IC를 실장하고, 다른 쪽 면에 상기 짝수번째의 주사 전극 그룹에 주사 펄스를 인가하는 주사 IC를 실장하고 있고,
    상기 구동 회로는,
    1 필드 기간을, 상기 홀수번째의 주사 전극 그룹에 속하는 주사 전극의 각각에 주사 펄스를 순차적으로 인가하는 홀수 기입 기간과, 상기 짝수번째의 주사 전극 그룹에 속하는 주사 전극의 각각에 주사 펄스를 순차적으로 인가하는 짝수 기입 기간을 갖는 복수의 서브필드로 구성하고,
    상기 홀수 기입 기간 및 상기 짝수 기입 기간 중 적어도 한쪽에서,
    주사 펄스를 인가하는 주사 전극 그룹에 속하는 주사 전극에는, 제 2 전압으로부터 주사 펄스 전압으로 천이하고 다시 상기 주사 펄스 전압으로부터 상기 제 2 전압으로 천이하는 주사 펄스를 순차적으로 인가하되, 상기 제 2 전압은 상기 주사 펄스 전압보다 높고,
    주사 펄스를 인가하지 않는 주사 전극 그룹에 속하는 주사 전극에는, 상기 주사 펄스 전압보다 높은 제 3 전압, 또는 상기 제 2 전압 및 상기 제 3 전압보다 높은 제 4 전압을 인가하고,
    적어도 인접하는 주사 전극에 상기 주사 펄스 전압이 인가되어 있는 동안은 상기 제 3 전압을 인가하는
    플라즈마 디스플레이 장치.
  2. 삭제
  3. 복수의 주사 전극을 갖는 플라즈마 디스플레이 패널과, 상기 복수의 주사 전극에 주사 펄스를 인가하는 주사 IC를 탑재한 회로 기판을 갖는 구동 회로를 구비한 플라즈마 디스플레이 장치로서,
    상기 구동 회로는, 상기 복수의 주사 전극을 홀수번째의 주사 전극 그룹과 짝수번째의 주사 전극 그룹으로 나눠 구동하고,
    상기 주사 IC를 탑재한 회로 기판은,
    2층 이상의 배선층을 구비한 다층의 회로 기판이며,
    상기 홀수번째의 주사 전극 그룹에 주사 펄스를 인가하는 주사 IC의 출력을 배선하는 배선층과 상기 짝수번째의 주사 전극 그룹에 주사 펄스를 인가하는 주사 IC의 출력을 배선하는 배선층이 상이하며,
    상기 구동 회로는,
    1 필드 기간을, 상기 홀수번째의 주사 전극 그룹에 속하는 주사 전극의 각각에 주사 펄스를 순차적으로 인가하는 홀수 기입 기간과, 상기 짝수번째의 주사 전극 그룹에 속하는 주사 전극의 각각에 주사 펄스를 순차적으로 인가하는 짝수 기입 기간을 갖는 복수의 서브필드로 구성하고,
    상기 홀수 기입 기간 및 상기 짝수 기입 기간 중 적어도 한쪽에서,
    주사 펄스를 인가하는 주사 전극 그룹에 속하는 주사 전극에는, 제 2 전압으로부터 주사 펄스 전압으로 천이하고 다시 상기 주사 펄스 전압으로부터 상기 제 2 전압으로 천이하는 주사 펄스를 순차적으로 인가하되, 상기 제 2 전압은 상기 주사 펄스 전압보다 높고,
    주사 펄스를 인가하지 않는 주사 전극 그룹에 속하는 주사 전극에는, 상기 주사 펄스 전압보다 높은 제 3 전압, 또는 상기 제 2 전압 및 상기 제 3 전압보다 높은 제 4 전압을 인가하고,
    적어도 인접하는 주사 전극에 상기 주사 펄스 전압이 인가되어 있는 동안은 상기 제 3 전압을 인가하는
    플라즈마 디스플레이 장치.
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